본 논문에서는 자기해석을 기초로 배관의 결함을 검사할 수 있는 자기인가장치를 개발하져다. 자기인가장치는 영구자석(Nd-Fe-B계열) 및 Linear Hall Effect 센서를 이용하여 배관을 충분히 자화시킬 수 있도록 설계되었으며, 센서 어레이는 8인치 크기로 설계, 제작하였다. 제작된 자기인가장치는 5개의 yoke와 45개의 Linear Hall Effect 센서로 구성된다. 자기회로법을 이용하여 설계된 자기장 인가장치가 배관을 포화시킬 수 있는가를 확인하였고. 또한 8인치 탄소강관(두께 : 5.85mm)에 인공 결함을 제작하여 누설 자속을 측정하였다. 시험 배관에 만들어진 두께 $10\%{\~}80\%$의 결함은 제작된 MFL 모듈을 이용하여 모두 검출하였으며 결함의 깊이가 가장 얇은 0.5mm까지 검출이 가능함을 확인하였다.
광집적회로(photonic integrated circuits) 소자의 기본적인 부품 중 하나인 방향성 결합기 소자는 두 개의 인접한 광도파로 사이에서 일어나는 모드 간 광결합에 의해서 광파워를 분배하는 기능을 가진다. 본 논문에서는 방향성 결합기 소자를 제작하기 위한 설계 과정에 대하여 살펴보고 실제로 제작된 소자의 특성으로부터 설계 결과의 정확도에 대하여 확인하는 과정을 수행한다. 빔전파기법(beam propagation method, BPM) 시뮬레이션을 통하여 방향성 결합기 소자를 설계하는 과정에서, 유효굴절률 계산을 통하여 2차원 평면 구조로 변환된 소자에 대한 이차원 BPM 설계를 하여서 소자 구조를 확정하고, 실리카 광도파로 방향성 결합기 소자를 어레이 형태로 제작한 뒤 특성을 측정하였다. 실험 결과와 차이를 보이는 2D BPM 설계 결과를 보완하기 위하여 계산량이 훨씬 많은 3D BPM 설계를 수행하였으며 그 결과는 실험 결과에 더욱 근접하였다. 실험 결과와 일치하는 설계 결과를 얻기 위하여 3D BPM에 사용된 광도파로 코어 굴절률을 미세하게 보정하였으며 이를 통하여 실험치를 정확히 예측 가능한 BPM 설계를 수행하는 방법을 확립하였다.
System on panel 프레임 버퍼를 위한 메모리 셀 어레이와 주변회로가 설계되었다. 또한, system on panel 공정의 낮은 yield를 극복하기 위해, 블럭 단위의 parallel test 방안이 제안되었다. 기존의 메모리 테스트 보다 빠르게 fault detection이 가능하며, 다양한 embedded memory나 일반 SRAM 테스트 분야에도 적용 가능하다. 또한 기존의 다양한 test vector pattern이 그대로 적용될 수 있어 fault coverage가 높고, 최근의 추세인 hierarchical bit line과 divided word line 구조에도 적용될 수 있다.
본 연구에서는 화자의 음성신호를 이용하여 추출된 공간정보를 통해 화자의 위치를 실시간으로 추적하는 시스템을 제안하고 실시간 구현하였다. 기존의 대표적인 화자 위치 추출 알고리듬인 CPSP(Cross Power Spectrum Phase)는 실내환경에서 심각하게 일어나는 반향신호에 취약한 단점을 갖고 있으므로 구현된 시스템에서는 위치 추적 성능 개선을 위하여 반향신호에 강인한 hybrid window 알고리듬을 제안하여 적용하였다. Hybrid window 알고리듬은 실내 환경에 적합한 hybrid window를 설계하여 수신된 음성신호에 적용함으로써 반향신호에 의한 상호 상관관계를 줄이고 직접 경로에 의한 신호들의 상관관계를 높임으로써 보다 정확한 시간 지연 추정을 가능하게 한다. 제안된 시스템의 성능분석을 위해 DSP를 이용해 실시간 구현된 하드웨어를 이용해 기존의 CPSP 알고리듬과 제안된 hybrid window를 적용한 시스템을 실제 환경에서의 실험하였고 제안한 알고리듬을 적용한 시스템이 $22\%$ 이상 성공적으로 화자의 위치를 추적하였다.
The BIPV system must be designed to reflect the architectural and electrical characteristics simultaneously because it replaces the role of the exterior material of the building, which makes it difficult to design the BIPV. The thin film type BIPV module has an electrical characteristic that the open voltage is higher and the short circuit current is lower than that of the crystalline type BIPV module. However, there are many differences in the design of the array, the collector distribution board, and the inverter in the system configuration since the crystal type BIPV module has the opposite feature. In this study, a crystalline BIPV module and a thinfilm BIPV module were applied to actual buildings. As a result, the elements to be considered in designing BIPV system were derived, and the architectural and electrical characteristics were mutually analyzed.
초음파 의료 영상 응용 분야를 위한 고전압 고집적 아날로그 front-end 집적회로를 0.18-${\mu}m$ 표준 CMOS 반도체 공정을 이용하여 구현하였다. 제안 된 아날로그 front-end 집적회로는 2.6 MHz에서 15 Vp-p 전압까지 동작하는 트랜지스터 stacking구조를 이용한 고전압 펄서와, 저전압에서 동작하는 저잡음 transimpedance 증폭기, 그리고 송신부와 수신부의 분리를 위한 고전압 차단 스위치로 구성되어 있다. 설계 된 집적회로는 $0.15mm^2$ 이하의 작은 면적을 사용함으로써 휴대용 영상 시스템을 포함한 다중 어레이 초음파 의료 영상 시스템에 적용이 가능하다.
본 논문에서는 아날로그필터를 위한 새로운 구조의 주파수 제어 방식(frequency tuning scheme)과 트랜스컨덕턴스(gm) 가변 범위가 넓은 트랜스컨덕터(OTA: Operational transconductor amplifier) 회로를 제안하였다. 제안된 주파수 제어 방식은 트랜스컨덕터와 커패시터로 구성된 1차 저역통과필터의 시정수와 커패시터에 일정 전압이 충전되는데 걸리는 시간과의 관계식을 이용한 것으로 전압제어필터 방식과 유사하게 간단한 구조를 가지며, 기준신호로 순수 정현파를 필요로 하지 않고, 시스템 클럭 또는 외부 수정 발진 회로를 통해 쉽게 얻을 수 있는 클럭 펄스를 사용할 수 있다는 장점이 있다. 또한, 클럭 주파수가 고정된 조건에서도 복잡한 구조의 커패시터 어레이를 사용하지 않고 다중 대역 지원을 목적으로 차단 주파수를 가변하면서 제어할 수 있다. 그리고 모의 실험을 통해 제안된 자동 주파수 제어회로의 동작을 확인하였다.
태양광 발전 시스템이 대용량화됨에 따라 태양전지 어레이 구성 시 부정합(mismatch) 문제가 대두되는 가운데, 태양전지 모듈을 직접 계통에 연계하는 AC 모듈형 태양광 모듈 집적형 전력변환장치(PV-MIC)에 관한 연구가 지속되고 있다. PV-MIC는 수명 및 고효율이 가장 큰 문제이며 이 문제를 해결하기 위해서 본 논문에서는 ZVS 동작을 통하여 스위칭 손실을 저감시키고 입력전류 리플감소를 통하여 입력 커패시턴스를 저감할 수 있는 능동 클램프 전류원 하프 브릿지 컨버터를 적용한 PV-MIC를 제안하고, 이에 관한 제어분담 및 설계에 대하여 고찰한다.
본 논문에서는 RSA 암호 시스템의 핵심 과정인 모듈로 멱승 연산에 대한 새로운 하드웨어 구조를 제시한다. 본 방식은 몽고메리 곱셈 알고리즘을 사용하였으며 기존의 방법들이 데이터 종속 그래프(DG : Dependence Graph)를 수직으로 매핑한 것과는 달리 여기서는 수평으로 매핑하여 1차원 선형 어레이구조를 구성하였다. 그 결과로 멱승시에 중간 결과값이 순차적으로 나와서 바로 다음 곱셈을 위한 입력으로 들어갈 수 있기 때문에 100%의 처리율(throughput)을 이룰 수 있고, 수직 매핑 방식에 비해 절반의 클럭 횟수로 연산을 해낼 수 있으며 컨트롤 또한 단순해지는 장점을 가진다. 각 PE(Processing Element)는 2개의 전가산기와 3개의 멀티플렉서로 이루어져 있고, 암호키의 비트수를 k비트라 할 때 k+3개의 PE만으로 파이프라인구조를 구현하였다. 1024비트 RSA데이터의 암호 똔느 복호를 완료하는데 2k$^2$+12k+19의 클럭 수가 소요되며 클럭 주파수 100Mhz에서 약 50kbps의 성능을 보인다. 또한, 제안된 하드웨어는 내부 계산 구조의 지역성(locality), 규칙성(regularity) 및 모듈성(modularity) 등으로 인해 실시간 고속 처리를 위한 VLSI 구현에 적합하다.
고주파 응용을 위한 AB급 바이폴라 선형 트랜스컨덕터들을 제안한다. 이들 트랜스컨덕터는 전압 폴로워, 저항기, 그리고 전류 폴로워로 구성된다. 폴로워 회로들은 트랜스리니어 셀들로 실현되기도 하고, 단위-이득 버퍼들로 실현되기도 한다. 제안된 트랜스컨덕터들은 8 GHz 바이폴라 트랜지스터-어레이 파라미터를 이용하여 SPICE 시뮬레이션 되었다. 시뮬레이션 결과는, 트랜스리니어 셀들을 이용한 트랜스컨덕터가 단위-이득 버퍼들을 이용한 그것보다 더 좋은 선형성을 가지는데 반해, 후자는 전자보다 더 좋은 온도 특성과 더 높은 입력 저항을 가진다는 것을 보여준다. 제안된 트랜스컨덕터들의 실용성을 검증하기 위하여, 이들 트랜스컨덕터로 중간 주파수(IF) 대역의 4차 대역-통과 여파기를 구현하였다.
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[게시일 2004년 10월 1일]
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