A four-step rapid thermal annealing (RTA) process is proposed in order to improve the throughput and stabilize the process, compared to the six-step RTA process. Effects of annealing on the properties of a structure mode of CMOS process in both cases were investigated. The implanted dopant(As, $BF_2$ and Ti/TiN) movement in silicon during different rapid thermal annealing conditions was studied using secondary ion mass spectroscopy (SIMS) technique. These results show that the four-step RTA process significantly improves time effect and throughput (15%) by the condition of ramping up compared to the six-step RTA process.
In this research, magnetoresistance (MR) ratio (MR), resistivity, and exchange coupling field $(H_{ex})$ behaviors for sputter deposited spin valves with FeMn antiferromagnetic layer have been extensively investigated by rapid thermal annealing (RTA) as well as conventional annealing (CA) method. 10 s of RTA revealed that interdiffusion was not significant up to $325^{\circ}C$ at the interfaces between the layers when the RTA time was short. The MR of FeMn spin valves were reduced when the spin valves were exposed to temperature of $250^{\circ}C$, even for a short time period of 10 s prior to CA. $H_{ex}$ was maintained up to $325^{\circ}C$ of CA when the specimen was subjected to 10 s of RTA at $200^{\circ}C$ prior to CA, which is $25^{\circ}C$ higher than the result obtained from the CA without prior RTA. Therefore, the stability of $H_{ex}$ could be enhanced by a prior RTA before performing CA up to annealing temperature of $325^{\circ}C$. MR and sensitivity of the specimens annealed without magnetic field up to $275^{\circ}C$ were recovered to the values prior to CA, but $H_{ex}$ was not recovered. This means that reduced MR sensitivity and MR during the device fabrication can be recovered by a field RTA.
본 연구에서는 저 에너지 이온 주입과 이중 열처리를 통하여 박막 $p^+-n$ 접합을 형성하였고, 보론 확산 모델을 가지고 새로운 시뮬레이터를 설계하여 이온 주입과 열처리 후의 보론 분포를 재현하였다. $BF_2$ 이온을 가지고 실리콘 기판에 저 에너지 이온 주입을 하였고, 이후 RTA(Rapid Thermal Annealing)와 FA(Furnace Annealing)를 통하여 열처리 과정을 수행하였다. 시뮬레이션을 위한 확산 모델은 점결함의 생성과 재결합, BI 쌍의 생성, 보론의 활성화와 침전 현상 등을 고려하였다. FA+RTA 열처리가 RTA+FA 보다 면저항 측면의 접합 특성에서 우수한 결과를 나타내었고, 시뮬레이터에서도 동일한 결과를 나타내었다. 따라서 본 연구를 통하여 박막접합을 형성할 때 열적 효율성을 고려하면 제안된 확산 시뮬레이터와 FA+RTA 공정 방법의 유용성을 기대할 수 있다.
The rapid thermal annealing effects of Sol-Gel derived ferroelectric PZT thin films were investigated. It was found that rapid thermal annealing(RTA) of spin coated thin films on silicon typically >$800^{\circ}C$ for about 1 min. was changed to the perovskite phase. Rapid thermally annealed films recorded maximum remanent polarization of about 5 .mu.C/cm$^{2}$, coercive field of around 30kV/cm. The switching time for polarization reversal was about 220ns. The films of RTA process showed smooth surface, and high breakdown voltages of over 1 MV/cm and resistivity of $1{\times}{10^12}$ .ohm.cm at 1 MV/cm. It was verified that the polarization reversal of the PZT film was varied partially with applying the multiple short pulse.
Transactions on Electrical and Electronic Materials
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제3권1호
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pp.42-45
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2002
Properties of lead zirconate titanate ferroelectric thin films prepared by rapid thermal annealing/direct insertion thermal annealing were investigated. The remnant polarization (Pr), saturation polarization (Ps), and coercive force (Ec) of typical samples annealed by rapid thermal annealing (RTA) are about 13.7 $\mu$ C/cm$^2$, 27.1 $\mu$C/cm$^2$, and 55.6 kV/cm, respectively. The dielectric constant of the sample is about 786, the dielectric loss tangent is about 2.4% at 1 kHz. Furthermore, ferroelectric, conduction, and piezoelectric properties of the thin films annealed by RTA process and the direct insertion thermal annealing (DITA) process were compared. The influence of temperature in the dry process on the above properties was also investigated.
We have investigated the influence of rapid thermal annealing (RTA) temperature on properties of Al-doped zinc oxide (AZO) thin films deposited on glass substrate by using radio-frequency magnetron sputtering. The RTA is performed in a nitrogen ambient in the temperature range from 300 to $600^{\circ}C$ for 1 minute in a rapid thermal annealer after growing the AZO thin films. The crystallographic structure and the surface morphology of AZO thin film are measured by using X-ray diffraction, and atomic force microscopy and scanning electron microscopy, respectively. The optical transmittance of the deposited thin films is examined in the wavelength range of 300-1100 nm, where the average transmittance is above the 90% in the visible and near-infrared regions. The optical bandgap is calculated from the Tauc's model, and it shows a significant dependence on the RTA temperature. As for the electrical properties of the thin films, the AZO thin film annealed at $400^{\circ}C$ shows the lowest electrical resistivity of $8.6{\times}10^{-3}{\Omega}cm$ and the Hall mobility of $11.3cm^2$/V-sec. These results suggest that the RTA temperature is an important parameter to influence on the structural, electrical, and optical properties of AZO thin films.
The effect of rapid thermal anneal (RTA) has been investigated on the properties of an FeMn exchange-biased magnetic tunnel junction (MTJ) using magnetoresistance and I-V measurements and transmission electron microscopy (TEM). The tunneling magnetoresistance (TMR) in an as-grown MTJ is found to be ∼27%, while the TMR in MTJs annealed by RTA increases with annealing temperature up to 300$\^{C}$, reaching ∼46%. A TEM image reveals a structural change in the interface of A1$_2$O$_3$layer for the MTJ annealed by RTA at 300$\^{C}$. The oxide barrier parameters are found to vary abruptly with annealing time within a few ten seconds. Our results demonstrate that the present RTA enhances the magnetoresistive properties of MTJs.
Two step RTD(Rapid Thermal Diffussion) of P into silicon wafer using tungsten halogen lamp was used to fabricated very shallow n$^{+}$p junction. 1st RTD was performed in the temperature range of 800.deg. C for 60 see and the heating rate was in the 50.deg. C/sec. Phosphrous solid source was transfered on the silicon surface. 2nd RTD process was performed in the temperature range 1050.deg. C, 10sec. Using 2 step RTD we can obtain a shallow junction 0.13.mu.m in depth. After RTD, the Ti-silicide process was performed by the two step RTA(Rapid Thermal Annealing) to reduced the electric resistance and to improve the n$^{+}$p junction diode. The titanium thickness was 300.angs.. The condition of lst RTA process was 600.deg. C of 30sec and that of 2nd RTA process was varied in the range 700.deg. C, 750.deg. C, 800.deg. C for 10sec-60sec. After 2 step RTA, sheet resistance was 46.ohm../[]. Ti-silicide n+p junction diode was fabricated and I-V characteristics were measured.red.
With varying rapid thermal annealing (RTA) temperature, luminescent properties of ZnMgS:Mn thin film sputter-deposited with one target were measured. Although all samples have the same composition, $Zn_{1-x}Mg_xS:Mn$ (x=0.25) can emit luminescence between 580 and 614 nm, which is controlled by only RTA temperature. It is understood that the energy band gap shift of ZnMgS:Mn thin film phosphor occurs with varying RTA temperature.
It is of importance to know that the bonding strength and interfacial stress of SOI wafer pairs to meet with mechanical and thermal stresses during process. We fabricated Si/2000$\AA$-SiO$_2$ ∥ 2000$\AA$-SiO$_2$/Si SOI wafer pairs with electric furnace annealing, rapid thermal annealing (RTA), and fast linear annealing (FLA), respectively, by varying the annealing temperatures at a given annealing process. Bonding strength and interfacial stress were measured by a razor blade crack opening method and a laser curvature characterization method, respectively. All the annealing process induced the tensile thermal stresses. Electrical furnace annealing achieved the maximum bonding strength at $1000^{\circ}C$-2 hr anneal, while it produced constant thermal tensile stress by $1000^{\circ}C$. RTA showed very small bonding strength due to premating failure during annealing. FLA showed enough bonding strength at $500^{\circ}C$, however large thermal tensile stress were induced. We confirmed that premated wafer pairs should have appropriate compressive interfacial stress to compensate the thermal tensile stress during a given annealing process.
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[게시일 2004년 10월 1일]
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