• 한국전기전자재료학회:학술대회논문집
• /
• 한국전기전자재료학회 2006년도 하계학술대회 논문집 Vol.7
• /
• pp.16-17
• /
• 2006

In this paper, Ni-V alloy was studied with different structures and thickness. In case of Ni-V and Ni-V/Co/TiN, low resistive Ni silicide was formed after one step RTP (Rapid Thermal Process) with temperature range from $400^{\circ}C$ to $600^{\circ}C$ for 30sec in vacuum. After furnace annealing with temperatures range from $550^{\circ}C$ to $650^{\circ}C$ for 30min in nitrogen ambient, Ni-V single structure shows the best thermal stability compare with the other ones. To enhance the thermal stability up to 650oC and find the optimal thickness of Ni silicide, different thickness of Ni-V was studied in this work. Stable sheet resistance was obtained through Ni-V single structure with optimal Ni-V thickness.

• 한국전기전자재료학회:학술대회논문집
• /
• 한국전기전자재료학회 2006년도 하계학술대회 논문집 Vol.7
• /
• pp.10-11
• /
• 2006

In this study, the Ni/Co/TiN (6/2/25 nm) structure was deposited for thermal stability estimation. Vacuum (30 mTorrs) annealing was carried out to compare with furnace annealing in nitrogen ambient. The proposed Ni/Co/TiN structure exhibited low temperature silicidation and wide range of rapid thermal process (RTP) windows. The sheet resistance was too high to measure after furnace annealing at $600^{\circ}C$ due to the thin thickness (15 nm) of the nickel silicide. However, the sheet resistance maintained stable characteristics up to $600^{\circ}C$ for 30 min after vacuum annealing. Therefore, the low resistance of thin film nickel silicide was obtained by vacuum annealing at $600^{\circ}C$.

• 한국재료학회지
• /
• 제16권10호
• /
• pp.656-662
• /
• 2006

We fabricated thermal evaporated 10 nm-$Ni_xCo_{1-x}$ (x=0.2, 0.5 and 0.8) /(poly)Si films to form nanothick cobalt nickel composite silicides by a rapid thermal annealing at $700{\sim}1100^{\circ}C$ for 40 seconds. A field emission scanning electron microscope and a micro-Raman spectrometer were employed for microstructure and silicon residual stress characterization, respectively. We observed self-aligned micro-pinholes on single crystal silicon substrates silicidized at $1100^{\circ}C$. Raman silicon peak shift indicates that the residual tensile strain of $10^{-3}$ in single crystal silicon substrates existed after the silicide process. We propose thermal stress from silicide exothermic reaction and high temperature silicidation annealing may cause the pinholes. Those pinholes are expected to be avoided by lowering the silicidation temperature. Our results imply that we may use our newly proposed composite silicides to induce the appropriate strained layer in silicion substrates.

• Nuclear Engineering and Technology
• /
• 제24권1호
• /
• pp.40-51
• /
• 1992

연구용 원자로의 분산형 핵연료에 대한 노내 조사 거동의 주요 특성중의 하나는 핵연료심 팽윤에 기인된 핵연료봉 직경 증가이다. 본 논문에서는 분산형 우라늄실리사이드 핵연료에 대한 노내 조사거 동과 실험 증거들을 분석함으로써 그 핵연료의 팽윤에 대한 물리적 해석 모형인, DFSWELL 전산 모형을 개발하였다. 문헌에 보고된 실험 증거들로부터 노내에서 U$_3$Si-Al 핵연료심의 부피변화는 온도와 핵분열율에 따라 크게 영향을 받는 것으로 나타났다. 분산형 우라늄 실리사이드 핵연료에 대한 정량적 팽윤량은 주어진 온도, 핵분열율, 핵분열고체생성물 측적 및 핵분열기체 기포거동을 고려함으로써 평가될 수 있다. 연구로의 분산형 우라늄실리사이드 핵연료의 팽윤 현상은 다음과 같은 세 가지 현상으로 귀결된다. i ) 핵분열기체생성물 기포 생성/축적에 치한 부피변화 ii ) 고체 핵분열생성물의 축적 및 상 변화에 의한 부피변화 iii ) 핵연료 입자와 기지 사이의 공유층에 대한 부피변화 상기 세 가지의 물리 적 현상을 고려하는 본 DFSWELL 전산 모형의 출력이력 조건에 따른 절대 예측치들은 실행 결과와 비교할 때 분산형 우라윰실리 사이드 핵연료의 조사추 팽윤 실측치와 잘 일치한다.

• 한국산학기술학회논문지
• /
• 제6권3호
• /
• pp.273-277
• /
• 2005

새로이 제안된 15nm-Ni/15nm-Co의 적층구조로부터 제조된 NiCo 복합실리사이드를 실제 디바이스에 채용하기 위해, $SiO_2$ 스페이서를 가진 폴리실리콘 게이트 선폭이 $0.25\~l.5um$까지 변화하는 테스트그룹을 이용하여 30초-RTA를 이용한 실리사이드화 온도를 $700^{\circ}C\~1100^{\circ}C$까지 변화시키면서 이때 cleaning전후의 잔류금속의 생성모습을 확인하였다. RTA온도가 올라갈수록 $SiO_2$로 구성된 필드와 스페이서 상부와, 실리사이드가 형성된 게이트 상부에 $0.25{\mu}m$정도의 단축직경을 가진 타원형 잔류금속이 미로형 또는 게이트 방향으로 생성되는 특징이 있었고 동시에 응집이 많아지는 현상이 있었다. 응집이 많을수록 하부 절연층과의 반응도가 증가하여 절연특성이 저하될 수 있었고 과도한 습식제거 공정을 오래하여야 하므로 실험범위 내에서 가급적 저온 실리사이드화 열처리가 바람직하였다.

• 한국진공학회:학술대회논문집
• /
• 한국진공학회 2000년도 제18회 학술발표회 논문개요집
• /
• pp.61-61
• /
• 2000

Device의 고성능화를 위하여 소자의 고속화, 고집적화가 가속됨에 따라 SALICIDE Process가 더욱 절실하게 요구되고 있다. 이러한 SALICIDE Process의 재료로써는 metal/silicide 중에서 비저항이 가장 낮은 TiSi2(15-25$\mu$$\Omega$cm), CoSi2(17-25$\mu$$\Omega$cm)가 일반적으로 많이 연구되어 왔다. 그러나 Ti-silicide의 경우 Co-silicide는 배선 선폭의 감소에 따른 면저항 값의 변화가 작으며, 고온에서 안정하고, 도펀트 물질과 열역학적으로 안정하여 화합물을 형성하지 않는다는 장점이 있으마 Ti처럼 자연산화막을 제거할 수 없어 Si 기판위에 자연산화막이 존재시 균일한 실리사이드 박막을 형성할 수 없는 단점등을 가지고 있다. 본 연구에서는 Ti Capping layer 에 의한 균일한 Co-silicide의 형성을 일반적인 Si(100)기판과 SCl 방법에 의하여 chemical Oxide를 성장시킨 Si(100)기판의 경우에 대하여 연구하였다. 스퍼터링 방법에 의해 Co를 150 증착후 capping layer로써 TiN, Ti를 각각 100 씩 증착하였다. 열처리는 RTP를 이용하여 50$0^{\circ}C$~78$0^{\circ}C$까지 4$0^{\circ}C$ 구간으로 N2 분위기에서 30초 동안 열처리를 한후, selective metal strip XRD, TEM의 분석장비를 이용하여 관찰하였다. lst RTP후 selective metal strip 후 면저항의 측정과 XRD 분석결과 낮은 면저항을 갖는 CoSi2로의 상전이는 TiN capping과 Co 단일박막이 일반적인 Si(100)기판과 interfacial oxide가 존재하는 Si(100)기판위에서 Ti capping의 경우보다 낮은 온도에서 일어났다. 또한 CoSi에서 CoSi2으로 상전이는 일반적인 Si(100)기판위에서 보다 interfacial Oxide가 존재하는 Si(100)기판 위에 TiN capping과 Co 단일박막의 경우 열처리 후에도 Oxide가 존재하는 불균인한 CoSi2박막을 관찰하였으며, Ti capping의 경우 Oxise가 존재하지 않는 표면과 계면이 더 균일한 CoSi2 박막을 형성 할 수 있었다.

• 마이크로전자및패키징학회지
• /
• 제12권2호
• /
• pp.149-154
• /
• 2005

궁극적으로 게이트를 저저항 복합 실리사이드로 대체하는 가능성을 확인하기 위해 70 nm 두께의 폴리실리콘 위에 각 20nm의 Ni, Co를 열증착기로 적층순서를 달리하여 poly/Ni/Co, poly/Co/Ni구조를 만들었다. 쾌속열처리기를 이용하여 실리사이드화 열처리를 40초간 $700{\~}1100^{\circ}C$ 범위에서 실시하였다. 복합 실리사이드의 온도별 전기저항변화, 두께변화, 표면조도변화를 각각 사점전기저항측정기와 광발산주사전자현미경, 주사탐침현미경으로 확인하였다. 적층순서와 관계없이 폴리실리콘으로부터 제조된 복합실리사이드는 $800^{\circ}C$ 이상부터 급격한 고저항을 보이고, 두께도 급격히 얇아졌다. 두께의 감소는 기존의 단결정에서는 없던 현상으로 폴리실리콘의 두께가 한정된 경우 금속성분의 inversion 현상이 커서 폴리실리콘이 오히려 실리사이드 상부에 위치하여 제거되기 때문이라고 생각되었고 $1000^{\circ}C$ 이상에서는 실리사이드가 형성되지 못하였다. 이러한 결과는 나노급 두께의 게이트를 저저항 실리사이드로 만 들기 위해서는 inversion과 두께감소를 고려하여야 함을 의미하였다.

• 한국재료학회지
• /
• 제19권4호
• /
• pp.179-185
• /
• 2009

We fabricated thermally evaporated 30 nm-Ni/(20 nm or 60 nm)a-Si:H/Si films to investigate the energy-saving property of silicides formed by rapid thermal annealing (RTA) at temperatures of $350^{\circ}C$, $450^{\circ}C$, $550^{\circ}C$, and $600^{\circ}C$ for 40 seconds. A transmission electron microscope (TEM) and a high resolution X-ray diffractometer (HRXRD) were used to determine the cross-sectional microstructure and phase changes. A UVVIS-NIR and FT-IR (Fourier transform infrared spectroscopy) were employed for near-IR and middle-IR absorbance. Through TEM and HRXRD analysis, for the nickel silicide formed at low temperatures below $450^{\circ}C$, we confirmed columnar-shaped structures with thicknesses of $20{\sim}30\;nm$ that had ${\delta}-Ni^2Si$ phases. Regarding the nickel silicide formed at high temperatures above $550^{\circ}C$, we confirmed that the nickel silicide had more than 50 nm-thick columnar-shaped structures with a $Ni_{31}Si_{12}$ phase. Through UV-VIS-NIR analysis, nickel silicide showed almost the same absorbance in the near IR region as well as ITO. However, in the middle IR region, the nickel silicides with low temperature showed similar absorbance to those from high temperature silicidation.

• 한국전기전자재료학회:학술대회논문집
• /
• 한국전기전자재료학회 2006년도 하계학술대회 논문집 Vol.7
• /
• pp.3-4
• /
• 2006

In this paper, a nickel silicide technology with post-silicidation annealing effect for thin film SOI devices is investigated in detail. Although lower resistivity Ni silicide can be easily obtained at low forming temperature, poor thermal stability and changing of characteristic are serious problems during the post silicidation annealing like ILD (Inter Layer Dielectric) deposition or metallization. So these effects are observed as deposited Ni thickness differently on As doped SOI (Si film 30nm). Especially, the sheet resistance of Ni thickness deposited 20nm was lower than 30nm before the post silicidation annealing. But after the post silicidation annealing, the sheet resistance was changed. Therefore, in thin film SOI MOSFETs or Ni-FUSI technology that the Si film is less than 50nm, it is important to decide the thickness of deposited Ni in order to avoid forming high resistivity silicide.

• 한국재료학회지
• /
• 제7권11호
• /
• pp.1018-1023
• /
• 1997

본 연구에서는 3C-SiC의 ohmic 접합에 대하여 그 전기적 특성과 미세구조의 상관관계에 대하여 분석하였다. 표준사진식각 공정을 통하여 ohmic접합 금속으로서 Ni을 진공증착시켜 일련의 TLM패턴으로 열처리에 따르는 전류-전압 특성을 조사하였고 TEM, SEM, AES, EDS를 사용하여 Ni/SiC 계면에 대한 미세구조, 화학적 특성을 분석하였다. 열처리 온도와 시간을 통한 thermal budget이 증가함에 따라서 접촉저항이 감소되었으며 그 값은 $10^{-2}$-$10^{-4}$Ω$\textrm{cm}^2$의 범위에 속하였다. EDS와 AES를 통하여 7$50^{\circ}C$이상의 열처리 후 silicide(NiSi$_{2}$)의 주변에 carbon층이 형성되는 것을 확인하였으며, 열처리 온도가 증가함에 따라서 island형 silicide의 크기가 조밀해지며 SiC와의 접착성이 향상됨을 알 수 있었다. Ni/3C-SiC ohmic 접합의 전기적 특성은 계면에 생성되는 silicide와 carbon의 형성거동에 의하여 결정되는 것으로 믿어진다.