Three fabrication techniques for forming thin barrier layer with uniform thickness and large barrier height in magnetic tunnel junction (MTJ) are discussed. First, the effect of immiscible element addition to Cu layer, a high conducting layer generally placed under the MTJ, is investigated in order to reduce the surface roughness of the bottom ferromagnetic layer, on which the barrier is formed. The Ag addition to the Cu layer successfully realizes the smooth surface of the ferromagnetic layer because of the suppression of the grain growth of Cu. Second, a new plasma source, characterized as low electron energy of 1 eV and high density of $10^{12}$$cm^{-3}$, is introduced to the Al oxidation process in MTJ fabrication in order to reduce damages to the barrier layer by the ion-bombardment. The magnetotransport properties of the MTJs are investigated as a function of the annealing temperature. As a peculiar feature, the monotonous decrease of resistance area product (RA) is observed with increasing the annealing temperature. The decrease of the RA is due to the decrease of the effective barrier width. Third, the influence of the mixed inert gas species for plasma oxidization process of metallic Al layer on the tunnel magnetoresistance (TMR) was investigated. By the use of Kr-O$_2$ plasma for Al oxidation process, a 58.8 % of MR ratio was obtained at room temperature after annealing the junction at $300{^{\circ}C}$, while the achieved TMR ratio of the MTJ fabricated with usual Ar-$0_2$ plasma remained 48.4%. A faster oxidization rate of the Al layer by using Kr-O$_2$ plasma is a possible cause to prevent the over oxidization of Al layer and to realize a large magnetoresistance.
Schottky barrier thin film transistors (SB-TFT) on polycrystalline silicon(poly-Si) are fabricated by platinum silicided source/drain for p-type SB-TFT. High quality poly-Si film were obtained by crystallizing the amorphous Si film with excimer laser annealing (ELA) or solid phase crystallization (SPC) method. The fabricated poly-Si SB-TFTs showed low leakage current level and a large on/off current ratio larger than $10^5$. Significant improvement of electrical characteristics were obtained by the additional forming gas annealing in 2% $H_2/N_2$ ambient, which is attributed to the termination of dangling bond at the poly-Si grain boundaries as well as the reduction of interface trap states at gate oxide/poly-Si channel.
This paper is studied for the improvement of the characteristics of gate oxide with 3-nm-thick gate oxide by deuterium ion implantation methode. Deuterium ions were implanted to account for the topography of the overlaying layers and placing the D peak at the top of gate oxide. A short anneal at forming gas to nitrogen was performed to remove the damage of D-implantation. We simulated the deuterium ion implantation to find the optimum condition by SRIM (stopping and range of ions in matter) tool. We got the optimum condition by the results of simulation. We compare the electrical characteristics of the optimum condition with others terms. We also analyzed the electrical characteristics to change the annealing conditions after deuterium ion implantation. The results of the analysis, the breakdown time of the gate oxide was prolonged in the optimum condition. And a variety of annealing, we realized the dielectric property that annealing is good at longer time. However, the high temperature is bad because of thermal stress.
3차원 TSV 접합 시접합 두께 및 전, 후 추가 공정 처리가 Cu-Cu 열 압착 접합에 미치는 영향을 알아보기 위해 0.25, 0.5, 1.5, 3.0 um 두께로 Cu 박막을 제작한 후 접합 전 $300^{\circ}C$에서 15분간 $Ar+H_2$, 분위기에서 열처리 후 $300^{\circ}C$에서 30분 접합 후 후속 열처리 효과를 실시하여 계면접착에너지를 4점굽힘 시험법을 통해 평가하였다. FIB 이미지 확인 결과 Cu 두께에 상관없이 열 압착 접합이 잘 이루어져 있었다. 계면접착에너지 역시 두께에 상관없이 $4.34{\pm}0.17J/m^2$ 값을 얻었으며, 파괴된 계면을 분석 한 결과 $Ta/SiO_2$의 약한 계면에서 파괴가 일어났음을 확인하였다.
Chen, Xiaochi;Huo, Yijie;Cho, Seongjae;Park, Byung-Gook;Harris, James S. Jr.
IEIE Transactions on Smart Processing and Computing
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제3권5호
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pp.331-337
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2014
Ge is becoming an increasingly popular semiconductor material with high Si compatibility for on-chip optical interconnect technology. For a better manifestation of the meritorious material properties of Ge, its surface treatment should be performed satisfactorily before the electronic and photonic components are fabricated. Ex-situ rapid thermal annealing (RTA) processes with different gases were carried out to examine the effects of the annealing gases on the thin-film quality of Ge grown epitaxially on Si substrates. The Ge-on-Si samples were prepared in different structures using the same equipment, reduced-pressure chemical vapor deposition (RPCVD), and the samples annealed in $N_2$, forming gas (FG), and $O_2$ were compared with the unannealed (deposited and only cleaned) samples to confirm the improvements in Ge quality. To evaluate the thin-film quality, room-temperature photoluminescence (PL) measurements were performed. Among the compared samples, the $O_2$-annealed samples showed the strongest PL signals, regardless of the sample structures, which shows that ex-situ RTA in the $O_2$ environment would be an effective technique for the surface treatment of Ge in fabricating Ge devices for optical computing systems.
NAND형 charge trap flash (CTF) non-volatile memory (NVM) 소자가 30nm node 이하로 고집적화 되면서, 기존의 SONOS형 CTF NVM의 tunnel barrier로 쓰이는 SiO2는 direct tunneling과 stress induced leakage current (SILC)등의 효과로 인해 data retention의 감소 등 물리적인 한계에 이르렀다. 이에 따라 개선된 retention과 빠른 쓰기/지우기 속도를 만족시키기 위해서 tunnel barrier engineering (TBE)가 제안되었다. TBE NVM은 tunnel layer의 전위장벽을 엔지니어드함으로써 낮은 전압에서 전계의 민감도를 향상 시켜 동일한 두께의 단일 SiO2 터널베리어 보다 빠른 쓰기/지우기 속도를 확보할 수 있다. 또한 최근에 각광받는 high-k 물질을 TBE NVM에 적용시키는 연구가 활발히 진행 중이다. 본 연구에서는 Si3N4와 HfAlO (HfO2 : Al2O3 = 1:3)을 적층시켜 staggered의 새로운 구조의 tunnel barrier Capacitor를 제작하여 전기적 특성을 후속 열처리 온도와 방법에 따라 평가하였다. 실험은 n-type Si (100) wafer를 RCA 클리닝 실시한 후 Low pressure chemical vapor deposition (LPCVD)를 이용하여 Si3N4 3 nm 증착 후, Atomic layer deposition (ALD)를 이용하여 HfAlO를 3 nm 증착하였다. 게이트 전극은 e-beam evaporation을 이용하여 Al를 150 nm 증착하였다. 후속 열처리는 수소가 2% 함유된 질소 분위기에서 $300^{\circ}C$와 $450^{\circ}C$에서 Forming gas annealing (FGA) 실시하였고 질소 분위기에서 $600^{\circ}C{\sim}1000^{\circ}C$까지 Rapid thermal annealing (RTA)을 각각 실시하였다. 전기적 특성 분석은 후속 열처리 공정의 온도와 열처리 방법에 따라 Current-voltage와 Capacitance-voltage 특성을 조사하였다.
Pandey, Rina;Cho, Se Hee;Hwang, Do Kyung;Choi, Won Kook
한국진공학회:학술대회논문집
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한국진공학회 2014년도 제46회 동계 정기학술대회 초록집
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pp.335-335
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2014
Over the past several years, transparent conducting oxides have been extensively studied in order to replace indium tin oxide (ITO). Here we report on fluorine doped zinc tin oxide (FZTO) films deposited on glass substrates by radio-frequency (RF) magnetron sputtering using a 30 wt% ZnO with 70 wt% SnO2 ceramic targets. The F-doping was carried out by introducing a mixed gas of pure Ar, CF4, and O2 forming gas into the sputtering chamber while sputtering ZTO target. Annealing temperature affects the structural, electrical and optical properties of FZTO thin films. All the as-deposited FZTO films grown at room temperature are found to be amorphous because of the immiscibility of SnO2 and ZnO. Even after the as-deposited FZTO films were annealed from $300{\sim}500^{\circ}C$, there were no significant changes. However, when the sample is annealed temperature up to $600^{\circ}C$, two distinct diffraction peaks appear in XRD spectra at $2{\Theta}=34.0^{\circ}$ and $52.02^{\circ}$, respectively, which correspond to the (101) and (211) planes of rutile phase SnO2. FZTO thin film annealed at $600^{\circ}C$ resulted in decrease of resistivity $5.47{\times}10^{-3}{\Omega}cm$, carrier concentration ~1019 cm-3, mobility~20 cm2 V-1s-1 and increase of optical band gap from 3.41 to 3.60 eV with increasing the annealing temperatures and well explained by Burstein-Moss effect. Change of work function with the annealing temperature was obtained by ultraviolet photoemission spectroscopy. The increase of annealing temperature leads to increase of work function from ${\phi}=3.80eV$ (as-deposited FZTO) to ${\phi}=4.10eV$ ($600^{\circ}C$ annealed FZTO) which are quite smaller than 4.62 eV for Al-ZnO and 4.74 eV for SnO2. Through X-ray photoelectron spectroscopy, incorporation of F atoms was found at around the binding energy of 684.28 eV in the as-deposited and annealed FZTO up to 400oC, but can't be observed in the annealed FZTO at 500oC. This result indicates that F atoms in FZTO films are loosely bound or probably located in the interstitial sites instead of substitutional sites and thus easily diffused into the vacuum from the films by thermal annealing. The optical transmittance of FZTO films was higher than 80% in all specimens and 2-3% higher than ZTO films. FZTO is a possible potential transparent conducting oxide (TCO) alternative for application in optoelectronics.
본 연구의 목적은 UL(미국보험협회)에 규정된 암모니아 대기상태에서 측벽형 스프링클러 헤드 디플렉터의 응력부식균열을 막기 위한 방안을 제시하는 것이다. 성형 후처리로서 성형제품 그대로와 샌드블래스팅 처리한 것, 그리고 풀림 열처리를 한 것 등 3가지에 대하여 부식시험을 실시하였다. 금속현미경으로 시편을 관측한 결과 잔류응력이 부식균열을 일으키는 주요원인이며, 극심한 부식조건에서 발생할 수 있는 잔류응력을 적절한 열처리를 통해 제거하거나 감소시킬 수 있어 파손을 방지할 수 있다는 것을 확인 하였다.
In this study, Cu-5Ni-10Sn(wt%) spinodal alloy was manufactured by gas atomization spray forming, and the microstructural features and mechanical properties of Cu-5Ni-10Sn alloy have been investigated during homogenization, cold working and age-hardening. The spray formed Cu-5Ni-10Sn alloy consisted of an equiaxed microstructure with a mixture of solid solution ${\alpha}$-(CuNiSn) grains and lamellar-structure grains. Homogenization at $800^{\circ}C$ and subsequent rapid quenching formed a uniform solid solution ${\alpha}$-(CuNiSn) phase. Direct aging at $350^{\circ}C$ from the homogenized Cu-5Ni-10Sn alloy promoted the precipitation of finely distributed ${\gamma}$' or ${\gamma}-(Cu,Ni)_3Sn$ phase throughout the matrix, resulting in a significant increase in microhardness and tensile strength. Cold working prior to aging was effective in strengthening Cu-5Ni-10Sn alloy, which gave rise to a maximum tensile strength of 1165 MPa. Subsequent aging treatment slightly reduced the tensile strength to 1000-1100 MPa due to annealing effects.
Most high-efficiency n-type silicon solar cells are based on the high quality surface passivation and ohmic contact between the emitter and the metal. Currently, various metalization methods such as screen printing using metal paste and physical vapor deposition are being used in forming electrodes of n-type silicon solar cell. In this paper, we analyzed the degradation factors induced by the front electrode formation process using e-beam evaporation of double passivation structure of p-type emitter and $Al_2O_3/SiN_x$ for high efficiency solar cell using n-type bulk silicon. In order to confirm the cause of the degradation, the passivation characteristics of each electrode region were determined through a quasi-steady-state photo-conductance (QSSPC).
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[게시일 2004년 10월 1일]
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