• 한국통신학회논문지
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• 제39B권1호
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• pp.1-7
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• 2014

본 논문은 멀티 코어 SoC의 전체 테스트 시간 감축을 위한 효율적인 테스트 wrapper 설계 방법을 제안한다. 제안된 알고리즘은 잘 알려진 Combine 알고리즘을 사용하여 멀티코어 SoC의 각 코어에 대해 초기 local wrapper해 집합을 구성하고 가장 긴 테스트 시간을 소모하는 코어를 dominant 코어로 선택한다. Dominant 코어의 테스트 시간을 기준으로 다른 코어들에 대해 wrapper 특성인 TAM 와이어 수와 테스트 시간을 조정한다. Design space exploration을 위해 일부 코어들의 TAM 와이어 수를 줄이고 테스트 시간을 증가시킨다. 변경된 wrapper 특성을 기존 local wrapper 해 집합에 추가한다. 코어들의 기존 local wrapper 해 집합이 global wrapper 해 집합으로 확장되어 스케줄러에 의한 멀티코어 SoC의 전체 테스트 시간이 감소한다. 제안된 wrapper의 효과는 ITC'02 벤치마크 회로에 대해 $B^*$-트리 기반의 테스트 스케줄러를 사용하여 검증된다. 실험 결과 기존의 wrapper를 사용하는 경우에 비해 테스트 시간이 평균 4.7% 감소한다.

• 전자공학회논문지
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• 제50권6호
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• pp.99-104
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• 2013

최근 주목받는 스마트 폰, 스마트 TV 등 스마트 전자기기들은 전통기기의 기능과 컴퓨터를 결합하는 공통점을 갖고 있다. 단순히 프로세서가 내장되어 연산만 수행하는 것이 아니라 OS(Operating System)가 포함되고 사용자가 개인 용도에 따라 새로운 기능을 추가할 수 있고 유무선 통신으로 인터넷 또는 PC와 연결하여 통신할 수 있는 개장된 멀티미디어 SoC 플랫폼이 필요하다. 본 논문에서는 Core-A 프로세서와 AMBA 버스 기반으로 영상, 음성 또는 각종 통신 형태를 지원하는 다기능 SoC 플랫폼을 설계하여 FPGA로 구현과 검증을 하였다. SoC 플랫폼의 전체 성능을 검증하기 위해 JPEG 디코딩 알고리즘과 ADPCM 인코딩 디코딩 알고리즘을 실행하고 실행 결과를 모니터 또는 스피커로 출력하여 검증했다.

• 전기전자학회논문지
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• 제16권4호
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• pp.375-381
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• 2012

본 연구에서는 멀티코어에서 피부색 정보와 병렬처리를 이용하여 Viola-Jones 알고리즘을 설계하였다. 불필요한 연산을 줄이고 빠른 검출 속도를 위해 기존의 얼굴 검출 방법 중 피부색을 이용한 얼굴 검출 알고리즘을 사용하여 배경영상을 삭제하였다. 병렬처리를 위해 알고리즘을 기능별로 분할하였고, 멀티코어에서 성능을 향상시키기 위해 의존성과 크기를 고려하여 독립적으로 동작되도록 설계하였다. Cortex-A9 멀티코어가 내장된 SoC에서 실험 결과 알고리즘을 분할하기 전에 비해 약 1.8배 빠른 검출 결과를 나타내었다.

• 한국정보통신학회:학술대회논문집
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• 한국해양정보통신학회 2009년도 추계학술대회
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• pp.959-962
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• 2009

최근 모바일 시스템은 하나의 단말로 다양한 서비스망에서의 운용을 위해 Multi-core 시스템 형태로 연구되고 있다. 따라서 하나의 단말로 WCDMA, GSM, WiBro 를 지원할 수 있는 모바일 시스템들이 출현할 것으로 예상된다. 다양한 서비스망을 지원하기 위한 모바일 시스템은 SoC(System on Chip) 기술과 더불어 하나의 칩셋으로 구현이 가능하며 그에 따른 모뎀 구조가 필요하다. 또한 하나의 단말로 서로 다른 주파수 대역에서 운용되어야 하므로 시스템의 비선형 특성과 각 주파수 대역에 따른 비선형 특성이 문제가 된다. 본 논문에서는 Multi-core 시스템의 모뎀 구조를 제안하고 시스템이 갖는 비선형 특성에 대하여 분석하였다. Multi-core 시스템의 구조는 OFDM(Orthogonal Frequency Division Multiplexing) 과 MC-CDMA(Multi Carrier-Code Division Multiple Access)를 기본 시스템으로 하여 구조를 제안하였고 시스템이 갖는 비선형 특성은 PSD(Power Spectral Density)를 이용하여 분석하였다.

• 전기전자학회논문지
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• 제21권3호
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• pp.260-263
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• 2017

다종의 CPU를 기반으로 ADC와 DC-DC 변환기를 포함하며 2M-byte의 SRAM이 내장된 SoC가 제안되었다. CPU 코어는 12-bit MENSA 코어, 32-bit Symmetric Multi-core 프로세서, 16-bit CDSP로 구성된다. 외부 SDRAM 메모리를 제거하기 위해 내부의 2M-byte SRAM을 설계하였으나 SRAM 블록들이 넓은 영역에 분포하여 기생 성분에 의해 속도가 저하되므로 SRAM을 작게 분할하여 레이아웃 하였다. 설계된 SoC는 55nm 공정으로 개발되었으며 속도는 200MHz이다.

• 전기전자학회논문지
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• 제21권3호
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• pp.185-194
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• 2017

본 논문에서는 다양한 분야와 환경에서 필요에 따라 기능을 쉽게 교환하고 조립이 가능한 모듈형 웨어러블 플랫폼을 제안한다. 제안된 플랫폼은 국내 CPU 코어 기반의 모듈형 플랫폼과 다양한 환경에 빠르게 대응하여 자유롭게 연결 가능한 plug & play 플랫폼으로 구성된다. 설계된 SoC는 32-bit RISC CPU, 32-bit symmetric multi-core processor, 그리고 16-bit DSP (CDSP)로 구성되고 여기에 필요에 따라 센서 모듈과 통신 모듈이 체인 형태로 연결된다. SoC 칩은 130nm 공정으로 개발되었고 온도와 습도 센서를 이용하여 제안된 모듈형 웨어러블 플랫폼의 기능의 동작을 검증하였다.

• 한국전산유체공학회지
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• 제16권3호
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• pp.95-103
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• 2011

In the block type VHTR core, there are inevitable gaps among core blocks for the installation and refueling of the fuel blocks. These gaps are called bypass gap and the bypass flow is defined as a coolant flows through the bypass gap. Distribution of core bypass flow varies according to the reactor operation since the graphite core blocks are deformed by the fast neutron irradiation and thermal expansion. Furthermore, the cross-flow through an interfacial gap between the stacked blocks causes flow mixing between the coolant holes and bypass gap, so that complicated flow distribution occurs in the core. Since the bypass flow affects core thermal margin and reactor efficiency, accurate prediction and evaluation of the core bypass flow are very important. In this regard, experimental and computational studies were carried out to evaluate the core bypass flow distribution. A multi-block experimental apparatus was constructed to measure flow and pressure distribution. Multi-block effect such as cross flow phenomenon was investigated in the experiment. The experimental data were used to validate a CFD model foranalysis of bypass flow characteristics in detail.

• 전기학회논문지
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• 제59권3호
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• pp.664-668
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• 2010

This paper presents a System-On-a-chip (SoC) for embedded image processing and pattern recognition applications that need Gaussian Pyramid structure. The system is fully implemented into Field-Programmable Gate Array (FPGA) based on the prototyping platform. The SoC consists of embedded processor core and a hardware accelerator for Gaussian Pyramid construction. The performance of the implementation is benchmarked against software implementations on different platforms.

• 한국항행학회논문지
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• 제14권2호
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• pp.213-219
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• 2010

최근 모바일 시스템은 하나의 단말로 다양한 서비스망에서의 운용을 위한 Multi-core 시스템 형태로 연구되고 있다. 따라서 하나의 단말로 WCDMA(Wideband Code Division Multiple Access), MC-CDMA(Multi Carrier-Code Division Multiple Access), CDMA(Code Division Multiple Access), WiBro(Wireless Broadband)를 지원할 수 있는 모바일 시스템들이 출현할 것으로 예상된다. 다양한 서비스망을 지원하기 위한 모바일 시스템은 SoC(System one Chip) 기술과 더불어 하나의 칩셋으로 구현이 가능하며 그에 따른 모뎀 구조가 필요하다. 4세대 이동통신 서비스를 위한 시스템은 고속데이터 전송을 필요로 하므로 OFDM(Orthogonal Frequency Division Multiplexing) 방식은 필수적으로 적용 되어야 한다. 그런데, OFDM 신호는 독립적으로 변조된 많은 부반송파들로 구성되므로 이들이 동 위상으로 더해질 때 신호의 진폭이 증가하여 PAPR(Peak-to-Average Power Ratio)문제가 발생한다. 본 논문에서는 4세대 이동통신 서비스를 위한 모뎀 구조를 제안하고 PAPR 문제를 해결하기 위한 PAPR 감소 기법을 제안한다.

• 소성∙가공
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• 제19권7호
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• pp.411-415
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• 2010

A sandwich panel which is comprised of truss cores faced with solid face sheets is lightweight and multi-functional. So it is widely used to not only structural material but also heat transfer media in transportation field such as airplane, train and vessel. There are various core topologies such as pyramidal and tetrahedral truss, square honeycombs and kagome truss. The study focused on analytical approach to optimize compression and shear quality of the unit cell of PCM with pyramidal configuration. With various unit cell models which have the same core weight per unit area but different truss member angle, analytical solution for effective stress ($\bar{\sigma},\bar{\tau}$), peak stress ($\bar{\sigma}_{peak},\bar{\tau}_{peak}$) by yielding and buckling, relative density ($\bar{\rho}_c$) and effective stiffness ($\bar{E},\bar{G}$) have been computed and compared each other. With this approach, the most optimal core configuration was predicted. The result has become the efficient guidelines for the design of PCM core structure.