이동멀티미디어방송 시스템의 기본 시스템을 이루는 유럽 방식인 Eureka-147 디지털 오디오 방송 시스템의 기본 요구 사항은 컴팩트 디스크와 같은 음질을 목표로 하므로 요구 비트오류률 ${10}^{-4}$을 기준으로 설계가 이루어졌다. 이동멀티미디어방송 시스템은 오디오 중심의 Eureka-147 디지털 오디오 방송 시스템과 달리, 멀티미디어 서비스를 중심으로 설계가 이루어져야 하기 때문에 요구 비트오류확률은 ${10}^{-7}$∼${10}^{-8}$ 이하를 요구한다. 이를 위하여 기존의 Eureka-147 디지털 오디오 방송 표준에 대한 호환성을 유지하면서 이동멀티미디어방송에 대한 요구 비트오류율을 만족하기 위한 방법으로 RS(Reed-Solomon) 부호와 길쌈 인터리버를 조합한 외부호화채널부호화 방식을 추가적으로 도입한다. 본 논문에서는 채널부호화 방식을 추가하였을 경우의 이동채널 모델을 기반으로 이동멀티미디어방송 시스템에 대한 채널 성능을 시뮬레이션하며, 시뮬레이션 결과로부터 채널부호화 추가의 필요성 및 적합성을 분석한다.
본 논문은 100 Gb/s급 광통신 시스템을 위한 반복적인 Bose-Chaudhuri-Hocquenghem (BCH) 부호와 고성능 복호기 구조를 보여준다. 제안된 구조는 고속 데이터 처리율뿐만 아니라 뛰어난 오류정정능력을 보여준다. 제안된 6회 반복 i-BCH 복호기는 메모리 기반의 인터리브 기술을 이용하였으며 6번의 반복 복호시 $10^{-15}$ post-FEC Bit Error Rate(BER) 기준 9.34 dB의 강력한 Net Coding Gain(NCG) 성능을 제공한다. 제안된 고성능 i-BCH 복호기의 구조는 90-nm CMOS 공정을 사용하여 합성한 후 수행한 성능 분석 결과 430 MHz의 동작 속도와 100 Gb/s의 데이터 처리율을 갖는다. 따라서 100 Gb/s급 광통신시스템을 위한 차세대 순방향 오류정정 구조에 적용할 수 있다.
This paper proposes an input-series-output-parallel connected ZVS full bridge converter with interleaved control for photovoltaic power conditioning systems (PV PCS). The input-series connection enables a fully modular power-system architecture, where low voltage and standard power modules can be connected in any combination at the input and/or at the output, to realize any given specifications. Further, the input-series connection enables the use of low-voltage MOSFETs that are optimized for a very low RDSON, thus, resulting in lower conduction losses. The system costs decrease due to the reduced current, and the volumes of the output filters due to the interleaving technique. A topology for a photovoltaic (PV) dc/dc converter that can dramatically reduce the power rating and increase the efficiency of a PV system by analyzing the PV module characteristics is proposed. The control scheme, consisting of an output voltage loop, a current loop and input voltage balancing loops, is proposed to achieve input voltage sharing and output current sharing. The total PV system is implemented for a 10-kW PV power conditioning system (PCS). This system has a dc/dc converter with a 3.6-kW power rating. It is only one-third of the total PV PCS power. A 3.6-kW prototype PV dc/dc converter is introduced to experimentally verify the proposed topology. In addition, experimental results show that the proposed topology exhibits good performance.
본 논문에서는 광대역 종합 통신망 응용을 위한 8b 52 MHz CMOS 서브레인징 (subranging) A/D 변환기 (analog-to-digital converter : ADC)를 제안한다. 제안된 A/D 변환기는 새로운 방식의 동작 순서 기법을 사용하여 기존의 이중 채널 서브레인징 A/D 변환기 동작에 존재하는 홀딩 시간 (holding time)을 제거함으로써 신호 처리 속도 (throughput rate)를 50 % 향상시켰다. 또한, 하위 비트 A/D 변환기에서의 잔류 전압처리에 인터폴레이션 (interpolation) 기법을 이용하여 A/D 변환기의 비교기에 사용되는 프리앰프의 수를 50 % 수준으로 줄임으로써 면적을 감소시켰다. 시제품 A/D 변환기는 0.8 um n-well double-poly double-metal CMOS 공정으로 제작되었고, 측정 결과, 5 V 전원 전압과 52 MHz 샘플링 주파수에서는 230 mW, 3 V 전원 전압 및 40 MHz 샘플링 주파수에서는 60 mW의 전력을 각각 소모한다.
본 논문은 임의의 펄스 레이저 송신기에서 방사되는 레이저 펄스 신호를 실시간으로 수신하여 수신된 레이저 펄스열(pulse train)의 펄스 반복주기(pulse repeat interval: PRI)의 형태와 반복 시간을 계산하는 방법에 대하여 기술하였다. 레이저 송신기에서 방사되는 펄스열의 형태와 주기는 고정(fixed), 지터(jitter), 삼각파 등 매우 다양하며, 이러한 레이저 신호의 PRI 패턴을 구하기 위해서 펄스도래시간(time of pulse arrival)의 1차 차분과 2차 차분을 이용하는 방법을 제안하였다. 제안된 방법은 TOA의 1차 차분의 표준편차가 평균값의 5%이하이면 수신된 펄스열은 고정 PRI 패턴 또는 지터 PRI 패턴이며, 5% 이상이면 삼각파 또는 톱니파 등의 PRI 패턴으로 분리한다. 본 알고리즘을 이용하여 펄스열을 분리한 결과 신호 분석능력이 우수하여 레이저 감시 시스템 등에 사용할 수 있을 것으로 판단된다.
본 논문에서는 Turbo coded BICM-ID (bit-interleaved coded modulation with iterative decoding)의 구현 복잡도를 개선하기 위한 기법을 제안한다. 터보 부호는 Shannon 한계에 근접하는 우수한 성능을 나타내는 오류정정부호 (error correction code)이며 터보 부호와 고차원 변조 (high order modulation)를 결합하여 전송효율을 개선할 수 있다. BICM (bit-interleaved coded modulation)은 채널 부호와 고차원 변조 사이에 이진 인터리버를 사용하는 기법이며 복호기와 복조기 간에 정보를 주고받으며 반복 복호 (iterative decoding)를 수행하는 BICM-ID를 이용하여 성능을 개선 할 수 있다. BICM-ID는 BICM과 비교하였을 때 반복 복호로 인하여 비트오율 (bit error rate) 성능이 개선되지만 구현 복잡도가 크게 증가하는 단점이 있다. 본 논문에서는 Turbo coded BICM-ID에서 구현 복잡도를 개선하기 위한 기법을 제안한다. 제안하는 기법은 기존에 제안된 Turbo coded BICM-ID 기법과 유사한 비트오율 (bit error rate) 성능을 나타내면서 구현 복잡도를 크게 감소시킬 수 있는 장점이 있다.
본 논문은 통신 시스템에서 요구하는 다양한 연산과 고속의 동작을 수행할 수 있는 재구성 가능 코프로세서를 제안하였다. 제안된 재구성 가능 코프로세서는 스크램블링, 인터리빙, 길쌈부호화, 비터비 디코딩, FFT 등과 같은 통신 시스템에 필수적인 연산 동작을 쉽게 구현할 수 있는 특징을 가진다. 제안된 재구성 가능 코프로세서는 VHDL로 설계하여 SEC 0.18$\mu$m 표준셀 라이브러리를 이용해 합성하였으며, 총 35,000 게이트에 3.84ns의 최대 동작 속도를 보였다. 제안된 코프로세서에 대한 성능검증 결과 IEEE 802.11a WLAN 표준에 대해 기존 DSP에 비해서 FFT 연산과 Complex MAC의 경우 약 $33\%$, 비터비 디코딩의 경우 약 $37\%$, 스크램블링 및 길쌈부호화의 경우 약 $48\%\~84\%$의 연산 사이클 감소를 확인하였으며 다양한 통신 알고리즘에 대해 기존 DSP보다 우수한 성능을 나타내었다.
본 논문에서는 패럴렉스 배리어 방식의 2D/3D 겸용 PC 및 핸드폰용 LCD를 위한 화소단위의 실시간 3D 영상변환 구조를 제안하고, 이를 FPGA 기반으로 설계한 후에 전체적인 동작을 위한 시스템으로 구현하였다. PC로부터 출력되는 아날로그 형태의 영상신호를 A/D 변환한 후에 디지털 형태의 신호를 입력된 영상의 형태에 따라서 3D 형태의 영상으로 재구성한다. 3D 형태의 영상으로 재구성하는 알고리즘은 패럴렉스 배리어에 많은 부분 의존하고 하는데, 입력되는 영상의 포맷에 따라서 R, G, B의 화소 단위로 영상을 인터리빙 하는 방식을 사용한다. 제안한 구조는 고속의 메모리 처리기법과 함께 다시점 2D 영상을 3D 영상으로 변환하는 FPGA로 설계되고, 고속의 데이터 저장 및 처리를 위해 4개의 SDRAM을 사용한다. 구현된 전체 시스템은 A/D 변환기를 위한 시스템과 디지털화된 2D 영상신호를 3D 디스플레이를 위한 영상신호로 변환하는 FPGA 시스템 그리고 3D영상을 디스플레이할 수 있는 LCD 패널로 구성된다.
본 논문에서는 하이브리드 자동차용 전력변환 장치인 HDC(High side DC/DC Converter)와 MCU(Motor Control Unit)의 제어 전략과 설계 결과를 설명한다. MCU와 HDC가 차량용 부품임을 감안하여 그 설계의 관점을 출력밀도 향상과 신뢰성 확보에 두고 있다. 이를 위해 제어기로는 고성능의 MPC5554 CPU를 기반으로 설계하였고, 수동 소자인 인덕터와 커패시터도 효율 최적화의 관점에서 제작하였으며, 전력용 반도체로는 세미크론사의 자동차용 모듈인 Skim63을 사용하였다. 방열기관의 전산해석을 통해 최적의 방열모델을 선정하였고 시뮬레이션을 통해 그 타당성을 검증하였다. 본 연구의 제어 전략과 각 부품의 성능은 실험벤치 및 실차 실험을 통하여 그 타당성을 검증하였고 보완설계 과정을 통하여 신뢰성을 확보하였다.
본 논문은 DVB-RCS NG(Next Generation) 에서 제안된 3차원 터보 부호와 터보 ${\Phi}$부호를 각 부호화율에 따라 성능 비교 분석하였다. 터보 ${\Phi}$ 부호에 있어서 기존의 이중 바이너리 구조에서 3진 바이너리 구조로 확장 될 때, 최적의 치환 패턴과 천공 패턴 분석을 제시하였다. 또한 3차원 터보 부호에서, post-encoder의 형태, 인터리빙 기법에 따라 성능이 달라지므로 각 파라메타에 대한 최적의 값을 제시하였다. 최적의 파라메타 설정을 근거로 성능분석 결과 터보 ${\Phi}$ 부호와 3차원 터보 부호가 기존의 DVB-RCS 터보 부호가 가지고 있었던 오류 마루 현상을 극복함을 알 수 있었고 터보 ${\Phi}$ 부호가 3차원 터보 부호에 비해 성능이 약간 우수하나 계산량 측면에서는 약 18% 정도가 복잡한 것을 알 수 있었다.
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[게시일 2004년 10월 1일]
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