본 논문에서는 ROM의 크기를 줄여 전력 소모를 줄일 수 있는 DDFS를 제안하였다. 새롭게 제안된 ROM 압축방식은 두 개의 ROM을 사용하여 원하는 주파수를 합성함으로써 전체적인 ROM들의 크기를 줄여준다. 표본화된 사인파의 양자화 값은 양자화 ROM(Quantized ROM : Q-ROM)과 차동 ROM(Differential ROM : D-ROM)에 저장된다. ROM 크기를 줄이기 위해 사인파를 양자화 할 때 일련의 차동 양자화 기술을 응용, 변형하여 두 개의 ROM을 사용한 QD-ROM 압축방식을 제안한다. 1/4주기의 사인파를 $2^L$개의 블록으로 나누어 양자화하고 이를 Q-ROM에 저장한다. D-ROM에는 Q-ROM의 표본화 간격을 $2^M$으로 나누어 표본화하고 양자화된 값은 그 블록의 표본화된 Q-ROM과의 차이만을 양자화하여 저장한다. 이렇게 함으로써 D-ROM에 저장되는 양자화 값의 최대 크기는 Q-ROM에 저장되는 양자화 값보다 작은 양이기 때문에 적은 데이터 길이로도 저장이 가능하다. 이를 사용함으로써 최대 67.5%의 ROM 크기를 감소시켜 전력소모를 줄일 수 있다.
더미 비트라인을 이용한 공유 커패시터 전하공유 롬(shared-capacitor charge-sharing ROM SCCS-ROM)이 제안되었다. SCCS-ROM은 기존의 전하공유 롬(charge-sharing ROM, CS-ROM)의 전하공유 기법으로 비트라인의 스윙전압을 줄였다. CS-ROM에서는 출력 비트 마다 3개의 작은 커패시턴스들이 필요하지만, 제안된 SCCS-ROM은 그 커패시터들을 공유함으로써 필요한 커패시터의 수를 단지 3개로 줄였다. 또한, 더미 비트라인들(dummy bit lines)로 커패시터들을 구현함으로써, 잡음내성을 증가시켰을 뿐만 아니라 소모전력 또한 줄였다. 8K×15bi1s의 SCCS-ROM이 0.35㎛ CMOS 공정으로 구현되었다. SCCS-ROM은 3.3V의 100㎒ 동작에서 8.63㎽의 전력을 소모하였다. 시뮬레이션에서 SCCS-ROM은 CS-ROM보다 8.4% 적은 전력을 소모하였다.
본 논문에서는 새로운 ROM 압축방식을 사용한 저전력 직접 디지털 주파수 합성기를 제안하고 낮은 클럭에서 동작하는 위상 누적기를 병렬로 연결하여 높은 주파수를 생성하는 위상-사인 변환기를 설계한다. ROM크기를 줄이기 위해 사인파를 양자화 할 때 일련의 차동 양자화 기술을 응용, 변형하여 양자화 ROM(Quantized ROM : Q-ROM과 차동 ROM(Differential ROM : D-ROM)을 사용하는 QD-ROM 압축방식을 제안한다. 이를 사용함으로써 67.5%의 ROM 사이즈를 감소시킬 수 있고 ROM의 크기를 줄여 전력 소모를 줄일 수 있다.
본 논문에서는 ROM의 크기를 줄여 전력 소모를 줄일 수 있는 DDFS를 제안하였다. 새롭게 제안된 병렬 ROM 방식은 두 개의 ROM을 사용하여 원하는 주파수를 합성함으로써 전체적인 ROM들의 크기를 줄여준다. 표본화된 사인파의 양자화 값은 양자화 ROM과 차동 ROM에 저장된다. ROM 크기를 줄이기 위해 사인파를 양자화 할 때 일련의 차동 양자화 기술을 응용, 변형하여 두 개의 병렬 ROM을 사용한 압축방식을 제안한다. 이를 사용함으로써 최대 67.5%의 ROM 크기를 감소시켜 전력소모를 줄일 수 있다.
본 논문에서는 연속적인 데이터를 위한 새로운 에러패턴 ROM(error pattern ROM: EP-ROM) 압축 기법이 제한되었다. EP-ROM은 연속적인 데이터를 근사값과 에러로 나눈 후 에러 대신 에러패턴의 인덱스를 저장함으로써 ROM의 크기를 줄인다. 이 기법은 연속된 데이터를 양자화할 때의 많은 경우 같은 에러패턴을 가진다는 특징을 이용한 것으로 ROM의 크기를 매우 작게 줄일 수 있다. 실험결과에서는 EP-ROM은 다양한 연속적인 데이터에 대하여 ROM 크기를 60∼77% 줄였다.
본 논문에서는 DPCM 방식의 차동 양자화 기술 및 병렬 기법을 응용하여 새로운 ROM 압축방식을 사용한 고속의 저 전력 직접디지털 주파수 합성기를 제안하고 FPGA를 사용하여 설계 및 제작한다. ROM 크기를 줄이기 위해 사인파를 표본화하여 양자화된 값을 양자화 ROM(Quantized ROM : Q-ROM)에 저장하고 각 표본화 사이클 차동 양자화하여 차동 ROM(Differential ROM : D-ROM)에 저장한다. 또한 낮은 클럭에서 동작하는 위상 누적기를 병렬로 2개 연결하여 높은 주파수를 생성하는 위상-사인 변환기를 설계 및 제작한다. 이를 사용함으로써 67.5%의 ROM 사이즈를 감소시킬 수 있고 ROM의 크기를 줄여 전력 소모를 줄일 수 있을 뿐만 아니라 고속의 직접 디지털 주파수 합성기를 설계 및 제작할 수 있다.
본 연구는 공공도서관에서 CD-ROM 출판물들이 어느 정도 수집ㆍ이용되고 있는지를 조사하였다. 출판된 자료들이 도서관의 장서로 구성되므로 출판과 도서관과는 밀접한 관계가 있을 것이라는 가정 하에 CD-ROM의 출판과 공공도서관에서의 이용을 비교하였다. 연구는 CD-ROM을 수집하고 이용시키는 7개 대구시립도서관을 대상으로 서베이 방법으로 수행되었다. 연구의 결과는 각 도서관의 CD-ROM 장서와 출판과의 관계는 인정되나, 이용 면에서는 출판의 영향을 인정하기 어려운 것으로 나타났다. 연구 결과에 대한 해석과 앞으로 노력해야 할 점들이 제안되었다.
한국통신연구(韓國通信硏究)센터에서 구축한 CD-ROM 네트워크 시스템인 CDLIB(CD-ROM Library)에서는 연구센터 내 근거리통신망(近距離通信網)(TRAN)에 접속된 모든 이용자들이 여러 대의 CB-ROM 드라이브와 이 드라이브에 놓인 디스크에 저정(貯藏)된 대량의 정보를 공유(共有)할 수 있도록 하였다. CDLIB 시스템은 CD-ROM 네트워크 서버와 파일 서버 그리고 이용자들이 네트워크를 통하여 CD-ROM 디스크를 검색할 수 있도록 해주는 소프트웨어로 구성되어 있으며, 이 시스템은 근거리통신망(近距離通信網) 환경에서 CD-ROM 자원을 공유(共有)하는 데 있어서 비용대(費用對) 효과면(效果面)에서 유리하고, 높은 시스템 성능(性能)을 얻을 수 있는 장점(長點)을 가지고 있다.
본 연구는 도서관과 정보(情報)센터에서 CD-ROM 제품을 수집하는 데 필요한 평가기준을 종합적으로 고찰한 것이다. 번 연구에서는 지금까지 많은 연구에서 논의된 CD-ROM 제품 평가 기준을 관리적인 면과 기술적인 면으로 구분하였고, 기술적인 면에서는 탐색(探索) 소프트웨어와 이용자 인터페이스 범주로 세분하여 각각의 기준들을 살펴보았다. 부록(附錄)으로 CD-ROM 제품 평가에 필요한 기본적인 체크리스트를 제시하였다.
본 논문에서는 sine-linear phase difference 방식과 DPCM 방식의 차동 양자화 기술을 응용하여 새로운 ROM 압축방식을 제안하고 이를 이용하여 저전력 직접 디지털 주파수 합성기를 FPGA를 사용하여 설계 및 제작한다. ROM 크기를 줄이기 위해 사인파의 1/4 주기를 $2^N$간격으로 표본화하여 양자화된 값을 양자화 ROM1에 저장하고 각 표본화 사이를 $2^K$간격으로 표본화하고 ROM1에 저장된 표본화 값의 차이를 ROM2에 저장하여 ROM의 크기를 줄이는 방식을 사용한다. 이를 사용함으로써 기존 방식 대비 약 37%의 ROM 크기만 필요하게 되여 전력 소모를 줄일 수 있다.
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[게시일 2004년 10월 1일]
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