• 한국정보통신학회:학술대회논문집
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• 한국정보통신학회 2013년도 춘계학술대회
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• pp.159-161
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• 2013

기업 및 기관의 통신실 및 전산실에서 운영하는 UPS, 항온항습기, 소화설비와 같은 기반설비에 대하여 발생할 수 있는 각종 장애를 사전에 감지하고, 장애 발생 시 신속히 대응할 수 있는 감시체제에 대하여 체계적으로 연구하고자 한다. 주요 통신설비 및 전산설비를 운영, 관리하는 환경에서는 공조기의 작동상태, 분전반 및 UPS의 상태 및 고장 유무, 화재발생시 신속한 통보체계가 필요하다. 기존 전산실의 주변 기반설비 장애 감시에 대한 현황 및 문제점을 파악함으로써 향후 체계적인 감시시스템 구축을 위한 개념 정립과 실무자들이 설계 시에 참조하여야 할 고려 사항들을 관리지침으로 제시하여 향후 데이터센터 감시시스템 구축과 관련한 다양한 연구의 필요성을 제시하고자 한다.

• 한국정보통신학회논문지
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• 제22권8호
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• pp.1068-1075
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• 2018

본 논문에서는 위상고정 상태에 따라 활성화 되는 루프가 다르게 설정하고, 두 개의 입력을 가지는 전압제어발진기를 사용하여 스퍼를 억제함과 동시에 루프필터의 크기를 줄이는 위상고정루프를 제안하였다. 동작 상태에 따른 안정도 분석을 통하여 위상고정 후에는 위상고정루프가 안정적으로 동작되게 설계하였다. 일반적으로 루프 필터의 커패시터는 위상고정루프에서 큰 면적을 차지한다. 두 개의 전하펌프에 의한 동시 충 방전 동작을 통해 커패시터의 유효커패시턴스를 증가시켜 루프필터 크기를 줄일 수 있으며, 서로 반대 위상으로 동작하는 두 개의 신호를 입력으로 가지는 전압제어발진기로 스퍼의 크기를 억제할 수 있었다. 위상고정 상태를 알려주는 LSI(Locking Status Indicator)를 사용하여 위상고정 시간은 $80{\mu}s$가 되도록 하였다. 제안된 위상고정루프는 1.8V의 공급전압과 $0.18{\mu}m$ CMOS공정을 사용하여 설계하였다.

• 한국철도학회:학술대회논문집
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• 한국철도학회 2011년도 춘계학술대회 논문집
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• pp.904-909
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• 2011

The development of train control system shall operate a series of processes like system designing, system production and system performance evaluation as a result of various requirements analysis presented in operation rules, operating guidelines for railway organizations etc, notified by the nation. Therefore, considering operation conditions, operation plan, linkage to railway network etc, the major document like system functional specifications, system development specifications, system test plans etc must be drawn up. In this paper we classify system operating scenarios required to prepare for system standard specification and system performance evaluation report of CBTC system for urban subways supporting unmanned automatic operation, and adjust each of the operating status.

• 한국정보디스플레이학회:학술대회논문집
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• 한국정보디스플레이학회 2005년도 International Meeting on Information Displayvol.II
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• pp.858-862
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• 2005

The industry of LCD monitor and LCD/TV production is complicate, so there are several OEM/ODM companies concentrated on technical and professional skills. Brand name company establishes its own brand name, sells its own product, and reflects market request. Therefore, the main duty of brand name company is on sales and marketing. This article explains the operating flow on LCD monitor and LCD/TV industry, operating relationship between brand name company and OEM/ODM, and advantage and disadvantage on different points. Furthermore, future trend of LCD monitor and LCD/TV can be reviewed in the article.

• 한국철도학회:학술대회논문집
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• 한국철도학회 2008년도 춘계학술대회 논문집
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• pp.1930-1935
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• 2008

Bimodal tram is able to run both general and special road. It has also the advantages of both public bus and subway which have the charateristics of easiness to approach and punctuality respectively. These advantages are accomplished by the cooperative communication between the control center and bimodal tram which is running with the fleet. This paper have investigated the requirement analysis and designing of the car operating computer system which have the functions of communication, broadcasting and display. car operating computer system communicates between bimodal tram and control center with wireless antenna. It can also transmit the location and status information of bimodal tram to control center for managing the bimodal tram fleet on road efficiently and economically.

• 한국원자력학회:학술대회논문집
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• 한국원자력학회 2004년도 추계학술발표회 발표논문집
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• pp.501-502
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• 2004

• 한국항공운항학회지
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• 제17권3호
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• pp.22-31
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• 2009

In this study, we surveyed the operating status of the Light Sport Aircraft(LSA) in Korea, and reviewed the flight route design for Light Sport Aircraft in Korea.

• 한국정보통신학회논문지
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• 제9권3호
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• pp.582-586
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• 2005

본 논문은 locking 상태에 따라서 루프대역폭이 변화하는 Phase Locked Loop (PLL)의 구조를 제안하였다. 제안한 PLL은 기본적인 PLL 블록과 NOR Gate, Inverter, Capacitor, 그리고 Schmitt trigger로 이루어진 Locking Status Indicator(LSI) 블록으로 구성되었다. LSI는 Loop Fille.(LF)에 공급되는 전류와 저항 값을 locking 상태에 따라 변화시켜서 unlock이 되면 넓은 루프대역폭 가지는 PLL로, lock이 되면 좁은 루프대역폭을 가지는 PLL로 동작하도록 한다. 이러한 구조의 PLL은 짧은 locking 시간과 저 잡음의 특성을 동시에 만족시킬 수 있다. 제안된 PLL은 Hynix CMOS $0.35{\mu}m$ 공정으로 Hspice 시뮬레이션 하였으며 40us의 짧은 locking 시간과 -76.1dBc 크기의 spur를 가진다.

• Journal of information and communication convergence engineering
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• 제3권3호
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• pp.142-145
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• 2005

In this paper, a new programmable DLL (delay locked loop) based clock synthesizer is proposed. DLL has several inherent advantages, such as no phase accumulation error, fast locking and easy integration of the loop filter. This paper proposes a new programmable DLL that includes a PFD(phase frequency detector), a LSI(lock status indicator), and a VCDL(voltage controlled delay line) to generate multiple clocks. It can generate clocks from 3 to 9 times of input clock with $2{\mu}s$ locking time. The proposed DLL operating in the frequency range of 300MHZ-900MHz is verified by the HSPICE simulation with a $0.35{\mu}m$ CMOS process.

• Journal of Multimedia Information System
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• 제6권4호
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• pp.323-328
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• 2019

In this paper, a method of constructing an advanced sequential circuit over finite fields is proposed. The method proposed an algorithm for assigning all elements of finite fields to digital code from the properties of finite fields, discussed the operating characteristics of T-gate used to construct sequential digital system of finite fields, and based on this, formed sequential circuit without trajectory. For this purpose, the state transition diagram was allocated to the state dependency code and a whole table was drawn showing the relationship between the status function and the current state and the previous state. The following status functions were derived from the status function and the preceding table, and the T-gate and the device were used to construct the sequential circuit. It was confirmed that the proposed method was able to organize sequential digital systems effectively and systematically.