• 제목/요약/키워드: MOS capacitor

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MOS 커패시터의 구조별 전리방사선 감도 특성 분석 (Ionizing Radiation Sensitivity Analysis of the Structural Characteristic for the MOS Capacitors)

  • 황영관;이승민
    • 전기학회논문지
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    • 제62권7호
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    • pp.963-968
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    • 2013
  • Ionizing Radiation effects on MOS devices provide useful information regarding the behavior of MOS based devices and circuits in the electronic instrumentation parts and instructive data for making the high sensitive sensors. The study presents the results of the analysis on the structural characteristics of MOS capacitor for sensing the ionizing radiation effect. We performed numerical modeling of Ionizing-radiation effect on MOS capacitor and simulation using Matlab program. Also we produced MOS capacitors and obtained useful data through radiation experiment to analyse the characteristic of ionizing radiation effect on MOS capacitor. Increasing the thickness of MOS capacitor's oxide layer enhanced the sensitivity of MOS capacitor under irradiation condition, but the sensitivity of irradiated MOS capacitor is uninfluenced by the area of MOS capacitor. The high frequency capacitance of the MOS capacitor is found to be strongly affected by incident ionizing radiation.

전리방사선 센서용 MOS Capacitors의 구조적 변화에 따른 감도 특성 분석 (Sensitivity Analysis of the Structural Characteristics of the MOS Capacitors for Sensing the Ionizing Radiation Effects)

  • 황영관;이남호;이현진
    • 대한전자공학회:학술대회논문집
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    • 대한전자공학회 2008년도 하계종합학술대회
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    • pp.1181-1182
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    • 2008
  • The study presents the results of the analysis on the structural characteristics of MOS capacitor for sensing the ionizing radiation effect. Increasing the thickness of MOS capacitor's oxide layer enhanced the sensitivity of MOS capacitor under irradiation condition, but the sensitivity of irradiated MOS capacitor is uninfluenced by the area of MOS capacitor.

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평면구조 P-MOS DRAM 셀의 커패시터 VT 이온주입의 최적화 (Optimization of Capacitor Threshold VT Implantation for Planar P-MOS DRAM Cell)

  • 장성근;김윤장
    • 한국전기전자재료학회논문지
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    • 제19권2호
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    • pp.126-129
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    • 2006
  • We investigated an optimized condition of the capacitor threshold voltage implantation(capacitor $V_T$ Implant) in planar P-MOS DRAM Cell. Several samples with different condition of the capacitor $V_T$ Implant were prepared. It appeared that for the capacitor $V_T$ Implant of $BF_2\;2.0{\times}l0^{13}\;cm^{-2}$ 15 KeV, refresh time is three times larger than that of the sample, in which capacitor $V_T$ Implant is in $BF_2\;1.0{\times}l0^{13}\;cm^{-2}$ 15 KeV. Raphael simulation revealed that the lowed maximum electric field and lowed minimum depletion capacitance ($C_{MIN}$) under the capacitor resulted in well refresh characteristics.

ZnO를 사용한 MOS 커패시터의 제작 조건에 따른 특성 변화 (Property Variations of ZnO-based MOS Capacitor with Preparation Conditions)

  • 남형진
    • 반도체디스플레이기술학회지
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    • 제9권3호
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    • pp.75-78
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    • 2010
  • In this study we investigated the electrical properties of ZnO-based MOS capacitor with $HfO_2$ as the gate dielectric. MIM capacitor, which uses either $HfO_2$ or $Al_2O_3$ as the dielectric layer, is also studied to understand the dependency of the dielectrics on the preparation conditions. It was found that thinner $HfO_2$ films yield better electrical properties, namely lower leakage current and higher breakdown electric field. These properties were observed to deteriorate when subsequently annealed. Capacitance in the depletion region of MOS capacitor was found to increase with UV ozone treatment time up to 60min. However, when the treatment time was extended to 120min, the trend is reversed. The 'threshold voltage' was also observed to positively shift with UV ozone treatment time up to 60min. The shift apparently saturated for longer treatment.

PECVD와 NO 어닐링 공정을 이용하여 제작한 N-based 4H-SiC MOS Capacitor의 SiC/SiO2 계면 특성 (SiC/SiO2 Interface Characteristics in N-based 4H-SiC MOS Capacitor Fabricated with PECVD and NO Annealing Processes)

  • 송관훈;김광수
    • 전기전자학회논문지
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    • 제18권4호
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    • pp.447-455
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    • 2014
  • 본 연구에서는 4H-SiC MOSFET의 주요 문제점인 $SiC/SiO_2$ 계면의 특성을 향상시키기 위해 PECVD (plasma enhanced chemical vapor deposition) 공정을 이용하여 n-based 4H-SiC MOS Capacitor를 제작하였다. 건식 산화 공정의 낮은 성장속도, 높은 계면포획 밀도와 $SiO_2$의 낮은 항복전계 등의 문제를 극복하기 위하여 PECVD와 NO어닐링 공정을 사용하여 MOS Capacitor를 제작하였다. 제작이 끝난 후, MOS Capacitor의 계면특성을 hi-lo C-V 측정, I-V 측정 및 SIMS를 이용해 측정하고 평가하였다. 계면의 특성을 건식 산화의 경우와 비교한 결과 20% 감소한 평탄대 전압 변화, 25% 감소한 $SiO_2$ 유효 전하 밀도, 8MV/cm의 증가한 $SiO_2$ 항복전계 및 1.57eV의 유효 에너지 장벽 높이, 전도대 아래로 0.375~0.495eV만큼 떨어져 있는 에너지 영역에서 69.05% 감소한 계면 포획 농도를 확인함으로써 향상된 계면 및 산화막 특성을 얻을 수 있었다.

MOS Capacitor 에서 Fixed Oxide Charge 가 문턱전압에 미치는 영향 분석

  • 차수형
    • EDISON SW 활용 경진대회 논문집
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    • 제5회(2016년)
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    • pp.362-364
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    • 2016
  • 본 논문에서는 MOS(Metal Oxide Semiconductor) Capacitor의 산화막내에 다양한 원인에 의해 존재하는 비이상적인 전하들 중 Fixed Oxide Charge가 소자의 문턱전압에 어떤 영향을 주는지 분석했다. 분석한 결과 n+ polysilicon Gate를 가지고, 산화막인 $SiO_2$의 두께가 3nm이고, 도핑농도가 $10^{18}cm^{-2}$인 P형 실리콘 기판으로 이루어진 MOS Capacitor에서 Fixed Oxide Charge Density가 $C/cm^2$ 이상일 때 문턱전압을 0.01V 이상 감소시키고 $C/cm^2$ 이하일 때 문턱전압을 0.01V 이상 증가시켰다.

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$Co^{60}-{\gamma}$ ray을 조사시킨 MOS 구조에서의 I-V특성의 방사선 조사 효과 (Radiation effects of I-V characteristics in MOS structure irradiated under $Co^{60}-{\gamma}$ ray)

  • 권순석;정수현;임기조;류부형;김봉흡
    • 한국전기전자재료학회:학술대회논문집
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    • 한국전기전자재료학회 1992년도 추계학술대회 논문집
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    • pp.123-127
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    • 1992
  • MOS 커패시터가 이온화 방사선에 노출되었을 경우, MOS 커패시터의 방사선 조사 효과는 소자의 전기적 특성 및 동작 수명에 심각한 영향을 일으킬 수 있다. MOS 커패시터는 (100) 방향의 P-type Si wafer 위에 산화막층을 $O^2$+T.C.E. 분위기에서 성장하였으며, 그 두께는 40~80 nm로 만들었다. MOS 커패시터에 대한 방사선 조사는 $Co^{60}-{\gamma}$선을 사용하였고, 조사선량은 $10^4{\sim}10^8$으로 조사하였다. MOS 커패시터에서 전기적 전도 특성의 방사선 조사효과는 산화막 두께와 조사선량을 변화하면서 측정된 P-type MOS 커패시터는 조사선량에 의해서 강하게 영향을 받는다는 것과 저전계 영역에서의 Ohmic 전류가 전체 선량에 의존한다는 것을 알았다. 이 결과는 방사선 조사에 의해 산화막 트랩전하와 산화막-반도체($SiO_2$-Si)계면 트랩전하에 의해서 설명 할 수 있다.

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안티퓨즈 MOS capacitor를 이용한 OTP 소자의 프로그래밍 후의 저항특성 (The resistance characterization of OTP device using anti-fuse MOS capacitor after programming)

  • 장성근;김윤장
    • 한국산학기술학회논문지
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    • 제13권6호
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    • pp.2697-2701
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    • 2012
  • 안티퓨즈 MOS 커패시터를 기반으로 제작된 OTP 소자의 수율은 프로그램 과정에서 입력 저항(Rin)값과 통과 트랜지스터(Pass Tr)의 크기, 데이터 읽기 과정에서 읽기 트랜지스터(Read Tr)와 읽기 전압에 영향을 받는다. 따라서 수율에 영향을 주는 요소를 분석하기 위해 여러 가지 실험 조건을 달리하여 각각의 조건에 대해 블로잉 후 실효소자의 저항 특성에 대한 풀 맵(full map) 데이터를 얻어 OTP 소자가 어떻게 동작하는지를 분석하여 수율 개선에 필요한 최적 조건을 연구하였다. 최적 조건은 입력저항이 $50{\Omega}$, 통과 트랜지스터의 W값이 $10{\mu}m$, 읽기 전압이 2.8 V 일 때이다.

Hf metal layer의 두께에 따른 $HfO_2$/Hf/Si MOS 커패시터의 전기적 특성 (Electrical Characterization of $HfO_2$/Hf/Si MOS Capacitor with Thickness of Hf Metal Layer)

  • 배군호;도승우;이재성;이용현
    • 한국전기전자재료학회:학술대회논문집
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    • 한국전기전자재료학회 2007년도 추계학술대회 논문집
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    • pp.9-10
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    • 2007
  • In this paper, Thin films of $HfO_2$/Hf were deposited on p-type wafer by Atomic Layer Deposition(ALD). And we studied the electrical characterization of $HfO_2$/Hf/Si MOS capacitor depending on thickness of Hf metal layer. $HfO_2$ films were deposited using TEMAH and $O_3\;at\;350^{\circ}C$. Samples were then annealed using furnace heating to $500^{\circ}C$. The MOS capacitor of round-type was fabricated on Si substrates. Through TEM(Transmission Electron Microscope), XRD(X-ray Diffraction), capacitance-voltage(C-V) and current-voltage(I-V) analysis, the role of thin Hf metal layer for the better $HfO_2$/Si interface property was investigated.

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