• 전자공학회논문지
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• 제49권10호
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• pp.159-168
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• 2012

본 논문에서는 $0.15{\mu}m$ GaAs pHEMT 기술을 이용하여 FMCW(Frequency-modulated continuous-wave) 레이더용 W-band 단일칩 수신기 MMIC를 구현하였다. 제작된 수신기는 4 단 저잡음 증폭기, 하향 변환 혼합기, 3 단 LO 버퍼 증폭기로 구성되어 있다. 수신기의 저잡음 특성과 선형성 향상을 위해 저잡음 증폭기의 성능을 최적화시켰다. 혼합기는 선형성 특성 및 낮은 IF 주파수에서 저잡음 특성을 위하여 저항성 혼합기로 설계하였다. W-대역에서 혼합기를 구동시키기 위해서는 높은 LO 입력이 요구되므로 추가적인 LO 버퍼 증폭기를 설계하였다. 단일칩 수신기의 측정 결과, RF 주파수 $f_0$ GHz, LO 입력 전력 -1 dBm, 그리고, IF 주파수 100 MHz에서, 6.2 dB의 변환 이득, 5.0 dB의 잡음 지수, 그리고, -12.8 dBm의 1-dB 이득 감쇄 입력 전력($P_{1dB,in}$) 등의 우수한 특성을 얻었다.

• 조명전기설비학회논문지
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• 제21권2호
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• pp.34-39
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• 2007

UWB(Ultra Wide Band) system for high speed and high accurate location has been studying actively. This paper presents the design and implementation of RF transceiver for DS-CDMA(Direct Sequence-Code Division Multiple Access) UWB device. Major components of RF transceiver such as Low Noise Amplifier(LNA) and Band Pass Filter(BPF) are designed and then fabricated to meet wideband characteristics. The RF transceiver was implemented by the use of the fabricated components and commercial devices after carrying out performance simulation. Through the performance evaluation of the UWB RF transceiver with W-CDMA signal, the approach of design, implementation and evaluation of RF transceiver which is available to DS-CDMA UWB system is verified.

• ETRI Journal
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• 제29권4호
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• pp.421-429
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• 2007

This paper presents a direct-conversion CMOS transceiver for fully digital DS-UWB systems. The transceiver includes all of the radio building blocks, such as a T/R switch, a low noise amplifier, an I/Q demodulator, a low pass filter, a variable gain amplifier as a receiver, the same receiver blocks as a transmitter including a phase-locked loop (PLL), and a voltage controlled oscillator (VCO). A single-ended-to-differential converter is implemented in the down-conversion mixer and a differential-to-single-ended converter is implemented in the driver amplifier stage. The chip is fabricated on a 9.0 $mm^2$ die using standard 0.18 ${\mu}m$ CMOS technology and a 64-pin MicroLead Frame package. Experimental results show the total current consumption is 143 mA including the PLL and VCO. The chip has a 3.5 dB receiver gain flatness at the 660 MHz bandwidth. These results indicate that the architecture and circuits are adaptable to the implementation of a wideband, low-power, and high-speed wireless personal area network.

• 항공우주기술
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• 제6권1호
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• pp.157-164
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• 2007

GPS 안테나는 위성발사체의 전 비행 구간에서 GPS 위성 신호를 정상적으로 수신하기 하여 발사체의 외피에 설치되어야 한다. 위성발사체의 표면 온도는 발사체가 대기권을 통과하면서 발생하는 열공력의 영향으로 급격하게 상승하며 발사체 외피에 설치되는 GPS 안테나는 극심한 고온 환경에 직접적으로 노출된다. 따라서 위성발사체의 외피에 설치되는 GPS 안테나에 대한 고온 환경 시험 규격은 발사체 내부 시스템의 고온 환경 시험 규격보다 더 가혹하게 설정되어야 한다. 본 논문에서는 KSLV-I 발사체에 탑재될 GPS 안테나의 고온 환경에서 성능 분석 절차 및 결과를 기술하며, GPS 안테나가 고온 환경에서 물리적인 변형이나 내부 LNA(Low Noise Amplifier)의 성능 저하 없이 정상적으로 동작하였을 보여주고 있다.

• 한국통신학회논문지
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• 제26권12B호
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• pp.1677-1685
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• 2001

본 논문에서 역방향 DS-CDMA(Direct Sequence-Code Division Multiple Access)에서 요구하는 QoS(Quality of Services)를 보장하기 위한 호 수락 제어를 제안한다 물리적 채널수에 의한 방법과 MODEM (modulator/ demodulator)부분으로부터 수신된 신호의 품질에 기반한 방법이 이미 연구되어졌다. 다른 방법으로, BTS(Base Transceiver Station)에서 수신된 파워 레벨을 사용한 방법과 사용자들의 위치를 통계적으로 분석한 방법으로 그 기준을 정하기도 한다. 이러한 방법들은 시스템의 과부하를 가져올 뿐만 아니라 시간 지연 또는 실제 환경에 적용하는데 큰 어려움이 있다. 이러한 문제를 풀기 위해, 실시간으로 BTS부분의 LNA(Low Noise Amplifier)에서 측정한 값을 기반으로 호 수락 제어를 목적으로 호 절단 추정을 제안한다. 본 논문에서 이러한 방법의 제안은 실시간에서 제공하는 서비스의 품질을 추정하고, 시스템의 부하를 줄이며, 짧은 시간지연을 가질 수 있다. 그러나 BTS에서 호 절단 률을 측정하고 수신 신호의 전력을 측정하기 위해 BTS에서 하드웨어 복잡성이 더해진다.

• 한국통신학회논문지
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• 제37권7A호
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• pp.545-551
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• 2012

본 논문에서는 K대역의 신호를 수신하여 저잡음 증폭 및 L대역으로 하향 변환하는 다채널 전단 수신기를 설계 및 제작하였다. 제작된 다채널 전단 수신기는 잡음지수 2.3 dB 이하의 특성을 가지는 GaAs-HEMT 기반의 저잡음 증폭소자, 이미지 성분의 억제를 위한 IR(Image Rejection) Filter, 이미지 성분 억제와 IMD (Intermodulation Distortion) 특성 개선을 위한 IR(Image rejection) 믹서를 포함한다. 제작된 다채널 전단 수신기의 시험결과, 3.8 dB 이하의 잡음지수와 27 dB 이상의 변환이득을 가지며 입력신호 기준 -9.5 dBm 이상의 P1dB(1dB Gain Compression Point) 특성을 나타내었다.

• 한국통신학회논문지
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• 제27권5C호
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• pp.522-529
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• 2002

GaAs pHEMT 기술로 V-band 수신단 각 MMIC 회로들을 설계 제작하였다. 또한 이를 집적하여 V-band downconverter module을 제작하였다. 제작된 downconverter는 24 dBm의 출력을 내는 LO 구동 전력 증폭기, 20dB의 소신호 이득을 가지는 저잡음증폭기, -1.6dBm의 출력을 내는 active parallel type의 발진기, 6 dB 이상의 변환이득 특성을 나타내는 cascode type의 혼합기로 구성되어 있다. 이처럼 혼합기의 우수한 변환이득 특성은 밀리미터파 대역에서 변환 이득 특성을 키우기 위해 반드시 필요한 거대한 IF buffer amplifier의 필요를 없애 주었다. 완성된 downconverter module의 측정결과 별도의 IF buffer amplifier없이 57.5 GHz와 61.7 GHz 사이에서 20 dB 이상의 높은 변환이득을 얻을 수 있었다.

• 전자공학회논문지 IE
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• 제47권4호
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• pp.34-38
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• 2010

본 논문에서 DCU는 기지국 전력증폭기의 성능을 안정적으로 유지하여 기지국 전체의 성능과 안정성 유지에 기여한다. 제안된 DCU는 전력증폭기에 공급되는 전력을 제어하며 실험에 사용한 앰프는 정격 입력이 10dBm일 때 정격 출력은 47.8dBm 이다. 성능의 비교는 DCU를 적용 했을 때와 미적용 했을 때를 비교하였고 연구결과 DCU가 IMD의 열화 경계에서 안정적으로 잘 동작 하였으며 전력증폭기가 매우 안정적으로 동작했다. DCU 없이 입력을 정격 보다 2dB 올렸을 때 IMD는 3~4dB 정도 나빠짐을 볼 수 있었다. 측정 결과를 보면 DSP를 이용한 제어가 유효하다는 것을 입증한다.

• 한국전자파학회논문지
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• 제16권11호
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• pp.1114-1122
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• 2005

본 논문에서는 S-band 대역에서의 수신단 one-chip MMIC 저잡음 증폭기, 믹서의 설계 및 제작, 측정에 관한 연구를 수행한다. 저잡음 증폭기는 공통 소스 구조의 2단으로 설계하였으며, 믹서는 LO 및 RF balun으로 구성되고, 이는 능동 소자를 이용하여 구현하였다. 각 능동 소자의 공정상의 변화를 보상하기 위하여 새로운 바이어스 안정화 회로를 적용하였다. 그리고 이를 단일 칩으로 구현, 제작하였다. 측정 결과로 저잡음 증폭기는 2.1 GHz에서 15.51 dB의 이득과 1.02 dB의 잡음지수를 가지고 있으며, 믹서의 변환 이득은 -12 dB이며 IIP3는 약 4.25 dBm, 포트간 격리도는 25 dB 이상의 값을 가진다. 제안된 새로운 바이어스 회로는 FET와 저항으로 구성되며 공정상의 변화와 온도의 변화 등에 의한 문턱 전압의 변화를 보상해 줄 수 있다. 제작된 칩의 크기는 $1.2[mm]\times1.4[mm]$이다.

• 전기학회논문지
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• 제64권2호
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• pp.276-279
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• 2015

This paper propose a method to reduce the backscatter field of the curved aluminum plate using the cancellation system. The cancellation circuit is composed of a circulator, a LNA(Low Noise Amplifier), a VGA(Variable Gain Amplifier) and two phase shifters. Prior to experiment, we performed simulations to confirm the possibility using FDTD(Finite Difference Time Domain) simulator. We confirmed that the backscatter field could be reduced by the cancellation circuit when we changed the appropriate gain and phase. Finally, we performed an experiment to verify the performance of the cancellation circuit.