• 제목/요약/키워드: Input Error Amplification

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입력 에러 증폭 방법을 이용한 비터비 디코더의 회로 구현 미스 매칭 문제 개선 (Relaxation of the Circuit Mismatching of the Viterbi Decoder using Input Error Amplification)

  • 양창주;마헤스워 사;임해평;김형석
    • 대한전자공학회:학술대회논문집
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    • 대한전자공학회 2009년도 정보 및 제어 심포지움 논문집
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    • pp.175-177
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    • 2009
  • 통신이나 저장 매체에서 에러 정정을 위해 사용하는 비터비 디코더를 1에 해당하는 회로와 0에 해당하는 회로로 나누어 구성하고 각 출력 값의 크기를 비교함으로써 디코딩을 수행하는 구조를 연구하였다. 특히, 디코딩회로를 하드웨어 구현 시의 mismatching에 대비하기 위해, 경로에러를 증폭하여 두 회로 출력 값 사이의 마진을 크게 하는 방법을 제안하였다. 제안한 구조에 대한 시뮬레이션 결과 노이즈가 매우 심한 경우에도 높은 에러 정정 성능을 보였다.

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Convergence Analysis of Noise Robust Modified AP(affine projection) Algorithm

  • Kim, Hyun-Tae;Park, Jang-Sik
    • Journal of information and communication convergence engineering
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    • 제8권1호
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    • pp.23-28
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    • 2010
  • According to increasing projection order, the AP algorithm bas noise amplification problem in large background noise. This phenomenon degrades the performances of the AP algorithm. In this paper, we analyze convergence characteristic of the AP algorithm and then suggest a noise robust modified AP algorithm for reducing this problem. The proposed algorithm normalizes the update equation to reduce noise amplification of AP algorithm, by adding the multiplication of error power and projection order to auto-covariance matrix of input signal. By computer simulation, we show the improved performance than conventional AP algorithm.

아날로그 PRML 디코딩 회로 구현 시의 미스 매칭 문제 완화를 위한 입력 심볼 에러 값 증폭 (Input Error Amplification for the Ease of Mismatching Problem in the Analog PRML Decoder Implementation)

  • 양창주;마헤스워 사;김형석
    • 대한전자공학회논문지SD
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    • 제46권8호
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    • pp.86-94
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    • 2009
  • 차동형 아날로그 PRML 디코더의 하드웨어 구현 시에 발생하는 mismatching 문제를 해결하기 위해서 입력 심볼 에러를 증폭함으로써 에러 정정 효과를 향상시키는 방법을 제안하였다. 차동형 아날로그 PRML 비터비 디코더는 축약된 길이만큼의 트렐리스 다이아그램 회로를 2 개 구성하고, 그 중 한 회로는 0에 해당하는 가지들을 절단하고, 다른 회로는 1에 해당하는 가지들을 절단하여 두 회로의 출력을 비교함으로써 디코딩한다. 이 때, 두 회로 출력 값의 차이가 작을 경우에는 하드웨어 구현시의 mismatching 때문에 디코딩 에러가 발생할 수 있다. 본 논문에서는 입력 심볼 에러 값들을 증폭함으로서 큰 경로 에러 값들은 saturation시키는 대신, 작은 경로 에러 값들 간에는 구별 성을 키움으로써 결과적으로 0 혹은 1 간의 구별 마진이 커지게 하는 방법을 제안하였다. 회로의 디코딩 성능 개선효과를 보이기 위해 시뮬레이션 결과를 제시하였다.

나노 변위확대기구의 정밀위치결정기구에 관한 연구 (Development of the Precision Positioning Mechanism by Nano Displacement Magnification Device)

  • 박창용;권현규;조지준
    • 한국기계가공학회지
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    • 제12권1호
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    • pp.97-103
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    • 2013
  • A new precision positioning mechanism for stage was been developed by Displacement Magnification Device(DMD) in this paper. The DMD was composed of the beam and multilayer piezoelectric actuators. The theoretical and experimental analysis of DMD to enlarge displacement more then 50times were discussed. And the 2-axis stage by using displacement amplification apparatus was added in the new DMD, and it was able to do it through finite element analysis and experiment. As the results, the magnification of DMD can be obtained about $100{mu}m$ displacement to the 10V input voltage($1.5{mu}m$). And the about 50nm of linearity error in the $30{mu}m$ measurement range and 20times of the amplification in displacement can be measured. In addition, the experimental results are confirmed the possibility of millimeter displacement characteristics and correspond to finite element analysis results.

미지 입력을 가진 기계 시스템을 위한 비선형 관측기 설계 (Design of a Nonlinear Observer for Mechanical Systems with Unknown Inputs)

  • 송봉섭;이지민
    • 제어로봇시스템학회논문지
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    • 제22권6호
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    • pp.411-416
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    • 2016
  • This paper presents the design methodology of an unknown input observer for Lipschitz nonlinear systems with unknown inputs in the framework of convex optimization. We use an unknown input observer (UIO) to consider both nonlinearity and disturbance. By deriving a sufficient condition for exponential stability in the linear matrix inequality (LMI) form, existence of a stabilizing observer gain matrix of UIO will be assured by checking whether the quadratic stability margin of the error dynamics is greater than the Lipschitz constant or not. If quadratic stability margin is less than a Lipschitz constant, the coordinate transformation may be used to reduce the Lipschitz constant in the new coordinates. Furthermore, to reduce the maximum singular value of the observer gain matrix elements, an object function to minimize it will be optimally designed by modifying its magnitude so that amplification of sensor measurement noise is minimized via multi-objective optimization algorithm. The performance of UIO is compared to a nonlinear observer (Luenberger-like) with an application to a flexible joint robot system considering a change of load and disturbance. Finally, it is validated via simulations that the estimated angular position and velocity provide true values even in the presence of unknown inputs.

Low complexity ordered successive interference cancelation detection algorithm for uplink MIMO SC-FDMA system

  • Nalamani G. Praveena;Kandasamy Selvaraj;David Judson;Mahalingam Anandaraj
    • ETRI Journal
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    • 제45권5호
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    • pp.899-909
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    • 2023
  • In mobile communication, the most exploratory technology of fifth generation is massive multiple input multiple output (MIMO). The minimum mean square error and zero forcing based linear detectors are used in multiuser detection for MIMO single-carrier frequency division multiple access (SCFDMA). When the received signal is detected and regularization sequence is joined in the equalization of spectral null amplification, these schemes experience an error performance and the signal detection assesses an inversion of a matrix computation that grows into complexity. Ordered successive interference cancelation (OSIC) detection is considered for MIMO SC-FDMA, which uses a posteriori information to eradicate these problems in a realistic environment. To cancel the interference, sorting is preferred based on signal-to-noise ratio and log-likelihood ratio. The distinctiveness of the methodology is to predict the symbol with the lowest error probability. The proposed work is compared with the existing methods, and simulation results prove that the defined algorithm outperforms conventional detection methods and accomplishes better performance with lower complication.

페러데이 효과를 이용한 특고압 직류전송용 광전류 센서 구현 (Implantation of DC Optical Current Sensor Based on Faraday Effect for HVDC)

  • 김광택;정대원;김영수
    • 센서학회지
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    • 제28권3호
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    • pp.187-190
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    • 2019
  • We proposed and demonstrated DC(direct current) optical current sensor based on Faraday effect for HVDC(high voltage direct current). The RIG((Bi1.3Gd0.43Y1.27)Fe5O12) was adopted as Faraday device because of its high Verdet constant and good thermal stability. The differential amplification scheme for signal processing was present. The sensor showed high linear response for the input current. Measurement range of the sensor was 0~200A and measurement error was less than 1%.

A Design of Wide-Bandwidth LDO Regulator with High Robustness ESD Protection Circuit

  • Cho, Han-Hee;Koo, Yong-Seo
    • Journal of Power Electronics
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    • 제15권6호
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    • pp.1673-1681
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    • 2015
  • A low dropout (LDO) regulator with a wide-bandwidth is proposed in this paper. The regulator features a Human Body Model (HBM) 8kV-class high robustness ElectroStatic Discharge (ESD) protection circuit, and two error amplifiers (one with low gain and wide bandwidth, and the other with high gain and narrow bandwidth). The dual error amplifiers are located within the feedback loop of the LDO regulator, and they selectively amplify the signal according to its ripples. The proposed LDO regulator is more efficient in its regulation process because of its selective amplification according to frequency and bandwidth. Furthermore, the proposed regulator has the same gain as a conventional LDO at 62 dB with a 130 kHz-wide bandwidth, which is approximately 3.5 times that of a conventional LDO. The proposed device presents a fast response with improved load and line regulation characteristics. In addition, to prevent an increase in the area of the circuit, a body-driven fabrication technique was used for the error amplifier and the pass transistor. The proposed LDO regulator has an input voltage range of 2.5 V to 4.5 V, and it provides a load current of 100 mA in an output voltage range of 1.2 V to 4.1 V. In addition, to prevent damage in the Integrated Circuit (IC) as a result of static electricity, the reliability of IC was improved by embedding a self-produced 8 kV-class (Chip level) ESD protection circuit of a P-substrate-Triggered Silicon Controlled Rectifier (PTSCR) type with high robustness characteristics.

면적평균강우의 추정오차와 유출계산에 미치는 영향 (Estimation Error of Areal Average Rainfall and Its Effect on Runoff Computation)

  • 유철상;김상단;윤용남
    • 한국수자원학회논문집
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    • 제35권3호
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    • pp.307-319
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    • 2002
  • 본 연구에서는 WGR 강우모형으로부터 모의된 공간적으로 분포된 강우자료를 수정Clark방법으로 유출 해석하여 면적평균강우의 추정에 따른 오차와 유출오차사이의 관계론 고찰해 보았다. 이러한 관계는 강우관측소의 밀도를 다양하게 변화시켜가며 아울러 호우의 방향을 여러 가지 경우로 가정하여 살펴보았으며, 그 결과를 정리하면 다음과 같다. (1) 면적평균강우의 추정오차 및 이에 따른 유출오차는 강우관측소의 밀도가 높아짐에 따라 지수함수적으로 줄어들고 있으며, 어떤 밀도 이상이 되면 그 감소 폭이 크게 둔화되는 것으로 나타났다. (2) 면적평균강우의 추정오차는 강우관측소의 밀도가 작을수록 유출에 보다 큰 영향력을 미치고 있음을 알 수 있었다. 그러나 면적평균 강우-유출의 관계에서는 그 오차의 비가 1.0이하로 유역면적평균강우 추정시의 오차가 유출에 감소되어 전달되는데 비해 첨두유출량에는 그대로 또는 경우에 따라 증폭되어 전달됨을 파악할 수 있었다. (3) 호우의 방향성에 따른 강우오차는 크게 영향 받지 않는 것으로 판단된다. 그러나, 유출오차는 호우의 방향이 유역의 배수방향에 일치하는 경우에 더 크게 나타나고 있으며, 특히 수문곡선의 형상적인 측면에서보다는 첨두유출량에 더 많은 영향력을 미치고 있는 것으로 보여진다.

CNT 센서 어레이를 위한 신호 검출 시스템 (A Signal Readout System for CNT Sensor Arrays)

  • 신영산;위재경;송인채
    • 대한전자공학회논문지SD
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    • 제48권9호
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    • pp.31-39
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    • 2011
  • 본 논문에서는 Carbon Nanotube(CNT) 센서 어레이를 위한 저 전력, 소 면적의 신호 검출 시스템을 제안한다. 제안된 시스템은 신호 검출회로, 디지털 제어기, UART I/O로 구성된다. 신호 검출회로는 VGA를 공유하는 64개의 transimpedance amplifier(TIA)와 11비트 해상도의 successive approximation register-ADC(SAR-ADC)를 사용하였다. TIA는 센서의 전압 바이어스 및 전류를 증폭하기 위한 active input current mirror(AICM)와 증폭된 전류를 전압으로 변환하는 저항 피드백 방식의 VGA(Variable Gain Amplifier)로 구성되어있다. 이러한 구조는 큰 면적과 많은 전력을 필요로 하는 VGA를 공유하기 때문에 다수의 센서 어레이에 대해 검출 속도의 저하 없이 저 전력, 소 면적으로 신호 검출이 가능하게 한다. SAR-ADC는 저 전력을 위하여 입력 전압 level에 따라 하위 bit의 동작을 생략하는 수정된 알고리즘을 사용하였다. ADC 및 센서의 선택은 UART Protocol 기반의 디지털 제어기에 의해 선택되며, ADC의 data는 UART I/O를 통해 컴퓨터와 같은 단말기를 통해 모니터링 할 수 있다. 신호 검출회로는 0.13${\mu}m$ CMOS 공정으로 설계되었으며 면적은 0.173 $mm^2$이며 640 sample/s의 속도에서 77.06${\mu}W$의 전력을 소모한다. 측정 결과 10nA - 10${\mu}A$의 전류 범위에서 5.3%의 선형성 오차를 가진다. 또한 UART I/O, 디지털 제어기는 0.18${\mu}m$ CMOS 공정을 이용하여 제작하였으며 총면적은 0.251 $mm^2$ 이다.