• 전력전자학회:학술대회논문집
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• 전력전자학회 2008년도 추계학술대회 논문집
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• pp.196-198
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• 2008

본 논문에서는 강압형 DC-DC 컨버터의 성능 개선을 위한 스위칭 기법인 2차 SDSDM(Space Dithered Sigma-Delta Modulation)방식을 제안한다. PWM 방식은 일정 스위칭 주파수 대역에서의 고조파로 인해 소음, 전자파 장애, 스위칭 손실 등을 초래한다. 이러한 문제를 해결하기 위한 DSDM 방식의 일종인 1차 SDSDM은 랜덤 디더(Random Dither) 발생기가 1차 SDM의 양자화기(quatizer) 입력 단에 위치하여 스위칭 주파수가 분산된다. 강압형 DC/DC 컨버터에 제안하는 2차 SDSDM의 방식을 적용한 실험 결과를 통해 타당성을 검증한다.

• 전자공학회논문지A
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• 제32A권12호
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• pp.142-148
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• 1995

Sb ${\delta}$-doped Si layers were grown by Si MBE (Molecular Beam Epitaxy) system using substrate temperature modulation technique. The Si substrate temperatures were modulated between 350$^{\circ}C$ and 600$^{\circ}C$. The doping profile was as narrow as 41$\AA$ and the doping concentration of up to 3.5${\times}10^{20}cm^{3}$ was obtained. The film quality was as good as bulk material as verified by RHEED (Reflected High Energy Electron Diffraction), SRP (Spreading Resistance Profiling) and Hall measurement. Since the film quality is not degraded after the growth a Sb ${\delta}$-doped Si layer, the ${\delta}$-doped layers can be repeated as many times as we want. The doping technique is useful for many Si devices including small scale devices and those which utilize quantum mechanical effects.

• 대한전자공학회논문지
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• 제15권6호
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• pp.1-7
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• 1978

本 論文에서는 음성신호의 디지털化와 대역폭축소의 한 방법으로 예측부호化 원리를 사용하는 adaptive differential pulse code modulation(ADPCM)과 adaptive delta modulation(ADM)에 관하여 고찰하였다. ADPCM에서 사용되는 대표적인 적응양자기의 원리를 설명하고 적응예측기의 계수를 얻는 두 방법, 즉 브록해석과 연차해석 방법을 검토하였다. 또한 ADM에서 사용되는 세가지 壓伸方法(instantaneous, syllabic, hybrid companding)을 구체적으로 설명하고 그의 성능을 비교하였다. 마지막으로 ADPCM과 ADM을 음성신호의 부호化器로 쓸 때의 성능과 장단점들을 비교 검토하였다.

• 대한전자공학회논문지
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• 제15권3호
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• pp.1-6
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• 1978

본 논문에서는 음성신호의 디지탈화와 대역폭축소의 한 방법으로 예측부호화 원리를 사용하는 adaptive differential pulse code modulation(ADPCM)과 adoptive delta modulation(ADM)에 관하여 고찰하였다. ADPCM에서 사용되는 대표적인 적응양자기의 원리를 설명하고 적응예측기의 계수를 얻는 두 방법, 즉 브록해석과 연차해석 방법을 검토하였다. 또한 ADM에서 사용되는 세가지 압신방법(instantaneous, syllabic, hybrid commanding)을 구체적으로 설명하고 그의 성능을 비교하였다. 마지막으로 ADPCM과 ADM을 음성신호의 부호화기로 쓸 때의 성능과 장단점들을 비교 검토하였다.

• 대한전기학회논문지:전기기기및에너지변환시스템부문B
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• 제50권10호
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• pp.513-519
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• 2001

This paper proposed a random sigma-delta modulator(RSDM), which is constructed by a 1st order sigma-delta modulator(SDM) and a simple structured random binary generator(RBG). The 1st order SDM produces a switching pulse waveform which has the same low-frequency component as the reference input, while the RBG spreads the distribution of the number of sampling per switching cycle, and thus disperses the spectrum spikes in the output. The relationship between the harmonic spectra and the number of sampling per switching cycle is studied through computer simulations, and the frequency spectra of the RSDM are confirmed in an experimental setup.

• JSTS:Journal of Semiconductor Technology and Science
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• 제13권2호
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• pp.170-183
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• 2013

This paper gives an overview of fractional-N phase-locked loops (PLLs) with practical design perspectives focusing on a ${\Delta}{\Sigma}$ modulation technique and a finite-impulse response (FIR) filtering method. Spur generation and nonlinearity issues in the ${\Delta}{\Sigma}$ fractional-N PLLs are discussed with simulation and hardware results. High-order ${\Delta}{\Sigma}$ modulation with FIR-embedded filtering is considered for low noise frequency generation. Also, various architectures of finite-modulo fractional-N PLLs are reviewed for alternative low cost design, and the FIR filtering technique is shown to be useful for spur reduction in the finite-modulo fractional-N PLL design.

• ETRI Journal
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• 제30권3호
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• pp.377-382
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• 2008

A novel power amplifier for a polar transmitter is proposed to achieve better spectral performance for a wideband envelope signal. In the proposed scheme, 2-bit sigma-delta (${\Sigma}{\Delta}$) modulation of the envelope signal is introduced, and the power amplifier configuration is modified in a binary form to accommodate the 2-bit digitized envelope signals. The 2-bit ${\Sigma}{\Delta}$ modulator lowers the noise of the envelope signal by fine quantization and thus enhances the spectral property of the RF signal. The Ptolemy simulation results of the proposed structure show that the spectral noise is reduced by 10 dB in a full transmit band of the EDGE system. The dynamic range is also enhanced. Since the performance is improved without increasing the over-sampling ratio, this technique is best suited for wireless communication with high data rates.

• 전력전자학회논문지
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• 제3권4호
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• pp.399-406
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• 1998

본 연구에서는 SRM의 고성능 운전을 구현하기 위해 토오크를 순시적으로 제어하기 위한 방법을 제시한다. 먼저 SRM의 토오크-전류-회전자 위치각 특성을 측정에 의해 구하여 이를 기기의 모델로 설정한다. 이를 바탕으로 각 상간의 토오크중첩을 고려하여 부하와 속도의 변동에 따라 총합 발생토오크를 순시적으로 제어함으로써 맥동성분을 최소화시키는 기준토오크를 설정하고, 이 기준토오크를 추종하기 위한 기준 상전류 파형을 구한다. 이러한 기준전류를 추종하는 방안으로써 PWM에 의한 델타변조 (Delta Modulation) 기법을 사용한다. 실험과 시뮬레이션과 실험결과를 비교함으로써 제안된 방식의 타당성을 입증한다.

• ETRI Journal
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• 제36권6호
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• pp.924-930
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• 2014

This paper presents a $0.13{\mu}m$ CMOS 3-level envelope delta-sigma modulation (EDSM) RF signal generator, which synthesizes a 2.6 GHz-centered fully symmetrical 3-level EDSM signal for high-efficiency power amplifier architectures. It consists of an I-Q phase modulator, a Class B wideband buffer, an up-conversion mixer, a D2S, and a Class AB wideband drive amplifier. To preserve fast phase transition in the 3-state envelope level, the wideband buffer has an RLC load and the driver amplifier uses a second-order BPF as its load to provide enough bandwidth. To achieve an accurate 3-state envelope level in the up-mixer output, the LO bias level is optimized. The I-Q phase modulator adopts a modified quadrature passive mixer topology and mitigates the I-Q crosstalk problem using a 50% duty cycle in LO clocks. The fabricated chip provides an average output power of -1.5 dBm and an error vector magnitude (EVM) of 3.89% for 3GPP LTE 64 QAM input signals with a channel bandwidth of 10/20 MHz, as well as consuming 60 mW for both channels from a 1.2 V/2.5 V supply voltage.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2000년도 하계종합학술대회 논문집(5)
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• pp.81-84
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• 2000

This paper proposes a new sigma delta modulator structure based on a LMS(Least Mean Square) algorithm that minimizes the quantization noise. The proposed architecture provides 40dB SNR improvement and 35dB wider dynamic range over conventional sigma delta modulation. The proposed architecture provides superior performance especially when the input signal is small.