• 한국표면공학회:학술대회논문집
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• 한국표면공학회 1999년도 추계학술발표회 초록집
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• pp.55-55
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• 1999

산소 이온빔이 보조된 e-baem evporation증착법에 의해 상온에서 유리 기판위에 제조된 tin-doped indium oxide(ITO) 박막의 전기적 광학적 특성과 산소 이온빔의 조건 사이에 존재하는 상관관계에 대해서 연구하였다. ITO박막의 증착률이 고정된 상태에서 증착되는 ITO박막의 성질은 조사되는 이온의 flux 및 에너지에 의존하게 된다. 이온의 에너지는 이온 건의 grid에 걸리는 전압에 의해서, flux는 이온 건으로 유입되는 산소의 유량과 rf power에 의해서 조절될 수 있다. 본 실험에서는 증착변 수를 줄이기 위해서 ITO의 증착률과 rf power을 0.6A/sec, 100W로 각각 고정 시켰고, 이러한 조건에서 grid의 가속 전압을 400~2.1kV, 산소의 유업량을 3~10sccm으로 변화시켜가며 실험을 수행하였다. 유량 6sccm, 가속전압 2.1kV에서 최저 비저항 값인 $6.6{\times}l0^{-4}{\Omega}cm$와 90%의 광학적 투과성을 갖는 ITO 박막을 상온에서 증착할 수 있었다.

• 대한전자공학회논문지SD
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• 제42권1호
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• pp.25-32
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• 2005

본 논문에서는 단 채널 GaAs MESFET과 SOI-구조의 Si JFET가 갖는 전형적인 특성: i) 드레인 전압 인가에 의한 문턱전압 roll-off, ii) 포화영역에서의 유한한 ac 출력저항, iii) 채널길이에 대한 드레인 포화전류의 의존성 약화, 등을 통합적으로 기술할 수 있는 해석적 모델을 제안하였다. 채널 방향의 전계 변화를 포함하는 새로운 형태의 가정을 기존의 GCA와 대체하고, 채널의 전류 연속성과 전계-의존 이동도를 고려하여, 공핍영역과 전도 채널에서 2차원 전위분포 식을 도출해 내었다. 이 결과, 문턱전압, 드레인 전류의 표현 식들이 동작전압전 구간의 영역에 걸쳐 비교적 정확하게 도출되었다. 또한 본 모델은 기존의 채널 shortening 모델에 비해 Early 효과에 대한 보다 더 적절한 설명을 제공하고 있음을 보이고 있다.

• 대한전자공학회논문지SD
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• 제47권12호
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• pp.17-23
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• 2010

본 논문에서는 단 채널 bulk-type MOSFET의 문턱전압의 표현식을 해석적으로 도출하는 모텔을 제시하였다 게이트 절연층 내에서는 2차원 Laplace 방정식을, silicon body 내 공핍층에서는 2차원 Poisson 방정식을 Fourier 계수 방법을 이용하여 풀어냈으며, 이로부터 채날 표면전위의 최소치를 도출하고 문턱 전압 표현 식을 도출하였다. 도출된 문턱전압 표현식을 모의 실험한 결과, 소자의 각종 parameter와 bias 전압에 대한 의존성을 비교적 정확히 도출할 수 있음을 확인할 수 있었다.

• 전자공학회논문지T
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• 제36T권2호
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• pp.8-13
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• 1999

본 논문은 MOSFET에서 2차원적 전위분포가 채널방향을 따라 준-선형적으로 변한다는 GCA(Gradual Channel Approximation)를 진성영역에서 수직 공핍층 폭이 준-선형적으로 변한다는 가정으로 대치하여 단채널 MOSFET에서도 적용 가능한 문턱전압의 해석적 모형을 제안하였다. 제안된 문턱전압 표현식은 유효 채널길이, 드레인전압, 기판(substrate) 바이어스 전압, 기판 도핑농도, oxide 두께 등에 대한 의존성을 통합적으로 나타내었으며, 계산된 결과는 BSIM3v3의 결과와 유사한 경향을 보이고 있다.

• 한국자기학회지
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• 제26권6호
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• pp.201-205
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• 2016

본 연구에서는 터널링 자기저항(TMR) 소자의 임피던스 스펙트럼을 측정하였으며, 절연체 장벽에 의한 터널링 저항($R_T$)과 터널링 전기 용량을 갖는 축전기($C_T$)가 병렬로 연결된 등가회로를 활용하여 TMR 소자의 완화 특성을 분석하였다. 두 자성체의 자화가 반평행 및 평행 상태일 때 모두 완화 주파수는 교류 전압에 따라 증가하는 경향을 보였다. 스펙트럼 측정 결과로부터 도출한 $R_T$는 TMR소자의 전형적인 바이어스 전압 의존성을 보였으나, $C_T$는 기하학적인 전기 용량에 비하여 약 4,500배 이상 증가하였다. 이러한 $C_T$의 거대한 증가는 TMR 소자의 고속 동작을 제한하는 요소로 작용하므로, 고속 동작을 요구하는 TMR 소자는 초고용량 $C_T$의 특성을 설계에 반영하여야 한다.

• E2M - 전기 전자와 첨단 소재
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• 제4권3호
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• pp.259-266
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• 1991

1.5.mu.m의 찬넬길이를 갖는 short channel 비휘발성 SNOSFET 기억소자를 기존의 CMOS 1 Mbit 공정기술을 이용하여 제작하고 I$_{d}$-V$_{d}$ 및 I$_{d}$- V$_{g}$특성과 스윗칭 및 기억유지특성을 조사하였다. 그 결과 제작한 소자는 논리회로 설계에 적절한 전도특성을 가졌으며 스윗칭시간은 인가전압의 크기에 의존함을 보였다. 그리고 3V의 memory window 크기를 얻기 위해서 V$_{w}$ =+34V, t$_{w}$ =50.mu.sec 및 V$_{e}$=-34V, t$_{e}$=500.mu.sec의 펄스전압으로 각각 write-in과 erase할 수 있었다. 또한 기억상태는 10년이상 유지할 수 있음을 알 수 있었다.

• 전력전자학회:학술대회논문집
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• 전력전자학회 2005년도 전력전자학술대회 논문집
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• pp.305-307
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• 2005

본 연구는 순수 국내기술로 개발된 국산화 전동차 광주도시철도 1호선의 추진제어 장치의 본선시운전에 관한 것으로, 외국기술에 의존해온 추진 제어장치를 국내기술로 설계하고 본선시운전을 통하여 추진제어장치의 신뢰성 및 안정성에 관하여 실험을 실시하였다. 그리고 추진제어 장치에 적용한 알고리즘은 필터 사이즈를 감소하기위하여 기존의 패턴에 의한 PWM방식을 사용치 않고, 출력전류의 고조파 리플이 적은 저주파 동기 공간벡터 PWM 알고리즘을 제안하고, 가선전압의 변동에 강인한 댐핑 제어 및 과전압 제한 제어 알고리즘을 제시하고, 제안된 알고리즘은 본선시운전을 통하여 타당함을 확인하였다.

• 한국진공학회:학술대회논문집
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• 한국진공학회 2013년도 제45회 하계 정기학술대회 초록집
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• pp.243.2-243.2
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• 2013

본 실험에서 $SiO_2$, $SiN_x$ 게이트 절연막에 따른 ITZO 산화물 반도체 트랜지스터를 제작하여, 온도변화에 따라 전달 특성 변화를 측정하여 열에 대한 소자의 안정성을 비교, 분석하였다. 온도가 증가함에 따라 carrier가 증가하는 온도 의존성을 보이며, 이로 인해 Ioff가 증가하였다. multiple-trapping 모델을 적용하여, 이동도 증가와 문턱 전압이 감소를 확인하였다. 또한 M-N rule을 적용하여 $SiO_2$, $SiN_x$ 게이트 절연막을 가진 ITZO 산화물 박막 트랜지스터의 활성화 에너지를 추출하고, sub-threshold 지역에서 활성화 에너지의 변화량이 $SiO_2$, SiNX 각각 0.37 eV/V, 0.24 eV/V로 차이를 통해 $SiN_x$ 게이트 절연체를 가진 ITZO 산화물 반도체 트랜지스터의 이동도와 문턱 전압의 변화가 더 컸음을 확인하였다.

• 대한전기학회:학술대회논문집
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• 대한전기학회 2004년도 하계학술대회 논문집 B
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• pp.773-775
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• 2004

최근 높은 임계전류를 지닌 고온초전도선재를 이용한 초전도 전력기기의 개발이 활발히 이루어지고 있다. 고온초전도선재의 임계전류는 자장에 대한 의존성을 지니고 있으며 이로 인해 고온초전도선재가 코일의 형태로써 초전도 전력기기의 개발에 이용되는 경우, 권선 방식에 따라 다른 전기적 특성을 지니게 된다. 이러한 특성은 초전도선재의 전력기기의 효율에 큰 영향을 미치므로 권선 방식에 따른 코일의 특성을 연구하는 것은 초전도선재를 이용한 전력기기의 효율을 높이는데 있어서 중요한 의미를 갖는다. 본 논문에서는 권선 방식에 따른 코일의 특성을 비교하기 위해 동일한 턴 수와 사용 선재길이를 가진 팬케이크 코일과 솔레노이드 코일을 설계, 제작하고 두 코일의 임계전류를 측정하였다. 또한 인가전류에 대한 두 코일의 전압, 저항특성과 교류손실 특성을 측정하고 비교하였다. 측정결과, 두 코일의 임계전류는 솔레노이드 코일이 109A로 팬케이크 코일에 비해 약 $36\%$ 더 높았다. 코일에 가해준 인가전류가 증가함에 따라 코일에서 발생하는 전압 중 손실에 관련된 저항성 성분의 전압이 변화하고 있음을 확인하였다. 또한 교류손실은 인가 전류의 피크값이 팬케이크 코일의 임계전류 이하인 구간에서 팬케이크 코일이 솔레노이드 코일의 교류손실보다 9배 크며, 팬케이크와 솔레노이드의 임계전류 사이에서는 8.3배 컸다.

• 한국정보통신학회논문지
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• 제18권4호
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• pp.885-890
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• 2014

비대칭 이중게이트(double gate; DG) MOSFET의 문턱전압이하 스윙의 게이트 산화막 두께에 대한 변화를 고찰하였으며 이를 위하여 포아송방정식의 해석학적 전위분포를 구하였다. 특히 포아송방정식을 풀 때 도핑분포함수에 가우시안 함수를 적용함으로써 보다 실험값에 가깝게 해석하였다. 비대칭 DGMOSFET 소자는 대칭적 구조를 갖는 DGMOSFET와 달리 4단자 소자로서 상단과 하단의 게이트 산화막 두께 및 인가전압을 달리 설정할 수 있다. 비대칭 DGMOSFET의 문턱전압이하 스윙을 상 하단 게이트 산화막 두께 변화에 따라 관찰한 결과, 게이트 산화막 두께에 따라 문턱전압이하 스윙은 크게 변화하는 것을 알 수 있었다. 특히 상 하단 게이트 산화막 두께가 증가할 때 문턱전압이하 스윙 값도 증가하였으며 상단 게이트 산화막 두께의 변화가 문턱전압이하 스윙 값에 더욱 큰 영향을 미치고 있다는 것을 알 수 있었다.