본 논문은 단상 그리드전압의 동기화에 가장 적합한 곱형 PLL 시스템을 설계한다. 소신호 해석방법으로 PLL 시스템을 모델링하고, 동기 과도 응답특성뿐만 아니라 동기신호의 왜곡을 고려하여 저역필터의 차단주파수 및 이득의 최적 값을 유도한다. 설계의 성능을 검증하기 위하여, 시뮬레이션 및 실험결과로 차단주파수 및 이득의 변화에 동기신호의 과도응답과 리플성분을 관찰한다.
본 논문은 밀리미터파 대역에서 사용될 PHEMT의 특성향상을 위한 연구의 일원으로 게이트 식각에 따른 소자의 특성 변화를 연구하였다. PHEMT는 ohmic 금속을 리세스 패턴으로 사용한 wide 리세스와 게이트 패턴을 리세스 패턴으로 사용한 narrow 리세스의 두가지를 이용하여 제작하였다. 제작된 PHEMT의 최대 전달컨덕턴스(g/sub m/)는 wide 리세스를 이용한 경우 332.7 mS/mm, narrow 리세스를 이용한 경우 504.6 mS/mm의 값을 각각 얻었다. 소신호 주파수 특성으로, wide 리세스를 이용하여 제작한 PHEMT는 전류 이득 차단주파수(f/sub T/) 113 GHz, 최대 공진 주파수(f/sub max/) 172 GHz를 각각 얻었다. Narrow 리세스를 이용하여 제작한 PHEMT의 전류 이득 차단주파수(f/sub T/)와 최대 공진 주파수(f/sub max/)는 101 GHz, 142 GHz를 각각 얻었다. 측정된 결과는 소신호 모델에서 각 파라미터의 변화와 비교, 분석하였다.
광파이버 네트웍에서 광전믹싱 광검파의 가용 주파수대역 확장을 위한 이론을 제시하고 시뮬레이션을 실시하였다. 광전믹싱 광검파의 정규화 이득을 정의하고, 검파소자의 차단주파수를 초월하는 고주파 영역의 신호도 검파가 가능함을 확인하였다. 포토다이오드 내부의 캐리어 천이에 대한 연속방정식을 풀어서 광전믹싱 현상의 메카니즘을 해석하였다. 정규화 이득은 신호주파수와 차주파수의 크기에 의존하였으나, 포토다이오드에 흐르는 광전류의 크기는 신호주파수와는 무관하였다. 신호 검파효율의 최대화를 위해서는 바이어스 전압과 국부신호의 진폭을 동시에 최적화할 필요가 있다.
본 논문에서는 SAW 필터가 없는 LTE-Advanced RF 송신기에 적용 가능한 기저대역 송신단 회로를 제안한다. 제안하는 기저대역 송신단 회로는 Tow-Thomas구조의 2차 능동 저역통과 필터 1개와 1차 수동 RC 필터 1개로 구현되었으며, 0.7 MHz, 1.5 MHz, 2.5 MHz, 5 MHz, 7.5 MHz, 10 MHz, 그리고 20 MHz의 총 7개의 채널 차단 주파수를 제공하며, 각 채널 별로 -41 dB에서 0 dB까지 1-dB 단계로 이득 조절이 가능하다. 제안하는 2차 능동 저역 통과 필터 회로는 DC 소모 전류 효율을 높이기 위해 채널 차단 주파수를 세 그룹으로 나누어서 선택된 차단 주파수 그룹에 따라 연산증폭기의 전류 소모를 3단계로 가변 할 수 있도록 연산증폭기 내부에 3개의 단위-연산증폭기(OTA)를 병렬로 연결하여 선택적으로 사용할 수 있도록 설계하였다. 또한, 제안하는 연산 증폭기는 저전력으로 1-GHz UGBW(Unit Gain Bandwidth)를 얻기 위해 Miller 위상 보상 방식과 feed-forward 위상 보상 방식을 동시에 사용하였다. 제안하는 기저대역 송신기는 65-nm CMOS 공정을 사용하여 설계되었고 1.2 V의 전압으로부터 선택된 채널 대역폭에 따라 최소 6.3 mW, 최대 24.1 mW의 전력을 소모한다.
이 논문에서는 채널 상태가 천천히 변할 때, 직교 주파수 분할 다중화-부호분할 다중접속 시스템에 적합한 채널 추정 방법을 제안하고 성능을 분석한다. 제안한 채널 추정 방법은 시간과 주파수 영역 모두에 파일럿 심볼을 삽입하고, 이산 퓨리에 변환 후 영을 채워 넣는 방법을 이용한 내삽법으로 모든 부채널의 전달 함수를 얻는다. 또한 변환 영역에서 저대역 여파를 통해 받은 파일럿 신호에 존재하는 가산성 백색 정규 잡음의 영향을 상당히 줄일 수 있다. 이 때 저대역 여파기의 차단 주파수는 채널의 다중경로 수에 따라 정해진다. 같은 방법을 이용한 내삽법을 시간축으로 적용하여 시간에 따라 변하는 부채널의 채널 응답을 얻을 수 있다. 이 논문에서는 여러 가지 내삽법에 대한 평균 제곱 오차 성능을 수식적으로 제시한다. 제안한 저대역 여파를 결합한 내삽법을 쓰면 채널의 통계적 특성에 관한 정보 없이, 그리고 훨씬 적은 계산량으로 선형 최소 평균 제곱 오차 추정기와 비슷한 성능을 얻는다. 레일리 감쇄 채널에 대한 모의 실험을 통해 같은 비트 오류율에 대한 신호 대 잡음 비의 이득이 있음을 보인다.
본 연구에서는 초고주파 대역 소신호 트랜지스터를 이용하여 광대역 특성을 갖는 캐스코드 증폭기의 설계에 대하여 기술한다. 캐스코드 구조를 사용함으로써, 중간대역 이득의 감소를 피하면서 밀러 효과를 감소시켜 차단주파수를 확장시켰다. 또한 입력 매칭을 용이하게 하고 광대역에서 리플이 작은 이득 특성을 얻기 위해 피드백 회로를 이용하였다. 종래에 광대역 증폭기로 평형 증폭기나 분산형 증폭기가 자주 사용되지만, 본 연구에서는 기존보다 회로의 크기를 감소시키면서 광대역 이득특성을 얻을 수 있도록 캐스코드 구조의 증폭기를 설계하였다. 실제 측정에서 1000-2000MHz사이에서 $8.5dB{\pm}1.5dB$의 이득을 보였다. 제작된 캐스코드 증폭기는, 비록 약간의 주파수 이동이 있으나, 예측 결과와 유사하게 1000MHz 이상의 대역폭에서 8dB 이상의 평탄한 이득을 가졌다.
본 논문에서는 개선된 elliptic 저역통과 함수를 제시하고, CMOS DDA 소자 및 DDA 응용회로를 이용하여 CDMA 무선 휴대폰용 아날로그 DDA 저역통과 필터를 설계하 였다. 개선된 elliptic 저역통과 필터 함수는 통과대역과 저지대역에서 점진적 감소 파상 특 성을 갖고, 우수 또는 기수 차수 모두에 대해서 ω=0에서는 통과대역의 최대값, ω=∞에서 는 영이 된다. 또한 극점-Q 값이 감소함에 따라 주파수 및 시간영역의 특성 등이 기존의 함수와 비교하여 향상되었다. 아날로그 능동 저역통과 필터는 수동 복종단 제자형 회로망의 저감도 특성이 유지되는 개구리 도약법으로 모의하고, 적분기등을 외부 소자와의 정합이 필 요 없는 DDA를 이용하여 설계하였다. 설계된 DDA 회로의 단위 이득 주파수는 1.32GHz이 고 이를 이용하여 DDA 저역통과 필터를 설계하여 HSPICE로 시뮬레이션한 결과 필터의 차단 주파수는 630KHz로 설계명세조건과 일치하였다.
본 논문에서는 TDMB와 KPSC를 지원하는 내장형 안테나를 제안한다. 제안된 안테나는 서로 다른 유전율을 가지는 안테나가 결합된 형태이며, 휴대폰에 적합한 작은 사이즈($45{\times}8{\times}8\;mm$, 약 2.8 cc)를 갖는다. TMDB 안테나는 각 셀간의 전류 흐름을 최대화 시킨 맴돌이 구조로 설계되었으며, KPCS 안테나는 휴대폰에 많이 사용되는 PIFA 형태로 설계되었다. TMDB 안테나는 부족한 공진 길이를 보상하기 위해 100 nH 이상의 인덕터가 사용된다. 이때, 인덕터는 높은 주파수 신호를 차단함으로 TDMB에서의 KPCS 주파수 입력은 차단된다. 또한, KPCS 대역에서 TDMB 안테나의 방사부는 기생 소자로 동작하기 때문에 각 밴드 간의 격리도 특성이 우수하다. 제안된 안테나는 CST Microwave Studio를 이용하여 설계하였으며, 전자파 무방향실에서 특성을 측정하였다. 제안된 안테나는 TMDB 대역에서 $-6{\sim}-14\;dBi$의 이득을 가지며, KPCS 대역에서 $-3.5{\sim}-5\;dBi$의 이득을 갖는다.
무선 송수신의 보급이 급속도로 확대됨에 따라 모바일 사용자는 새로운 기기를 구입해야 하는 불편을 따른다. 이에 대안으로 같은 기기로 다양한 기준주파수 보다, 낮은 주파수를 수용할 수 있는 주파수대역의 튜닝이 가능한 DCR(Direct conversion receiver) 의 필요성이 대두 되고 있다. 이에 DCR에 들어가는 저역통과필터는 다양한 기준주파수를 만족하기 위한 대역폭, 이득을 튜닝 하는데 중요한 부분을 차지하게 된다. 본 논문에서는 3차 Elliptic Gm-C Low Pass filter를 자이레이터 방식을 통해 DCR내의 Low Pass filter를 구현 하였다. 공급전압은 3.3V이고 외부에서 인가되는 튜닝전압에 의해 차단 주파수가 변화됨을 알 수 있었다. 그 결과를 통해서 레이아웃 하였으며, 설계된 회로는 COMS $0.18{\mu}m$ 설계 파라미터를 활용하여 Cadence 사의 Specter로 시뮬레이션 하였으며, Virtuso2로 레이아웃 하였다.
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[게시일 2004년 10월 1일]
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