• 한국전자통신학회논문지
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• 제9권6호
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• pp.681-687
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• 2014

원자력 산업계는 최근 원전 계측제어계통 설비의 단종과 같은 예상치 못한 환경에 직면해오고 있으며, 이러한 문제를 근본적으로 해결하고자 노력하고 있다. IAEA, IEC, 등의 연구결과에 따르면, FPGA는 단종이 예상되는 제어계통에의 대체수단으로 주목받고 있다. FPGA가 원자력 플랜트의 PLC(Programmable Logic Controller)를 대체하기 위해서는 높은 건정성과 신뢰성을 가져야 한다. 따라서, FPGA 기반 제어기의 건전성과 신뢰성을 향상시키기 위하여 HDL 개발수명주기를 적용하여 개발하였다. 또한, 원전 계측제어계통에 적용하기 위하여 번인시험과 환경시험의 기기검증이 수행되었다. 시험수행결과, 352시간의 번인시험과 92시간의 환경시험 중에 정상적인 기능 및 성능을 수행함을 확인할 수 있었다.

• 한국정보통신학회논문지
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• 제20권10호
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• pp.1949-1954
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• 2016

스마트 그리드(smart grid) 기술은 전력 공급자와 소비자 사이를 실시간으로 전력정보를 교환함으로써 전력의 효율성을 높이는 전력망 관리 기술이다. 최근에는 유지보수 및 설치가 용이한 태양광 발전시스템에 대한 적용이 늘고 있다. 그러나 태양광 발전 시스템은 고장진단이 어려우며, PV(PhotoVoltaics) 어레이 및 인버터(inverter) 등의 결함과 기타 잠재적인 출력저하 요소로 인하여 발전량이 감소하기도 한다. 이처럼 태양광 발전 시스템을 통하여 안정적인 에너지 포집과 관리 및 조속한 고장 검출이 필수 요구사항이라 할 수 있다. 본 논문에서는 태양광 발전 시스템을 대상으로 전력 생산량 및 이상 동작 현상을 모니터링하고 외부 환경을 계측하는 계측모듈을 개발하고, 계측된 정보 데이터를 전송할 수 있는 통신모듈을 통하여 원격지에서 태양광 발전 시스템의 동작 상태를 모니터링 하도록 설계하였다. 또한 스마트폰을 기반으로 구축된 태양광 발전 시스템을 실시간으로 관리하고 모니터링 할 수 있는 모바일 관리 시스템을 제시하고자 한다.

• 한국통신학회논문지
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• 제25권9B호
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• pp.1551-1562
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• 2000

국내에서 개발된 광섬유 격자{FBG)를 사용하여 국내 최초로 3종의 FBG 음향 트랜스듀서를 설계 및 제작하였다. 제작된 FBG 트랜스듀서들에 대하여 수중에서 각각 주파수응답특성 설험을 하고, 그 특성을 분석하였다. 주파수 응답특성실험 결과 C형태는 최대 18 kHz대까지 수중음파 검출이 기능하였다. 또한, 수중에서 넓은 영역에 대한 다중점 신호검출을 구현하기 위하여, 파장분활 방법과 Passive band-pass filter system을 이용하여 어레이 시스템을 구축하고 2개의 B형태 FBG 트랜스듀서에서 주파수 1.3 kHz대까지 다중점 수중 음파 신호검출을 성공하였다. 아울러, 음원의 방향과 각도에 따라 검출 신호의 세기가 변화되므로 음원의 물체에 대한 방향성 검출이 가능함으로서, 향후 FBG 하이드로폰의 실용화 연구에 새로운 기틀을 마련하였다.

• 한국정보과학회논문지:시스템및이론
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• 제31권8호
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• pp.453-464
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• 2004

In order to solve the well-known drawback of reduced flexibility that is associate with ASIC implementations, this paper proposes a novel arithmetic unit over GF(2$^{m}$ ) for field programmable gate arrays (FPGAs) implementations of elliptic curve cryptographic processor. The proposed arithmetic unit is based on the binary extended GCD algorithm and the MSB-first multiplication scheme, and designed as systolic architecture to remove global signals broadcasting. The proposed architecture can perform both division and multiplication in GF(2$^{m}$ ). In other word, when input data come in continuously, it produces division results at a rate of one per m clock cycles after an initial delay of 5m-2 in division mode and multiplication results at a rate of one per m clock cycles after an initial delay of 3m in multiplication mode respectively. Analysis shows that while previously proposed dividers have area complexity of Ο(m$^2$) or Ο(mㆍ(log$_2$$^{m}$ )), the Proposed architecture has area complexity of Ο(m), In addition, the proposed architecture has significantly less computational delay time compared with the divider which has area complexity of Ο(mㆍ(log$_2$$^{m}$ )). FPGA implementation results of the proposed arithmetic unit, in which Altera's EP2A70F1508C-7 was used as the target device, show that it ran at maximum 121MHz and utilized 52% of the chip area in GF(2$^{571}$ ). Therefore, when elliptic curve cryptographic processor is implemented on FPGAs, the proposed arithmetic unit is well suited for both division and multiplication circuit.

• 전력전자학회논문지
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• 제19권4호
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• pp.364-375
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• 2014

Parametric array transducers are used for long-range and highly directional communication in an underwater environments. The power amplifiers for parametric array transducers should have sufficient linear output characteristic and high efficiency to avoid communication errors, system heating, and fuel problems. But the conventional power amplifier with fixed source voltage is very low efficient due to large power loss by the big difference between the fixed source voltage and the amplifier output voltage. Thus to solve the problems this paper proposes the high efficiency power amplifier for parametric array transducers. The proposed power amplifier ensures high linearity of output characteristic by utilizing the push-pull class B type amplifier and furthermore gets high efficiency by applying the envelope tracking technique that variable source voltage tracks the envelope of the amplified signal. Also the paper suggests the detailed circuit topology and design guideline of class B push-pull type amplifier and variable output voltage AC/DC converter. Its characteristics are verified by the detailed simulation and experimental results.

• 방송공학회논문지
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• 제24권4호
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• pp.660-669
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• 2019

최근 3차원 스캐닝 장비 및 다차원 어레이 카메라의 발달로 AR(Augmented Reality)/VR(Virtual Reality), 자율 주행과 같은 응용분야에서 3차원 데이터를 다루는 기술에 관한 연구가 지속해서 이루어지고 있다. 특히, AR/VR 분야에서는 3차원 영상을 포인트 데이터로 표현하는 콘텐츠가 등장하였으나, 이는 기존의 2차원 영상보다 많은 양의 데이터가 필요하다. 따라서 3차원 포인트 클라우드 콘텐츠를 사용자에게 서비스하기 위해서는 고효율의 부호화/복호화와 저장 및 전송과 같은 다양한 기술 개발이 요구된다. 본 논문에서는 MPEG-I(MPEG-Immersive) V-PCC(Video based Point Cloud Compression) 그룹에서 제안한 V-PCC 부호화기를 통해 생성된 V-PCC 비트스트림을 MPEG-DASH(Dynamic Adaptive Streaming over HTTP) 표준에서 정의한 세그먼트로 구성하는 방안을 제안한다. 또한, 사용자에게 3차원 좌표계 정보를 제공하기 위해 시그널링 메시지에 깊이 정보 파라미터를 추가로 정의한다. 그리고 본 논문에서 제안된 기술을 검증하기 위한 검증 플랫폼을 설계하고, 제안한 기술의 알고리듬 측면에서 확인한다.

• 한국음향학회지
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• 제38권2호
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• pp.145-153
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• 2019

적응빔형성 기법은 부엽을 줄이고 약한 신호에 대한 탐지 성능을 향상시킨다. MVDR(Minimum Variance Distortionless Response)과 같은 일반적인 적응빔형성 기법은 설계한 가중벡터와 실제 입사신호의 조향벡터의 불일치에 대해 매우 민감하다. 또한 센서 수가 많은 어레이를 이용하여 광대역 적응빔형성을 할 경우 공분산행렬을 산출하기 위해 긴 관측시간과 많은 연산량이 요구된다. 본 논문은 센서 수가 많은 수동 선배열 소나의 광대역 적응빔형성 성능향상 및 안정성을 위해 WBRCB(Wideband Robust Capon Beamforming)를 적용하였다. 불일치 요소에 강인한 WBRCB 구현을 위해 다양한 불일치 요소를 반영하여 최적의 불일치 파라미터를 도출하였다. 도출된 파라미터를 반영한 WBRCB 기법을 시뮬레이션 및 실험데이터에 적용하여 수동 선배열 소나의 광대역 적응빔형성 성능 향상을 검증하였다.

• 한국정보통신학회논문지
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• 제24권7호
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• pp.879-884
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• 2020

기존의 비디오 파일 시스템에서는 비디오 파일들이 대용량의 하드디스크 혹은 디스크 어레이를 보유한 고성능 서버에 저장되어 있다. 3D 인터넷 방송을 위해서는 비디오 파일을 다수의 클라이언트들에게 전송하는 과정에서 실시간 처리가 요구된다. 본 논문에서는 5G 환경에서 많은 사용자에게 실시간으로 서비스를 제공할 수 있는 3D 인터넷 방송 시스템의 설계를 보여준다. IP 멀티캐스트 기술은 라우터 환경의 제약으로 인하여 실제 대부분의 인터넷을 통한 동영상 콘텐츠 전송은 유니캐스트 기반의 서비스가 대부분이다. 또한 VOD와 같은 On-Demand 환경의 멀티미디어 방송 서비스 등은 서비스 제공자에게 막대한 시스템과 네트워크 자원을 요구하므로 3D 인터넷 방송 환경에 적용하기 어렵다. 사용자 시스템 자원을 통한 전송 방법으로서 활발히 연구가 진행되고 있는 오버레이 멀티캐스트 기법은 라이브 방송, 화상회의 등의 다수의 사용자 그룹 전송에 적합한 응용을 위해 최적화 되어 있어 IP 멀티캐스트 대안으로서 각광 받고 있다. 본 연구에서는 호스트 기반 멀티캐스트에서 발생하는 성능 저하 요인들을 최소화하여 효율적인 데이터 전송을 제공하는 3D 인터넷 방송 시스템을 구성한다.

• 한국산학기술학회논문지
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• 제13권11호
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• pp.5452-5457
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• 2012

태양전지를 실제적인 건물의 한 구성요소로 이용하는 건물일체형 태양광발전(BIPV : Building Integrated Photovoltaic) 시스템은 기존의 건물재료를 대체하여 재료비용 및 건설비용의 절감효과를 가져다주며 건물의 미적인 가치를 높여주는 장점을 가지고 있다. BIPV에 대한 연구가 유럽 및 미국, 일본 등의 나라에서 오래전부터 활발히 수행되고 있으며, 시장성 또한 무한 확대되고 있다. 아치형 PV 시스템은 PV 어레이의 직병렬 연결 상태 및 아치각에 따라 효율 특성이 상이하지만 이에 관한 분석은 미흡하며, 아치형 PV 시스템을 설계함에 있어서 미적인 요소만 고려하고 이러한 발전효율에 관한 요소는 전혀 고려되지 않은 채 설계되고 있다. 본 논문에서는 아치형 PV 시스템의 효율에 관한 파라미터인 위도와 경도, 온도 및 일사량, 아치각, 시스템 구성에 따른 각종 손실 등 이에 대한 세부적인 기술검토와 각 장비들의 특성을 정합시켜 아치형 PV 시스템의 최적화를 이루어 효율을 개선시키고자 한다. 아치형 PV 시스템의 효율개선을 위하여 다중제어 인버터 방식을 제안하고 시뮬레이션 툴인 Solar Pro를 이용하여 평판형 및 다양한 아치형 PV 시스템을 구성하여 운전특성을 비교 분석하였다.

• 한국정보전자통신기술학회논문지
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• 제13권1호
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• pp.64-71
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• 2020

전력 반도체 소자의 게이트 구동 칩의 아날로그 회로를 트리밍하기 위해서는 eFuse OTP IP가 필요하다. 기존의 NMOS 다이오드 형태의 eFuse OTP 셀은 셀 사이즈가 작은 반면 DNW(Deep N-Well) 마스크가 한 장 더 필요로 하는 단점이 있다. 본 논문에서는 CMOS 공정에서 추가 공정이 필요 없으면서 셀 사이즈가 작은 PMOS-다이오드 형태의 eFuse OTP 셀을 제안하였다. 본 논문에서 제안된 PMOS-다이오드 형태의 eFuse OTP 셀은 N-WELL 안에 형성된 PMOS 트랜지스터와 기억소자인 eFuse 링크로 구성되어 있으며, PMOS 트랜지스터에서 기생적으로 만들어지는 pn 접합 다이오드를 이용하였다. 그리고 PMOS-다이오드 형태의 eFuse 셀 어레이를 구동하기 위한 코어 구동회로를 제안하였으며, SPICE 모의실험 결과 제안된 코어 회로를 사용하여 61㏀의 post-program 저항을 센싱하였다. 한편 0.13㎛ BCD 공정을 이용하여 설계된 PMOS-다이오드 형태의 eFuse OTP 셀과 512b eFuse OTP IP의 레이아웃 사이즈는 각각 3.475㎛ × 4.21㎛ (=14.62975㎛2)과 119.315㎛ × 341.95㎛ (=0.0408㎟)이며, 웨이퍼 레벨에서 테스트한 결과 정상적으로 프로그램 되는 것을 확인하였다.