• 제목/요약/키워드: 반도체 패키지

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시뮬레이션 모델을 이용한 K회사 반도체 패키지 공정의 생산량 증가를 위한 연구 (A Study on Throughput Increase in Semiconductor Package Process of K Manufacturing Company Using a Simulation Model)

  • 채종인;박양병
    • 한국시뮬레이션학회논문지
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    • 제19권1호
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    • pp.1-11
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    • 2010
  • K 회사는 국내외 반도체 제조업체의 주문에 의해 반도체 패키지 제품을 생산 공급하는 기업이다. 생산 공정은 Die Sawing, 조립, 테스트로 구성된 기계중심의 조립라인 형태를 따르고 있다. 본 논문은 K 회사의 공정분석을 토대로 패키지 공정의 생산량을 늘리기 위한 3가지 방안을 제안하고, 이들을 실제 자료를 이용한 시뮬레이션 모델을 통해 평가하는 사례연구를 다룬다. 3가지 방안은 병목공정에 기계 추가에 의한 라인균형, 제품의 그룹 스케쥴링, 비병목공정에서 작업자의 재배치이다. 시뮬레이션 평가결과, 3가지 방안을 혼합 적용하는 경우에 2.8%의 납기위반율 감소 효과와 함께 17.3%의 가장 높은 일일 생산량 증가를 보여 주는 것으로 나타났다. 3가지 방안의 혼합 적용하는 경우의 투자회수기간은 1.37년으로 매우 짧게 구해졌다.

ESG를 위한 반도체 패키지 기술 트렌드 (Technology Trends of Semiconductor Package for ESG )

  • 서민석
    • 마이크로전자및패키징학회지
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    • 제30권3호
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    • pp.35-39
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    • 2023
  • ESG는 많은 기업에게 기업 가치를 향상시키고, 지속 경영이 가능하게 하는 큰 지침이 되고 있다. 그 중에서도 환경(Environment)은 기술적 관점의 접근이 필요하다. 환경 오염을 줄이거나 방지하고, 에너지를 절감하는 것은 기술적인 해법이 필요하기 때문이다. 반도체 패키지 기술은 반도체 패키지의 본연의 역할인 칩의 보호, 전기/기계적 연결, 열 방출 등을 잘 하기 위해 개발 및 발전해 왔는데, 이에 따라 열 방출 효과 향상, 전기적/기계적 특성 향상, 칩을 보호하는 신뢰성 향상, 적층 및 소형화, 그러면서 비용절감을 위한 기술들이 개발되고 발전해 왔다. 그 중에서도 열 방출 기술은 열효율을 높이고, 냉각을 위한 에너지 소모를 작게 하며, 전기적 특성 향상 기술도 저전력 사용과 에너지 소모를 줄이는 효과를 만들어서 환경에도 영향을 주었다. 또한 재사용이나 재료 소모를 줄이는 기술은 환경 오염을 줄이게 되며, 특히 환경에 유해한 물질들에 대해 대체하는 기술들은 환경 개선에 기여하게 된다. 본 논문에서는 이러한 환경 오염 방지 및 개선을 위한 반도체 패키지 기술들의 트렌드를 정리하였다.

적응적 다중 이진화에 의한 IC 패키지 및 Pin1 딤플 검출 (IC Package Location and Pin1 Dimple Extraction Using Adaptive Multiple Thresholding)

  • 김민기
    • 한국정보과학회:학술대회논문집
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    • 한국정보과학회 2001년도 가을 학술발표논문집 Vol.28 No.2 (2)
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    • pp.361-363
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    • 2001
  • 반도체 패키지의 마킹검사(marking inspection)를 위해서는 입력 영상으로부터 검사할 패키지의 정확만 위치 검출과 패키지 윗면에 나타난 제작사 로고, 문자, Pin1 딤플의 추출이 필수적이다. 본 연구는 마킹검사를 위한 선행 연구로 마킹검사를 수행할 때, 검사할 IC 패키지의 위치와 방향을 정확하게 검출하는 것을 목적으로 하고 있다. IC 패키지의 외곽을 구성하는 리드의 명도 값은 트레이의 명도 값과 큰 차이를 나타낸다. 그러나 IC 패키지의 방향을 나타내는 Pin1 딤플은 배경과 동일한 색상으로 다만 약간 오목하게 들어가서 명도 값의 차이가 미세하다. 이러한 두 가지 상이한 특징을 효과적으로 처리하기 위하여 적응적 다중 이진화 방법을 제시하였다. 76개의 명도 영상에 대한 실험 결과 제안된 이진화 방법은 매우 효과적이었으며, 이진화된 영상으로부터 IC 패키지의 정확한 위치 검출과 방향 확인이 가능하였다.

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반도체 패키지의 굽힘변형 측정을 위한 그림자 무아레의 감도향상 기법연구 (Sensitivity Enhancement of Shadow Moiré Technique for Warpage Measurement of Electronic Packages)

  • 이동선;주진원
    • 마이크로전자및패키징학회지
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    • 제22권3호
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    • pp.57-65
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    • 2015
  • 반도체 패키지는 여러 가지 다양한 재료로 구성되어 있으며, 제조시나 사용 환경에서 온도가 변하면 각 재료의 열팽창 계수의 차이로 인하여 굽힘변형이 발생하게 된다. 그림자 무아레 방법은 비접촉으로 전체 영역에 걸친 면외변위를 측정하는 광학적 방법이지만 측정 감도가 $50{\mu}m/fringe$ 이상이어서 반도체 패키지의 굽힘변형을 측정하기에는 적당하지 않은 면이 있었다. 본 논문에서는 그림자 무아레 시스템에 위상이동 기법을 적용하여 $12.5{\mu}m/fringe$의 향상된 감도를 갖는 측정장치를 구성하였다. 그림자 무아레 측정에서 나타나는 탈봇 현상을 고려하여 1/2 탈봇 영역에서 변형을 측정할 수 있도록 실험을 수행하였다. 위상이동에 의해 기록되는 4장의 그림자 무늬를 영상처리하여 감도가 4배 향상된 그림자 무늬를 얻어내었다. 본 논문에서 개발한 측정방법을 기존의 섬유강화 패키지 기판과 무섬유 패키지 기판에 적용하여 상온과 약 $100^{\circ}C$의 환경에서 발생하는 굽힘변형을 측정하였다.

초미세 범프 측정 시스템 개발을 위한 사전 기술 분석 (An Preliminary Technical Analysis of Developing Micro Bump Inspection System)

  • 유성근;송민정;박상일;조성만;전소연;전지혜;김희태;명찬규;박구만
    • 한국방송∙미디어공학회:학술대회논문집
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    • 한국방송∙미디어공학회 2017년도 추계학술대회
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    • pp.144-145
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    • 2017
  • 최근 전자 기기의 크기가 줄어들고 PCB의 사이즈와 반도체 패키지의 크기가 소형화되어 플립 칩 본딩(Flip chip bonding) 기술을 적용한 반도체 패키지 방식이 점점 늘어나고 있다. 이에 따라 PCB와 반도체 칩 사이를 연결하기 위해 응용되던 BGA(Ball Grid Array)에 핀 배열 대신 사용되는 범프(Bump)를 50um 이내의 초미세 범프로 만들어 일정한 배열을 유지하는 것이 중요하다. 또한 초미세 범프의 모양과 품질이 패키지 수율과 밀접하게 연관되기 때문에 이를 검사할 수 있는 기술이 필수적이다. 이에 본 논문은 초미세 범프측정을 할 수 있는 시스템 개발을 위한 측정 대상의 특징과 사용할 수 있는 광학계를 분석하였고, 획득된 영상을 가지고 딥러닝을 적용하여 정확하게 불량여부를 판별할 수 있는 초미세 범프 측정 시스템을 고안하였다.

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레이저 스페클 간섭법을 이용한 반도체 패키지의 비파괴검사 (Non-destructive Inspection of Semiconductor Package by Laser Speckle Interferometry)

  • 김경석;양광영;강기수;최정구;이항서
    • 비파괴검사학회지
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    • 제25권2호
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    • pp.81-86
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    • 2005
  • 본 논문에서는 반도체 패키지 내부결함의 비파괴 정량평가를 위한 ESPI 기법을 이용한 시스템 및 검사기 법을 제안하고 있으며, 검사시스템은 ESPI 검사장치, 열변형유도장치, 단열챔버로 구성되어있다. 기존 초음파, X-ray 기반의 검사기법에 비하여 측정시간 및 검사방법이 용이하며, 결함의 정량검출이 가능하다는 장점이 있다. 검사결과에서 대부분의 결함이 열 방출이 많은 칩 주위에서 박리결함으로 나타났으며, 원인은 층간 접착강도의 약화와 열분배 설계에서 문제점인 것으로 사료된다.