• JSTS:Journal of Semiconductor Technology and Science
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• 제13권2호
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• pp.152-156
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• 2013

This paper presents a fast-lock dual-loop successive approximation register-controlled duty-cycle corrector (SARDCC) circuit using a mixed (binary+sequential) search algorithm. A wider duty-cycle correction range, higher operating frequency, and higher duty-cycle correction accuracy have been achieved by utilizing the dual-loop architecture and the binary search SAR that achieves the fast duty-cycle correcting property. By transforming the binary search SAR into a sequential search counter after the first DCC lock-in, the proposed dual-loop SARDCC keeps the closed-loop characteristic and tracks variations in process, voltage, and temperature (PVT). The measured duty cycle error is less than ${\pm}0.86%$ for a wide input duty-cycle range of 15-85 % over a wide frequency range of 0.5-2.0 GHz. The proposed dual-loop SARDCC is fabricated in a 0.18-${\mu}m$, 1.8-V CMOS process and occupies an active area of $0.075mm^2$.

• 센서학회지
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• 제30권4호
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• pp.223-228
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• 2021

This work presents a low-power CMOS image sensor (CIS) with a multi-column-parallel (MCP) readout structure while focusing on improving its performance compared to previous works. A delta readout scheme that utilizes the image characteristics is optimized for the MCP readout structure. By simply alternating the MCP readout direction for each row selection, additional memory for the row-to-row delta readout is not required, resulting in a reduced area of occupation compared to the previous work. In addition, the bias current of a pre-amplifier in a successive approximate register (SAR) analog-to-digital converter (ADC) changes according to the operating period to improve the power efficiency. The prototype CIS chip was fabricated using a 0.18-㎛ CMOS process. A 160 × 120 pixel array with 4.4 ㎛ pitch was implemented with a 10-bit SAR ADC. The prototype CIS demonstrated a frame rate of 120 fps with a total power consumption of 1.92 mW.

• 한국지구과학회지
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• 제32권1호
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• pp.84-98
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• 2011

이 연구에서는 장르 분석 및 레지스터 분석을 통해 중학생들의 지구과학 주제 글쓰기의 언어적 특징을 분석하였다. 연구 자료는 7, 9학년 학생들을 대상으로 '지구 온난화'와 '암석의 분류' 주제 글쓰기를 실시하여 얻은 학생들의 글쓰기를 대상으로 하였다. 연구 결과는 다음과 같다. 첫째, 학생들은 장르별 글쓰기에 익숙하지 않았으며 특히 논설장르 글쓰기에 많은 어려움을 보였다. 둘째, 내용과 논리관계의 특징으로 정의나 분류와 같이 한 부분을 다른 부분과 관련시키는 관계적 술어보다는 행동 및 하는 것을 의미하는 현상적 술어와 부가적 논리 관계가 많이 나타났다. 셋째, 상호관계적 표현의 특징으로 글 속에서 글의 주체, 글쓴이의 감정, 주관적 의견들이 많이 드러났으며, 학생들은 자신의 생각에 대해서 확신을 가지지 못하고 불확실성을 드러내었다. 넷째, 텍스트 구성의 특징으로 대부분의 학생들이 부가 접속사를 통해 단편적인 정보들을 나열하였으며, 체계적이며 논리적인 글을 쓰는데 익숙하지 않았다. 연구 결과를 바탕으로 과학적 소양의 함양을 목표로 하는 과학 학습에서 과학 글쓰기가 강조되어야 하며 국가 교육과정차원에서 체계적인 계획뿐만 아니라 과학 글쓰기에 대한 교사들의 인식이 향상되어야 함을 논의하였다.

• 대한전자공학회논문지SD
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• 제38권8호
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• pp.54-61
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• 2001

High-bandwidth DRAM을 위해 1Gb/s의 데이터 전송률까지 동작하고 그 출력 전압 스윙이 온도와 전원 전압(VDD) 변동에 무관한 CMOS open-drain 출력 구조 회로를 설계하였다. 출력 구동 회로는 여섯 개의 binary-weighted NMOS 트랜지스터로 구성되는데, 이 여섯 개 중에서 ON시킬 current control register의 내용은 추가 호로 없이 DRAM 칩에 존재하는 auto refresh 신호를 이용하여 새롭게 수정하였다. Auto refresh 시간 구간동안 current control register를 수정하는데, 이 시간 구간동안 부궤환 (negative feedback) 동작에 의해 low level 출력 전압($V_OL$)이 저전압 밴드갭 기준전압 발생기(bandgap reference voltage generator)에 의해서 만들어진 기준전압($V_{OL.ref}$)과도 같도록 유지된다. 테스트 칩은 1Gb/s의 데이터 전송률까지 성공적으로 동작하였다. 온도 $20^{\circ}C$~$90^{\circ}C$, 전원 전압 2.25V~2.75V영역에서 최악의 경우 제안된 출력 구동 회로의 $V_{OL.ref}$와 $V_OL$의 변동은 각각 2.5%와 725%로 측정된 반면, 기존의 출력 구동 회로의 $V_OL$의 변동은 같은 온도의 전원 접압의 영역에 대해 24%로 측정되었다.

• 한국화재소방학회논문지
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• 제29권6호
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• pp.57-64
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• 2015

육상 및 해상에서 일어나는 화재를 진압하기 위한 가스계 소화설비 중 이산화탄소 소화설비는 우수한 성능 및 높은 경제성으로 인하여 널리 사용되고 있지만, 고농도 이산화탄소로 인한 질식사고가 빈번히 발생하여 안전문제가 항상 지적되어 왔다. 본 연구에서는 수치해석을 통하여 선박 내 압축기실의 이산화탄소 소화설비 화재 진압 특성을 예측하고, 이산화탄소 소화설비로 인한 질식사고를 방지하기 위한 2중 안전 제어기법을 제시하여, 이산화탄소 소화설비의 안전을 도모하였다. 수치해석 결과로는 4가지 시나리오를 선정하여, 화재발생 후 이산화탄소 소화설비 작동으로 인한 열발생률 변화, 온도변화, 이산화탄소 농도변화, 산소 농도변화 및 화재진압 특성을 고찰하였으며, 방호구역 내 환기팬 용량이 충분하지 않은 경우의 위험성 및 적절한 환기시스템의 필요성을 제시하였다.

• 한국전자파학회논문지
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• 제12권6호
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• pp.994-1001
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• 2001

본 논문에서는 이동 통신 시스템에서의 PIC기법으로 간섭을 제거하여 개선된 SIR을 기반으로 하는 전력 제어 방식을 제안한다. 일반적으로 전력 제어는 SIR을 기반으로 하는 방식이 사용되고 있다. 그러나 이 방식은 시스템의 안정성을 떨어뜨리는 Positive Feedback 현상을 발생시킨다. 따라서 제안된 전력 제어 기법은 SIR의 변수인 간섭신호를 감소시켜 개선된 SIR을 기반으로 하는 전력제어를 수행하여 시스템의 안정화를 도모하였다. 또한 이동국에서 기존의 Up-Down전력 명령대신 Up-Maintain-Down기법을 이용하여 성능을 향상시켰다. 새로운 전력 제어 기법인 개선된 SIR방식과 기존의 방식을 모의 실험을 통하여 비교, 제안된 시스템의 성능 개선을 확인했다.

• International Journal of Naval Architecture and Ocean Engineering
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• 제11권1호
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• pp.52-58
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• 2019

Marine emissions of Volatile Organic Compounds (VOCs) have received much attention because the International Maritime Organization (IMO) requires the installation of vapour emission control systems for the loading of crude oils or petroleum products onto ships. It was recently recognised that significant corrosion occurs inside these vapour emission control systems, which can cause severe clogging issues. In this study, we analysed the chemical composition of drain water sampled from currently operating systems to investigate the primary causes of corrosion in vapour recovery systems. Immersion and electrochemical tests were conducted under simulated conditions with various real drain water samples, and the impact of corrosion on the marine vapour recovery system was carefully investigated. Moreover, corrosion tests on alternative materials were conducted to begin identifying appropriate substitutes. Thermodynamic calculations showed the effects of environmental factors on the production of condensed sulphuric acid from VOC gas. A model of sulphuric acid formation and accumulation by the characteristics of VOC from crude oil and flue gas is suggested.

• 한국전자통신학회논문지
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• 제6권2호
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• pp.256-261
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• 2011

본 논문에서는 친환경 하이브리드 자동차의 핵심부품중 배터리 전압을 모니터하는 CVM(Cell Voltage Monitoring) 동작에서 모니터링된 배터리 전압을 디지털 데이터로 변환시키는 A/D (Analog to Digital) 컨버터의 설계 및 제작결과를 소개한다. CVM에 적정한 A/D컨버터는 중속동작 및 고분해능의 동작이 필요하여, SAR(Successive Approximate Register) typed A/D 컨버터 사용을 제안하였고, Magna 0.6um 40V 공정을 이용하여 10bits 분해능을 갖도록 설계 및 제작하였으며, 측정결과 FSR(Full Scale Range) 5V 전구간에서 ${\pm}1$ LSB Accuracy의 선형성을 확보하여, CVM 구현에 유용함을 나타내었다.

• 전기전자학회논문지
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• 제19권3호
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• pp.455-459
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• 2015

본 논문은 그래픽 처리 뿐 만 아니라 범용 연산의 가속화를 지원하기 위한 SIMT 구조 GP-GPU의 Dispatch Unit과 Operand Selection Unit을 제안한다. Warp Scheduler로부터 발행된 명령어에서 사용되는 Operand의 모든 정보를 Decoding 하면 불필요한 Operand Load가 발생하여 레지스터 부하가 발생 한다. 이러한 문제점을 해결하기 위해 Pre-decoding방법을 사용하여 Operand의 정보만을 먼저 Decoding 하여 Operand Load를 줄이고, 레지스터의 부하를 줄일 수 있는 방법을 제안한다. 제안하는 Dispatch Unit에서 나온 Operand 정보들을 레지스터 뱅크 충돌을 방지하는 방법을 적용한 Operand Selection Unit에 전달해 전체적인 처리 성능을 향상 시켰다. Modelsim 10.0b를 이용하여 Warp Scheduler로부터 발행된 10,000개의 임의의 명령어를 처리하여 소요되는 총 Clock Cycle을 측정하였다. 본 논문에서 제안한 Pre-Decoding 기능을 탑재한 Dispatch Unit과 Operand Selection Unit을 적용하여 기존의 방법들 보다 각각 약 11%, 24%의 처리 효율이 증가한 것을 확인 할 수 있었다.

• 방송공학회논문지
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• 제11권3호
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• pp.326-335
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• 2006

본 논문에서는 직교 주파수분할다중화(orthogonal frequency division multiplexing; OFDM)의 변조된 신호열에서 항상 최소화된 첨두전력 대 평균전력비(peak-to-average power ratio; PAPR)를 보장할 수 있는 블록부호가 제안된다. 제안된 최소 PAPR 부호(minimum PAPR code; MPC) 부호화 과정은 씨앗부호어(seed codeword) 검색, 레지스터 요소의 순회천이(circular shifting), 그리고 비트반전(bit inversion)으로 이루어진다. 시간영역 전송신호열의 첨두 포락선전력(peak envelope power; PEP)이 레지스터에 저장된 부호어의 순회천이와 부호의 비트반전에 대하여 변화되지 않음을 보였다. 이러한 성질에 기반하여 체계적인 MPC 부호화 규칙이 제안되었다. 제안된 부호 규칙으로 MPC 부호화를 위한 조견표(look-up table)의 크기를 대폭 감소시킬 수 있다.