A large residual fraction of aliphatic components of diesel prevails in soil, which has adverse effects on the environment. This study identified the most bio-recalcitrant aliphatic residual fraction of diesel through total petroleum-hydrocarbon fractional analysis. For this, the strain Acinetobacter sp. K-6 was isolated, identified, and characterized and investigated its ability to degrade diesel and n-alkanes (C18, C20, and C22). The removal efficiency was analysed after treatment with bacteria and nutrients in various soil microcosms. The fractional analysis of diesel degradation after treatment with the bacterial strains identified C18-C22 hydrocarbons as the most bio-recalcitrant aliphatic fraction of diesel oil. Acinetobacter sp. K-6 degraded 59.2% of diesel oil and 56.4% of C18-C22 hydrocarbons in the contaminated soil. The degradation efficiency was further improved using a combinatorial approach of biostimulation and bioaugmentation, which resulted in 76.7% and 73.7% higher degradation of diesel oil and C18-C22 hydrocarbons, respectively. The findings of this study suggest that the removal of mid-length, non-volatile hydrocarbons is affected by the population of bio-degraders and the nutrients used in the process of remediation. A combinatorial approach, including biostimulation and bioaugmentation, could be used to effectively remove large quantities of aliphatic hydrocarbons persisting for a longer period in the soil.
본 논문은 2.4 GHz 대역의 IoT용 주파수합성기를 위한 이중-루프 구성의 서브-샘플링 디지털 PLL을 소개한다. PLL은 초기에 주파수 분주기를 사용하는 coarse locking을 수행하며, 이 후 최종적으로는 주파수 분주기를 사용하지 않는 서브-샘플링 방식의 fine locking loop로 스위칭하게 된다. DTC를 사용하여 양자화 에러 제거를 수행하며 이를 통해 특정 타이밍 범위를 갖는 고해상도 TDC를 사용함으로써 낮은 인-밴드 위상잡음 특성을 가질 수 있다. 본 논문에서는 또한 coarse loop와 fine loop간의 위상 오프셋을 제거하기 위한 보정 회로를 제안하였다. Coarse locking이 진행되는 동안 fine loop의 위상 에러를 예측하고, 이를 다시 coarse loop에 보상함으로써 빠른 락킹 타임과 안정적인 동작을 확보하였다. 회로는 SystemVerilog 및 Verilog 언어로 모델링 및 Register-Transfer Level (RTL) 수준으로 설계 되었으며 시뮬레이션을 통해 충분히 그 동작이 검증되었다.
IEEE 802.11n 표준에 제시된 3가지 블록길이(648, 1294, 1944)와 4가지 부호율(1/2, 2/3, 3/4, 5/6)을 지원하는 다중모드 LDPC(Low Density Parity Check) 복호기의 성능을 분석하였다. 최소합 알고 리듬과 layered 복호방식이 적용된 LDPC 복호기의 고정소수점(fixed-point) 시뮬레이션 모델을 Matlab으로 개발하였다. 고정소수점 시뮬레이션을 통해 복호기 내부 비트 수와 정수부 및 소수부의 비트 수에 따른 복호 수렴속도를 분석하여 다중모드 LDPC 복호기의 하드웨어 구현을 위한 최적의 설계조건을 탐색하였으며, 블록길이와 부호율에 따른 복호성능을 분석하였다.
IEEE 802.11n 표준에 제시된 3가지 블록길이(648, 1296, 1944)와 4가지 부호율(1/2, 2/3, 3/4, 5/6)을 지원하는 다중모드 LDPC(low density parity check) 복호기의 최적 설계조건을 분석하였다. 최소합 알고리듬과 layered 복호방식이 적용된 LDPC 복호기의 고정소수점(fixed-point) 시뮬레이션 모델을 Matlab으로 개발하였다. 고정소수점 시뮬레이션을 통해 복호기 내부 비트 폭, 정수 부분과 소수 부분의 비트 폭에 따른 복호 수렴속도를 분석하여 다중모드 LDPC 복호기의 하드웨어 구현을 위한 최적의 설계조건을 탐색하였으며, 블록길이와 부호율에 따른 복호성능을 분석하였다.
확산 텐서 영상을 이용하여 뇌경색 환자의 손상된 백질 섬유를 시각화할 수 있게 되었다. 본 연구의 목적은 뇌경색 환자에서 NIHSS와 분할 비등방도의 상관을 평가하고자 하였다. MR 확산영상에서 뇌경색이 확인된 16명(남:11, 여:5, 평균연령 61세) 환자를 대상으로 24방향 DTI를 시행하였다. 뇌경색 발발 후 2주 이내에 증상이 개선된 환자 9명과 증세가 악화된 환자 7명으로 구분하였다. FA값의 정량측정을 위해 병소와 병소 반대측이 통계적으로 유의한 차이가 있음을 확인하였다. 확산강조영상에서는 병소가 고신호로 보였으나, FA값은 정상측 보다 낮게 측정되었다. NIHSS상의 임상증상이 개선된 환자들의 FA값은 0.41, 반대측 정상부는 0.49로 병소측이 15%정도 낮게 측정되었다. 그러나 NIHSS상 증상이 악화된 환자들의 경우 병소측 FA값이 0.28, 반대측 정상부는 0.56으로 큰 차이를 보였다. 결론적으로 DTI에서의 FA값은 뇌경색 환자의 예후를 평가하는데 매우 유용한 지표로 이용될 수 있을 것이다.
트란스-1,2-비스피라질에틸렌(BPE)과 테트라메틸에틸렌(TME)용액에 빛을 쪼이면 이에대응한 탄화수소와는 달리 자유라디칼중간체를 거쳐 광첨가반응이 일어난다. 이 광첨가반응은 BPE의 $^1(n,\;{\pi}^*)$ 상태가 어느정도 자유라디칼 성격을 띄어 TME로 부터 알릴위치에 있는 수소원자를 탈취하여 일어난다. 주생성물을 대롱 크로마토그래피와 진공분별승화법으로 분리하여 2,3-디메틸-5,6-비스피라질-2-헥센임을 밝혔다.
JSTS:Journal of Semiconductor Technology and Science
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제12권1호
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pp.10-17
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2012
This paper presents a clock regenerator using two $2^{nd}$ order ${\sum}-{\Delta}$ (sigma-delta) modulators for wide range of dividing ratio as defined in HDMI standard. The proposed circuit adopts a fractional-N frequency synthesis architecture for PLL-based clock regeneration. By converting the integer and decimal part of the N and CTS values in HDMI format and processing separately at two different ${\sum}-{\Delta}$ modulators, the proposed circuit covers a very wide range of the dividing ratio as HDMI standard. The circuit is fabricated using 0.18 ${\mu}m$ CMOS and shows 13 mW power consumption with an on-chip loop filter implementation.
Let $S_o*({\alpha},{\beta},{\mu})$ denote the class of functions $f(z)=a_1z-{\sum}{\limit}^{\infty}_{n=2}\;a_nz^n$ analytic in the unit disc $U=\{z:{\mid}z{\mid}<1\}$ and satisfying the condition $${\mid}\frac{\frac{zf'(z)}{f(z)}-1}{(1+\mu)\;\beta(\frac{zf'(z)}{f(z)}-\alpha)-(\frac{zf'(z)}{f(z)}-1)}\mid<1$$ for some $\alpha(0{\leq}{\alpha}<1),\;{\beta}(0<{\beta}{\leq}1),\;{\mu}(0{\leq}{\mu}{\leq}1)$ and for all $z{\in}U$. And it is the purpose of this paper to show a necessary and sufficient condition for the class $S_o*({\alpha},{\beta},{\mu})$, some results for the Hadamard products of two functions f(z) and g(z) in the class $S_o*({\alpha},{\beta},{\mu})$, the distortion theorem and the distortion theorems for the fractional calculus.
안티-하모닉락 기능을 가지는 고속-락킹 MDLL 기반의 디지털 클락 주파수 증배기를 소개한다. 제안하는 디지털 주파수 증배기는 하모닉락 문제 없이 빠른 락킹 시간을 구현하기 위하여 새로운 MSB-구간 검색 알고리즘을 사용한다. 제안하는 디지털 MDLL 주파수 증배기는 65nm CMOS 공정으로 설계되었으며, 1 GHz ~ 3 GHz의 출력 동작주파수 영역을 가진다. 제안하는 디지털 MDLL은 프로그래머블한 N/M (N=1, 4, 5, 8, 10, M=1, 2, 3)의 분수배 주파수 증배 기능을 제공한다. 제안하는 MDLL은 1GHz에서 3.52 mW의 전력을 소모하고, 14.07 ps의 피크-투-피크 (p-p) 지터를 갖는다.
본 논문에서는 Peano curve의 가장자리에 인덕터를 집적한 주파수 가변 소형 metamaterial 안테나를 제안하였다. 제안된 안테나는 1차 Peano curve 평면과 그라운드 평면으로 구성되며, 이 두 평면은 두 개의 단락 post로 연결되어 있다. 이 단락 post와 Peano curve 사이에는 인덕터가 부착되어 있다. 두 인덕터의 inductance를 적절히 선택하여 입력 임피던스 대역폭의 감소 없이 안테나의 동작 주파수를 조절할 수 있다. 안테나의 동작 원리를 설명하기 위해 안테나의 등가 회로를 제시했다. 시뮬레이션 결과를 검증하기 위해 몇 가지 다른 인덕터가 부착된 안테나를 제작했으며, 측정 결과는 시뮬레이션 결과와 매우 잘 일치한다. 인턱터 값 조합에 따라 입력 임피던스의 감소 없이 동작 주파수가 1.47 GHz에서 0.586 GHz로 변함이 측정되었다. 91 nH와 470 nH의 두 인덕터를 집적한 경우, 안테나의 전기적 크기는 $0.0246 {\lambda}{\times}0.0246{\lambda}{\times}0.0114{\lambda}$로 매우 소형이다. 이 때 측정된 입력 임피던스 대역폭$(S_{11}{\leq}-10 dB)$과 방사 효율은 각각 5.22 %와 47.25 %이다.
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[게시일 2004년 10월 1일]
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