PLL(Phase Locked Loop) are widely used circuit technique in modern electronic systems. In this paper, We propose the low voltage and high speed PLL. We design the PFD(Phase Frequency Detector) by using TSPC (True Single Phase Clock) circuit to improve the performance and solve the dead-zone problem. We use CP(Charge Pump} and LP(Loop filter) for Negative feedback and current reusing in order to solve current mismatch and switch mismatch problem. The VCO(Voltage controlled Oscillator) with 5-stage differential ring oscillator is used to exact output frequency. The divider is implemented by using D-type flip flops asynchronous dividing. The frequency divider has a constant division ratio 32. The frequency range of VCO has from 200MHz to 1.1GHz and have 1.7GHz/v of voltage gain. The proposed PLL is designed by using 0.18um CMOS processor with 1.8V supply voltage. Oscillator's input frequency is 25MHz, VCO output frequency is 800MHz and lock time is 5us. It is evaluated by using cadence spectra RF tools.
This paper reports a high power 60 GHz push-push oscillator fabricated using 0.12 um metamorphic high electron-mobility transistors (mHEMTs). The devices with a $0.1{\mu}m$ gate-length exhibited good DC and RF characteristics such as a maximum drain current of 700 mA/mm, a peak gm of 660 mS/mm, and an $f_T$ of 170 GHz. By combining two sub-oscillators having $6{\times}50{\mu}m$ periphery mHEMT, the push-push oscillator achieved a 6.3 dBm of output power at 59.5 GHz with more than -35 dBc fundamental suppression. This is one of the highest output power obtained using mHEMT technology without buffer amplifier, and demonstrates the potential of mHEMT technology for cost effective millimeter-wave commercial applications.
Software Defined Radio(SDR)에서는 ADC를 안테나 가까이에 위치시키는 것을 목표로 하고 있다. 하지만 실제 RF 대역의 신호를 ADC를 이용해 디지털화 하는 방법은 아직 어렵다. 그래서 RF 대역의 신호를 IF 대역으로 하향 변환 후 샘플링을 하는 방법이 연구되고 있다. 이런 방법의 하나로, Sub-Sampling 방식은 발진기 없이 RF 대역의 신호를 IF로 변환할 수 있는 방법이다. Sub-Sampling 방법을 이용한다면 2개 이상의 밴드를 하향 변환할 수 있지만, RF 필터의 성능으로 인해 하향 변환된 신호간에 간섭이 작용할 수 있어 성능을 저하시킨다. 본 논문에서는 time division multiplexing(TDM) 방식을 이용해 2개 이상의 신호를 시간적으로 분리시킴으로써 RF 필터의 좋지 않은 성능으로 인해 발생할 수 있는 신호간 간섭을 피할 수 있는 방법을 제안한다. 이 방식은 샘플앤홀더에서 두 신호에 대한 시간적 분리와 Sub-Sampling을 동시에 구현함으로써 하드웨어적인 큰 변화 없이 신호를 수신할 수 있다.
Journal of electromagnetic engineering and science
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제12권1호
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pp.37-44
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2012
This paper describes a compact and novel wireless vital sign sensor at 2.4 GHz that can detect heartbeat and respiration signals. The oscillator circuit incorporates a planar resonator, which functions as a series feedback element as well as a near-field radiator. The periodic movement of a human body during aerobic exercise could cause an input impedance variation of the radiator within near-field range. This variation results in a corresponding change in the oscillation frequency and this change has been utilized for the sensing of human vital signs. In addition, a surface acoustic wave (SAW) filter and power detector have been used to increase the system sensitivity and to transform the frequency variation into a voltage waveform. The experimental results show that the proposed sensor placed 20 mm away from a human body can detect the vital signs very accurately.
This study was conducted to develop a grain moisture meter using microwave free space transmission technique at X-band frequency. The 10.5GHz microwave oscillator using a dielectric resonator was designed and fabricated to transmit electromagnetic wave through standard horn antenna to a sample holder with the wetted Hwasung and Chuchung rough rice(12.00∼26.25%). To detect the output voltage of transmitted wave from receiving horn antenna, the detector was composed of shottkey diode and RF impedance matching circuit. The regression model for measurement of grain moisture content was developed. Its correlation coefficient and standard error of prediction (SEP) were found to be 0.9882 and 0.657 respectively between measure and predicted moisture contents.
A GaAs MMIC composed of VCO (voltage controlled oscillator) and mixer for PCS receiver has been developed using 1.mu.m ion implanted GaAs MESFET process. The VCO consists of a colpitts-type oscillator with a dielectric resonator and the circuit configuration of the mixer is a dual-gate type with an asymmetric combination of LO and RF FETs for the improvement of intermodulation characteristics. The common-source self-biasing is used in all circuits including a buffer amplifier and mixer, achieving a single power supply (3V) operation. The total power dissipation is 78mW. The VCO chip shows a phase noise of-99 dBc/Hz at 100KHz offset. The combined VCO/mixer chip shows a flat conversion gain of 2dB, the frequency-tuning factor of 80MHz/volts in the varacter bias ranging from 0.5V to 0.5V , and output IP3 of dBm at varactor bias of 0V. The fabricated chip size is 2.5mm X 1.4mm.
JSTS:Journal of Semiconductor Technology and Science
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제14권3호
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pp.313-321
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2014
A low-power low-cost polar transmitter for EDGE is designed in $0.18{\mu}m$ CMOS. A differential delta-sigma modulator (DSM) tunes a three-terminal voltage-controlled oscillator (VCO) to perform RF phase modulation, where the VCO tuning curve is digitally pre-compensated for high linearity and the carrier frequency is calibrated by a dual-mode low-power frequency-locked loop (FLL). A digital intermediate-frequency (IF) pulse-width5 modulator (PWM) drives a complementary power-switch followed by an LC filter to achieve envelope modulation with high efficiency. The proposed transmitter with 9mW power dissipation relaxes the time alignment between the phase and envelope modulations, and achieves an error vector magnitude (EVM) of 4% and phase noise of -123dBc/Hz at 400kHz offset frequency.
JSTS:Journal of Semiconductor Technology and Science
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제13권3호
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pp.207-212
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2013
A new CMOS voltage-bias differential LC voltage-controlled oscillator (LC-VCO) with active source degeneration is proposed. The proposed degeneration technique preserves the quality factor of the LC-tank which leads to improvement in phase noise of VCO oscillators. The proposed VCO shows the high figure of merit (FOM) with large tuning range, low power, and small chip size compared to those of conventional voltage-bias differential LC-VCO. The proposed VCO implemented in 0.18-${\mu}m$ CMOS shows the phase noise of -118 dBc/Hz at 1 MHz offset oscillating at 5.03 GHz, tuning range of 12%, occupies 0.15 $mm^2$ of chip area while dissipating 1.44 mW from 0.8 V supply.
JSTS:Journal of Semiconductor Technology and Science
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제15권2호
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pp.194-201
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2015
A frequency modulated ultra-wideband (FM-UWB) transmitter with a high-robust relaxation oscillator for subcarrier generation and a dual-path Ring VCO for RF FM is proposed, featuring low power and low complexity. A prototype 3.65-4.25 GHz FM-UWB transceiver employing the presented transmitter is fabricated in $0.18{\mu}m$ CMOS for short-range wireless data transmission. Experimental results show a bit error rate (BER) of $10^{-6}$ at a data rate of 12.5 kb/s with a communication distance of 60 cm is achieved and the power dissipation of 4.3 mW for the proposed transmitter is observed from a 1.8 V supply.
송수신기의 방식에는 직접변환 방식과 기저대역 신호와 LO(Local Oscillator)를 혼합하여 interpolation 기법을 사용하여 중간 주파수 단계까지 up conversion을 하고 두 번째 LO와 IF신호를 혼합하여 RF신호로 변환하여 송신하는 헤테로다인 방식이 존재한다. 본 논문에서는 이런 송수신기 방식 중에서 헤테로다인 방식을 적용하여 QPSK에서의 digital up /down converter를 Simulink 환경에서 설계 및 구현하였다. Up converter는 4배의 interpolation 필터와 4단짜리 cascaded integrate-comb(CIC)필터를 사용하여 입력데이터의 샘플 레이트를 클럭 레이트까지 증가시켰으며, numerically controlled oscillator (NCO)와 mixer를 사용하여 신호를 변조하였다. Down converter의 구조는 up converter와 동일하며 단지 up converter의 반대순서로 구성되어있다. 이런 모든 과정을 Simulink를 이용한 시뮬레이션과 스펙트럼 분석기를 사용하여 검증해 보았다.
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[게시일 2004년 10월 1일]
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