• 제목/요약/키워드: M35

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fullcustom $0.35\mu m $ CMOS 공정을 이용한 16*16 bit 고속 승산기의 설계 (Design of fast 16-bit multiplier with $0.35\mu m $ CMOS technology)

  • 박현규;신현철;김종진
    • 융합신호처리학회 학술대회논문집
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    • 한국신호처리시스템학회 2000년도 추계종합학술대회논문집
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    • pp.229-232
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    • 2000
  • 각종 범용 컴퓨터 및 디지탈 신호처리에서 중요한 역할을 하는 16비트 정수형, 2의 보수 형태의 곱셈연산을 수행하기 위한 고속 승산기구조를 설계하고 시뮬레이션 하였다. 부분곱을 합하는 부분은 일반적으로 전체 곱셈기 처리 지연시간의 절반정도를 차지하므로 이 부분의 설계방법이 곱셈기의 궁극적인 속도향상에 직접적인 영향을 미친다. 부분곱의 개수를 줄이기 위하여 Booth encoder를 사용하였고, partial product(부분곱)의 덧셈시간을 줄이기 위하여 4:2 CSA(can save adder)와 3:2 CSA로 CSA tree를 구성 하였으며, 최종결과는 carry look- ahead tree로 얻어진다. Hyundai CMOS 0.35$\mu\textrm{m}$ 1-poly 4-metal 공정으로 layout하여 설계하였으며, 곱셈시간은 2.7ns(tipical case)이하로 측정되었다.

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$0.35{\mu}m$ CMOS 공정을 이용한 프리만 모델의 기본 신경 셀 설계 (Circuit Design of the Basic Neural Cell for the Freeman's Model using a $0.35{\mu}m$ CMOS Process)

  • 이소영;강명훈;최충기;이제원;송한정;전민현
    • 한국지능시스템학회:학술대회논문집
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    • 한국퍼지및지능시스템학회 2006년도 추계학술대회 학술발표 논문집 제16권 제2호
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    • pp.145-148
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    • 2006
  • 본 논문은 $0.35{\mu}m$ 2중 폴리 CMOS 공정을 이용하여 프리만 신경회로 모델의 기본 요소가 되는 입력 취합 블록과 필드 앤드 홀드 방식의 2차 저역 통과 필터의 구현 및 부궤환과 비대칭 트랜스 콘덕터로 이루어지는 비선형 함수 블록을 설계하고 SPICE 회로 모의실험을 통해 결과를 확인하였다.

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MIMIC 전력증폭기에 응용 가능한 0.2 ${\mu}{\textrm}{m}$ 이하의 게이트 길이를 갖는 전력용 AlGaAs/InGaAs/GaAs PHEMT (AlGaAs/InGaAs/GaAs PHEMT power PHEMT with a 0.2 ${\mu}{\textrm}{m}$ gate length for MIMIC power amplifier.)

  • 이응호
    • 한국통신학회논문지
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    • 제27권4B호
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    • pp.365-371
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    • 2002
  • 본 논문에서는 전자선 묘화 장비를 이용하여 게이트 길이가 0.2 $\mu\textrm{m}$ 이하인 밀리미터파용 전력 PHEMT 소자를 제작하고 DC 특성과 주파수 특성 그리고 전력 특성을 측정하고 분석하였다. PHEMT의 제작에 사용된 단위공정은 저 저항 오믹 접촉, 에어 브릿지 및 후면 가공 공정기술 등을 이용하였다. 제작된 전력용 PHEMT는 35 GHz의 중심주파수에서 4 dB의 S21 이득과 317 mS/mm의 최대 전달컨덕턴스 그리고 62 GHz의 차단주파수와 12G GHz의 최대 공진주파수를 나타내었다. 또한 측정된 전력 특성은 35.5 %의 드레인 효율과 16 dB의 최대 출력전력 그리고 4 dB의 전력 이득을 나타내었다.

陰 Ion 交換樹脂에 依한 稀土類元素의 溶離行動에 關한 硏究 (The Elution Behavior of Rare Earth Elements in Diethylene Triamine N,N,N',N',N)

  • 정오진;김일두;이계수;차기원
    • 대한화학회지
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    • 제28권1호
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    • pp.47-53
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    • 1984
  • DTPA 용리액의 pH와 농도를 변화시키면서 음이온 교환수지관을 이용해서 희토류 원소들을 분리하는 연구를 하였다. 희토류 원소들의 가장 좋은 분리조건은 0.025M DTPA, pH 8.35이 있었으며 희토류 원소들의 용리순서는 Sm을 제외하고 희토류 원소들의 원자번호 순서와 일치하였다. 0.025M DTPA, pH 8.35에서 분리한 인접 희토류 원소들의 분리값은 3.03~1.25이었으며 그중 Ce/Pr이 3.03으로 최대값을,Eu/Gd은 최소값을 각각 갖는다. 0.025M DTPA 희토류 원소들을 용리하였을 때, pH 8.0~8.6의 넓은 범위에서 비교적 좋은 분리현상을 보였다.

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저전력 디지털 신호처리 응용을 위한 작은 오차를 갖는 절사형 Booth 승산기 설계 (A Design of Low-Error Truncated Booth Multiplier for Low-Power DSP Applications)

  • 정해현;박종화;신경욱
    • 한국정보통신학회논문지
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    • 제6권2호
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    • pp.323-329
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    • 2002
  • N-비트$\times$N-비트 2의 보수 승산에서 승산결과 2N-비트만을 출력하는 절사형 Booth 승산기의 절사오차 최소화를 위한 효율적인 오차보상 방법을 제안하였다. 제안된 방법을 적용하여 작은 칩 면적과 저전력 특성을 갖는 절사형 승산기를 설계하고 면적, 절사오차 등을 기존의 방식과 비교하였다. 제안된 절사형 Booth 승산기는 승산결과의 하위 N-비트를 계산하는 회로를 생략하므로, 절사되지 않은 일반 승산기에 비해 게이트 수가 약 35% 정도 감소한다. 본 논문에서 설계된 절사형 Booth 승산기는 기존의 고정 오차보상 방법을 적용한 경우에 비해 평균오차를 약 60% 정도 줄일 수 있다. 제안된 방법을 적용하여 16-비트$\times$16-비트 절사형 승산기를 0.35-$\mu\textrm{m}$ CMOS 공정을 이용하여 full-custom 방식으로 설계하였다. 약 3.000개의 트랜지스터로 구성되는 승산기 코어는 330-$\mu\textrm{m}$$\times$262-$\mu\textrm{m}$의 면적을 가지며, 3.3-V 전원전압에서 200-MHz로 동작 가능하며 약 20-㎽의 전력소모 특성을 갖는다.

花粉分析을 중심으로 본 一山지역의 홀로세 環境變化와 古地理復元 (The Holocene Environmental Change and Reconstruction of the Palaeogeography at Ilsan Area with the Special Reference to Pollen Analysis)

  • 윤순옥
    • 대한지리학회지
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    • 제32권1호
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    • pp.15-30
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    • 1997
  • 花粉, 沖積層의 堆積相, 炭素年代 등의 분석자료를 기초로 식생환경, 해면변동 및 홀로세 환경변화를 고찰하고, 각 시기별 古地理圖를 작성하였다. 각 花粉帶 별 環境특성은 다음과 같다. 1) 화분대 I(3.75~5.75m)dms 8,000~4,200년BP 시기로서, 우점식생은 Alnus-EMW로 대표된다. 빠른 해면상승과 해진의 영향으로 매우 습윤하였다. 2) 화분대 II(5.75~6.35m)는 4,200~2,300년BP 시기로서, 해수면 하강 및 地下水面 하강으로 건륙화된 환경하에 Pinus가 증가하고, 포자류와 초본류가 우점하였다. 3) 화분대 III(6.35~6.55m)은 2,300년BP에서 1,800년BP 까지 지속되었으며, 해진의 영향과 인간의 간섭을 모두 반영하는 초본류의 비율이 높은 시기였다. 아분대 IIb와 화분대 III의 경계는 베버의 限界層의 특징을 나타낸다.

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사각 마이크로 채널의 단상 유동 열전달 특성 연구 (Study on Heat Transfer Characteristics for Single-phase Flow in Rectangular Microchannels)

  • 문지현;김선창
    • 대한기계학회논문집B
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    • 제35권9호
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    • pp.891-896
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    • 2011
  • 본 연구에서는 사각 마이크로 채널의 열전달 특성을 연구하기 위한 실험을 수행하였다. 실험에 사용된 시료의 채널 수력직경은 $700{\mu}m$이며, 채널의 개수는 20개이다. 작동유체는 물이며, 작동유체의 입구 온도는 $20^{\circ}C$ 이다. 실험 변수는 Reynolds 수 400 ~ 800 및 열 유속 35 ~ 85 kW/$m^2$ 이다. 결과로, Reynolds 수가 큰 경우일수록 대류 열전달 계수가 증가하는 것으로 나타났으며, 열적으로 완전히 발달 된 영역에 대하여 대류 열전달 계수는 약 4.6 ~ 6.4 kW/$m^2^{\circ}C$로 나타났다. 또한, 사각 마이크로 채널에서의 열적 입구길이는 Reynolds 수가 커지는 경우일수록 길어지는 것을 알 수 있었으나, 열 유속의 변화는 입구길이에 영향을 미치지 않는 것으로 나타났다. 본 연구의 결과로 완전히 발달된 유동영역에 대하여 사각 마이크로 채널의 열적 특성을 나타내기 위한 Nusselt 수 상관식을 제안하였다.

CMOS 트랜지스터의 채널 폭 및 길이 변화에 따른 RF 특성분석 및 최적화 (Analysis and Optimization of the CMOS Transistors for RF Applications with Various Channel Width and Length)

  • 최정기;이상국;송원철
    • 대한전자공학회논문지SD
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    • 제37권8호
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    • pp.9-16
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    • 2000
  • 0.35m CMOS공정을 이용하여 MOSFET의 RF특성을 평가하였다. 채널길이(L-0.25~0.8m)와 채널폭(W=50~600m) 및 바이어스 전압의 변화에 따른 RF특성을 분석하였으며, 차단주파수$f_T$는 최대 22GHz, 최대공진주파수($f_{max}$)는 최대 28GHz의 값을 얻었다. 채널폭의 변화에 대해서 차단주파수는 영향을 받지 않았으며, 최대공진주파수는 감소하는 경향을 보였고, 채널길이 증가에 대해서는 차단주파수 및 최대공진주파수 모두 감소하는 경향을 나타내었다. 최소잡음지수는 채널폭이 증가할수록 감소하고 채널길이가 증가할수록 증가하는 경향을 얻었는데, 2GHz에서 최소 0.45dB의 값을 얻었다. 평가결과로부터 0.35m CMOS공정이 2GHz대역의 상업용 RFIC 구현에 충분한 RF특성을 보유하고 있음을 확인할 수 있었으며, 바이어스 및 채널폭과 길이변화에 대한 CMOS 트랜지스터의 RF 특성분석을 통하여 RF 회로설계에 대한 지침을 제시하였다.

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설계다이어그램을 이용한 KTX와 HEMU 차량 주행시 단경간 단순지지 교량의 동특성 분석 (Dynamic Characteristics of Simply Supported Single Span Bridges for KTX and HEMU using Design Diagram)

  • 조정래;조근희;곽종원;김영진
    • 한국철도학회논문집
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    • 제15권5호
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    • pp.498-507
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    • 2012
  • 본 논문에서는 KTX와 HEMU 차량 주행시 단경간 단순지지교량의 간편한 동적 해석을 위한 ERRI 설계다이어그램을 제시하고, 이를 통해 교량의 동적응답특성과 설계시 고려사항을 분석하였다. 국내에서 많이 적용되는 25m, 30m, 35m, 40m 지간장을 갖는 단경간 단순지지 교량에 대해 KTX 및 HEMU 차량 주행시 설계다이어그램을 계산하였다. 이를 통해 선택된 4개 지간장 교량을 대상으로 각 열차하중에 대한 동특성을 분석하였다. 또한 공진시 가속도 응답을 만족하는 최소한의 단위길이당 질량을 지간길이, 차량유형, 감쇠비 등에 따라 제시하였고 설계시 고려사항을 분석하였다. 25m 교량은 HEMU와 KTX 차량 모두 공진시 응답이 증폭되므로 공진이 발생하지 않도록 설계하는 것이 경제적이다. 30m 교량은 HEMU 차량, 35m와 40m 교량은 KTX 차량이 주행할 때 응답이 증폭될 수 있으며 공진을 회피하거나 최소한의 단위길이당 질량을 배치하도록 설계해야 한다.

Body-Bias Technique을 이용한 저전압 진동에너지 하베스팅 전파정류회로 (A Low-Voltage Vibrational Energy Harvesting Full-Wave Rectifier using Body-Bias Technique)

  • 박근열;유종근
    • 한국정보통신학회:학술대회논문집
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    • 한국정보통신학회 2017년도 추계학술대회
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    • pp.425-428
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    • 2017
  • 본 논문에서는 진동 에너지를 이용하여 에너지를 수확하는 전파 정류 하베스팅 회로를 설계하였다. 설계된 회로는 저전압에서도 전력효율이 우수하도록 Beta-Multiplier를 이용하여 Body-Bias technique을 Negative Voltage Converter에 적용하였으며, Comparator를 Bulk-Driven type으로 설계하였다. 제안된 회로는 $0.35{\mu}m$ CMOS 공정으로 설계하였으며, 설계된 회로의 칩 면적은 $931{\mu}m{\times}785{\mu}m$이다.

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