Kim, Hogyoung;Yun, Hee Ju;Choi, Seok;Choi, Byung Joon
한국재료학회지
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제29권8호
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pp.463-468
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2019
The electrical and interfacial properties of $HfO_2/Al_2O_3$ and $Al_2O_3/HfO_2$ dielectrics on AlN/p-Ge interface prepared by thermal atomic layer deposition are investigated by capacitance-voltage(C-V) and current-voltage(I-V) measurements. In the C-V measurements, humps related to mid-gap states are observed when the ac frequency is below 100 kHz, revealing lower mid-gap states for the $HfO_2/Al_2O_3$ sample. Higher frequency dispersion in the inversion region is observed for the $Al_2O_3/HfO_2$ sample, indicating the presence of slow interface states A higher interface trap density calculated from the high-low frequency method is observed for the $Al_2O_3/HfO_2$ sample. The parallel conductance method, applied to the accumulation region, shows border traps at 0.3~0.32 eV for the $Al_2O_3/HfO_2$ sample, which are not observed for the $Al_2O_3/HfO_2$ sample. I-V measurements show a reduction of leakage current of about three orders of magnitude for the $HfO_2/Al_2O_3$ sample. Using the Fowler-Nordheim emission, the barrier height is calculated and found to be about 1.08 eV for the $HfO_2/Al_2O_3$ sample. Based on these results, it is suggested that $HfO_2/Al_2O_3$ is a better dielectric stack than $Al_2O_3/HfO_2$ on AlN/p-Ge interface.
본 논문에서는 LTCC 다층기판으로 구현할 수동 소자를 수축공정과 무수축공정으로 구분하여 설계, 제작하고 분석하였다. 유전율 7 또는40의 두 종류 세라믹 소재를 사용하여 기본 형태의 수동소자를 다양하게 두 가지 공정으로 제작하여 특성을 비교하였다. 유전율40 기판을 사용할 때 수축공정은 X, Y 방향에서 17%, Z 방향에서 36%의 수축율을 보이는 것과 비교하여, 무수축공정은 X,Y 방향에서 변화하지 않고 Z 방향으로만 43% 수축하여 평면상에서 높은 치수 정밀도와 표면 평탄도를 얻을 수 있다. 측정 값으로 부터 매개 변수를 이용한 경험적 해석 식을 이용하여 제작한 LTCC 소자의 인덕턴스 및 커패시턴스를 추정하였으며 설계 라이브러리 형태로 구현하였다. 유전율과 제작 공정에 따라 인덕터의 권선수와 단위 면적에 따른 커패시턴스를 측정하여 권선수 및 단위면적에 따른 소자값을 예측할 수 있는 다항식을 제시하였다.
In this work, high-k dielectric stacks of $HfO_2$ and $HfO_2$/$Al_2O_3$/$HfO_2$ (HAH) were deposited on $SiO_2/Si$ substrates by atomic layer deposition as charge trapping layers in charge trapping devices. The structural stability and the charge trapping characteristics of such stacks were investigated using Metal-Alumina-Hafnia-Oxide-Silicon (MAHOS) structure. The surface roughness of $HfO_2$ was stable up to 11 nm with the insertion of 0.2 nm thick $Al_2O_3$. The effect of the thickness of the HAH stack and the thickness of intermediate $Al_2O_3$ on charge trapping characteristics were investigated for MAHOS structure under various gate bias pulse with duration of 100 ms. The threshold voltage shift after programming and erase showed that the memory window was increased with increasing bias on gate. However, the programming window was independent of the thickness of HAH charge trapping layers. When the thickness of $Al_2O_3$insertion increased from 0.2 nm to 1 nm, the erase window was decreased without change in the programming window.
24시간/7일 동안 높은 관전압 하에서 높은 프레임 속도로 검사 대상체의 불량을 검사하는 산업용 동영상 엑스레이 디텍터의 중요한 요구사양은 높은 방사선 내구성을 확보하는 것이다. 본 연구는 비정질 실리콘 (a-Si), 다결정 실리콘 (Poly-Si), In-Ga-Zn-O 산화물 (IGZO) 등의 반도체 층을 갖는 다양한 박막트랜지스터를 제작하여 각각의 방사선 내구성을 확인하였다. a-Si TFT 대비 수십 배 높은 전계효과 이동도로 고속 동영상 구현이 가능한 IGZO TFT의 경우, IGZO 반도체 층과 층간절연막 사이에 수소화 처리를 진행할 경우 산업용 요구사양인 10,000 Gy 누선선량까지 엑스레이 영상센서로 적용 가능한 수준 이상으로 전기적 특성의 변화가 없음을 확인하였다. 따라서 수소화한 IGZO TFT는 방사선 내구성을 확보함과 동시에 높은 전계효과 이동도로 동영상 디텍터의 영상센서에 적용 가능한 유일한 소자임을 확인하였다.
In this paper, a design for a radio frequency(RF) and infrared(IR) absorber with metasurfaces is discussed in microwave frequency bands. The RF absorber includes double layers of metasurfaces to operate in S- and X-bands. Effects of sheet resistance of the metasurfaces and thicknesses of dielectric supporting layers on reflection responses are investigated. An IR stealth layer incorporates an array of conductive grids with slits to reflect IR signals but to transmit RF signals and visible rays. Periodicity of the grids and slits is studied for transmission responses in the X-band and a surface area ratio. Reflection responses of the RF/IR multispectral absorber are found to be lower than -10 dB and -16 dB in the S- and X-bands, respectively, from full-wave simulation. Finally, the RF/IR multispectral absorber is fabricated and its reflection responses are measured to verify designed performance.
아스팔트 콘크리트 포장의 하부구조는 보조기층, 동상방지층 및 노상층으로 구성되어 있으며, 노상층의 경우 겨울철을 지나 봄이되면 동상효과에 따른 포장 파손과 여름철 장마 기간 동안의 수분 침투로 인한 지지력 감소와 같은 문제점이 발생할 수 있다. 따라서 도로하부의 함수비를 계측하기 위하여 시간이력 반사방식(Time Domain Reflectometry, TDR)의 함수센서를 통하여 실시간 함수비를 계측하는 기술이 국내에 도입되었다. TDR 방식의 함수센서는 흙과 물의 유전율을 통하여 함수비를 측정하기 때문에 온도의 영향을 받을 수 있다. 특히 국내는 계절 영향을 받아서 겨울철 대기 온도가 지역적으로 영하 $20^{\circ}C$ 보다 낮은 온도를 보여줄 수 있기 때문에 영하의 측정 온도 범위에 대한 함수센서의 정확도를 파악할 필요가 있다. 따라서 본 연구에서는 흙의 온도 범위를 영하 $2^{\circ}C$ 미만까지 확장하여 TDR 방식의 함수비 센서에 대한 온도 민감도 시험을 수행하였다. 체적함수비 20%와 30%에 대한 시험 결과 공시체 표면 온도가 영하로 떨어지면서 센서부근의 수분이 감소하고, 공시체 상부의 함수비가 증가하는 경향을 보여주었다. 그러나 함수센서에 대한 온도의 영향은 함수비가 낮을 경우 미소한 것으로 나타났다.
본 연구에서는 상용화된 2.4 GHz 영역대에서 사용되어지는 WiFi용 DPDT(Double Pole Double throw) switch 칩을 laser 비아 가공과 도금 공정을 이용하여 폴리머 기판내에 내장시켜 그 특성을 분석하였으며 통상적으로 실장되는 wire 본딩방식으로 패키징된 기판과 특성차이를 분석 비교하였다. 폴리머는 FR4기판과 아지노 모토사의 ABF(Ajinomoto build up film)를 이용하여 패턴도금법으로 회로를 형성하였다. ABF공정의 최적화를 위해 폴리머의 경화정토를 DSC (Differenntial Scanning Calorimetry) 및 SEM (Scanning Electron microscope)으로 분석하여 경화도에 따라 도금된 구리패턴과의 접착력을 평가하였다. ABF의 가경화도가 $80\sim90%$일 경우 구리층과 최적의 접착강도를 보였으며 진공 열압착공정을 통해 기공(void)없이 칩을 내장할 수 있었다. 내장된 기관과 와이어 본딩된 기판의 측정은 S 파라미터를 이용하여 삽입손실과 반사손실을 비교 분석하였으며 그 결과 삽입손실은 두 경우 유사하게 나타났지만 반사손실의 경우 칩이 내장된 경우 6 GHz 까지 -25 dB 이하로 안정적으로 나오는 것을 확인할 수 있었다.
실리콘 기판 위의 초기 산화막을 NO 열처리 및 재산화 공정방법으로 성장한 재산화된 질화산화막을 게이트 유전막으로 사용한 새로운 전하트랠형 기억소자로의 응용가능성과 계면트랩특성을 조사하였다. 0.35$\mu$m CMOS 공정기술을 사용하여 게이트 유전막은 초기산화막을 $800^{\circ}C$에서 습식 산화하였다 전하트랩영역인 질화막 층을 형성하기 위해 $800^{\circ}C$에서 30분간 NO 열처리를 한 후 터널 산화막을 만들기 위해 $850^{\circ}C$에서 습식 산화방법으로 재산화하였다. 프로그램은 11 V, 500$\mu$s으로 소거는 -l3 V, 1 ms의 조건에서 프로그래밍이 가능하였으며, 최대 기억창은 2.28 V이었다. 또한 11 V, 1 ms와 -l3 V, 1 ms로 프로그램과 소거시 각각 20년 이상과 28시간의 기억유지특성을 보였으며 $3 \times 10^3$회 정도의 전기적 내구성을 나타내었다. 단일접합 전하펌핑 방법으로 소자의 계면트랩 밀도와 기억트랩 밀도의 공간적 분포를 구하였다. 초기상태에서 채널 중심 부근의 계면트랩 및 기억트랩 밀도는 각각 $4.5 \times 10^{10}/{cm}^2$ 와 $3.7\times 10^{1R}/{cm}^3$ 이었다. $1 \times 10^3$프로그램/소거 반복 후, 계면트랩은 $2.3\times 10^{12}/{cm}^2$으로 증가하였으며, 기억트랩에 기억된 전하량은 감소하였다.
수트리의 진행과정은 십수년이 걸리며 보통 매우 오래된 지중케이블에서 발견된다. 이러한 지중케이블들은 이미 접근이 어려운 곳에 있어 수트리를 검출하기 위해서는 많은 비용과 시간이 소요된다. 이러한 지중케이블의 유지보수 비용과 시간을 절감하기 위해서는 수트리가 진행된 지중케이블이 전력망에 미치는 영향을 분석할 수 있는 수학적 모델링이 필요하고, 이를 이용한 수트리 탐지 기술개발이 매우 필요한 실정이다. 본 논문에서는 수트리가 포함된 XLPE 케이블 대한 수학적 모델링을 하고자 수트리의 복잡한 구조를 Vented tree의 확인된 특정 패턴 2가지를 기준으로 가정하여 단순화 하였다. 그리고 수트리의 발달에 따른 케이블 절연층의 캐패시턴스 및 레지스턴스를 계산 및 분석하기 위해 matlab으로 시뮬레이션을 실시하였으며, 모델링의 유용성을 검증하기 위해서 참고문헌 Burkes 논문의 케이블 데이터를 동일하게 적용하였다. 시뮬레이션 결과, 캐패시턴스 크기의 변화는 케이블에 수트리 영역이 절연층에 95%까지 진행되었을 때 정상대비 약 0.025×10-13[Farads/mm] 증가됨을 확인하였다. 레지스턴스 값의 경우 정상대비 약 0.5×1016[ohm/m] 정도 감소되는 것을 확인하였다. 따라서, Burkes 논문의 물리적 모델링 시뮬레이션 결과와 비교하였을 때 그 변화값이 매우 유사하여 본 논문에서 제시한 수학적 모델링의 유용성을 검증하였다.
The manufacturing cost of thin-film photovoltics can potentially be lowered by minimizing the amount of a semiconductor material used to fabricate devices. Thin-film solar cells are typically only a few micrometers thick, whereas crystalline silicon (c-Si) wafer solar cells are $180{\sim}300\mu}m$ thick. As such, thin-film layers do not fully absorb incident light and their energy conversion efficiency is lower compared with that of c-Si wafer solar cells. Therefore, effective light trapping is required to realize commercially viable thin-film cells, particularly for indirect-band-gap semiconductors such as c-Si. An emerging method for light trapping in thin film solar cells is the use of metallic nanostructures that support surface plasmons. Plasmon-enhanced light absorption is shown to increase the cell photocurrent in many types of solar cells, specifically, in c-Si thin-film solar cells and in poly-Si thin film solar cell. By proper engineering of these structures, light can be concentrated and coupled into a thin semiconductor layer to increase light absorption. In many cases, silver (Ag) nanoparticles (NP) are formed either on the front surface or on the rear surface on the cells. In case of poly-Si thin film solar cells, Ag NPs are formed on the rear surface of the cells due to longer wavelengths are not perfectly absorbed in the active layer on the first path. In our cells, shorter wavelengths typically 300~500 nm are also not effectively absorbed. For this reason, a new concept of plasmonic nanostructure which is NPs formed both the front - and the rear - surface is worth testing. In this simulation Al NPs were located onto glass because Al has much lower parasitic absorption than other metal NPs. In case of Ag NP, it features parasitic absorption in the optical frequency range. On the other hand, Al NP, which is non-resonant metal NP, is characterized with a higher density of conduction electrons, resulting in highly negative dielectric permittivity. It makes them more suitable for the forward scattering configuration. In addition to this, Ag NP is located on the rear surface of the cell. Ag NPs showed good performance enhancement when they are located on the rear surface of our cells. In this simulation, Al NPs are located on glass and Ag NP is located on the rear Si surface. The structure for the simulation is shown in figure 1. Figure 2 shows FDTD-simulated absorption graphs of the proposed and reference structures. In the simulation, the front of the cell has Al NPs with 70 nm radius and 12.5% coverage; and the rear of the cell has Ag NPs with 157 nm in radius and 41.5% coverage. Such a structure shows better light absorption in 300~550 nm than that of the reference cell without any NPs and the structure with Ag NP on rear only. Therefore, it can be expected that enhanced light absorption of the structure with Al NP on front at 300~550 nm can contribute to the photocurrent enhancement.
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[게시일 2004년 10월 1일]
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