This study proposes a high efficiency bridgeless Power Factor Correction (PFC) converter with improved common mode noise characteristics. Conventional PFC has limitations due to low efficiency and enlarged heat sink from considerable conduction loss of bridge diode. By applying a Common Mode (CM) coupled inductor, the proposed bridgeless PFC converter generates less conduction loss as only a small magnetizing current of the CM coupled inductor flows through the input diode, thereby reducing or removing heat sink. The input diode is alternately conducted every half cycle of 60 Hz AC input voltage while a negative node of AC input voltage is always connected to the ground, thus improving common mode noise characteristics. With the aim to improve switching loss and reverse recovery of output diode, the proposed circuit employs Critical Conduction Mode (CrM) operation and it features a simple Zero Current Detection (ZCD) circuit for the CrM. In addition, the input current sensing is possible with the shunt resistor instead of the expensive current sensor. Experimental results through 480 W prototype are presented to verify the validity of the proposed circuit.
In this paper, we propose a security architecture for HDLC-based T4 class common data link. The common data links are composed of point-to-point, multi-to-point, and point-to-multi mode. For multi-to-point mode, one node has a bundle of point-to-point links with different end-point on the other side of the links. Thus multi-to-point mode can be considered as a bundle of point-to-point mode. Point-to-multi mode is broadcasting link. For point-to-point mode we adopted robust security network scheme to establish a secure data link, and for multi-to-point mode we use broadcast encryption scheme based on ID-based cryptography to distribute encryption key for broadcasting message encryption. We also included MACsec technology for point-to-point data link security. Computational and communicational complexity analysis on the broadcast encryption have been done.
본 논문은 차동 모드로 동작하는 메타 재질 구조를 바탕으로 평형 필터 설계를 제안한 것이다. 이 메타 재질 구조는 차동 모드 동작에서는 Composite Right/Left-Handed(CRLH) 메타 재질로 동작하여 필터 특성을 갖지만, 공통 모드에서는 통과대역이 차단되는 성질을 갖는 평형 CRLH 단위 셀로 구성되었다. 이러한 차동모드 특성을 갖는 단위 셀을 직렬로 4단을 연결하여 필터를 구성하였으며, 제안된 메타 재질의 특성은 차동 모드 평형 필터로 동작하고, 공통 모드에서는 차단되는 특성을 실험 결과를 통하여 확인하였다. 메타 재질을 이용한 평형 필터는 대역폭이 960 MHz~1000 MHz, 4.1dB의 삽입손실을 갖는 특성을 얻었다.
This paper presents an improved vertical alignment nematic liquid crystal mode characterized by the protrusions or slits of the top substrate and additional stripe type common electrodes with polarity switching of the bottom substrate to improve multi-domain vertically aligned (MVA) and patterned vertically aligned (PVA) nematic modes. MVA and PVA modes have disadvantages such as an LC disclination in the vicinity of the middle region of electrodes between the top and bottom protrusions in MVA mode or the top and bottom slits in PVA mode. Therefore, the stripe type common electrode generating a horizontal electric field and the protrusion or slit producing some pretilt of liquid crystals (LCs) were used to improve the LC disclination, which influences the transmittance and response speed. The simulation results showed that the proposed VA mode has higher transmittance than the MVA and PVA modes. As a result, the proposed VA mode can improve the response speed and transmittance remarkably, which makes it useful for upgrading the LCD display quality.
본 논문은 차동과 공통 모드로 동작하는 메타 재질 구조를 바탕으로 평형 믹서 수신기를 제안한 것이다. 이 메타 재질 구조는 리키 웨이브 안테나로 동작하며, 순수 공통 모드는 억압한다. 이러한 특성은 낮은 LO 누설전력과 높은 RF-LO 고립도를 갖고 있어 LO과 RF 경로에 추가적인 여파기가 필요로 하지 않는다. 이 메타 재질은 차동 모드 동작에서는 Composite Right/Left-Handed(CRLH) 메타 재질처럼 동작하고, 공통 모드에서는 차단되는 성질을 갖는 단위 셀을 기초로 설계하였다. 제안된 메타 재질의 차동과 공통 모드 특성은 실험 결과를 통하여 증명하였다. 메타 재질을 이용한 수신기는 $1.96{\sim}2.40$ GHz의 주파수 범위에서 동작하는 안테나와 평형 믹서를 집적화시켜 제작하였고, 2.4 GHz에서 21.1 dB의 믹서의 변환 손실을 얻었다.
본 논문에서는 다수의 병렬 입.출력 환경을 위한 높은 노이즈 마진을 갖고 있는 LVDS I/O 회로를 소개한다. 제안된 LVDS I/O회로는 송신단과 수신단으로 구성되어 있으며 송신단 회로는 차동위상 분할기와 공통모드 피드백(common mode feedback)을 가지고 있는 출력단으로 이루어져 있다. 차동위상 분할기는 SSO(simultaneous switching output) 노이즈에 의해 공급전압이 변하더라도 안정된 듀티 싸이클(duty cycle)과 $180^{\circ}$의 위상차를 가진 두 개의 신호를 생성한다. 공통모드 피로백을 가지고 있는 출력단 회로는 공급전압의 변화에 상관없이 일정한 출력전류를 생성하고 공통모드 전압(common mode voltage)을 ${\pm}$0.1V 이내로 유지한다. LVDS 수신단 회로는 VCDA(very wide common mode input range differential amplifier)구조를 사용하여 넓은 공통 입력전압 범위를 확보하고 SSO 노이즈에 의한 공급 전압의 변화에도 안정된 듀티 싸이클(50% ${\pm}$ 3%)을 유지하여 정확한 데이터 복원이 가능하다. 본 논문에서 제안한 LVDS I/O 회로는 0.18um TSMC 라이브러리를 기본으로 하여 설계 되었으며 H-SPICE를 이용하여 시뮬레이션 하였다.
An EMC analysis of a switched mode power supply (SMPS) have been usually using unbalance circuit topologies and the major factor of disturbance is parasitic capacitance. We have proposed a balanced switching converter circuit, which is an effective way to reduce the common mode conducted noise. In this paper presents the relationship between common mode current and radiated field.
Reddy, M. Harsha Vardhan;Reddy, T. Bramhananda;Reddy, B. Ravindranath;Suryakalavathi, M.
Journal of Power Electronics
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제15권6호
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pp.1524-1532
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2015
Conventional space vector pulse width modulation based asymmetrical dual inverter configuration produces high common mode voltage (CMV) variations. This CMV causes the flow of common mode current, which adversely affects the motor bearings and electromagnetic interference of nearby electronic systems. In this study, a simple and generalized carrier based pulse width modulation (PWM) technique is proposed for dual inverter configuration. This simple approach generates various continuous and discontinuous modulating signals based PWM algorithms. With the application of the discontinuous modulating signal based PWM algorithm to the asymmetrical dual inverter configuration, the CMV can be reduced with a slightly improved quality of output voltage. The performance of the continuous and discontinuous modulating signals based PWM algorithms is explored through both theoretical and experimental studies. Results show that the discontinuous modulating signal based PWM algorithm efficiently reduces the CMV and switching losses.
고속 스위칭 소자의 출현과 함께 높은 전압 상승률(dv/dt)은 PWM 인버터에 EMI 노이즈 및 축 전압 그리고 베어링 누설전류 등의 문제 등을 발생시키고 있다. 본 논문에서는 유도전동기 시스템에서의 새롭게 개발된 전도성 EMI 저감 SVPWM 기법의 응용에 대하여 기술한다. 새롭게 개발된 커먼모드 전압제거 SVPWM 기법은 인버터 제어에 있어서 영벡터 상태를 사용하지 않고 종래의 PWM 기법에 비하여 커먼모드 전압의 감소가 가능하다. 소프트웨어 접근에 의한 제안된 기법의 타당성은 시뮬레이션과 실험적 결과를 통하여 확인하였다.
This paper describes an optimal configuration for multi-central inverters in a medium-voltage (MV) grid, which is suitable for large-scale photovoltaic (PV) power plants. We theoretically analyze a proposed common-mode equivalent model for problems associated with multi-central transformerless-type three-phase full bridge(3-FB) PV inverters employing two-winding MV transformers. We propose a synchronized PWM control strategy to effectively reduce the common-mode voltages that may simultaneously occur. In addition, we propose that the existing 3-FB topology may also have the configuration of a multi-central inverter with a two-winding MV transformer by making a simple circuit modification. Simulation and experimental results of three 350kW PV inverters in a multi-central configuration verify the effectiveness of the proposed synchronization control strategy. The modified transformerless-type 3-FB topology for a multi-central PV inverter configuration is verified using an experimental prototype of a 100kW PV inverter.
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[게시일 2004년 10월 1일]
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