• 대한전자공학회논문지SD
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• 제37권3호
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• pp.20-26
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• 2000

본 연구에서는 온도의 증가에 따른 RF-CMOS의 ｇ/sub m/과 ｆ/sub T/ 및 f/sub max/의 감소를 측정하였다. RF응용에서 MOS소자는 포화영역에서 동작되므로 모든 측정바이어스에서 온도에 따른 g/sub m/특성 변화를 실험적인 관계식으로 모델링하였다. CMOS의 f/sub T/와f/sub max/는 g/sub m/에 비례하기 때문에 온도에 따른f/sub T/ 및 f/sub max/ 변화도 온도에 따른 g/sub m/관계식으로부터 구할 수 있었다. 그리고 온도 증가에 따른fт와f/sub max/ 감소는 대부분 g/sub m/ 감소에 기인되며 DC와 RF특성 상관관계로부터 저온에서는f/sub T/와f/sub max/가 크게 증가됨을 예견할 수 있었다.

• Asian-Australasian Journal of Animal Sciences
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• 제28권3호
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• pp.343-350
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• 2015

Cocoa pod is among the by-products of cocoa (Theobroma cacao) plantations. The aim of this study was to apply a number of treatments in order to improve nutritional quality of cocoa pod for feeding of ruminants. Cocoa pod was subjected to different treatments, i.e. C (cocoa pod without any treatment or control), CAm (cocoa pod+1.5% urea), CMo (cocoa pod+3% molasses), CRu (cocoa pod+3% rumen content) and CPh (cocoa pod+3% molasses+Phanerochaete chrysosporium inoculum). Analysis of proximate and Van Soest's fiber fraction were performed on the respective treatments. The pods were then subjected to an in vitro digestibility evaluation by incubation in rumen fluid-buffer medium, employing a randomized complete block design (n = 3 replicates). Further, an in vivo evaluation of the pods (35% inclusion level in total mixed ration) was conducted by feeding to young Holstein steers (average body weight of $145{\pm}3.6kg$) with a $5{\times}5$ latin square design arrangement (n = 5 replicates). Each experimental period lasted for 30 d; the first 20 d was for feed adaptation, the next 3 d was for sampling of rumen liquid, and the last 7 d was for measurements of digestibility and N balance. Results revealed that lignin content was reduced significantly when cocoa pod was treated with urea, molasses, rumen content or P. chrysosporium (p<0.01) with the following order of effectiveness: CPh>CAm>CRu>CMo. Among all treatments, CAm and CPh treatments significantly improved the in vitro dry matter and organic matter digestibility (p<0.05) of cocoa pod. Average daily gain of steers receiving CAm or CPh treatment was significantly higher than that of control (p<0.01) with an increase of 105% and 92%, respectively. Such higher daily gain was concomitant with higher N retention and proportion of N retention to N intake in CAm and CPh treatments than those of control (p<0.05). It can be concluded from this study that treatment with either urea or P. chrysosporium is effective in improving the nutritive value of cocoa pod.

• 문화기술의 융합
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• 제6권2호
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• pp.515-520
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• 2020

디지털 회로설계 기술에서 사용되는 CMOS는 양자 터널링 현상 등으로 인해 집적도의 한계에 다다르고 있다. 이를 대체할 수 있는 양자점 셀룰러 오토마타(QCA : Quantum-dot Cellular Automata)는 적은 전력 소모와 빠른 스위칭 속도 등으로 많은 장점이 있음으로 CMOS의 많은 디지털 회로들이 QCA 기반으로 제안되었다. 그중에서도 멀티플렉서는 D-플립플롭, 레지스터 등 다양한 회로에 쓰이는 기본 회로로써 많은 연구가 되고 있다. 하지만 기존의 멀티플렉서는 공간 효율성이 좋지 않다는 단점이 있다. 따라서, 본 논문에서는 셀 간 상호작용을 이용하여 새로운 다층구조 멀티플렉서를 제안하고, 이를 이용하여 D-래치를 제안한다. 본 논문에서 제안하는 멀티플렉서와 D-래치는 면적, 셀 개수, 지연시간이 개선되었으며, 이를 이용하여 큰 회로를 설계할 시 연결성과 확장성이 우수하다. 제안된 모든 구조는 QCADesigner를 이용해 시뮬레이션하여 동작을 검증한다.

• 전자공학회논문지SC
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• 제39권3호
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• pp.191-200
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• 2002

본 논문에서는 다변수 다치 논리함수에 대하여 구간함수를 절단 차분 함수로 변환하는 방법을 제시하였고, 절단 차분 함수를 전류모드 CMOS에 의한 전류 미러 회로와 금지회로를 사용하여 일정한 패턴을 갖는 다치 논리회로로 구현하는 방법을 제시하였다. 또한 제시한 방법을 2변수 4치 MOD(4) 가산 진리표와 2변수 4치 유한체 GF(4)상의 승산 진리표를 실현하는 회로의 구현에 적용하였다. PSpice 시뮬레이션을 통하여 이 회로들에 대하여 동작특성을 보였다. 회로들의 시뮬레이션은 2㎛ CMOS 표준 기술을 이용하였고, 단위 전류를 15㎂로 하였으며, 전원전압은 3.3V를 사용하였다. 본 논문에서 제시한 전류모드 CMOS에 의해 구현된 회로들은 일정한 패턴, 상호연결의 규칙성을 가지며, 다치 논리함수의 변수의 확장성을 가지므로 VLSI 실현에 적합할 것으로 생각된다.

• 전기전자학회논문지
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• 제14권2호
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• pp.90-97
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• 2010

본 논문에서는 DT-CMOS(Dynamic Threshold voltage CMOS) 스위칭 소자와 DTMOS Error Amplifier를 사용한 고 효율 전원 제어 장치(PMIC)를 제안하였다. 높은 출력 전류에서 고 전력 효율을 얻기 위하여 PWM(Pulse Width Modulation) 제어 방식을 사용하여 PMIC를 구현하였으며, 낮은 온 저항을 갖는 DT-CMOS를 설계하여 도통 손실을 감소시켰다. 벅 컨버터(Buck converter) 제어 회로는 PWM 제어회로로 되어 있으며, 삼각파 발생기, 밴드갭 기준 전압 회로, DT-CMOS 오차 증폭기, 비교기가 하나의 블록으로 구성되어 있다. 제안된 DT-CMOS 오차증폭기는 72dB DC gain과 83.5위상 여유를 갖도록 설계하였다. DTMOS를 사용한 오차증폭기는 CMOS를 사용한 오차증폭기 보다 약 30%정도 파워 소비 감소를 보였다. Voltage-mode PWM 제어 회로와 낮은 온 저항을 스위칭 소자로 사용하여 구현한 DC-DC converter는 100mA 출력 전류에서 95%의 효율을 구현하였으며, 1mA이하의 대기모드에서도 높은 효율을 구현하기 위하여 LDO를 설계하였다.

• 센서학회지
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• 제5권6호
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• pp.25-34
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• 1996

본 논문에서는 압저항형 압력센서를 위한 신호처리회로를 설계하였다. 신호처리회로는 압저항형 압력센서를 구동하기 위한 기준전압 회로와 미소한 센서 신호의 증폭을 위한 인스트루먼트 증폭기로 구성이 되어있다. 신호처리회로는 단일 폴리 이중 메탈(single poly double metal) $1.5\;{\mu}m$ BiCMOS 공정 파라미터를 이용하여 HSPICE로 시뮬레이션 하였다. 시뮬레이션 결과, 밴드갭 기준전압회로의 온도 계수는 $0\;{\sim}\;70^{\circ}C$의 범위에서 $21\;ppm/^{\circ}C$였고 PSRR은 80 dB였다. BiCMOS 증폭기의 이득, 옵셋, CMRR, CMR, PSRR, 특성은 CMOS나 바이폴라보다 우수하였고 전력소비 및 잡음전압 특성은 CMOS가 우수하였다. 설계한 신호처리 회로는 옵셋이 적고 입력 임피던스가 높으며 CMRR 특성이 우수하기 때문에 센서 및 계측용 신호처리회로로서 사용하기에 적합하다.

• 동의생리병리학회지
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• 제17권4호
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• pp.952-957
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• 2003

To certify the protective effect of herbal medicine against oxygen free radical-induced myocardiotoxicity, cytotoxicity was measured using LDH activity and TBARS assay in the presence of Jisilhaebaekgyejitang(JHGT) extracts or single constituents of this prescription, In the present study, xanthine oxidase/hypoxanthine (XO/HX) resulted in a cell damage such as increases in LDH activity in culture medium and lipid peroxidation in cultured myocardial cells. In the effect of JHGT extract and its single constituents, which are Fructus Ponciri Seu Aurantii Immaturus (FPSAI), Cortex Magnoliae Officinalis (CMO), Bulbus Allii Macrostemi (BAM), Ramulus Cinnamomi (RC) and Fructus Trichosanthis (FT), they showed the prevention from the XO/HX-induced cardiotoxicity by the decrease of LDH activity and lipid peroxidation. From these results, they show that XO/HX is cardiotoxic in cultured myocardial cells derived from neonatal rat, and it suggests that JHGT, FPSAI, PT, CMO, BAM, RC and FT extracts are positively effective in the blocking in XO/HX-induced cardiotoxicity.

• 한국컴퓨터산업학회논문지
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• 제3권1호
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• pp.57-66
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• 2002

본 논문에서는 전류모드 CMOS의 기본회로를 이용해 다치 논리(Multiple-Valued Logic) 연산기를 설계하고자 한다. 우선, 2진(Binary)FFT(Fast Fourier Transform)를 확장해 다치 논리회로를 이용해서 고속 다치 FFT 연산기를 구현하였다. 다치 논리회로를 이용해서 구현한 FFT연산은 기존의 2치 FFT과 비교를 해 본 결과 상당히 트랜지스터의 수를 줄일 수 있으며 회로의 간단함을 알 수가 있었다. 또한, 캐리 전파 없는 가산기를 구현하기 위해서 ｛0,1,2,3｝의 불필요한(Redundant) 숫자 집합을 이용한 양의 수 표현을 FFT회로에 내부적으로 이용하여 결선의 감소와 VLSI 설계시 정규성과 규칙성으로 효과적이다. FFT승산을 위해서는 승산기의 연산시간과 면적을 다치 LUT(Look Up Table)로 이용해 승산의 역할을 하였다. 마지막으로 이진시스템(Bin system)과의 호환을 위해 다치 하이브리드형 FFT 프로세서를 제시하여 2진4치 부호기와 4치 2진 복호기 및 전류모드 CMOS회로를 사용하여 상호 호환성을 갖도록 설계를 하였다.

• Journal of Ceramic Processing Research
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• 제13권spc2호
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• pp.341-345
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• 2012

[Li0.055(K0.5Na0.5)0.945](Nb1-xTax)O3 (0.05 ≤ x ≤ 0.25) ceramics were prepared by the partial sol-gel (PSG) method to improve the microstructure homogeneity of Ta5+ ion and were compared to those prepared by the conventional mixed oxide (CMO) method. For the PSG method, Ta(OC2H5)5 was directly reacted with calcined [Li0.055(K0.5Na0.5)0.945]NbO3 powders and the specimens sintered at 1100 ℃ for 5 hrs showed a single phase with a perovskite structure. Compared to the specimens prepared by conventional mixed oxide powders, the relative ratio of tetragonal phase to orthorhombic phase of the sintered specimens prepared by Ta(OC2H5)5 was larger than that of the sintered specimens prepared by Ta2O5. The electromechanical coupling factor (kp), piezoelectric constant (d33) and dielectric constant (εr) of the sintered specimens were increased with Ta5+ content. These results could be attributed to the decrease of the orthorhombic-tetragonal polymorphic phase transition temperature (To-t), which could be evaluated by oxygen octahedral distortion. Strain of the sintered specimens prepared by the PSG method was higher than that of specimens prepared by the CMO method due to the increase of relative density. The effects of crystal structure on the strain characteristics of the specimens were also discussed.

• 한국마이크로전자및패키징학회:학술대회논문집
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• 한국마이크로전자및패키징학회 2001년도 추계 기술심포지움
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• pp.209-212
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• 2001

DRAM과 Logic을 하나의 칩 위에 제조하기 위한 EDL (Embedded DRAM and Logic) 기술에 코발트 실리사이드가 접촉저항을 낮추기 위해 사용된다. 본 연구에서는 코발트 실리사이드 제조에 사용되는 보호막이 CMOS 소자의 전기적 특성에 미치는 영향을 조사하였다. EDL 제조공정이 완전히 진행된 소자에 적용된 실리사이드가 누설전류에 미치는 영향을 비교하였다. 또한 실리사이드 보호막이 전기적 신호의 delay에 미치는 영향을 평가하기 위해, 99개의 CMOS 인버터가 직렬연결되어 있는 평가패턴을 사용하였다. 이상의 결과로 TiN 보호막이 pMOSFET의 전류전달 능력과 그 결과로 생기는 속도지연 측면에서 Ti 보호막보다 우수함을 알 수 있었다.