• Journal of the Microelectronics and Packaging Society
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• v.5 no.2
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• pp.65-69
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• 1998

본 연구는 전하 결합 영양소자에서 감지회로의 특성을 향상시키기 위하여 N형 MOSFET과 Polysilcon 저항에 의한 전압 분배 회로를 가진 감지회로를 설계하였다. 감지회 로에 흐르는 전류는 전압분배회로를 N형 MOSFET으로 설계하였을때가 Polysilicon 저항으 로 설계한 경우보다 감도 특성도 좋은 것으로 나타났다. 이는 전압분배회로를 Polysilicon으 로 설계한 경우보다 N형 MOSFET으로 설계하였을 때 동작 주파수가 높을수록 전압이득 특성이 우수하기 때문이다. 감지회로에 흐르는 전류는 전압분배회로를 N형 MOSFET으로 설계하였을 때 2mA 정도를 나타내고 polysilcon으로 설계하였을 때 4mAwjd도로 나타났다.

• Journal of the Korean Institute of Intelligent Systems
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• v.26 no.4
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• pp.273-278
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• 2016

In this paper, chaotic circuit of the Lorentz system using multipliers, operational amplifiers, capacitor, fixed resistor and variable resistor for control has been designed in a electronic circuit. Through PSPICE program, electrical characteristics such as time waveforms, frequency spectra and phase attractors analyzed. And in the special area ($10{\sim}100k{\Omega}$) of the $500k{\Omega}$ control variable resistor, the circuit showed chaotic dynamics. Also, we implemented the circuit in a electronic hardware system with discrete elements. Measured results of the circuit coincided with simulated data.

• Proceedings of the KIPE Conference
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• 2013.11a
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• pp.67-68
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• 2013

저가형 저전력 LED 구동회로에서는 종종 직렬 저항을 이용한 전류 밸런스 회로를 사용한다. 이러한 회로에서 밸런싱 저항은 양산시 생기는 LED 순방향 전압의 편차에 관계없이 LED 스트링간의 전류 밸런싱을 유지시키는 역할을 한다. 본 논문에서는 직렬 저항의 공칭값과 공급 전압값을 최적설계 하기위한 효과적인 설계 알고리즘을 제안한다. 제안한 알고리즘은 몬테카를로 기법을 사용하여 순방향 전압의 통계적인 산포와 직렬저항 소자의 상용값 및 공차를 동시에 고려하고, 비용함수를 도입하여 회로 최적화를 진행한다. 기존의 설계 방법 대비 성능 개선 정도를 구체적인 설계사례를 통해 비교 분석함으로써 제안 방법을 검증한다.

• Journal of the Korean Institute of Telematics and Electronics
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• v.11 no.1
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• pp.15-22
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• 1974

A new ternary full adder using the current controlled negative-resistance circuit is described. The full adder is constructed from the modified-half-adder which was devised by making use of a negative resistance circuit. This full adder makes the number of its gates decrease and makes its own speed increase in comparison with the full adders which had been introduced previously. It is convenient to construct to the integrated circuit because transistor, SBD(Schottky Barrier Diode) and resistors were used as the circuit elements.

• Journal of the Institute of Electronics Engineers of Korea SD
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• v.41 no.3
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• pp.8-8
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• 2004

본 논문에서는 새로운 interpolation-2 방식의 비교기 구조를 제안하여 칩 면적과 전력 소모를 줄이며 오류정정 회로를 내장하는 6-비트 70㎒ ADC를 설계하였다. Interpolation 비교기를 적용하지 않은 flash ADC의 경우 2n개의 저항과 2n -1개의 비교기가 사용되며 이는 저항의 수와 비교기의 수에 비례하여 많은 전력과 큰 면적을 필요로 하고 있다. 또한, interpolation-4 비교기를 적용한 flash ADC는 면적은 작으나 단조도, SNR, INL, DNL 특성이 떨어진다는 단점이 있었다. 본 논문에서 설계한 interpolation-2 방식의 ADC는 저항, 비교기, 앰프, 래치, 오류정정 회로, 온도계코드 디텍터와 인코더로 구성되며, 32개의 저항과 31개의 비교기를 사용하였다. 제안된 회로는 0.18㎛ CMOS 공정으로 제작되어 3.3V에서 40mW의 전력소모로 interpolation 비교기를 적용하지 않은 flash ADC에 비해 50% 개선되었으며, 칩 면적도 20% 감소되었다. 또한 노이즈에 강한 오류정정 회로가 사용되어 interpolation-4 비교기를 적용한 flash ADC 에 비해 SNR이 75% 개선된 결과를 얻었다.

• Composites Research
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• v.12 no.2
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• pp.1-9
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• 1999

The piezoelectric material connected to external electric networks possesses frequency dependent stiffness and loss factor which are also affected by the shunting circuit. The external electric networks are generally specialized for two shunting circuits: one is the case of a resistor alone and the other is the combination of a resistor and an inductor. For resistive shunting, the material properties exhibit frequency dependency similar to viscoelastic materials, but are much stiffer and more independent of temperature. Shunting with a resistor and inductor introduces an electrical resonance, which can change the characteristics of structural resonance optimally in a manner analogous to a PMD (proof mass damper). Passive damping enhancement of composite beam using piezoelectric material connected to external electrical networks is achieved and presented in this paper.

• Proceedings of the KIPE Conference
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• 2014.07a
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• pp.337-338
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• 2014

본 논문에서는 배터리 셀 간의 빠른 전하 균일화를 위한 새로운 셀 밸런싱 회로를 제안한다. 대칭적인 다권선 변압기를 이용하는 밸런싱 회로의 경우 셀들 간의 밸런싱 전류의 크기가 회로 내부 저항 및 변압기의 누설 인덕턴스에 의해 크게 제약 받고, 배터리 셀 간의 밸런싱이 이루어짐에 따라 충방전 전류가 감소한다는 단점이 있다. 본 논문에서는 보조 회로를 이용하여 밸런싱 전류를 부스트 업 시켜 빠르게 셀 간의 전하 밸런싱을 맞추어주는 회로를 제안한다. 이를 통해 회로 내부 저항의 영향을 줄이고 일정한 충방전 전류를 흘려보냄으로 빠르게 셀 전하들의 밸런싱을 맞출 수 있다.

• Journal of the Korean Institute of Telematics and Electronics
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• v.8 no.5
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• pp.10-19
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• 1971

Problems and technologies involved in integrating an audio preamplifier in terms of thick film technology has been discussed in detail. In particular, an attempt has been made to find methods for functional trimming of the amplifer by employing computer analysis. Among seven resistors integrated on a alumina substrate, only one resistor was found to be very sensitive to over all performance of the preamplifier. By trimming this resistor to its freguency charcteristic reguirements, it was possible to cut down trimming labor by one seventh. Besides, problems concerning resistor conductor contacts, crossover parasitic capacitance and the relations between noise per(ormance and trimming method are discussed in detail.

• The Journal of Korean Institute of Electromagnetic Engineering and Science
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• v.15 no.6
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• pp.590-598
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• 2004

An active capacitance circuit which employs series feedback network for the implement of negative resistance and low noise operation is analyzed in depth and its application to low noise active RF BPF's is discussed. Whereas many authors reported a lot of circuits that embody negative resistance circuit most of them have concerns for the equivalent resistance and reactance value at the center frequency. In this case, it could be possible to face a problem that the negative resistance circuit becomes unstable, or have poor flatness in passband because of insufficient forecast for the negative resistance values as the frequency goes higher or lower. In this paper, we extracted the exact equivalent values of this circuit and analyzed the RF characteristics with the varying the values of active devices and feedback circuits and presented the method that the flatness of passband can be improved. We have designed a 4-pole active BPF, which has the bandwidth of 60 ㎒, 0.67 ㏈ insertion loss, 0.3 ㏈ ripple, and noise figure of 3.0 ㏈ at 1.99 ㎓ band.

• Journal of the Korea Academia-Industrial cooperation Society
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• v.13 no.12
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• pp.6046-6051
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• 2012

In this paper, we designed a Chua's chaotic circuit using transcondcutor based nonlinear resistor for secure communication applications. Proposed chaotic circuit consist of passive devices such as L and C, a MOS based variable resistor and a transcondcutor based Chua's diode. From SPICE simulation results, the proposed circuit showed variable chaotic dynamics through time waveforms, frequency analysis and phase plots.