• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2009년도 정보 및 제어 심포지움 논문집
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• pp.175-177
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• 2009

통신이나 저장 매체에서 에러 정정을 위해 사용하는 비터비 디코더를 1에 해당하는 회로와 0에 해당하는 회로로 나누어 구성하고 각 출력 값의 크기를 비교함으로써 디코딩을 수행하는 구조를 연구하였다. 특히, 디코딩회로를 하드웨어 구현 시의 mismatching에 대비하기 위해, 경로에러를 증폭하여 두 회로 출력 값 사이의 마진을 크게 하는 방법을 제안하였다. 제안한 구조에 대한 시뮬레이션 결과 노이즈가 매우 심한 경우에도 높은 에러 정정 성능을 보였다.

• 한국산업정보학회:학술대회논문집
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• 한국산업정보학회 1999년도 춘계학술대회 발표논문집
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• pp.53-57
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• 1999

본 논문에서는 입출력간의 연관관계가 트리구조로 표현되는 DTG(Directed tree graph)에 의한 고속병렬다치논리회로를 설계하는 알고리즘과 DTG의 각 절점에 코드를 할당하는 알고리즘을 제안한다. 임의의 절점을 갖는 DTG에 대하여 본 논문에서는 절점들이 매개변수에 의하여 표현될 때 양의 정수로 표현되도록 논리레벨 P를 할당하고 각 레벨에 각기 다른 잉여절점을 추가하여 회로를 설계한다. 또한, 절점들의 입출력 관계를 단지 하나의 매개변수 m$_{i}$를 이용하여 전달행렬 A를 구하기 때문에 더 빠르고 간단하게 회로를 설계할 수 있다. 본 논문에서 제안한 알고리즘은 Nakajima 등에 의해 제안된 알고리즘으로는 설계가 가능하지 않았던 임의의 절점을 가지는 DTG에 대해서도 회로를 설계할 수 있는 장점이 있다. 또한, 자연수 내에서 선형성, 정규성, 및 가시적인 장점을 가지며 절점수의 감소를 통한 처리속도의 향상, 회로 구성의 간략화 및 비용절감등의 장점등이 있다.

• 제어로봇시스템학회지
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• 제1권3호
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• pp.83-91
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• 1995

이 글에서는 신경회로망의 장점과 퍼지논리의 장점을 최대한 이용하며 각각의 단점을 보완하는 뉴로-퍼지 융합 기술과 현재 연구의 흐름을 간단히 살펴보았다. 비구조적인 정보 뿐만 아니라 구조적인 정보까지도 신경회로망의 영역 안에서 처리할 수 있는 새로운 뉴로-퍼지 회로망을 소개하였다. 소개한 뉴로-퍼지 회로망은 비퍼지화와 비퍼지화에 의해 발생하는 오차를 잘 보상할 수 있을 뿐만 아니라, 최적의 입출력 퍼지 소속 함수의 중심점과 모양을 찾을 수 있는 장점이 있다. 또한, 그 특성을 알지 못하는 임의의 비선형 동적 시스템에서 입출력 데이터만 얻을 수 있으며 시스템을 모델할 수 있는 퍼지 규칙을 언어적인 방법과 수치적인 방법으로 표현할 수 있으며 간단한 예제를 통한 시뮬레이션 결과를 보였다. 소개한 뉴로-퍼지 회로망을 이용하여 뉴로-퍼지 제어기를 구성할 수도 있으며, 또한 시스템의 역 퍼지 규칙을 찾는데 이용할 수도 있다. 향후 보다 우수한 일반화 성능을 가질 수 있는 뉴로-퍼지 회로망의 개발이 필요하며, 충분한 입출력 데이터를 얻는 방법의 연구도 필요하다.

• 한국ITS학회 논문지
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• 제9권5호
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• pp.67-71
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• 2010

본 논문에서는 L-형 회로구조에 기반한 새로운 이중대역 임피던스 변환기를 제안한다. 제안된 회로는 전원 또는 부하단에 하나의 스터브 선로가 부착된 전송선로를 사용하여 구성된다. 각 회로 구조와 부하조건에 대해 이중대역 동작조건을 자세히 분석하였으며 이로부터 선로의 길이와 임피던스 등의 이중대역 설계 공식을 간단한 형태로 유도하였다. 제안된 방법을 이용하여 이중대역 임피던스 정합회로를 설계하고 마이크로스트립 회로로 제작, 측정하여 이중대역 동작을 확인하였다.

• 전력전자학회:학술대회논문집
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• 전력전자학회 2002년도 전력전자학술대회 논문집
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• pp.627-630
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• 2002

본 논문에서는 플라즈마 디스플레이 패널(PDP)의 높은 소비 전력을 줄이기 위해 요구되어지는 에너지 회수회로를 제안한다. 제안하는 회로는 기존의 회로와 비교하여 저가형 구조를 가지며 효율을 증대 시킬 수 있는 장점을 가진다 본 회로는 유지 구간 동안 두 번의 공진을 수행하게 된다. 패널과 병렬로 결합된 인덕터와 외부 캐패시터 사이에서 발생하는 첫 번째 공진은 정$\cdot$부의 선택적인 펄스를 발생시키기 위해 이용되고, 스위치 오프 구간동안 순간적으로 발생되는 인덕터와 패널사이의 두번째 공진은 PDP의 용량성 변위 전류에 의한 에너지를 회수하게 된다. 제안하는 회로의 동작원리와 설계절차를 제시하였으며, 7.5인치 패널을 이용한 시작품을 제작하여 시뮬레이션과 실험결과를 통해 타당성 을 검증하였다.

• 한국통신학회논문지
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• 제10권1호
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• pp.42-47
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• 1985

본 논문에서는 대각선으로 출력이 1이 되는 양수 =1을 실현하는 간단한 논리회로를 제시하며 동시에 2출력을 갖는 ROM구조의 $\textrm{I}^2\textrm{L}$에 의한 다치논리회로의 설계를 제시한다. 제시된 회로는대칭적인 다치진리치표의 회로설계와 독립변수를 갖는 다치진리치표의 회로설계에 적합하다. 또한 Galois field(GF) 다치진리치표에 적용하였다.

• 전력전자학회:학술대회논문집
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• 전력전자학회 2012년도 전력전자학술대회 논문집
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• pp.275-276
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• 2012

최근 노트북 및 UPS, 그리고 전기자동차에 이르기까지 배터리를 사용하는 분야에서 에너지 밀도가 높은 리튬이온 배터리가 주로 사용된다. 이러한 리튬 이온 배터리의 안전성을 보장하고 배터리 수명을 늘리기 위해서는 각 셀 간의 전하 균일이 필요하며 여러 전하 균일 회로가 연구되었다. 이중 자기소자가 없이 능동 전하 균일을 이룰 수 있는 스위치드 커패시터 방식은 가장 간단하고 작은 부피로 제작이 가능하며, 셀 전압 센싱 없이 자동적으로 전하 균일을 이룰 수 있는 장점이 있으나, 전하 균일 속도가 셀 수가 증가 할수록 현저하게 느려지는 단점을 보인다. 제안하는 셀 전하 균일회로는 체인구조의 스위치드 커패시터 회로를 통하여 셀 간의 전하 균일 속도를 향상시킬 수 있다. 본 논문에서는 제안된 회로의 동작원리를 설명하고 실험을 통해 제안된 회로의 뛰어난 전하 균일 성능을 검증한다.

• 전력전자학회:학술대회논문집
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• 전력전자학회 2019년도 전력전자학술대회
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• pp.17-19
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• 2019

본 논문에서는 전기자동차(EV) 충전기용 위상천이 풀브리지(PSFB) 컨버터의 정류기 다이오드 전압 스트레스를 저감하기 위한 새로운 형태의 클램핑 회로를 제안한다. 제안하는 회로는 하나의 커패시터로 구성된 매우 단순한 구조임에도 불구하고, 정류기 다이오드의 전압 스트레스를 큰 폭으로 감소시킨다. 뿐만 아니라, 해당 회로는 프리휠링 구간의 전류를 감소시키며, 출력 인덕터의 사이즈 또한 줄일 수 있다는 장점을 지닌다. 따라서 제안된 컨버터는 정류기 다이오드의 도통손실을 큰 폭으로 저감하여 고효율을 달성할 수 있으며, 간단한 구조의 클램핑 회로와 줄어든 출력 필터 사이즈에 의해서 고밀도화를 달성할 수 있다. 제안된 컨버터의 타당성은 3.3kW, $270-420V_{DC}$의 CC-CV 모드 충전 조건하에서 실험하여 검증되었다.

• 한국통신학회논문지
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• 제18권6호
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• pp.854-862
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• 1993

CMOS아날로그 및 아날로그 디지탈시스템은 여러 개의 기본회로로 구성되어지며 그중에서도 증폭회로 부분은 시스템의 성능을 결정할 수도 있는 중요한 블럭중에 하나이다. 증폭회로는 시스템에서 사용되어지는 용도에 따라서 여러가지 구조(고이득, 저전력, 고속회로등)를 가지며 이러한 증폭회로를 설계하기 위하여 증폭기내의 입력증폭단의 설계 방법도 다양하다. 본 논문에서는 CMOS 상보형 차동이득 구조를 갖는 새로운 형태의 입력 차동증폭 회로를 제안하였다. 제안된 회로는 CMOS 상보형 회로에 의하여 고이득 특성을 가지며, 바이어스 전류를 내부적으로 공급하여 전체 시스템 구성시, 바이어스회로를 구성하기 위한 트랜지스터의 수를 줄일 수 있다. 이 회로를 표준 $1.5{\mu}m$ 공정파라메타를 이용한 SPICE 시뮬레이션을 통하여 광범위하게 이용되고 있는 CMOS 차동증폭 회로와 비교해 본 결과, 오프셋, 위상마진등의 특성이 그대로 유지된 상태에서 이득이 배가 되었다. 또한 제안된 회로를 이용하여 높은 출력스윙(-4.5V-+4.5V)과 함께 7nsec(CL-1pF) 이하의 세틀링시간을 갖을 수 있는 CMOS비교기를 설계하였다.

• 한국정보통신학회논문지
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• 제14권9호
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• pp.2023-2030
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• 2010

본 논문에서는 3차원 그래픽스 시스템에 적용 가능한 고성능 스캔변환회로를 설계하고 FPGA로 구현한 내용을 기술한다. 스캔변환회로의 성능을 높이기 위하여 본 논문에서는 계층적 타일기반 탐색기법과 SIMD 구조를 적용한 스캔변환회로 구조를 제안한다. 제안한 스캔변환회로는 Xilinx Vertex4 LX100 FPGA 디바이스에서 약 124Mhz로 동작가능하며, 실제 연산결과의 올바른 출력을 확인하기 위해 셰이더, 텍스처 매핑회로 그리고 $240{\times}320$ 컬러 TFT-LCD의 컨트롤러를 설계하여 통합하였다. FPGA상에 구현된 스캔변환회로는 약 311Mpixels/sec의 픽셀 생성율을 가지므로 데스크 탑 PC용 3차원 그래픽스 시스템뿐만 아니라 고성능을 요구하는 모바일 3차원 그래픽스 시스템에도 적용 가능하다.