• 한국표면공학회지
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• 제49권5호
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• pp.447-453
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• 2016

In this study, we intended to extend the life of electropolishing solution through the reduction of electric resistance by improving the electrolysis efficiency. The optimum conditions were obtained by half round bus bar and Taguchi method. As the main control factors in the electropolishing process, current density, polishing time, electrolyte temperature and flow rate were selected. The electrolyte temperature was the most significant to the electrolysis efficiency. The optimum conditions for the life extension of electropolishing solution were as follows: current density, $45A/dm^2$; polishing time, 6 min; electrolyte temperature, $70^{\circ}C$; flow rate, 11 L/min. As a results of ANOVA of SN ratios, it was found that the electrolyte temperature was significant factor at the 90% confidence level.

• 한국방송∙미디어공학회:학술대회논문집
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• 한국방송공학회 2002년도 정기총회 및 학술대회
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• pp.63-68
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• 2002

JPEG2000은 기존의 정지영상압축부호화 방식에 비해 우수한 비트율-왜곡(Rate-Distortion)특성과 향상된 주관적 화질을 제공하며 인터넷, 디지털 영상카메라, 이동단말기, 의학영상 등 다양한 분야에서 적용될 수 있는 새로운 정지영상압축 표준이다. 본 논문에서는 SoC(System on a Chip)설계를 고려한 JPEG2000 인코더의 구조를 제안하고 IP(Intellectual Property)를 설계 및 검증하였다. 구현된 JPEG2000 IP는 DWT(Discrete Wavelet Transform)블록, 스칼라양자화블록, EBCOT(Embedded Block Coding with Optimized Truncation)블록으로 구성되어 있다. IP는 모의실험을 통해 구현 구조에 대한 타당성을 검증하였고, 반도체설계자산연구센터에서 제시한 'RTL Coding Guideline'에 따라 HDL을 설계하였다. 특히, DWT블록은 구현시 많은 연산과 메모리 용량이 필요하므로 영상을 저장할 외부 메모리를 사용하였고, 빠른 곱셈과 덧셈연산을 위한 3단 파이프라인 부스곱셈기(3-state pipeline booth multiplier)와 캐리예측 덧셈기(carry lookahead adder)를 사용하였다. 설계된 JPEG2000 IP들은 삼성 0.35$\mu\textrm{m}$ 라이브러리를 이용하여 Synopsys사 Design Analyzer 틀을 통해 논리 합성하였으며, Xillinx 100만 게이트 FPGA칩에 구현하여 그 동작을 검증하였다. 또한, Hard IP 설계를 위해 Avanti사의 Apollo툴을 이용하여 Layout을 수행하였다.

• 전기학회논문지
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• 제66권11호
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• pp.1651-1656
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• 2017

This paper deals with the thermal and mechanical properties of ceramic coating material for bus bars. A ceramic coated samples were prepared for the mechanical properties test. There are two types of samples. One is a square shape and the other is a busbar shape. Each sample was deteriorated for 30 days to compare the thermal and mechanical properties with the non-degraded samples. Two thermal properties tests are TGA and flammability tests, and four mechanical properties tests are drop impact test, cross cut, tensile test, and bend test. The ceramic coating material was never damaged by impact and did not separate from aluminum in the cross cut test. In the tensile test, the breakage of the insulating material did not occur until aluminum fractured, and the breakage of the insulating material did not occur until the maximum load in the bending test. The decomposition temperature (melting point) of the ceramic coating material was higher than that of other epoxy insulators. This ceramic coating material is nonflammable and it has excellent fire stability.

• 대한전기학회:학술대회논문집
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• 대한전기학회 1998년도 하계학술대회 논문집 A
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• pp.302-304
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• 1998

Self magnetic field in a Bus bar usually degrades the critical current in it. Actually the total critical current of a Bus bar is not the same as the sum of total critical current of each stacked HTS tape. This is due to the self field effects in a bus bar. To reduce the degradations of critical current in a bus bar, we need to analyze the self field distributions in a bus bar. Conceptually, by rearranging the each stacked tapes, the self field effects can be minimized. In this paper, we calculate the self magnetic field distributions across a bus bar analytically, with the variations of the relative angle of the two conductors in a go-and-return pair. As a result, we suggest that the optimum relative angle exist which minimize the self field effect in a bus bar.

• 한국컴퓨터정보학회논문지
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• 제13권7호
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• pp.221-229
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• 2008

컴퓨터와 더불어 멀티미디어의 발전은 가상현실이라는 신기술을 만들어 내게 하였고 가상현실 분야 중 컴퓨터 시뮬레이션 기술은 항공, 자동차, 의학, 스포츠, 교육, 패션 분야에 이르기까지 그 적용이 확대되고 있다 본 연구는 헤어스타일링 분야에서 기존의 2차원 헤어시뮬레이션의 개발 및 상용 현황과, 연구 단계에 있는 3차원 헤어스타일 시뮬레이션의 개발 현황을 살펴본다. 아울러 현재 개발된 3차원 헤어스타일 시뮬레이션이 상용화하기 위해서는 3D 시스템 부스의 조정, 저가 저화질의 카메라 개선 등의 문제점이 있음을 제시하였다. 이를 개선하기 위해서 object photography 방식에서 panoramic photography 방식의 전환, 중 고가의 고화질 카메라로의 대체들을 제안한다.

• Journal of the Korean Data and Information Science Society
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• 제22권6호
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• pp.1041-1051
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• 2011

정보기술의 발달은 인간에게 많은 유익한 정보를 쉽게 제공하고 있으나 그 유익한 정보를 부적절한 사용자로부터 보호할 필요가 생겼다. 정보와 관련된 위험을 분석 및 관리하는 과정에서 정보에 대한 가치를 정확히 측정해야 한다. 한 가지 방법으로 조건부 가치 측정법에 대하여 고찰하려 한다. 공공재 또는 비시장재의 가치를 평가하는 방법인 조건부 가치 측정법을 통하면 관심 대상의 가치에 대한 불용의액수를 통계인 방법으로 추정할 수 있다. 특별히, 지불 용의액에 대한 신뢰구간의 추정에 초점을 맞추어 보았다. 정보시스템에 존재하는 정보의 가치를 보전하기 위해 지불하고자 하는 금액으로부터 정보의 가치를 통계적으로 추정하는 방법을 R을 이용한 사례를 분석하여 소개한다.

• 한국IT서비스학회지
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• 제10권1호
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• pp.35-46
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• 2011

As development of exhibition, it has been an important issue to analyze exhibition for the next success of exhibition. A lot of existing researches have focused on the exhibitor's and visitor's satisfaction problem. However, the exhibitor's satisfaction and success of exhibition come from the analysis of exhibition in the network level. Booths composing exhibition are regarded as nodes in network, so the trace of visitors visiting booths can construct the arc of networks. The purpose of this study is to analyze the booth visiting pattern and components of network through social network analysis using data collected in the $17^{th}$ International KIDS & EDU EXPO for Children. This research is the first approach of network-leveled analysis of exhibition, and the result of network analysis is helpful to support the booth arrangement in next exhibition. Our analysis results the following implications. First, Booths with high degree centrality or betweenness centrality should be deployed in the wide space or corner of the exhibition hall. Finally, booths within a block should be deployed in the same space of the exhibition hall to provide convenience to the visitors and to enhance exhibition performance.

• Journal of Platform Technology
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• 제12권2호
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• pp.58-63
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• 2024

CNN은 이미지 인식분야에서 높은 성능을 보이지만 반복적인 학습이 진행될 경우 많은 데이터 연산처리로 인한 시스템 자원부족으로 학습 시간이 오래 걸리고 많은 전력을 소모한다는 단점이 있다. 이에 본 논문에서는 합성곱 신경망 연산처리의 핵심 요소인 곱셈 프로세싱 엘리먼트에서 곱셈연산을 수행할 때 발생되는 스위칭 엑티비티를 줄이기 위해 승수와 피승수의 교환율을 늘리는 저전력 부스 곱셈기를 기반으로 하는 프로세싱 엘리먼트를 제안한다. 합성곱 신경망 병렬 연산처리를 지원하는 저전력 곱셈 프로세싱 엘리먼트는 Verilog-HDL을 사용하여 설계되었고, Intel DE1-SoC FPGA Board에 구현하였다. 실험은 성능평가에 대표적으로 MNIST의 숫자 이미지 데이터베이스를 대상으로 기존 제안된 곱셈기의 교환율과 비교하여 성능을 검증하였다.

• 분석과학
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• 제28권3호
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• pp.187-195
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• 2015

승화열은 대기 유기 오염물질의 확산에 관련된 환경적인 문제를 해결하거나, 위험한 화학 물질의 위해성을 평가하는 데에 중요한 변수이다. 하지만 실험적으로 승화열을 측정하려면 많은 시간과 비용이 소모 되며, 그 실험자체도 복잡하고 위험하다. 따라서 본 연구에서는 유기화합물의 승화열을 간단하게 예측하는 모델을 개발하기 위하여 정량적 구조-물성 상관관계 연구를 이용하였다. 군기반 전진선택방법을 적용하여 다중선형회귀방법과 서포트 벡터 머신과 같은 학습방법에 적합한 분자표현자들을 선택하도록 하였다. 개별 모델과 복합모델들은 부스트래핑 방법과 y-임의추출법에 의해 내부검증이 되었다. 외부 테스트 데이터의 예측 성능은 적용범위를 고려하므로서 개선되었다. 다중선형회귀모델에 따르면, 승화열은 분자간의 분산력, 수소결합, 정전기적 상호작용, 쌍극자-쌍극자 상호작용과 관련이 있는 것을 나타낼 수 있었다.

• 대한전자공학회논문지SD
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• 제41권9호
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• pp.115-124
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• 2004

본 논문은 고효율, 저전력을 갖는 PRML 디스크 드라이브 읽기 채널용 6비트, 8탭의 FIR 필터 칩을 제안한다. 제안된 필터는 병렬처리 구조를 채택하고 있으며 4단의 파이프라인으로 구성되어 있다. 곱셈 연산을 위하여 수정 부스 알고리즘을 사용하였으며 덧셈 연산을 위하여 압축회로 로직을 사용하였다. 전력 소모를 줄이기 위하여 CMOS 패스-트랜지스터 로직을 사용하였으며 싱글-레일 로직을 이용하여 칩의 면적을 감소시켰다. 제안된 필터는 실제 칩으로 구현되었으며 3.3V 전원을 공급하여 100MHz에서 120mV의 전력을 소비하고 1.88×1.38 ㎟의 면적을 차지한다. 구현된 필터는 유사 선폭의 공정을 사용한 기존구조에 비해 약 11.7%의 전력이 감소하였다.