• 한국정보통신학회:학술대회논문집
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• 한국해양정보통신학회 2004년도 춘계종합학술대회
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• pp.682-684
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• 2004

Random Telegraph Signal(RTS)에 의한 1/f 잡음이 CMOS Ring Oscillator의 Phase Noise와 Jitter에 미치는 영향을 조사한다. 7단 Ring Oscillator의 각 노드에 병렬 연결된 10개의 Piece-Wise-Linear 전류원이 RTS 신호를 모델링 한다. RTS 전류원의 진폭과 Time Constant를 변화시키면서 Ring Oscillator 출력의 FFT 및 전력 스팩트럼 밀도, Jitter를 관찰한다. RTS 전류원의 진폭은 Phase Noise의 폭을 증가시키고 결과적으로 Jitter의 크기도 증가 시키는 것이 확인 되었다. 그리고 RTS Time Constant가 짧아질수록 출력 신호의 FFT peak의 폭이 커지고 Cycle to Cycle Jitter 값이 증가하였다.

• 전기전자학회논문지
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• 제25권2호
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• pp.234-242
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• 2021

위상배열 레이다를 위한 마이크로웨이브 포토닉 (MWP) 시스템을 구현할 경우, 송수신되는 빔의 정확도를 위해서 잡음 및 시간 지연 오차는 최소화 되어야 한다. MWP 시스템에서의 시간 지연 오차는 신호의 잡음에 의해 발생하고 timing jitter에 기인한다. 본 논문에서는 위상배열 레이다를 위한 MWP 시스템에서의 잡음 및 timing jitter에 대하여 분석하였고 광 증폭기의 이득변화에 따른 잡음 및 timing jitter 변화를 실험을 통해 검증하였다. 광 증폭기에 의한 신호의 증폭율과 잡음의 증폭율이 동일할 때까지 신호를 증폭하면 timing jitter는 감소하고 신호의 SNR은 증가하는 것을 확인하였다.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2003년도 하계종합학술대회 논문집 V
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• pp.2625-2628
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• 2003

Phase locked loops are widely used in many applications such as frequency synthesis, clock/data recovery and clock generation. In nearly all the PLL applications, low jitter and fast locking time is required. Without using adaptive loop filter, this paper proposes very simple method for improving locking time and jitter reduction simultaneously in charge pump PLL(CPPLL) using Daul Phase/Frequency Detector(Dual PFD). Based on the proposed scheme, the lock time is improved by 23.1％, and the jitter is reduced by 45.2％ compared with typical CPPLL.

• 방송공학회논문지
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• 제16권5호
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• pp.722-737
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• 2011

본 논문에서는 MPEG-2 TS (transport stream)를 포함하는 TCP 패킷들을 유무선 인터넷 환경에서 프로그레시브 스트리밍 서비스를 통해 클라이언트로 전달할 때 발생하게 되는 네트워크 jitter 를 추정하는 기법을 제안한다. 추정된 네트워크 jitter의 크기를 바탕으로 네트워크 jitter를 흡수할 수 있는 수신측에서 필요한 de-jitter 버퍼링 시간을 계산할 수 있다. 이를 위해서 TS 패킷에 기록되어 있는 PCR (program clock reference) 정보를 활용하여 TCP 패킷 헤더의 optional 필드에 jitter 크기 추정에 필요한 새로운 타임스탬프 정보를 생성한다. 제안된 de-jitter 버퍼링 기법을 IP 망을 통한 프로그레시브 스트리밍 서비스에 활용할 경우 기존의 T-STD 버퍼 모델의 동작 원리를 그대로 따를 수 있게 되어 기존의 T-STD 버퍼 모델을 수정 없이 활용할 수 있다. 제안된 기법은 최근에 국제표준으로 개발된 MPEG DASH (dynamic adaptive streaming over HTTP) 기술에 응용될 수 있다.

• 한국ITS학회 논문지
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• 제10권4호
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• pp.93-99
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• 2011

본 논문에서는 자동차 환경내 안정된 VoIP 통신시스템을 위한 새로운 네트워크 지터 추정 알고리즘을 제안한다. 제안된 알고리즘은 패킷간의 도착시간과 생성시간 차이를 계산하여 패킷이 겪은 현재 네트워크 환경을 추정하고, 추정된 네트워크 환경을 통해 네트워크 지터 추정에 사용될 네트워크 지터 분산 가중치를 조정한 후에, 조정된 지터 분산 가중치와 네트워크 지터의 평균과 분산을 계산하여 다음에 도착할 패킷의 네트워크 지터를 추정한다. 본 논문에서는 WiFi를 이용한 VoIP에서 수신단에 도착한 패킷에 대해 Delay와 Loss를 측정함으로써 제안된 방식의 우수성을 입증하였다.

• 한국정보과학회논문지:컴퓨팅의 실제 및 레터
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• 제16권1호
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• pp.11-16
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• 2010

본 논문에서는 실시간 제어 시스템에서의 지터를 줄이기 위한 스케줄링 기법들을 비교 분석한다. 기존의 실시간 지터에 대한 연구들은 동적우선순위 스케줄링 기법에 초점을 맞추는 반면, 본 논문의 연구는 실제 상황에서 더 널리 사용되는 고정우선순위 스케줄링 기법들에 중점을 둔다. 기존의 연구들에서 사용한 지터의 측정법은 상대적 값을 측정하기 때문에 유용하지 않은 경우가 있음을 지적하고, 새로운 측도를 제시하여 시뮬레이션을 통한 실험을 수행하였다. 실험 결과 본 논문에서 제시된 지터 한계를 이용한 고정우선순위 할당 기법이 지터 감소 및 제어 성능 향상에서 우수한 성능을 보임을 알 수 있다.

• JSTS:Journal of Semiconductor Technology and Science
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• 제14권4호
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• pp.457-462
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• 2014

This letter proposes a low-jitter DLL-based clock generator with two negative feedback loops. The main negative feedback loops suppress the jitter of DLL. The additional negative feedback loops suppress the delay-time variance of each delay stages. Both two negative feedback loops in a DLL results in suppressing the jitter of clock signal further. Measurement results of the DLL-based clock generator with two negative feedback loops fabricated in a one-poly six-metal $0.18{\mu}m$ CMOS process show 5.127-ps rms jitter and 47.6-ps peak-to-peak jitter at 1 GHz.

• ETRI Journal
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• 제33권3호
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• pp.326-334
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• 2011

This paper outlines the time jitter effect of a sampling clock on a software-defined radio technology-based digital intermediate frequency (IF) transceiver for a mobile communication base station. The implemented digital IF transceiver is reconfigurable to high-speed data packet access (HSDPA) and three bandwidth profiles: 1.75 MHz, 3.5 MHz, and 7 MHz, each incorporating the IEEE 802.16d worldwide interoperability for microwave access (WiMAX) standard. This paper examines the relationship between the signal-to-noise ratio (SNR) characteristics of a digital IF transceiver with an under-sampling scheme and the sampling jitter effect on a multichannel orthogonal frequency-division multiplexing (OFDM) signal. The simulation and experimental results show that the SNR of the OFDM system with narrower band profiles is more susceptible to sampling clock jitter than systems with relatively wider band profiles. Further, for systems with a comparable bandwidth, HSDPA outperforms WiMAX, for example, a 5 dB error vector magnitude improvement at 15 picoseconds time jitter for a bandwidth of WiMAX 3.5 MHz profile.

• 한국정보통신학회:학술대회논문집
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• 한국정보통신학회 2017년도 춘계학술대회
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• pp.197-199
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• 2017

본 논문은 RC 시정수 회로를 이용하여 지터 특성을 개선한 위상고정루프의 구조를 제안하였다. RC 시정수 회로에서는 루프 필터 전압이 작은 시정수와 큰 시정수 값을 가지는 회로를 통과하여 비교기로 전달된다. 이런 부궤환 루프는 필터 출력 전압 변동 폭을 줄여서 지터 크기를 감소시켜준다.

• The Journal of the Acoustical Society of Korea
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• 제16권2E호
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• pp.47-54
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• 1997

This paper presents two results on intersymbol interferences in baseband digital communication over an additive white Gaussian noise channel-the interferences due to mismatched square-root raised-cosine filters, in which the filters have different roll-off factors, and / or due to sampling-time jitter. The result for the mismatched filters is that even the jitter-free sampling causes intersymbol interference and it is negligibly small for a wide range of signal-to-noise ratio up to 10dB, for the roll-off factor ranging from 0.2 to 0.5, the mismatch loss being within 0.1dB from the optimum at around 10-6 .For jitter interference an approximation formula for the bit error probability is derived in case of the matched filters, which shows how the roll-off factors and the amount of jitter affect the system performance. The formula is reasonably accurate.