• 제목/요약/키워드: switches

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교류 전동기 구동을 위한 IPM(Intelligent Power Module) IGBT 스위치 성능 분석 방법 개발 (Development of IPM(Intelligent Power Module) IGBT switch performance evaluation system for the driving of the A.C. motor)

  • 최중경
    • 한국정보전자통신기술학회논문지
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    • 제15권4호
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    • pp.291-297
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    • 2022
  • 본 논문은 가전용 교류 전동기 구동을 위한 인버터 회로에 포함된 지능형 스위칭 모듈인 IPM 모듈에 대한 특성 및 신뢰성 계측 회로 설계 방법에 대한 연구이다. IPM은 전동기 구동기의 핵심 부품으로 그 스위칭 특성이 서보 구동 중에 일관되게 유지돼야 한다. 그 특성 중 스위치 온 특성을 결정하는 콜렉터-에미터간 도통 전압 Vce(on) 특성이 중요하다. 인버터 구성의 핵심 부품인 IPM은 여러 브랜드의 제품이 생산되고 있기 때문에 응용시스템의 최적 성능을 위해서는 IPM의 제품군에 따른 IGBT 스위치의 콜렉터-에미터간 도통 전압 Vce(on) 값을 측정하기 위한 방법 및 계측 평가 시스템이 필요하다. 제안된 방법은 제조사별 IPM이 전동기 구동회로에 장착된 상태에서 부하에 따른 Vce(on) 값을 계측 평가할 수 있는 새로운 방법으로 사용자 회사 입장에서는 중요한 설비가 될 수 있다.

256 능동위상배열 기반 연직바람 관측장비의 송수신 채널 크기 및 위상 보정 방법 연구 (Study on TRX Channel Amplitude and Phase Calibration Method for a Radar Wind Profiler Based on 256 Active Phased Array)

  • 정우재;이종철
    • 한국ITS학회 논문지
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    • 제21권5호
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    • pp.162-170
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    • 2022
  • 본 논문에서는 256 능동위상배열 기반의 연직바람 관측장비(RWP)의 송수신 채널의 크기 및 위상을 보정하는 방법등이 논의된다. 별도의 모듈 추가 없이 송수신 전단기 및 송수신 전환기에 커플러 및 스위치를 사용하여 송신 및 수신 보정 경로를 확보하였고, Gain 및 Phase Detector를 사용하여 256 송수신 채널의 크기 및 위상을 독립적으로 보정하였다. 보정된 256 능동위상배열 안테나는 근접전계 시험을 통해 5개의 빔 (연직, 동, 서, 남, 북)의 빔폭 및 사이드 로브가 시뮬레이션 계산 값과 일치함을 확인하였다. 제안된 보정방법은 실외 환경에서 운용되는 능동위상배열 기반의 시스템에 용이하게 적용이 가능하다.

Assessing Efficiency of Handoff Techniques for Acquiring Maximum Throughput into WLAN

  • Mohsin Shaikha;Irfan Tunio;Baqir Zardari;Abdul Aziz;Ahmed Ali;Muhammad Abrar Khan
    • International Journal of Computer Science & Network Security
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    • 제23권4호
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    • pp.172-178
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    • 2023
  • When the mobile device moves from the coverage of one access point to the radio coverage of another access point it needs to maintain its connection with the current access point before it successfully discovers the new access point, this process is known as handoff. During handoff the acceptable delay a voice over IP application can bear is of 50ms whereas the delay on medium access control layer is high enough that goes up to 350-500ms. This research provides a suitable methodology on medium access control layer of the IEEE 802.11 network. The medium access control layer comprises of three phases, namely discovery, reauthentication and re-association. The discovery phase on medium access control layer takes up to 90% of the total handoff latency. The objective is to effectively reduce the delay for discovery phase to ensure a seamless handoff. The research proposes a scheme that reduces the handoff latency effectively by scanning channels prior to the actual handoff process starts and scans only the neighboring access points. Further, the proposed scheme enables the mobile device to scan first the channel on which it is currently operating so that the mobile device has to perform minimum number of channel switches. The results show that the mobile device finds out the new potential access point prior to the handoff execution hence the delay during discovery of a new access point is minimized effectively.

사각 고주파 주입을 통한 저가형 인버터의 센서리스 운전 (Sensorless Operation of Low-cost Inverters through Square-wave High Frequency Voltage Injection)

  • 황상진;이동명
    • 전기전자학회논문지
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    • 제26권1호
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    • pp.95-103
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    • 2022
  • 본 논문에서는 저가격 인버터에서의 사각파 주입에 의한 센서리스 기법의 제어 성능을 보인다. 저가격 인버터는 소위 말하는 B4 인버터이다. 이 인버터는 저가격화를 위하여 스위칭 소자를 4개를 사용한 형태이다. 고주파 주입을 통한 센서리스 기법을 B4 인버터에 적용하였으며, 주입 고주파의 주파수는 1kH이다. 본 논문에서는 Matlab/ Simulink를 이용한 B4 인버터를 이용한 영구자석 전동기의 센서리스 시스템 모델을 설명한다. 한편, 본 연구에서는 회전자의 위치 추정을 위한 고주파 전류 성분 검출에 노치 필터를 사용하였으며, 추정된 속도의 리플 저감을 위하여 이차 저역 통과 필터를 사용하였다. 노치 필터에 의해 추출된 전류 파형에 고주파 전압을 곱하여 영구 자석 동기 전동기의 회전자 각도를 추정한다. Simulink 시뮬레이션의 통해 제안하는 기법의 타당성을 보인다.

A Study of 0.5-bit Resolution for True-Time Delay of Phased-Array Antenna System

  • Cha, Junwoo;Park, Youngcheol
    • International journal of advanced smart convergence
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    • 제11권4호
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    • pp.96-103
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    • 2022
  • This paper presents the analysis of increasing the resolution of True-Time-Delay (TTD) by 0.5-bit for phased-array antenna system which is one of the Multiple-Input and Multiple Output (MIMO) technologies. For the analysis, a 5.5-bit True-Time Delay (TTD) integrated circuit is designed and analyzed in terms of beam steering performance. In order to increase the number of effective bits, the designed 5.5-bit TTD uses Single Pole Triple Throw (SP3T) and Double Pole Triple Throw (DP3T) switches, and this method can minimize the circuit area by inserting the minimum time delay of 0.5-bit. Furthermore, the circuit mostly maintains the performance of the circuit with the fully added bits. The idea of adding 0.5-bit is verified by analyzing the relation between the number of bits and array elements. The 5.5-bit TTD is designed using 0.18 ㎛ RF CMOS process and the estimated size of the designed circuit excluding the pad is 0.57×1.53 mm2. In contrast to the conventional phase shifter which has distortion of scanning angle known as beam squint phenomenon, the proposed TTD circuit has constant time delays for all states across a wide frequency range of 4 - 20 GHz with minimized power consumption. The minimum time delay is designed to have 1.1 ps and 2.2 ps for the 0.5-bit option and the normal 1-bit option, respectively. A simulation for beam patterns where the 10 phased-array antenna is assumed at 10 GHz confirms that the 0.5-bit concept suppresses the pointing error and the relative power error by up to 1.5 degrees and 80 mW, respectively, compared to the conventional 5-bit TTD circuit.

저면적 디지털 제어 발진기의 양자화 에러 최소화를 위한 추가 서모미터 코드 잠금 기법 (Additional Thermometer Code Locking Technique for Minimizing Quantization Error in Low Area Digital Controlled Oscillators)

  • 강병석;김영식;김신웅
    • 전기전자학회논문지
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    • 제27권4호
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    • pp.573-578
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    • 2023
  • 본 논문에서는 고성능 디지털 위상 고정 루프(DPLL)에 적용 가능한 새로운 잠금 기법을 소개한다. 이 연구는 LC 기반 디지털 제어 발진기(DCO)에서 발생하는 양자화 오류를 줄이기 위해 추가 서모미터 코드를 사용한다. 본 방식은 전체 DCO 코드를 서모미터 방식으로 구현하지 않음에도 불구하고 높은 선형성을 통해 양자화 오류를 감소시킨다. 초기 잠금 단계에서 바이너리 코드를 사용하고, 잠금이 완료되면 서모미터 코드로 전환하여 높은 주파수 대비 선형성과 낮은 지터 특성을 달성한다. 이 접근법은 낮은 DCO 이득(Kdco) 값을 요구하는 응용에서 서모미터 코드만을 사용하는 기존 방식과 비교하여 스위치의 수를 현저히 줄이고 발진기의 면적을 최소화한다. 또한, 지터 특성은 서모미터 코드만을 사용하는 방식과 동일한 수준을 유지한다. SystemVerilog 및 Verilog HDL을 사용한 모델링과 RTL 수준에서의 설계를 통해 이 기법의 효과가 입증되었다.

단상 태양광 발전용 고효율 벅부스트 하프브리지 인버터 (A High-efficiency Buck-boost Half-bridge Inverter for Single-phase Photovoltaic Generation)

  • 류형민
    • 전기전자학회논문지
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    • 제27권4호
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    • pp.450-455
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    • 2023
  • 태양광 패널의 큰 기생 커패시턴스에 기인하는 과도한 누설 전류를 피하기 위한 단상 태양광 인버터 중에 부스트 컨버터와 하프브리지 인버터를 종속적으로 결합하는 방식은 가장 단순하면서 누설 전류가 가장 작다. 하지만 직류단 전압이 높아 스위칭 소자의 정격 전압이 높고 스위칭 손실이 크다. 본 논문은 부스트 컨버터를 제거하는 대신에 하프브리지 인버터의 출력 측에 2개의 양방향 스위치를 추가함으로써 벅부스트 인버터로 동작할 수 있는 새로운 회로 토폴로지를 제안한다. 고전압 직류단을 거치는 두 단계의 전력 변환을 한 단계로 줄인 덕분에 전력 손실을 절감할 수 있으며 비용 및 누설 전류는 증가하지 않는다. 제안된 회로 토폴로지의 타당성은 컴퓨터 시뮬레이션 및 전력 손실 계산을 통해 검증한다.

화학사고 예방을 위한 사업장 화학안전캠페인 활동 사례 (A Regional Safety Campaign to Prevent Chemical Accidents in the Workplace)

  • 박지훈;박선오;박효진;권혜옥
    • 한국환경보건학회지
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    • 제49권5호
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    • pp.247-250
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    • 2023
  • This case report aims to introduce the safety campaign activities for preventing chemical accidents that were cooperatively conducted by an environmental office and chemical-handling workplaces located in the Ulsan area. A chemical safety campaign was initiated to examine and manage chemical-handling facilities at high risk for chemical accidents, specifically valves, flanges, and switches (VFS) from October 2020 to December 2022. The VFS safety check campaign was conducted to raise workers' safety consciousness based on a campaign of advertisements in the workplace from October 2020 to December 2021. In addition, a VFS plus [+] campaign was initiated to encourage actual management activities for chemical-handling facilities at high risk of chemical accidents in 2022. A total of 49 corporations participated in the VFS plus [+] campaign. In contrast to the VFS safety check campaign, which simply focused on publicity and resulted in changes in worker awareness, practicable safety management activities focusing on the handling facilities were carried out. Although notable short-term impacts have yet to be discerned from the campaigns, it is expected that they will eventually serve as a starting point for developing a proper safety culture and environment.

HMIPv6 네트워크에서 Robust 한 Inter-MAP 바인딩 업데이트 기법 (Robust Inter-MAP Binding Update Scheme in HMIPv6)

  • 박진욱;정종필;추현승
    • 한국정보처리학회:학술대회논문집
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    • 한국정보처리학회 2008년도 추계학술발표대회
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    • pp.1387-1390
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    • 2008
  • In a wireless network, handover latency is very important in supporting user mobility with the required quality of service (QoS). In view of this many schemes have been developed which aim to reduce the handover latency. The Hierarchical Mobile IPv6 (HMIPv6) approach is one such scheme which reduces the high handover latency that arises when mobile nodes perform frequent handover in Mobile IPv6 wireless networks. Although HMIPv6 reduces handoff latency, failures in the mobility anchor point (MAP) results in severe disruption or total disconnection that can seriously affect user satisfaction in ongoing sessions between the mobile and its correspondent nodes. HMIPv6 can avoid this situation by using more than one mobility anchor point for each link. In [3], an improved Robust Hierarchical Mobile IPv6 (RH-MIPv6) scheme is presented which enhances the HMIPv6 method by providing a fault-tolerant mobile service using two different MAPs (Primary and Secondary). It has been shown that the RH-MIPv6 scheme can achieve approximately 60% faster recovery times compared with the standard HMIPv6 approach. However, if mobile nodes perform frequent handover in RH-MIPv6, these changes incur a high communication overhead which is configured by two local binding update units (LBUs) as to two MAPs. To reduce this communication overhead, a new cost-reduced binding update scheme is proposed here, which reduces the communication overhead compared to previous schemes, by using an increased number of MAP switches. Using this new proposed method, it is shown that there is a 19.6% performance improvement in terms of the total handover latency.

높은 정확도를 가진 집적 커페시터 기반의 10비트 250MS/s $1.8mm^2$ 85mW 0.13un CMOS A/D 변환기 (A 10b 250MS/s $1.8mm^2$ 85mW 0.13um CMOS ADC Based on High-Accuracy Integrated Capacitors)

  • 사두환;최희철;김영록;이승훈
    • 대한전자공학회논문지SD
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    • 제43권11호
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    • pp.58-68
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    • 2006
  • 본 논문에서는 차세대 디지털 TV 및 무선 랜 등과 같이 고속에서 저전압, 저전력 및 소면적을 동시에 요구하는 고성능 집적시스템을 위한 10b 250MS/s $1.8mm^2$ 85mW 0.13um CMOS A/D 변환기 (ADC)를 제안한다. 제안하는 ADC는 요구되는 10b 해상도에서 250MS/s의 아주 빠른 속도 사양을 만족시키면서, 면적 및 전력 소모를 최소화하기 위해 3단 파이프라인 구조를 사용하였다. 입력단 SHA 회로는 게이트-부트스트래핑 (gate-bootstrapping) 기법을 적용한 샘플링 스위치 혹은 CMOS 샘플링스위치 등 어떤 형태를 사용할 경우에도 10비트 이상의 해상도를 유지하도록 하였으며, SHA 및 두개의 MDAC에 사용되는 증폭기는 트랜스컨덕턴스 비율을 적절히 조정한 2단 증폭기를 사용함으로써 10비트에서 요구되는 DC 전압 이득과 250MS/s에서 요구되는 대역폭을 얻음과 동시에 필요한 위상 여유를 갖도록 하였다. 또한, 2개의 MDAC의 커패시터 열에는 소자 부정합에 의한 영향을 최소화하기 위해서 인접신호에 덜 민감한 향상된 3차원 완전 대칭 구조의 커패시터 레이아웃 기법을 제안하였으며, 기준 전류 및 전압 발생기는 온-칩 RC 필터를 사용하여 잡음을 최소화하고, 필요시 선택적으로 다른 크기의 기준 전압을 외부에서 인가할 수 있도록 설계하였다. 제안하는 시제품 ADC는 0.13um 1P8M CMOS 공정으로 제작되었으며, 측정된 DNL 및 INL은 각각 최대 0.24LSB, 0.35LSB 수준을 보여준다. 또한, 동적 성능으로는 200MS/s와 250MS/s의 동작 속도에서 각각 최대 54dB, 48dB의 SNDR과 67dB, 61dB의 SFDR을 보여준다. 시제품 ADC의 칩 면적은 $1.8mm^2$이며 전력 소모는 1.2V 전원 전압에서 최대 동작 속도인 250MS/s일 때 85mW이다.