• 한국정보통신학회논문지
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• 제17권5호
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• pp.1203-1212
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• 2013

본 논문에서는 HEVC 복호기내 화면내 예측의 연산 복잡도를 감소시키기 위해 공유 연산기, 공통 연산기, 고속 smoothing 결정 알고리즘, 고속 필터계수 생성 알고리즘을 적용한 하드웨어 구조를 제안한다. 공유 연산기는 공통수식을 공유하여 smoothing 과정의 연산 중복성을 제거하고, DC모드의 평균값을 미리 계산하여 수행 사이클 수를 감소시킨다. 공통 연산기는 모든 예측모드의 예측픽셀 생성과 필터링 과정을 하나의 연산기로 처리하기 때문에 연산기의 개수를 감소시킨다. 고속 smoothing 결정 알고리즘은 비트 비교기만을 사용하고, 고속 필터계수 생성 알고리즘은 곱셈연산 대신 LUT를 사용하여 연산 개수, 하드웨어 면적과 처리 시간을 감소시킨다. 또한 제안하는 구조는 2개의 공유 연산기와 8개의 공통 연산기를 사용하여 병렬처리함으로써 화면내 예측의 수행 사이클 수를 감소시킨다. 제안하는 구조를 TSMC 0.13um CMOS 공정 라이브러리를 이용하여 합성한 결과 게이트 수는 40.5k, 최대 동작 주파수는 164MHz이다. HEVC 참조 소프트웨어 HM 7.1에서 추출한 데이터를 이용하여 성능을 측정한 결과 제안하는 구조의 수행 사이클 수가 기존 구조 대비 93.7% 감소하였다.

• 조명전기설비학회논문지
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• 제16권4호
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• pp.15-21
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• 2002

본 논문에서는 동적 전류분담 인덕터를 이용한 ZVT 풀 브리지 DC/DC 컨버터의 병렬운전 특성을 해석하였다. 기존의 경우 CT(Current Transformer)를 사용하여 각 단위 컨버터 전류의 크기를 감지하여, 제어회로에서 각 컨버터에 균등한 전류 배분을 하는 방법을 사용하였으나, 본 연구에서는 동적 전류분담 인덕터를 사용함으로써 병렬운전하는 두 대의 풀 브리지 컨버터의 전류분배를 위한 제어회로를 비교적 단순하게 하였다. 동시에 ZVT회로를 이용하여 컨버터의 효율을 향상시켰으며 스위칭소자로서 IGBT를 사용하여 2[㎾]급 시작품을 제작, 50[KHz]에서 실험하였다.

• 대한전기학회:학술대회논문집
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• 대한전기학회 2001년도 하계학술대회 논문집 B
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• pp.942-945
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• 2001

This paper presents parallel operation of ZVT(Zero Voltage Transition) Full Bridge Converter with Dynamic Current Shared Inductor. In the conventional method, CT(Current Transformer) have been used to share the load current equally with converters. In this system, at parallel operation of ZVT Full Bridge Converter, dynamic current shared inductor divides the same current of unit converter and ZVT circuit aids to high efficiency. This method which is proposed to compare in the conventional method will do simple control circuit. To show the superiority of this converter is verified through the experiment with a 2kW, 50kHz prototype converter.

• 대한전기학회:학술대회논문집
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• 대한전기학회 2001년도 춘계학술대회 논문집 전기기기 및 에너지변환시스템부문
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• pp.324-328
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• 2001

This paper presents parallel operation and control loop design of ZVT(Zero Voltage Transition) Full Bridge DC/DC Converter. At parallel operation of ZVT Full Bridge Converter, dynamic current shared inductor devides the same current of unit converter and ZVT circuit and aids to high efficiency in the system. Base on the modeling of ZVT. Full Bridge Converter, the control loop is designed using a simple two-pole, one-zero compensation circuit. To show the validity of the design procedures, the small signal analysis of the closed loop system and open loop system is carried out and the superiority of the dynamic characteristics is verified through the experiment with a 2kW, 50kHz prototype converter.

• 융합신호처리학회논문지
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• 제21권4호
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• pp.202-208
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• 2020

최근 코로나 19로 인해 비대면의 중요성이 강조되고 있으며, 공유공간의 이용 부분에 대하여도 확대되고 있다. 공유공간 출입관리에 언텍트 체크인 기술을 이용하면 대기시간을 감소시키며, 근무자의 효율을 최적화함에 따라서 운영비 절감효과가 발생한다. 본 논문에서는 모바일 키 및 RCU(Room Control Unit)에 기반한 공유공간 출입관리 시스템을 제안하여 모바일 키를 사용하여 시설에 대한 출입을 진행하고, RCU를 사용하여 시설에 대한 모니터링을 제안한다. 제안시스템은 공유 숙박, 임대 분야(레지던스, 분양형 호텔), 공유 오피스 등을 대상으로 특정 요일과 시간에 일회성 방문자가 있는 경우, 그에 맞는 비밀번호를 모바일 플랫폼 기반으로 전달함으로써 기존 비밀번호에 대한 노출 및 열쇠 전달 등의 불편함을 줄일 수 있는 현장적응형 시스템으로 지원한다. 제안 통합시스템의 동작을 시험하기 위해 사용자의 예약, 입실, 퇴실 등의 상태를 전반적으로 파악하기 위한 시나리오에 따라 테스트를 시행하였으며, 테스트의 신뢰성을 위해 성능지표를 설정하여 각 항목에 대한 100%의 성공률을 도출하였다.

• 한국건설관리학회논문집
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• 제19권2호
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• pp.50-60
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• 2018

최근 인력자원 투입량 감소 및 공기단축이 가능한 모듈러 건축공법은 반복 공정이 많은 기숙사, 주거시설, 호텔 공사 등에 다양하게 적용되고 있다. 모듈러 건축공법은 유닛 설치비용을 제외한 현장 공사비에서 외장 마감공사 비용의 비중은 약 40%를 차지하며, 마감공사는 목표공기와 비용을 유지하는데 주요한 역할을 한다. 모듈러 현장에서 유닛 설치 및 마감공사 수행을 위해 한정된 장비가 후속 액티비티에 영향을 주지 않도록 공유되어야 하며 현장 마감 비중이 커지는 모듈러 프로젝트일수록 공정관리에서 양중 계획은 매우 중요하기 때문이다. 이와 같은 T/C 운용 계획은 단일 사이클 또는 다중 사이클의 형태를 가지게 되며 사이클 주기 조율은 장비효율을 높일 수 있다. 그러나 유닛 설치 및 마감공사를 지원하기 위한 T/C 운용 계획의 대안을 평가하는데 어려움이 있다. 따라서 본 연구는 모듈러 건축 현장에서 T/C 운용의 사이클 주기 설정에 따른 운용방식의 대안을 평가하기 위해 유닛 양중 시간 및 주기, 외장재 양중 시간, 마감 작업 소요시간을 변수화하여 T/C 가동시간과 공정에 주는 영향을 파악한다. 이러한 목적을 달성하기 위해 현장에서 이루어지는 작업 프로세스 분석을 바탕으로 작업 속도를 조절하여 T/C 효율을 증대시킬 수 있는 시뮬레이션 모델을 개발한다. 본 연구는 양중 사이클 개념을 적용한 자원 평준화 방법을 제시함으로써 학술적 기여가 있으며 실무적으로 현장관리자에게 장비 계획의 대안 선택을 위한 기초자료로서 활용될 수 있을 것이다.

• JSTS:Journal of Semiconductor Technology and Science
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• 제10권4호
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• pp.316-324
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• 2010

In this paper, we design a 256 kbits EEPROM for a MCU (Microcontroller unit) with the wide voltage range of 1.8 V to 5.5 V. The memory space of the EEPROM is separated into a program and data region. An option memory region is added for storing user IDs, serial numbers and so forth. By making HPWs (High-voltage P-wells) of EEPROM cell arrays with the same bias voltages in accordance with the operation modes shared in a double word unit, we can reduce the HPW-to-HPW space by a half and hence the area of the EEPROM cell arrays by 9.1 percent. Also, we propose a page buffer circuit reducing a test time, and a write-verify-read mode securing a reliability of the EEPROM. Furthermore, we propose a DC-DC converter that can be applied to a MCU with the wide voltage range. Finally, we come up with a method of obtaining the oscillation period of a charge pump. The layout size of the designed 256 kbits EEPROM IP with MagnaChip's 0.18 ${\mu}m$ EEPROM process is $1581.55{\mu}m{\times}792.00{\mu}m$.

• 대한전기학회논문지:시스템및제어부문D
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• 제50권12호
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• pp.584-589
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• 2001

This paper presents an implementation method of multi-channel synchronized phasor measurement device, which is based on the ASIC implementation of the sliding-DFT. A time-shared multiplier structure is proposed to minimize the number of gates required for the implementation. The design is verified by the timing simulation of its operation. The effect of coefficient approximation in the recursive implementation of the sliding-DFT is analytically derived and verified with the computer simulations.

• 대한의용생체공학회:학술대회논문집
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• 대한의용생체공학회 1994년도 춘계학술대회
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• pp.53-56
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• 1994

We have developed biological signal measurement modules and data acquisition and control card for a biological signal measurement, archiving, and communication system (SiMACS). Biological signals included in this system are ECG, EEG, EMG, invasive blood pressure, respiration, and temperature. Parameters of each module can be controlled by PC-base IDPU (intelligent data processing unit) through a data acquisition and control card. The data acquisition and control card can collect up to 16 channels of biological signals with sampling rate of $50\;{\sim}\;2,000Hz$ and 12-bit resolution. All measurement moduls and data acquisition functions are controlled by microcontroller which receives commands from PC. All data transfers among PC, microcontroller, and ADC are done through a shared RAM access by polling method for real rime operation.

• 한국수학교육학회지시리즈A:수학교육
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• 제53권2호
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• pp.201-217
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• 2014

This research has an intention of developing a professional development program. We proposed an alternative mathematics teacher training model based on the situated learning theory, community of practice, and reflective practitioner. The developed mathematics teacher professional development program recruited participation unit that was consisted of 3 or 4 teachers in same school and total of 28 teachers from 9 schools. Also, there were 18 mentors to support each school. In this sense, it can be called multi-tired teacher community professional development program. Through the program, the teachers improve their teaching competency. Also, the operation ability of teacher learning community was improved. Learning community culture has been formed in each school. It shows ability that the explorative learning community can be operated voluntarily although the program finished. Furthermore, community shared corporate responsibility about open class. They recognize open class as a new method to improve community teaching ability than a tool to evaluate individual teaching ability.