• 제목/요약/키워드: programmable

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QCA 클록킹 방식의 D 플립플롭을 이용한 프로그램 가능한 양자점 셀 구조의 설계 (Design of Programmable Quantum-Dot Cell Structure Using QCA Clocking Based D Flip-Flop)

  • 신상호;전준철
    • 한국산업정보학회논문지
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    • 제19권6호
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    • pp.33-41
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    • 2014
  • 본 논문에서는 QCA(quantum-dot cellular automata) 클록킹(clocking) 방식의 D 플립 플롭의 구조를 제안하고, 이를 이용하여 프로그램 가능한 양자점 셀(programmable quantum-dot cell: QPCA) 구조를 설계한다. 기존의 QCA 상에서 제안된 D 플립플롭은 클록 펄스의 신호로 동작을 수행하기 때문에 이에 대한 입력 값을 임의로 설정해야 하고, QCA 클록킹과 중복되어 사용하기 때문에 낭비되는 출력 값들이 존재했다. 이러한 단점을 개선하기 위해서 이진 배선과 클록킹 기법을 이용하여 새로운 형태의 D 플립플롭을 제안하고, 이를 이용하여 QPCA 구조를 설계한다. 이 구조는 입력을 제어하는 배선 제어 회로, 규칙 제어 회로, D 플립플롭, 그리고 XOR 논리 게이트로 구성된다. 설계된 QPCA 구조는 QCADesigner를 이용하여 시뮬레이션을 수행하고, 그 결과를 기존의 D 플립플롭을 이용하여 설계한 것과 비교 분석하여 효율성을 확인한다.

Programmable DSP 코어를 사용한 고성능 디지털 보청기 프로세서 (A High-performance Digital Hearing Aid Processor Based on a Programmable DSP Core)

  • 박영철;김동욱;김인영;김원기
    • 대한의용생체공학회:의공학회지
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    • 제18권4호
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    • pp.467-476
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    • 1997
  • 본 논문에서는 DSP코어를 채용한 디지털 보청기 칩을 설계 제작하였다. 디지털 보청기 칩은 크기와 소비전력면에서 크게 제한을 받는다. 이와함께 다양한 형태와 범위의 청각 손실에 대해 보상을 할 수 있어야 하기 때문에 알고리즘 개발을 위해 구조적인 유연성을 필요로 한다는 점도 칩 설계에 있어 또다른 제약이 된다. 본 연구에서는 16비트 고정 소수점 연산을 하는 크로그래머블 DSP 코어를 사용하여 보청기 칩을 설계하였다. 제작된 보청기 칩은 난청자의 청각 측정치를 바탕으로 8개의 주파수 대역에 걸쳐 비선형적으로 라우드니스를 보상해 준다. 필터 뱅크를 사용하는 대신에 본 연구에서에서는 단일 필터를 주파수 샘플링 방법으로 설계함으로써 주파수 왜곡을 최소화 하였다. 또한 프로그램 가능한 DSP 코어를 사용하였기 때문에 알고리즘 개발을 위한 시스템으로도 활용이 가능할 뿐만 아니라 $5,500\times5000$$\mu$$m^2$의 크기와 저전력 동작특성을 갖고 있어서 소형 보청기 제작에 적합하다.

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HPD 개발수명주기를 적용한 원전 FPGA 기반 제어기의 설계와 검증 (Design and Qualification of FPGA-based Controller applying HPD Development Life-Cycle for Nuclear Instrumentation and Control System)

  • 이준구;정광일;박근옥;손광영
    • 한국전자통신학회논문지
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    • 제9권6호
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    • pp.681-687
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    • 2014
  • 원자력 산업계는 최근 원전 계측제어계통 설비의 단종과 같은 예상치 못한 환경에 직면해오고 있으며, 이러한 문제를 근본적으로 해결하고자 노력하고 있다. IAEA, IEC, 등의 연구결과에 따르면, FPGA는 단종이 예상되는 제어계통에의 대체수단으로 주목받고 있다. FPGA가 원자력 플랜트의 PLC(Programmable Logic Controller)를 대체하기 위해서는 높은 건정성과 신뢰성을 가져야 한다. 따라서, FPGA 기반 제어기의 건전성과 신뢰성을 향상시키기 위하여 HDL 개발수명주기를 적용하여 개발하였다. 또한, 원전 계측제어계통에 적용하기 위하여 번인시험과 환경시험의 기기검증이 수행되었다. 시험수행결과, 352시간의 번인시험과 92시간의 환경시험 중에 정상적인 기능 및 성능을 수행함을 확인할 수 있었다.

새로운 구조의 프로그램어블 주파수 분주기를 사용한 주파수 합성기 설계 (Design of Frequency Synthesizer using Novel Architecture Programmable frequency Divider)

  • 김태엽;박수양;손상희
    • 한국통신학회논문지
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    • 제27권6C호
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    • pp.619-624
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    • 2002
  • 본 논문에서는 50%의 duty cycle 출력을 가지며, 디지털 방식으로 분주수를 제어할 수 있는 새로운 분주기 구조를 제안하였다. 그리고 0.25$\mu\textrm{m}$ 2-poly, 5-metal CMOS 공정 파라미터를 이용한 HSPICE 모의실험을 통해서 제안한 주파수 분주기를 이용한 900MHz 주파수 합성기를 설계하였다. 제안한 주파수 분주기의 동작은 0.657m 2-poly, 2-metal CMOS 공정을 사용하여 제작한 칩을 측정하여 확인하였다. 설계한 전압제어발진기(VCO)는 2.5V 전원전압 하에서 900Mh의 충간주파수, $\pm$10%의 동작 범위, 154MHz/V의 이득을 가진다. 또한 모의실험 결과 주파수 합성기의 settling time은 약 $1.5\mu\textrm{m}$이고 짝수와 홀수 분주시 50%의 duty cycle과 820MHz~1GHz의 동작 주파수 범위를 갖으며, 전력소모는 대략 70mW 임을 확인하였다.

곱셈기가 필요없는 2의 누승 계수를 사용한 프로그램 가능한 FIR필터의 구현 (Implementation of Programmable Multiplierless FIR Filters with Powers-of-Two Coefficients)

  • 오우진;이용훈
    • 한국통신학회논문지
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    • 제19권11호
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    • pp.2249-2254
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    • 1994
  • 본 논문에서는 계수가 2의 누승으로 표현되는 프로그램 가능한 FIR 필터 (2PFIR 필터)를 구현할 때 유용한 성질을 구했다. 특히 2PFIR 필터의 계수가 갖는 2의 수능 값이 M ternary의 canonical signed digit (CSD) 코드로 표현되면 ternary 값을 M개보다 적은 {0, 1, 2, $\cdots$, M-1}의 부분집합에서 선택해도 같은 결과가 얻어진다는 사실을 보였다. 따라서 프로그램 가능한 2PFIR 필터의 쉬프터 길이가 M보다 작아지므로 훨씬 효율적으로 구현할 수 있다. 또한 본 논문에서는 몇 가지 실험 결과를 통해 2PFIR 필터의 쉬프터 길이를 추가적으로 감축할 수 있음을 보였다.

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Development of FPGA-based Programmable Timing Controller

  • Cho, Soung-Moon;Jeon, Jae-Wook
    • 제어로봇시스템학회:학술대회논문집
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    • 제어로봇시스템학회 2003년도 ICCAS
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    • pp.1016-1021
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    • 2003
  • The overall size of electronic product is becoming small according to development of technology. Accordingly it is difficult to inspect these small components by human eyes. So, an automation system for inspecting them has been used. The existing system put microprocessor or Programmable Logic Controller (PLC) use. The structure of microprocessor-based controller and PLC use basically composed of memory devices such as ROM, RAM and I/O ports. Accordingly, the system is not only becomes complicated and enlarged but also higher price. In this paper, we implement FPGA-based One-chip Programmable Timing Controller for Inspecting Small components to resolve above problems and design the high performance controller by using VHDL. With fast development, the FPGA of high capacity that can have memory and PLL have been introduced. By using the high-capacity FPGA, the peripherals of the existent controller, such as memory, I/O ports can be implemented in one FPGA. By doing this, because the complicated system can be simplified, the noise and power dissipation problems can be minimized and it can have the advantage in price. Since the proposed controller is organized to have internal register, counter, and software routines for generating timing signals, users do not have to problem the details about timing signals and need to only send some values about an inspection system through an RS232C port. By selecting theses values appropriate for a given inspection system, desired timing signals can be generated.

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Programmable Storage/Logic Array에 대한 보편적인 Test Set (Universal Test Set for Programmable Storage/Logic Arrays)

  • 도양회;권우현;김채영
    • 대한전자공학회논문지
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    • 제22권1호
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    • pp.7-13
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    • 1985
  • 쉽게 시험할 수 특성을 가진 SLA 의 설계에 관해 논하였다. 제안된 SLA는 hardware를 부가함으로써 회로의 상태를 쉽게 조절하고 점검할 수 있게 하였다. 제안된 SLA는 test pattern과 응답이 SLA에 구현된 함수에 관계없고 단지 SLA의 크기에 따라 유일하게 결정되는 매우 짧은 보편적인 test sequence를 갖는다. 여기서 고려된 SLA의 고장은 단일 및 다중 stuck faults, crosspoint faults 및 bridge faults이다. 또한 고장의 위치 판별 및 그 처리에 관해서도 고찰하였다.

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모터 구동시스템 시험을 위한 개선된 프로그램어블 다이나모메터 제어 (A Improved Programmable-Dynamometer Control For Motor Drive Systems Testing)

  • 김길동;박현준;조정민;전기영;오봉환;이훈구;한경희
    • 대한전기학회논문지:전기기기및에너지변환시스템부문B
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    • 제52권5호
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    • pp.211-220
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    • 2003
  • The control method of programmable dynamometer for overall test of machine is to load the reference torque which is computed from torque transducer into motor under test. But the torque information detected from torque transducer have a lot of noise when the load torque of meter is a small quantity or changing. Thus, torque transducer must have a low pass filter to detect a definite torque information. But The torque delay generated by filter with torque transducer occur a torque trouble for meter torque of programmable dynamometer. Therefore, this kind of system could not perform dynamic and nonlinear load. In this paper, the control method using the load torque observer without a measure for torque transducer is Proposed. The proposed system improved the problem of the torque measuring delay with torque transducer, and the load torque is estimated by the minimal order state observer based on the torque component of the vector control induction meter. Therefore, the torque controller is not affected by a load torque disturbance. To verify a superiority of the proposed control algorithm, the analysis for a root locus of a conventional control method and the proposed one, and simulation and experiment is performed. Therefore we hope to be extended in industrial application.

PLC 고장허용에 대한 이중화 시스템 연구 (A Study on Redundancy System for Fault Tolerance of PLC)

  • 이석용;이홍규
    • 조명전기설비학회논문지
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    • 제14권1호
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    • pp.47-52
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    • 2000
  • 이중화 PLC 제어시스템은 높은 유용성과 고장허용을 목표로 사용되고 2채널(1-out-of-Z) 구조로 동기화된 마스터, 스탠바이 시스템으로 PLC의 고장허용 제어를 실현함으로써 기계, 플랜트의 연속운전을 실현하며 데이터 링 크는 마스터와 스탠바이 제어기로 연결되어 있다. 고장허용 제어시스템은 전체 제어시스템에서 최소한의 고장으로 손실을 감소시키고 고장발생시 공정의 연속적인 운전과 시스템의 중단없이 수리 및 점검올 가능하게 하여 생산손실을 최소화하며 전체 시스템에 대하여 신뢰도를 향상시키는것이다.

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전력공급장치를 이용한 선박용 연료전지 시뮬레이터의 구현 (Implementation of Fuel Cell Simulator for Ship Using the Programmable Power Supply)

  • 박도영;오진석
    • Journal of Advanced Marine Engineering and Technology
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    • 제36권8호
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    • pp.1117-1122
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    • 2012
  • 연료전지를 선박에 적용하는 연구를 위해서는 연료전지 특성을 고려한 전력 시스템 설계 및 부하 제어에 대한 연구가 필요하다. 하지만 연료전지를 직접 실험하기 위해서는 여러 보조기기들과 복잡한 제어 기술이 필요하다. 이러한 이유로 연료전지 시뮬레이터가 필요하며, 이를 위한 연구가 활발히 진행중이다. 본 논문에서는 자동차, 소형 선박 등에 적용되고 있는 PEMFC에 관하여 LabVIEW를 기반으로 시뮬레이션 하였다. 또한 이러한 시뮬레이션 데이터를 바탕으로 프로그램이 가능한 전력공급장치를 이용하여 시뮬레이터를 제작하여 연료전지의 특성을 구현하였다. 이를 통해 연료전지의 분극화 곡선과 변수에 따른 I-V특성을 확인할 수 있었다.