We propose a speckle reduction technique in electronic holographic display systems, where digital micro-mirror array devices are used as spatial light modulators. By adopting a programmable filtration in a general 4-f optic configuration, it is shown that the signal spectrum components in the frequency domain of a viewing-window-based holographic display system can be selectively filtered. Compared to the widely utilized single-sideband filtration techniques in electronic holographic display systems, our proposed programmable filtration can be utilized to effectively reduce the speckles in the reconstruction of point-cloud-based computer-generated holograms. Experimental results are presented to verify our proposed concept.
In this paper, we investigate and characterize the parallel processing of a hybrid system interfacing binary decision(BD) programmable controller with a microcomputer. The generation of analog signals and estimation of data, which can not properly be performed by the BD programmable controller alone, have been done by the the expanded controller utilizing BD/Micdro P.C. In addition, implementation of its hardware and software is considered.
최근 인공지능 분야는 자율주행, 로봇 및 스마트 통신등 다양한 분야에 응용되고 있다. 현재의 인공지능 응용분야는 파이썬을 기반으로 한 tensor flow를 이용하는 소프트웨어 방식을 이용하고 있으며, 프로세서로는 PC의 그래픽 카드 내부에 존재하는 GPU (Graphics Processing Unit)를 이용하고 있다. 본 연구에서는 HDL (Hardware Description Language)을 이용하여 FPGA (Field Programmable Gate Array)를 기반으로 한 신경망 회로를 이용하여 인공지능 시스템을 구현하였으며, 본 논문에서는 FPGA기반 인공지능 시스템을 구현하기 위한 영상인식 시스템에 대해 발표하고자 한다.
Programmable Metallization Cell (PMC) is a memory device based on the electrolytical characteristic of chalcogenide materials. We investigated the nature of thin films formed by photo doping of Cu ions into chalcogenide materials for use in solid electrolyte of PMC. We were able to do more economical approach by using copper which play an electrolyte ions role. The results imply that a Cu-rich phase separates owing to the reaction of Cu with free atoms from chalcogenide materials.
제어로봇시스템학회 1993년도 한국자동제어학술회의논문집(국내학술편); Seoul National University, Seoul; 20-22 Oct. 1993
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pp.1012-1017
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1993
In this paper, the instruction set and the architecture of a RISC processor for programmable logic controller is suggested. From the measurement of existing programs, the characteristics of ladder instructions are analyzed. The instruction set is defined so that the existing ladder program can be reused with simple translation. Because bit instructions controls the behavior of word instructions, the processor suits for high level language like SFC. Simulations show that the PLC with the suggested processor is twenty times faster than the PLC with the multi-purpose microprocessor.
New CMOS ROM cell is reported in this paper, distinguished from conventional ones in that it can be re-programmed by multi-times. It uses the comparator offset as the physical storage quantity and the MOSFET FN stress effect for offset programming. It demands very low offset for read, and works well in very low voltage. It can become a promising ROM solution for various SoC systems.
MAP(Manufacturing Automation Protocol), Network Protocol for FA has 7 Layer Structure of OSI. Being an Application Layer Protocol for Communication Interfaced with the Actual Programmable Devices, MMS(Manufacturing Message Specification) Consists of Three Factors of Services, Interfaces, and Protocol. For Details, It Classifies with the Followings ; Connection/Context Management, Remote Variable Access, Semaphore Management, File transfer and Management, Program UP/DOWN Load, Remote Program Fxecution. In this Paper Designing MAP Network Station of Programmable Device, we Analyze the Protocol of MMS, and Realize the State Diagram of each Services and Propose the Model of MMS Function Call Instructions.
The architecture of a multiprocessor based programmable controller(MBPC) is presented. It consists of a host processor, processing elements, and Input/Output processors. Some problems in implementing such architecture are also described. To resolve them, we proposed and presented INFOBUS, a system bus for MBPC. The performances of INFOBUS and MBPC are analysed using both analytic models and simulations. Some results from the analysis will be given and validated. In case of 50% of BTI(Block Type Instruction) and 4 processors, the scanning time is shown to be 0.194msec/Kstep with some reasonable assumptions.
This paper describes the development of a 'General-purpose ETRI MAP interface module' (GEM) for a Mini-MAP network. GEM operates as a Mini-MAP node in our FA system. To communicate between GEM and programmable devices such as PLC, CNC, and robot, RS232C is used, which is a traditional method. A Mini-MAP host system controls and monitors programmable devices via GEM. The Mini-MAP function of GEM is implemented and tested on the basis of the MAP V3.0.
본 연구에서는 금성계전에서 이미 개발된 고기능 PC인 STARCON-M에 적용 할 수 있는 Link 시스템을 구성하여 다음과 같은 결론을 얻을 수 있었다. 1) 병렬 Link 시스템을 구성하여 최대 입출력 점수가 280점인 PC를 최대 744점 프로그램 용량이 최대 12K Word까지 확장하여 사용 할 수 있었다. 2) 직렬 Link 시스템을 구성하여 완벽한 분산제어 시스템을 구성할 수 있었으며 Master와 Local의 비율을 1:7까지 할 수 있고 동축 cable에 의해 500m 까지 연결하므로서 PC의 효율성을 증가시켰다. 3) Computer Link 에 의해 PC와 Computer간에 Data를 교신하므로서 관리 감시 제어 시스템을 구성할 수 있었다.
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[게시일 2004년 10월 1일]
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