Journal of the Korean Institute of Telematics and Electronics B
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v.32B
no.3
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pp.66-76
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1995
In this research, a mesh connected VLSI structure is proposed for the real time computation of the generalized Hough transform(GHT). The purpose of the research is to design a generalized Hough transformer that can be realized as a single chip processor. The GHT has been modified to yield a highly parallel structure consisting of simple processing elements(PEs) and communication networks. In the proposed structure, the GHT can be computed by first assigning an image pixel to a PE and performing shift and add operations. The result of the CAD circuit simulation shows that it can be computed in the time proportional to the number of pixels in the pattern. In addition to the Hough transformer, the peak detector has been designed to reduce 1)the number of the I/O operations between the transformer and the host computer and 2) the host computer's burden for peak detection by transmitting only the local peaks detected from the transformed accumulator. It is expected that the proposed single chip Hough transformer with peak detector makes a fast and inexpensive edge based object recognition systems possible for many industrial and military applications.
Journal of the Korean Institute of Telematics and Electronics C
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v.35C
no.7
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pp.101-108
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1998
In this paper, after we got to realized FDNN (fuzzy decision neural network) applied the quantization triangularity fuzzy function to DBNN(decision based neural network) of a hierarchical structure for image process, we could esign hardware of the realized FDNN. Also it is normalized the standard image and the input image as the same size. We are applied DWW algorithm which selected the closest value with finding similarity of an interval image by this distance to FDNN. So we could calulated in terms of distance to weight of pixel which composed two image and eliminated the nise of image, minimized the lost of information, obtained the optimal information. It is designed hardware of high speed weighted FDNN using COMPASS tool. Aslo, the total circuit is realized as gates of 61,000 and could show to superiority of FDNN using the simulation.
In this paper, the design of one-chip FED system integrated with driving circuits in reported on the basis of MOSFET controlled FEA (MCFEA). To integrate a MOSFET with a FEA efficiently, a new fabrication process is proposed. It is confirmed that the MOSFET with threshold voltage of about 2volts controls the FEA emission current up to 20 ${\mu}$A by applying driving voltage of 15 volts, which is enough current level to utilize the MCFEA as a pixel for FED. The drain breakdown voltage of the MOSFET is measured to be 70 volts, which is also high enough for 60 volt operation of FED. The circuits for row and column driver are designed stressing on saving area, reducing malfunction probability and consuming low power to maximize the merit of on-chip driving circuits. Dynamic logic concept and bootstrap capacitors are used to meet these requirements. By integrating the driving circuit with FEA, the number of external I/O lines can be less than 20, irrespectively of the number of pixels.
Multi-Layer Ceramic Circuit(MLCC) in the face of thousands of fine pitch multi hole is processed. However, the fine pitch multi hole has a size of only a few micrometers. Therefore, in order to curtail the measurement time and reduce error, the image processing measurement method is required. So, we proposed an image processing measurement algorithm which is required to accurately measure the fine pitch multi hole. The proposed algorithm gets image of the fine pitch multi hole, extracts object from the image by morphological process, and extracts the parameters of its position and feature by edge detecting process. In addition, we have used the sub-pixel algorithm to improve accuracy. As a result, the proposed algorithm shows 97% test-retest measurement reliability within 2 ${\mu}m$. We found that the algorithm was wellsuited for measuring the fine pitch multi hole.
Park, Haeng-Won;Moon, Seung-Hwan;Kang, Nam-Soo;Lee, Sung-Yung;Park, Jin-Hyuk;Kim, Sang-Soo
한국정보디스플레이학회:학술대회논문집
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2005.07a
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pp.531-534
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2005
This paper presents a new data line sharing technique for TFT-LCD panels. This technique reduces the number of data driver IC's to half by having two adjacent pixels share the same data line. This in turn doubles the number of gate lines, which are integrated directly on the glass substrate of amorphous silicon for further cost reduction and more compactness. The proposed technique with new pixel array structure was applied to 15.4 inch WXGA TFT-LCD panels and has proven that the number of driver IC's were halved with nearly 41% circuit cost reduction and 5.3% reduction in power consumption without degrading the image quality.
Transactions of the Society of Information Storage Systems
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v.7
no.2
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pp.75-79
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2011
Recently mobile phone camera become generally spread, it is required to develop high resolution, multi-functional camera module for obtaining high image quality. To satisfy this demand, number of pixels has been increased and pixel size decreased in small mobile phone cameras. As a result, image quality is seriously dropped by blur phenomena. Especially when hand tremble is occurred, image quality is dropped by camera shake. Therefore, to obtain high quality image, it is necessary to compensate user's hand tremble. In this paper, we propose voice coil actuator for compensating hand tremble, which can apply optical image stabilization (OIS) system. Sensitivity analysis and size optimization are performed to obtain high driving force. Finally, it is confirmed that the optimized electromagnetic circuit can be applied in OIS system.
능동 구동형 유기 발광 소자 디스플레이용 수소화된 비정질 실리콘 박막 트랜지스터의 전류 안정성을 개선하기 위해, 음전압 인가방식을 채택한 새로운 화소 회로를 제안하였다. 제안한 회로는 5개의 트랜지스터를 사용하였고, 직전에 인가했던 $V_{GS}$에 따라 음의 전압을 인가하여 양의 전압에 의한 구동 박막 트랜지스터의 열화 현상을 줄여준다. 본회로는 SPICE 시뮬레이션을 통해 검증하였다.
Proceedings of the Korean Institute of Electrical and Electronic Material Engineers Conference
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2007.06a
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pp.421-422
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2007
The fringe electric field driven transflective liquid crystal display with dual orientation has a problem that the voltage-dependent transmittance and reflectance curves do not match each other, requiring a dual driving circuit to achieve a high electro-optic performance. Optimizations of the electrode structure in the array substrate and rubbing direction solve this problem so that the transflective display with a single gap and a single gamma curve for reflective and transmissive region is possible.
Meng, Yunlong;Hu, Xuemei;Yang, Cheng;Shen, Xinyu;Cao, Xueyun;Lin, Lankun;Yan, Feng;Yue, Tao
Current Optics and Photonics
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v.6
no.4
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pp.359-366
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2022
In this paper, we present a new design for angle-sensitive pixels (ASPs). The proposed ASPs take advantage of subwavelength compound gratings to capture the light angle, which enables pixel size to reach the wavelength scale of 0.7 ㎛ × 0.7 ㎛. The subwavelength compound gratings are implemented by the wires of the readout circuit inherent to the standard complementary metal-oxide-semiconductor manufacturing process, thus avoiding additional off-chip optics or post-processing. This technique allows the use of two pixels for horizontal or vertical angle detection, and can determine the light's angle in the range from -45° to +45°. The proposed sensor enables surface-profile reconstruction of microscale samples using a lensless imaging system.
JSTS:Journal of Semiconductor Technology and Science
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v.14
no.5
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pp.658-665
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2014
The neural stimulators have been employed to the visual prostheses system based on the functional electrical stimulation (FES). Due to the size limitation of the implantable device, the smaller area of the unit current driver pixel is highly desired for higher resolution current stimulation system. This paper presents a 16-channel compact current-mode neural stimulator IC with digital to analog converter (DAC) sharing scheme for artificial retinal prostheses. The individual pixel circuits in the stimulator IC share a single 6 bit DAC using the sample-and-hold scheme. The DAC sharing scheme enables the simultaneous stimulation on multiple active pixels with a single DAC while maintaining small size and low power. The layout size of the stimulator circuit with the DAC sharing scheme is reduced to be 51.98 %, compared to the conventional scheme. The stimulator IC is designed using standard $0.18{\mu}m$ 1P6M process. The chip size except the I/O cells is $437{\mu}m{\times}501{\mu}m$.
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[게시일 2004년 10월 1일]
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