• 제목/요약/키워드: low-power ECC

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다양한 유전 연산자를 이용한 저전력 오류 정정 코드 설계 (Design of Low Power Error Correcting Code Using Various Genetic Operators)

  • 이희성;홍성준;안성제;김은태
    • 한국지능시스템학회논문지
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    • 제19권2호
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    • pp.180-184
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    • 2009
  • 저전력 환경에서의 메모리 집적도가 증가함에 따라 메모리는 soft error에 매우 민감해졌다. 오류 정정 코드는 일반적으로 양산 이후 메모리의 soft error를 수정하기 위해서 사용된다. 본 논문에서는 새로운 저전력 오류 정정 코드의 설계방법을 제안한다. 오류 정정 코드의 전력소비는 parity check 행렬의 선택을 통해 최소화 될 수 있다. 따라서 오류 정정 코드의 설계는 비선형 최적화 문제로 포함되는데 우리는 다양한 유전 연산자를 포함하는 유전자 알고리즘을 이용하여 이 문제를 해결한다. 제안하는 방법을 Hamming code와 Hsiao code에 적용하여 그 효율성을 입증하였다.

정보보호 시스템을 위한 FPGA 기반 하드웨어 가속기 설계 (Design of FPGA Hardware Accelerator for Information Security System)

  • 차정우;김창훈
    • 한국산업정보학회논문지
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    • 제18권2호
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    • pp.1-12
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    • 2013
  • 정보보호 시스템은 소프트웨어, 하드웨어, FPGA(Field Programmable Array) 디바이스를 이용하여 구현되었다. S/W의 구현은 다양한 정보보호 알고리즘에 대해 높은 유연성을 제공하나 속도, 전력, 안전성 측면에서 매우 취약하며, ASIC 구현은 속도, 전력 측면에서는 매우 우수하지만 구현의 특성상 다양한 보안 플랫폼을 지원할 수 없다. 이러한 문제점들의 상충관계를 개선하기 위해 최근 FPGA 디바이스 상에서의 구현이 많이 이루어 졌다. 본 논문에서는 다양한 환경에서의 정보보호 서비스를 제공하기위한 정보보호 시스템을 위한 FPGA 기반 하드웨어 가속기를 설계한다. 개발한 정보보호 시스템은 비밀키 암호알고리즘(AES : Advanced Encryption Standard), 암호학적 해쉬(SHA-256 : Secure Hash Algorithm-256), 공개키 암호알고리즘(ECC : Elliptic Curve Cryptography)을 수행할 수 있으며, Integrated Interface에 의해 제어된다. 또한 기존의 시스템에 비해 다양한 정보보호 알고리즘을 지원하여 활용도를 높였으며, 파라미터에 따라 상충관계를 개선 할 수 있기 때문에 저 비용 응용뿐만 아니라 고속의 통신장비에도 적용이 가능하다.

A Platform-Based SoC Design of a 32-Bit Smart Card

  • Kim, Won-Jong;Kim, Seung-Chul;Bae, Young-Hwan;Jun, Sung-Ik;Park, Young-Soo;Cho, Han-Jin
    • ETRI Journal
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    • 제25권6호
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    • pp.510-516
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    • 2003
  • In this paper, we describe the development of a platform-based SoC of a 32-bit smart card. The smart card uses a 32-bit microprocessor for high performance and two cryptographic processors for high security. It supports both contact and contactless interfaces, which comply with ISO/IEC 7816 and 14496 Type B. It has a Java Card OS to support multiple applications. We modeled smart card readers with a foreign language interface for efficient verification of the smart card SoC. The SoC was implemented using 0.25 ${\mu}m$ technology. To reduce the power consumption of the smart card SoC, we applied power optimization techniques, including clock gating. Experimental results show that the power consumption of the RSA and ECC cryptographic processors can be reduced by 32% and 62%, respectively, without increasing the area.

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이동환경에서 환불 가능한 타원형 곡선 전자화폐 (A Refundable Elliptic Curve Electronic Cash in Mobile Environments)

  • 권은경;조용구;채기준
    • 정보처리학회논문지C
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    • 제11C권3호
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    • pp.287-292
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    • 2004
  • 브랜드의 카운터 방식 전자화폐 알고리즘(BOCC)은 이동 환경에 적절하지만, 스마트 카드내 금액정보를 공격할 수 있다. 따라서 토큰 데이터에 지불 한계 금액을 삽입함으로써 상한금액을 넘어서 사용하지 못하도록 하고, 상한과 하한 값을 같게 하면 고정금액 토큰이 된다. 또한 온라인 거래에서 더욱 빈번히 발생 가능한 환불성을 추가한다. 기존의 BOCC는 이산대수문제(Discrete Logarithm Problem)에 근거하기 때문에 지수 승을 반복해서 수행하여야 한다. 그런데 제한된 계산 능력을 가진 이동단말의 경우는 계산량을 줄여야 한다. 따라서 타원곡선 알고리즘(ECC)을 적용함으로써 기능은 동일하나 계산량 감소를 얻을 수 있다

LDPC를 이용한 예측 기반 워터마킹 알고리듬 (Estimation-based Watermarking Algorithm with Low Density Parity Check (LDPC) Codes)

  • 임재혁;원치선
    • 대한전자공학회논문지SP
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    • 제44권1호
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    • pp.76-84
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    • 2007
  • 본 논문에서는 워터마크 예측과 LDPC 코드를 이용하여 워터마크의 성능을 향상시키는 알고리듬을 제안한다. 워터마크 추출의 경우 삽입된 워터마크의 파워(power)가 원본 영상의 파워에 비해 아주 작기 때문에 워터마크의 추출 성능을 높이기 위해서는 워터마크의 예측이 필수적이다. 본 논문에서는 웨이블릿 영역에서 잡음 제거 필터를 사용하여 워터마크의 예측을 수행하였다. 이렇게 예측된 워터마크에 에러가 발생할 경우 LDPC 코드를 사용하여 수정하였다. 에러 수정 시 삽입된 워터마크의 통계적인 특성을 사용하여 기존의 LDPC 코드의 성능보다 우수한 실험 결과를 도출하였다.

ARM Cortex-M3 상에서 곱셈 연산 최적화 구현 (Compact Implementation of Multiplication on ARM Cortex-M3 Processors)

  • 서화정
    • 한국정보통신학회논문지
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    • 제22권9호
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    • pp.1257-1263
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    • 2018
  • 경량 사물인터넷 디바이스 상에서의 암호화 구현은 정확하고 빠르게 연산을 수행하여 서비스의 가용성을 높이는 것이 중요하다. 특히 곱셈 연산은 RSA, ECC, 그리고 SIDH와 같은 공개키 암호화에 활용되는 핵심 연산으로 최적화된 구현이 요구된다. 하지만 최신 저전력 프로세서인 ARM Cortex-M3 프로세서의 경우에는 곱셈연산 입력 크기에 따라 수행속도가 달라지는 보안 취약점을 가지고 있다. 수행속도가 달라지게 될 경우 연산 시간의 차이점을 확인하여 비밀정보를 추출하는 것이 가능하다. 이를 보완하기 위해 최근 연구에서는 고정된 연산 시간 안에 곱셈 연산을 수행하는 기법이 제안되었다. 하지만 해당 구현에서는 여전히 속도가 완전히 최적화되어 있지 않다. 본 논문에서는 기존에 제안된 곱셈연산을 보다 효율적으로 연산하기 위한 기법을 제안한다. 제안된 기법은 기존 방식에 비해 연산 속도를 최대 25.7% 향상시킨다.

유·무선 환경에 적용 가능한 효율적인 Wi-Fi Easy Connect 프로토콜 개선방안 연구 (A Research on Effective Wi-Fi Easy Connect Protocol Improvement Method Applicable to Wired and Wireless Environments)

  • 유호제;김찬희;임성식;김서연;김동우;오수현
    • 융합보안논문지
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    • 제23권1호
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    • pp.45-54
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    • 2023
  • 최근 사물인터넷의 발전과 함께 UI가 없는 장치도 간편하게 네트워크에 연결할 수 있는 프로토콜에 관한 연구가 꾸준하게 이루어지고 있다. 이를 위해 Wi-Fi Alliance에서는 QR 코드를 사용하여 네트워크에 연결할 수 있는 Wi-Fi Easy Connect를 발표하였다. 하지만, Wi-Fi Easy Connect는 안전성을 위해 많은 연산량을 요구하고 있어 저전력·소형화된 사물인터넷 장치에 적용하기 어렵다는 문제가 있다. 또한, 확장성을 고려한 Wi-Fi Easy Connect는 유선 환경에서도 동작할 수 있도록 설계되었지만, TLS와 같이 보안 환경을 고려하지 않아 중복 암호화 등의 문제가 발생하고 있다. 따라서 본 논문에서는 Wi-Fi Easy Connect 프로토콜을 분석하고, TLS 환경에서도 효율적으로 동작할 수 있는 프로토콜을 제안한다. 제안하는 프로토콜은 기존 보안 요구사항을 만족함과 동시에 연산량이 큰 ECC scalar multiplication 연산이 약 67% 감소하는 것을 확인할 수 있었다.

차량용 온칩 버스의 데이터 무결성을 위한 종단간 에러 정정 코드(e2eECC)의 설계 및 구현 (Design and Implementation of e2eECC for Automotive On-Chip Bus Data Integrity)

  • 길은배;박찬;김주호;정준호;이주석;이성수
    • 전기전자학회논문지
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    • 제28권1호
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    • pp.116-122
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    • 2024
  • AMBA AHB-Lite 버스는 저전력 및 경제성 측면에서 SoC에 널리 사용되는 온칩 버스 프로토콜이다. 하지만 이 프로토콜은 종단간 데이터 무결성을 위한 에러 검출 및 정정이 불가능하다. 이로 인해 자동차와 같이 열악한 환경에서 동작하는 경우에 데이터 변질과 시스템 불안정을 일으킬 수 있다. 이러한 문제를 해결하기 위해 본 논문에서는 AMBA AHB-Lite 버스에 SEC-DED(Single Error Correction-Double Error Detection)를 적용하는 방법을 제안한다. 이는 전송 중 발생하는 데이터 에러를 실시간으로 감지하고 정정하여 종단간 데이터 무결성을 강화한다. 시뮬레이션 결과, 에러가 일어나도 실시간으로 이를 감지하고 정정하여 차량용 온칩 버스에서 종단간 데이터 무결성을 강화하는 것을 확인하였다.

박동류 및 비박동류에 의한 체외순환의 비교 (Comparative Studies of Pulsatile and Nonpulsatile Blood Flow during Cardiopulmonary Bypass)

  • 선경;백광제;김요한;임창영;김광택;김학제;김형묵
    • Journal of Chest Surgery
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    • 제18권2호
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    • pp.182-192
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    • 1985
  • [here are so many reports that pulsatile blood flow provides physiologic organ perfusions during cardiopulmonary bypass. So, we compared the recent 30 cases undergoing cardiac surgery by Cobe-Stckert pulsatile roller pump with another 30 cases by Polystan nonpulsatile roller pump. Pulsatile flow was applied during aortic-cross clamping period when synchronized to internal EKG simulator, and perfusion mode was changed to continuous nonpulsatile flow after declamping of aorta. Age, sex, weight, and disease entities were comparable and operative techniques were similar between two groups. 1. There were no differences in average ACC time, ECC time, and Operation time. 2. Postoperative artificial respiration time was 6hrs 30mins in nonpulsatile group and 4hrs 48mins in pulsatile group, and detubation time after ventilator weaning was 2hrs 44mins in nonpulsatile group and 1hrs 43mins in pulsatile group. 3. Average pulse pressure was 8mmHg in nonpulsatile group and 55mmHg in pulsatile group, and a mean arterial pressure was 66.0mmHg in nonpulsatile group and 60.7mmHg in pulsatile group. 4. Mean urine-output during ACC;ECC period was 9.717.3;9.913.2ml/kg/hr in nonpulsatile group and 14.215.0;15.817.5 in pulsatile group [p<0, 05], and thereafter progressive decrease of differences in urine output between two groups until POD 2, and lesser amounts of diuretics was needed in pulsatile group during same postoperative period. Serum BUN/Cr level showed no specific difference and urine concentration power was well preserved in both groups. 5. Plasma proteins and other Enzymes showed no differences between two groups, but serum GOT/GPT level was higher in nonpulsatile group till POD 2. 6. Serum Electrolytes showed no differences between two groups. 7. WBC, RBC, Platelet counts, Hgb and Hct were not different and Coagulogram was well preserved in both groups. 8. Plasma free Hgb level was 7.09mg% in pulsatile group compared with 3.48mg% in pulsatile group on POD 1 but was normalized on POD 2. Gross hemoglobinuria after ECC was noted in 6 cases [20%] of pulsatile group and 4 cases [13%] of nonpulsatile group. 9. In both groups, most patients were included in NYHA class III to IV [28 cases;93% in nonpulsatile group, 22 cases;73% in pulsatile group] preoperatively, and well improved to class I to 11[22 cases; 73% in nonpulsatile group, 30 cases; 100% in pulsatile group] postoperatively. There were 7 operative mortalities in nonpulsatile group only, which were 5 cases of TOF with hepatic failure, 1 case of multiple VSDs with low out-put syndrome, and 1 case of mitral valvular heart disease with cardiomyopathy. We concluded that the new, commercially available Cobe-Stckert pulsatile roller pump device was safe, simple, and reliable.

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The Novel Efficient Dual-field FIPS Modular Multiplication

  • Zhang, Tingting;Zhu, Junru;Liu, Yang;Chen, Fulong
    • KSII Transactions on Internet and Information Systems (TIIS)
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    • 제14권2호
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    • pp.738-756
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    • 2020
  • The modular multiplication is the key module of public-key cryptosystems such as RSA (Rivest-Shamir-Adleman) and ECC (Elliptic Curve Cryptography). However, the efficiency of the modular multiplication, especially the modular square, is very low. In order to reduce their operation cycles and power consumption, and improve the efficiency of the public-key cryptosystems, a dual-field efficient FIPS (Finely Integrated Product Scanning) modular multiplication algorithm is proposed. The algorithm makes a full use of the correlation of the data in the case of equal operands so as to avoid some redundant operations. The experimental results show that the operation speed of the modular square is increased by 23.8% compared to the traditional algorithm after the multiplication and addition operations are reduced about (s2 - s) / 2, and the read operations are reduced about s2 - s, where s = n / 32 for n-bit operands. In addition, since the algorithm supports the length scalable and dual-field modular multiplication, distinct applications focused on performance or cost could be satisfied by adjusting the relevant parameters.