플라이휠 에너지 저장 장치는 잉여 전기를 회전관성을 통해 운동 에너지로 저장하는 장치로, 회전의 중심이 되는 축과 외부의 플라이휠로 구성이 된다. 수치해석을 위한 일반적 프로그램들은 3차원의 모델을 통하여 구조해석 및 주파수 응답 등의 해석을 수행하게 된다. 허나 상용 프로그램을 이용한 동역학적 해석의 응용은 매우 어려운 실정이며, 사용자가 그 방법을 익히는 것 또한 쉽지 않다. 이러한 문제들을 보완하고자 동역학적 해석을 위한 프로그램을 2차원의 모델을 사용하여 구축하였다. 본 논문에서 제시한 모델링은 회전체를 2차원으로 표현함으로써 3차원에 비해 시스템의 표현을 보다 단순화하여 시스템의 구조를 쉽게 이해할 수 있도록 하였으며, 회전체를 서로 다른 재질의 다중 레이어로 모델이 가능하게 하였다. 또한 축계에 추가적 강성의 영향을 줄 수 있는 열박음 부분에 대하여, 그 영향 정도를 선택적으로 입력할 수 있게 하여 열박음에 대한 효과를 조정할 수 있도록 하였다. 따라서 본 논문에서 제시하는 2차원 모델을 이용한 동특성 해석 프로그램의 해석 오차를 알아보기 위해 상용 프로그램의 해석 결과와 비교하였으며, 모델링을 위한 시간과 해석 수행 시간 역시 비교하였다.
In this paper, we investigated current (I)- and voltage (V)-sweeping properties in a double-stack structure, Ge2Sb2Te5/Ti/W-doped Ge8Sb2Te11, a candidate medium for applications to multilevel phase-change memory. 200-nm-thick and W-doped Ge2Sb2Te5 and W-doped Ge8Sb2Te11 films were deposited on p-type Si(100) substrate using magnetron sputtering system, and the sheet resistance was measured using 4 point-probe method. The sheet resistance of amorphous-phase W-doped Ge8Sb2Te11 film was about 1 order larger than that of Ge2Sb2Te5 film. The I- and V-sweeping properties were measured using sourcemeter, pulse generator, and digital multimeter. The speed of amorphous-to-multilevel crystallization was evaluated from a graph of resistance vs. pulse duration (t) at a fixed applied voltage (12 V). All the double-stack cells exhibited a two-step phase change process with the multilevel memory states of high-middle-low resistance (HR-MR-LR). In particular, the stable MR state is required to guarantee the reliability of the multilevel phase-change memory. For the Ge2Sb2Te5 (150 nm)/Ti (20 nm)/W-Ge8Sb2Te11 (50 nm), the phase transformations of HR→MR and MR→LR were observed at t<30ns and t<65ns, respectively. We believe that a high speed and stable multilevel phase-change memory can be optimized by the double-stack structure of proper Ge-Sb-Te films separated by a barrier metal (Ti).
본 논문에서는 기존에 주로 연료전지나 배터리 분석용으로 사용되었던 EIS 장비를 그 적용 범위를 넓혀 차세대 축전지인 EDLC 슈퍼커패시터까지도 분석할 수 있도록 개발하였다. 시스템은 다양한 패턴을 발생시킬 수 있는 신호 발생기, 정전위기, 수집된 신호처리를 위한 고속 디지털 필터 및 측정 프로그램으로 구성되었다. 개발된 시스템은 연구실 레벨에 그치지 않고 휴대용이면서 양산용에도 적합한 전기화학 분석 장치이다. 시스템의 특징으로는 0.01에서 20kHz까지 신호 출력이 가능하며, 동시에 수집된 전류신호는 푸리에변환을 이용하여 빠르게 분석할 수 있다. 장치를 이용하여 분석한 EDLC의 특성인 복소 저항 임피던스와, 등가이론을 적용한 등가회로 임피던스 데이터를 비교한 결과, 비슷한 결과를 확인 할 수 있었다. 이 시스템을 사용하면, 슈퍼커패시터의 생산 과정에서 시간에 따라 변하는 전기화학적 임피던스 변화를 빠른시간에 측정 할 수 있을 것으로 예상된다.
국제해사기구(IMO)에서는 해양 환경보호를 위해 황산화물($SO_X$), 질소산화물($NO_X$), 이산화탄소($CO_2$) 등의 선박 배기가스 배출 규제를 강화하고 있으며, 특히 미국, 유럽을 중심으로 배출가스통제구역(Emission Control Area, ECA)을 설정하여 운용하고 있다. 이러한 환경 규제의 대응방법으로서 친환경 고효율 선박에 대한 요구가 커지면서 배출가스를 줄일 수 있는 전기추진시스템 관련 연구 및 기술에 대한 관심이 늘어나고 있다. 컨테이너선과 같은 상선은 경제속도 운항의 이유로 전기추진시스템의 적용대상에서 벗어나 있었으나, 앞으로 배기가스 배출 규제가 강화되고 4차 산업혁명 기술로 대표되는 빅데이터, IoT 기술을 적용한 자동화 시스템이 선박에 적용되기 위해서는 모니터링 및 제어가 쉬운 전기추진시스템이 필요할 것으로 전망된다. 따라서 본 논문에서는 6,800TEU 컨테이너 선박을 대상으로 전기추진시스템을 적용하기 위해서 기존 컨테이너 선박의 부하분석을 통해 부하분석 기반의 발전기 및 배터리 용량 설계를 목표로 연구를 진행하였다. 부하분석기반으로 설계된 시스템은 배터리를 이용한 부하분배제어를 통해 발전기가 높은 효율구간에서 운용할 수 있다는 장점이 있다.
본 논문은 이중 펄스 폭을 지닌 PFM(Pulse-Frequency Modulator) 부스트 변환기를 제안한다. 부스트 변환기의 구동 회로 구조는 밴드 갭 기준 전압 발생 회로와 이를 이용해 여러 가지의 기준 전압을 생성하는 기준 전압 발생 회로, 소프트 시동 회로, 에러 증폭기, 고속 전압 비교기, 인덕터 전류 센싱 회로, 펄스 폭 발생 회로로 구성되어있다. 변환기는 부하 전류 상태에 따라 서로 다른 최대 인덕터 전류 값을 갖도록 구성해 부하 범위를 넓히고, 출력 전압 리플을 감소하도록 했다. 제안된 PFM 부스트 변환기는 입력 전압으로 3.7V를 받고, 18V의 출력 전압을 생성한다. 구동 가능한 부하 전류는 0.1~300mA의 범위를 가진다. 모의실험 결과 저 부하 전류 동작 구간에서 0.43%, 고 부하 전류 동작 구간에서는 0.79%의 출력 전압 리플을 보였다. 변환기는 저 부하 구간에서 85%의 효율을 나타내며 20mA에서 86.4%로 최대의 효율을 나타냈다.
본 논문은 풍력터빈의 출력 제어 방법에 관한 논문이다. MW급 풍력 터빈 출력제어의 기본 제어 구조는 가변속도 가변피치 방식을 사용한다. 가변속도 가변피치 제어는 파워 커브를 추종하기 위한 방법으로서, 풍속변화에 따라 이 제어방식이 어떻게 적용되는지 논의한다. 제어 시스템 설계를 위하여 단순화된 드라이브 트레인 모델이 사용되었다. 제어 시스템은 토크제어와 피치제어로 구성되고, 제시된 동적 모델을 사용하여 설계된 제어 시스템의 시뮬레이션 결과에 대하여 논의한다.
본 논문은 대용량 유도전동기의 기동특성을 분석하였다. 유도전동기 토크는 전류와 자속의 곱으로서 이 자속을 발생시키기 위해서는 여자전류에 해당되는 무효전력이 필요하다. 유도전동기에 필요한 무효전력을 공급하는 방법으로 역률 보상장치를 사용하여 전원측을 대신하여 공급하는 방법을 많이 사용하는데, 역률 보상장치를 사용할 경우 피상전력을 줄일 수 있어 역률을 향상시킬 수 있다. 역률을 개선하기 위한 보상장치를 설치하는 방법으로 부하마다 설치하는 경우와 전체를 일괄 보상하는 방법으로 고압 대용량의 부하로서 일정한 운전패턴을 가지고 있는 경우에는 주로 개별보상이 주로 사용된다. 일반적으로 대용량 유도전동기는 기동 보호장치를 이용하지만 이 논문은 전전압 기동시의 특성을 분석하는 가상의 상황을 가정하여 기동특성에 대한 이론과 실제의 운전특성을 측정 분석하고 역률개선 콘덴서를 이용하여 기동특성을 개선해 보았다.
원시 프로그램에 대한 컴파일 과정 중 최적화 단계에서는 프로그램의 실행 속도를 개선시키고 코드 크기를 줄일 수 있는 다양한 최적화 기법을 수행한다[17]. 최적화 패턴 매칭 방법 중 스트링 패턴 매칭 방법은 중간 코드에 대응하는 최적의 패턴을 찾기 위한 방법으로 과다한 최적화 패턴 검색 시간으로 비효율적이다. 트리 패턴 매칭은 패턴 결정시 중복 비교가 발생할 수 있으며, 코드의 트리 구성에 많은 비용이 드는 단점을 가지고 있는 방법들이다[16,18]. 본 논문에서는 기존의 최적화 방법들의 단점을 극복하기 위한 방법으로 DFA (Deterministic Finite Automate) 최적화 테이블을 이용한 코드 최적화기를 제안하려고 한다. 이 방법은 다른 패턴 매칭 기법보다 결정적인 오토마타(Automata)로 구성하기 때문에 비용은 적어지고, 오토마타를 통해 결정적으로 패턴이 확정됨에 따른 패턴 선택 비용이 줄어들며, 최적화 패턴 검객 시간도 빨라지는 효율적인 방법의 최적화기이다.
IEEE 802.11a에 의해 규정되어진 데이터 전송속도 12Mbps, 부호화 율 1/2, 구속장이 7인 무선 LAN용 비터비 디코더의 이론적인 성능분석을 위해서 Cramer법칙을 이용하여 전달함수를 구하고 가산성 백색 가우시안 잡음 환경하에서 각 구속장 별 첫 번째 사건에서의 에러 확률과 비트 에러 확률을 구하였다. 설계과정에서는 4 비트 연성판정을 위해 입력 심볼을 16단계로 양자화 하였으며, 역 추적을 위한 방식으로 메모리를 사용하는 대신 레지스터 교환방식을 사용함으로써 다수결 결정이 가능한 구조를 제시하였다. 구현과정에서는 12Mbps 고속의 데이터를 처리하기 위해 파이프 라인을 적용한 병렬구조를 갖는 비터비 디코더와 가산성 백색 가우시안 잡음 설계를 FPGA 칩을 사용하여 구현하여 실시간 환경에서 성능검증을 하였다.
본 논문에서는 Ka 대역 소형 레이다용 주파수합성기를 제안하였다. 제작된 주파수합성기는 시스템에서 요구하는 다양한 파형을 생성하고 고속의 파형 및 주파수 전환을 위해 DDS를 적용하였다. 소형화를 위해 Ku 대역에는 MMIC를 최대한 적용하여 Ka 대역 회로를 소형 집적화 하였고 파형발생부 과 주파수 상향 변환부를 하나의 모듈로하여 설계 제작하였다. 제안된 주파수합성기는 선형 주파수 변조 파형과 위상변조 가능한 주파수 변조 연속 파형 등 발생이 가능하고, 대역폭 1GHz, 주파수 전환 속도 $0.191{\mu}sec$, 1 kHz 오프셋(offset)에서 -89.16 dBc/Hz의 위상잡음, 불요파 -50.9 dBc가 측정되었다.
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[게시일 2004년 10월 1일]
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