• International Journal of Naval Architecture and Ocean Engineering
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• 제11권1호
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• pp.274-284
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• 2019

The control architectures of Chuan Suo (CS) deep submergence rescue vehicle are introduced. The hardware and software architectures are also discussed. The hardware part adopts a distributed control system composed of surface and underwater nodes. A computer is used as a surface control machine. Underwater equipment is based on a multi-board-embedded industrial computer with PC104 BUS, which contains IO, A/D, D/A, eight-channel serial, and power boards. The hardware and software parts complete data transmission through optical fibers. The software part involves an IPC of embedded Vxworks real-time operating system, upon which the operation of I/O, A/D, and D/A boards and serial ports is based on; this setup improves the real-time manipulation. The information flow is controlled by the software part, and the thrust distribution is introduced. A submergence vehicle heeling control method based on ballast water tank regulation is introduced to meet the special heeling requirements of the submergence rescue vehicle during docking. Finally, the feasibility and reliability of the entire system are verified by a pool test.

• Journal of Multimedia Information System
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• 제6권1호
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• pp.7-14
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• 2019

This work presents a virtual prototyping design approach for an area-based image stitching hardware. The virtual hardware obtained from virtual prototyping is equivalent to the conceptual algorithm, yet the conceptual blocks are linked to the actual circuit components including the memory, logic gates, and arithmetic units. Through the proposed method, the overall structure, size, and computation speed of the actual hardware can be estimated in the early design stage. As a result, the optimized virtual hardware facilitates the hardware implementation by eliminating trail design and redundant simulation steps to optimize the hardware performance. In order to verify the feasibility of the proposed method, the virtual hardware of an image stitching platform has been realized, where it required 10,522,368 clock cycles to stitch two $1280{\times}1024$ sized images. Furthermore, with a clock frequency of 250MHz, the estimated computation time of the proposed virtual hardware is 0.877sec, which is 10x faster than the software-based image stitch platform using MATLAB.

• 한국통신학회논문지
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• 제34권7B호
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• pp.744-750
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• 2009

본 논문에서는 신뢰성을 명가하는 데 있어서 소프트웨어 및 하드웨어 측면을 고려한 통합된 마코브 모델링(Markov modeling)으로 AVTMR(AlI Voting Triple Modular Redundancy) 시스템의 신뢰성을 분석한다. 본 시스템의 모델링은 하드웨어의 경우에 고장율이 시불변 특성을 가지며, 소프트웨어 경우에는 시 가변 특성으로 모델링되어 AVTMR 시스템과 단일 시스템에 대한 신뢰성 비교를 한다. 특히, 소프트웨어적인 특성은 G-O/NHPP 기법을 이용하여 분석이 되며, AVTMR 시스템의 전체적인 특성을 소프트웨어 및 하드웨어적인 관점에서 고장율 따른 특성을 이해할 수 있게 된다. 평가된 AVTMR 은 엄베디드 통신 시스템, 항공기 등의 결함 허용 시스댐에 요구되는 스팩에 맞도록 설계를 하기 위한 기반을 제시한다.

• 대한원격탐사학회:학술대회논문집
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• 대한원격탐사학회 2004년도 Proceedings of ISRS 2004
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• pp.39-41
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• 2004

This paper demonstrates the in-house development of the subsystem C&DH in a D-SAT satellite project of Astronautic Technology (M) Sdn. Bhd. (ATSB). D-SAT is a non-imaging satellite. It will carry a dosimeter as the payload for scientific objectives. Since one of the D-SAT project establishment intended objectives is to demonstrate the research and development skill of the ATSB engineers on the satellite system building, most of the subsystems of the D-SAT are developed in-house including the C&DH subsystem. C&DH subsystem plays an important role for managing data handling tasks and general operation of the satellite system. The C&DH development includes the research and study on the hardware and software design, the design of both the hardware and software, the development of the software system, the integration between the software and the hardware system and the implementation of the subsystem into the satellite system. This program allows ATSB to accomplish the engineers with expertise not only in the C&DH subsystem but other subsystems too besides developing knowledge in the management of a space project that covers not only on the technical issues but issues relating to the economic, political and legal issues.

• 한국정보통신학회논문지
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• 제17권5호
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• pp.1089-1094
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• 2013

본 논문에서는 모바일 디스플레이장치에 필요한 MDDI(Mobile Display Digital Interface) 프로토콜 패킷생성방법을 소프트웨어로 구현하는 것을 제안한다. 최소한의 하드웨어 구성을 가지며, 소프트웨어를 이용하여 MDDI 프로토콜 패킷을 생성한다. 이의 구현을 위해 고속 마이크로프로세와 FPGA(Field-Programmable Gate Array)로 하드웨어를 설계하였다. 소프트웨어로 생성한 패킷은 FPGA를 통해 LVDS(Low-Voltage Differential Signaling) 신호로 변환되어 출력된다. 제안하는 방식의 장점은 다양한 패킷을 소프트웨어로 쉽게 만들 수 있다는 것이다. 단점은 패킷전송에 걸리는 시간이 기존에 제안된 방식보다 빠르지 않았다. 이는 향후 개선되어야 할 과제로 남았다.

• 대한전자공학회논문지
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• 제20권2호
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• pp.7-15
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• 1983

근년, 반도체 기술의 급격한 진보에 따라 고기능 논리회로의 VLSI화가 가능하게 되었다. 이에 따라 수치 처리의 고원화, 광대역 화상처리등을 위한 고기능 회로들의 전용 VLSI 칩의 설계가 연구되고 있으며, 여러 종류의 소프트웨어 패키지의 VLSI화가 가능하게 되었다. 본 논문에서는 계산기의 회귀분석용 범용 소프트웨어 패키지(BMD)를 하드웨어화하는 설계 수법을 제안하였다. 이것은 종래의 통계 처리를 소프트웨어에만 의존하기 때문에 처리 속도가 저하되는 것을 하드웨어화함으로써 개선하였다. 설계 알고리즘은 통계 수첩의 계산 특징을 살려 본 시스템을 구성한다. 그 결과 하드웨어화에 의하여 소프트웨어 패키지의 복잡성이 제거되고, 고속 처리함으로써 확률을 향상시켰다.

• 융합보안논문지
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• 제18권5_1호
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• pp.67-73
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• 2018

소프트웨어 공학 관점에서 트레이싱은 프로그램의 실행 정보를 기록하는 로깅의 특수한 형태이다. 엄청난 데이터를 실시간으로 생성하고 디코딩해야 하는 트레이서의 특징상 전용 하드웨어를 사용하는 트레이서가 많이 사용되고 있다. Intel(R) PT는 전용 하드웨어를 사용하여 각 하드웨어 쓰레드에서 소프트웨어 실행에 대한 모든 정보를 기록한다. 소프트웨어 실행이 완료되면 PT는 해당 소프트웨어의 트레이스 데이터를 처리하여 정확한 프로그램 흐름을 재구성할 수 있다. 하드웨어 트레이스 프로그램은 운영체제에 통합되어 사용할 수 있으나 윈도우 시스템의 경우에는 커널 개방과 같은 문제로 인하여 긴밀한 통합은 이루어지지 않고 있다. 또한, 단일 프로세스만 트레이스 할 수 있고 다중 프로세스 스트림을 트레이스 하는 방법은 제공하고 있지 않다. 본 논문에서는 이러한 단점을 극복하고자 윈도우 환경에서 다중 프로세스 스트림을 트레이스 지원이 가능하도록 기존의 PT 트레이스 프로그램을 확장하는 방안을 제안하였다.

• 한국산학기술학회논문지
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• 제15권9호
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• pp.5726-5737
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• 2014

무기체계에서의 소프트웨어에 대한 비중이 커짐에 따라, 소프트웨어 ILS(Integrated Logistics Support)에 대한 관심이 커지고 있다. 그러나 기존 무기체계에서 ILS 개발은 하드웨어 중심으로 적용하고 있어 소프트웨어에 그대로 적용하기 힘든 실정이다. 본 논문은 소프트웨어 ILS의 실무 적용 어려움이 무엇인지 원인을 파악하고 문제점을 분석하기 위해 국내/외 규정 및 사례들을 통해 현 실태를 파악하였다. 또한, 소프트웨어의 유지보수 특성을 고려하여 소프트웨어와 하드웨어 ILS의 차이점을 검토하고, 소프트웨어 ILS 요소개발 범위 설정을 통해 국내에 적용이 가능한 소프트웨어 ILS 개발방안을 제안하였다. 이는 소프트웨어 ILS 개발을 위한 구체적인 실무 적용방안을 수립하는 데 도움이 될 것으로 기대한다.

• 제어로봇시스템학회:학술대회논문집
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• 제어로봇시스템학회 1993년도 한국자동제어학술회의논문집(국내학술편); Seoul National University, Seoul; 20-22 Oct. 1993
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• pp.308-313
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• 1993

In this paper, the navigation computer design of RPV(remotely piloted vehicle) using GPS is investigated, and its hardware and software structures are described. The proposed hardware adopts the common PC configuration by using 5016A micro PC card and software is divided into several modules such as navigation module, guidance module and control module, etc. The performance of the navigation computer is verified through PILS(process in the loop simulation).

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2008년도 하계종합학술대회
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• pp.1187-1188
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• 2008

An area of research called evolvable hardware has recently emerged which combines aspects of evolutionary computation with hardware design and synthesis. Evolvable hardware (EHW) is hardware that can change its own circuit structure by genetic learning to achieve maximum adaptation to the environment. In conventional EHW, the learning is executed by software on a computer. In this paper, we have studied and surveyed a gate-level evolvable hardware chip, by integrating both GA hardware and reconfigurable hardware within a single LSI chip. The chip consists of genetic algorithm(GA) hardware, reconfigurable hardware logic, and the control logic. In this paper, we describe the architecture, functions of the chip.