It is remarkable that the children's wear market has been growing instead of declining birth rate. The parents are willing to pay more when they find children's wear of better design and improved quality. For better quality, it is necessary to research on the pattern making of children's wear. After the interview with the 10 leading children's brands, we found that they develop individual design pattern based on each items middle block pattern which characterize the brands design line. Most frequently used middle block is for casual pants. Through interview with pattern designers, comparative study of patterns drafting methods, wearing test of trial garments and altering and adjustment of patterns, we developed the casual pants block pattern for 7 years old boys.
The major components of an engine are engine block (or cylinder block), cylinder head, crank shaft, connecting rod and cam shaft. Thus the engine shop usually consists of six sub-lines, five machining lines and one assembly line. Flow line is the typical concept of layout for machining these parts, especially for engine block. In order to design an engine block machining line, several factors should be considered such as yearly production target, working hours, machines, tools, material handling equipments and so on. If the designers of manufacturing line were unaware of some factors those would be influenced on the system performance, it would make greater problems in the phase of mass production. Therefore the initial design of engine block machining line should be verified carefully. Simulation is the most powerful tool for analyzing the initial layout. This paper introduces the major factors those should be considered for designing the machining line and their effects on the system performance. 3D simulation models are developed with QUEST. Using the simulation model developed the initial layout is analyzed, and we suggest some ideas for improvement.
음성 인식에서의 dynamic time warp(DTW)은 반복적 계산을 필요로 하며, 이 계산을 수행하기에 합당한 PE cell의 설계는 매우 중요하다. 따라서 이 연구에서는 실제에 가까운 실시간 어휘 인식을 가능하게 하는 large dictionary 의 DTW 알고리즘을 hardware로 구현하기 위한 PE(Processing Element) cell의 설계에 주안점을 두었다. 이 DTW 용 PE cell은 크게 세가지의 블록으로 대별된다. 즉 MIN block, ADD block 그리고 ABS block인데, "MIN"은 accumulated minimum distance를 계산하기 위한 블록이고 "ADD"는 이들 minimum distance들의 합을 계산하는 블록, 그리고"ABS"는 이러한 합에 의한 local distance의 절대값을 구하기 위한 블록이다. 본 연구에서는 이들 세가지 블록중 MIN 회로의 설계 및 검증을 행하였으며, 3um CMOS N-well 설계 규칙에 따라 MIN 블록에 대한 레이아웃을 행한 후 설계 규칙 검사(DRC)를 마쳤다.레이아웃을 행한 후 설계 규칙 검사(DRC)를 마쳤다.
In this paper we are concerned with comparing ordered treatment effects with a control in a randomized block design with multiple observations per cell. Two nonparametric procedures for detecting which treatment are better than the control are proposed and compared. An example is given and the results of a Monte Carlo power study are discussed.
In the last two decades, many researchers proposed various usages of the orthogonal functions such as Walsh, Haar and BPF to solve the system analysis, optimal control, and identification problems from and algebraic form. In this paper, a simple procedure to design and algerbraic observer for the descriptor system is presented by using block pulse function expansions. The main characteristic of this technique is that it converts differential observer equation into an algerbraic equation. And furthermore, a simple recursive algorithm is proposed to obtain BPFs coefficients of the observer equation.
강 구조물의 접합부는 구조물이 안전에 큰 영향을 미치는 부분으로서 이에 대한 연구는 많이 이루어지고 있으나 순수 인장력을 받는 접합부의 블록전단 파단에 대한 연구는 외국에서도 근래에 시작되었으며 현재 국내에서는 연구실적이 없는 상태이다. 본 연구는 최근 우리나라에서 제정된 강구조 한계상태설계기준에 따른 블록전단 산정식의 타당성을 인장력을 받는 ㄱ형강 접합부의 실험에 의하여 규명하고자 한다. 연구방법은 기존의 연구결과의 블록전단 파단형상 및 극한내력을 본 연구와 비교분석하고 기준 산정식의 합당성을 평가하였다. 실험결과 접합부는 2가지 형상, 인장항복 전단파단과 전단항복 인장파단이 일어났으며 실험 파단하중이 기준식에 의한 내력보다 약 15% 크게 나타나고 있어 앞으로 보다 많은 연구에 의해 강구조 한계상태 설계법의 블록전단 산정식에 대한 평가가 필요하다고 사료된다.
Purpose: This study was investigated the effect of multi-layer zirconia block type and design location on the mechanical properties of zirconia copings. Methods: Three kinds of multi-layered zirconia blocks (Snow princess multi layered block, Multi cherry, Dental zirconia pre-shaded blank) were used to identify the effects of the kinds of multi-layered zirconia blocks, design locations on mechanical characteristics of zirconia copings. 150 Zirconia copings were fabricated and fracture strength, hardness and microstructure were compared and evaluated. Results: Dental zirconia pre-shaded blank(2,256.9N) had the highest fracture strength of zirconia copings on all the design locations, and it was followed by Snow princess multi layered block(2,107.5N) and Multi cherry(917.0N). Snow princess multi layered block(1,949.7Hv) had the highest hardness of zirconia copings on all the design locations, and it was followed by Dental zirconia pre-shaded blank(1,671.7Hv) and Multi cherry(1,383.7Hv). The cervical layer had the highest fracture strength and hardness of zirconia copings in all the blocks, and it was followed by the cervical+gradation layer, the enamel layer, the enamel+gradation layer, and the gradation layer. Conclusion: It was found that the fracture strength and hardness were different according to the kinds of multilayer zirconia block and design location, and it was confirmed that it is lower than the fracture strength of white zirconia.
Communications for Statistical Applications and Methods
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제19권1호
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pp.77-84
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2012
반복이 있는 랜덤화 블록 계획법을 검정하는 비모수 검정방법에는 Mack과 Skillings (1980)가 제안한 검정법이 있다. 이 방법은 각 블록의 처리에서 반복된 각 관측값 대신에 반복된 관측값들의 평균을 이용하여 순위를 매기기 때문에 정보의 손실이 있을 수 있다. 본 논문에서는 Hodges와 Lehmann (1962)이 제안한 정렬방법을 이용하여 새로운 비모수 검정법을 제안한다. 또한 모의실험을 통하여 여러 비모수 검정방법들의 검정력을 비교하였다.
본 논문은 symmetric balance incomplete block design(BIBD) code와 arrayed-waveguide grating(AWG) router의 주기적인 특성을 이용하여 optical CDMA network을 위한 coder-decoder(codec)을 구성하였다. 기존의 M-sequence code를 이용한 경우보다 다양한 구성을 할 수 있고 이 시스템의 잡음인 phase-induced intensity noise(PIIN)와 thermal noise를 분석하여 BER을 계산한 결과 향상된 성능을 보임을 알 수 있었다.
본 논문에서는 EPCglobal Class-1 Generation-2 UHF RFID 1.1.0 프로토콜에 따른 수동형 UHF대역 RFID 태그 IC의 제어부를 설계한다. 제어부는 PIE 부, CRC5/CRC16, Slot Counter, Random Number Generator, Main Control 부, Encoder, Memory Interface로 나누어 Verilog HDL을 이용하여 설계하고 시뮬레이션을 하였다. 제어부 전체 동작에 대한 시뮬레이션 결과 7개 상태에서 11개의 명령어들이 올바르게 동작함을 확인하였다. 또한, 제어부의 설계를 Synopsys Design Compiler와 Apollo를 이용하여 Magnachip 0.25$\mu$m 공정 라이브러리를 통해 레이아웃을 하였고 총 36,230개의 게이트가 사용되었다.
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[게시일 2004년 10월 1일]
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