• 제목/요약/키워드: bit data

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비트변환방식을 이용한 데이터 취득에 관한 연구 (A Study on the Data Acquisition by Bit Conversion Method)

  • 박상길
    • 수산해양기술연구
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    • 제22권1호
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    • pp.34-40
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    • 1986
  • This paper deals with a new bit conversion method. When 12 bit AID converter is adapted to 16 bit micro-computer, complicated data aquisition method is not necessary to acquire the AID converted data into memory of computer. However, when the 12 bit AID converter is adapted to the 8 bit micro-computer 12 bit data should be divided into 4 bit data and 8 bit data. Therefore the old data-dividing method made 4 bitl2byte of memory space wasted. On the contrary, using the new bit conversion method suggested in this paper the two of 12 bit data are converted into 3 byte of data without extending the AID conversion time.

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A Steganographic Data Hiding Method in Timestamps by Bit Correction Technique for Anti-Forensics

  • Cho, Gyu-Sang
    • 한국컴퓨터정보학회논문지
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    • 제23권8호
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    • pp.75-84
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    • 2018
  • In this research, a bit correction technique of data hiding method in timestamp of MFT entry in NTFS file system is proposed. This method is proposed in two ways, depending on the number of bytes of data to hide. A basic data hiding method using a bit correction technique to solve the problems of the conventional 2-byte technique is proposed. In order to increase the capacity of the data, a 3-byte data hiding method using an extended bit correction technique is proposed. The data hiding method in the timestamps is based on the fact that is not revealed in the Windows explorer window and the command prompt window even if any data is hidden in the timestamp area of less than one second. It is shown that the validity of the proposed method through the experimental two cases of the basic data hiding method by the bit correction method and the 3-byte data hiding method by the extended bit correction method.

Data Bit Jitter가 Data 동기회로의 Bit Slip Rate에 미치는 영향에 관한 연구 (Effect of Data Bit Jitter on the Bit Slip Rate of the Data Tracking Loop)

  • 최형진
    • 한국통신학회논문지
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    • 제15권5호
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    • pp.353-363
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    • 1990
  • 본 논문은 Data Bit Jitter(DBJ)가 Data 동기수신회로의 Bit Slip Rate(BSR) 에 미치는 영향에 관하여 고찰하였다. 특히 이 논문에서는 BSR치를 계산하는데 필요한 특성 jitter parameter 들을 부각시켰으며 또한 DBJ에 관한 새로운 규격설정을 제시하였다. 새로이 제시된 방법에 의하면 종래의 방법에 비하여 복잡해진 점은 있으나, 반면 보다 현실적이고 보다 더 정확하게 DBJ의 BSR에 관한 영향을 예측할 수 있는 장점이 있다고 생각된다. 새로이 제시된 방법에서는 수신기에 의존하는 parameter들이 부각되었으며 jitter spectrum의 각 부분(저주파, 고주파 부분등)에 대한 적절한 비중이 고려되었다.

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디지털 이동통신 채널상의 14Kbps SBC-APCM(AQB)를 위한 비트선택적 에러정정부호 (Bit-selective Forward Error Correction for 14Kbps SBC-APCM (AQB) over Digital Mobile Communication Channels)

  • 김민구;이재홍
    • 대한전자공학회논문지
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    • 제27권6호
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    • pp.821-828
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    • 1990
  • A forward error correction (FEC) technique is presented for speech data in 16 Kbps digital mobile communications. 14Kbps SBC-APCM(AQB) and QPSK are used as speech coding and modulation techniques, respectively. Because each bit in a speech data block had different importance, applying FEC to speech data bit-selectively in more effective than applying FEC to all speech data equally. To select bits in a speech data block to be protected by FEC the bit error sensitivity of each bit is computed. For a few BCH and Reed-Solomon codes used as bit-selective FEC the performance of the coding technique is computed.

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IBM-PC를 위한 다목적용 데이타 수집 및 컨트롤 장치의 개발 (Disign and Evaluation of a Versatile Data Acquisition and Control Adaptor for IBM Personal Computers)

  • 김해동;송형수
    • 분석과학
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    • 제5권3호
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    • pp.295-301
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    • 1992
  • IBM-PC를 위한 다목적용 데이타 채집 및 컨트롤 장치를 개발하였다. 개발된 데이타 채집 및 컨트롤 장치는 컴퓨터를 이용한 데이타 채집 및 기기 컨트롤에 필요한 주요 기능을 대부분 보유하고 있다. 아날로그 신호는 최고 4쌍의 차동신호를 받을 수 있으며 실험조건에 따라 두 개의 12-bit A/D 컨버터를 선택하여 처리할 수 있다. 또한 2개의 12-bit D/A 컨버터와 3채널의 16-bit 카운터/타이머, 그리고 24-bit 디지탈 입출력장치 등 실험실에서 컴퓨터를 이용한 실험자동화에 필요한 대부분의 기능을 가지고 있어 다목적용으로 사용될 수 있다.

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A Serial Input/Output Circuit with 8 bit and 16 bit Selection Modes

  • Yang, Yil-Suk;Kim, Jong-Dae;Roh, Tae-Moon;Lee, Dae-Woo;Koo, Jin-Gun;Kim, Sang-Gi;Park, Il-Yong;Yu, Byoung-Gon
    • ETRI Journal
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    • 제24권6호
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    • pp.462-464
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    • 2002
  • This paper presents a serial interface circuit that permits selection of the amount of data converted from serial-to-parallel and parallel-to-serial and overcomes the disadvantages of the conventional serial input/output interface. Based on the selected data length operating mode, 8 bit or 16 bit serial-to-parallel and 8 bit or 16 bit parallel-to-serial conversion takes place in data blocks of the selected data length.

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8비트 데이타 정밀도를 가지는 다층퍼셉트론의 역전파 학습 알고리즘 (Learning of multi-layer perceptrons with 8-bit data precision)

  • 오상훈;송윤선
    • 전자공학회논문지B
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    • 제33B권4호
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    • pp.209-216
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    • 1996
  • In this paper, we propose a learning method of multi-layer perceptrons (MLPs) with 8-bit data precision. The suggested method uses the cross-entropy cost function to remove the slope term of error signal in output layer. To decrease the possibility of overflows, we use 16-bit weighted sum results into the 8-bit data with appropriate range. In the forwared propagation, the range for bit-conversion is determined using the saturation property of sigmoid function. In the backwared propagation, the range for bit-conversion is derived using the probability density function of back-propagated signal. In a simulation study to classify hadwritten digits in the CEDAR database, our method shows similar generalization performance to the error back-propagation learning with 16-bit precision.

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SPICE를 이용한 16-BIT ALU의 회로 해석 및 설계에 관한 연구 (A Study on the Analysis and Design of 16-BIT ALU by Using SPICE)

  • 강희조
    • 한국통신학회논문지
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    • 제15권3호
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    • pp.197-212
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    • 1990
  • 빠른 설계 시간 및 재 설계 가능성 부여 등에 주안점을 두어 고성능의 단일 칩 16-bit data path를 설계하였다. 원칙적인 설계 방법의 체계적인 연구를 위하여 module화의 개념을 근간으로한 설계방법을 도입하였으며, 이에 따라 각 내부블럭이 bus에 연결되어 독립적으로 동작하는 subsystem이 되도록 이를 결합하여 전체 시스템의 설계를 완성하였다. 시스템은 data path이다. Data path는 16-bit의 데이터를 처리하는 부분으로 ALU(Arithmetic Logic Unit), register file, barrel shifter 및 bus 회로로 구성된다. 이 회로에서의 게이트의 폭과 길이는 spice2를 사용하여서 결정하였다. 회로 시뮬레이션의 결과는 기대하였던 회로 특성과 잘 일치하였다.

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Dynamic Element Matching을 통한 Multi-bit Delta-Sigma Modulator에서의 DAC Error 감소 방안 비교 (Comparison of Dynamic Elements Matching Method in the Delta-Sigma Modulators)

  • 현덕환
    • 한국정보통신학회논문지
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    • 제10권1호
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    • pp.104-110
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    • 2006
  • 고정도, 저주파용 데이터 변환기로 사용되어온 델타-시그마 변환기는 그 출력 단에 1 bit 혹은 multi-bit 양자화기(ADC)를 사용할 수 있다. 이 중 multi-bit 양자화기를 사용하는 경우 궤환회로에도 multi-bit DAC을 사용하여야 하며 시스템의 데이터 변환 정확도는 DAC의 비선형성에 직접적인 영향을 받는다. 이 영향을 최소화하여 델타-시그마 변환기의 변환 정확도를 높이기 위해서는 DAC에 사용되는 단위 데이터 변환소자 간의 오차가 시스템에 미치는 영향을 최소화 하여야한다. 이 과정 즉 Dynamic Element Matching을 위하여 제안된 4가지 방안(DER, CLA, ILA, DWA)을 비교 설명하였다. 그리고 각 방안을 사용하였을 때 시스템 출력의 잡음 특성을 비교 하였다. 이중 DWA(Data Weighted Averaging) 방안이 가장 우수한 출력 특성을 보였다.

Bit-map-based Spatial Data Transmission Scheme

  • OH, Gi Oug
    • 한국컴퓨터정보학회논문지
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    • 제24권8호
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    • pp.137-142
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    • 2019
  • This paper proposed bitmap based spatial data transmission scheme in need of rapid transmission through network in mobile environment that use and creation of data are frequently happen. Former researches that used clustering algorithms, focused on providing service using spatial data can cause delay since it doesn't consider the transmission speed. This paper guaranteed rapid service for user by convert spatial data to bit, leads to more transmission of bit of MTU, the maximum transmission unit. In the experiment, we compared arithmetically default data composed of 16 byte and spatial data converted to bitmap and for simulation, we created virtual data and compared its network transmission speed and conversion time. Virtual data created as standard normal distribution and skewed distribution to compare difference of reading time. The experiment showed that converted bitmap and network transmission are 2.5 and 8 times faster for each.