A feed forward differential architecture of analog PRML decoder is investigated to implement on analog parallel processing circuits. The conventional PRML decoder performs the trellis processing with the implementation of single stage in digital and its repeated use. The analog parallel processing-based PRML comes from the idea that the decoding of PRML is done mainly with the information of the first several number of stages. Shortening the trellis processing stages but implementing it with analog parallel circuits, several benefits including higher speed, no memory requirement and no A/D converter requirement are obtained. Most of the conventional analog parallel processing-based PRML decoders are differential architecture with the feedback of the previous decoded data. The architecture used in this paper is without feedback, where error metric accumulation is allowed to start from all the states of the decoding stage, which enables to be decoded without feedback. The circuit of the proposed architecture is simpler than that of the conventional analog parallel processing structure with the similar decoding performance. Characteristics of the feed forward differential architecture are investigated through various simulation studies.
본 논문에서는 전기자동차용 충전기를 위한 단일단 소프트스위칭 AC-DC 컨버터를 제안한다. 제안하는 컨버터는 두 대의 인터리빙 컨버터에 저손실 스위칭기법을 적용하여 변압기의 저주파 성분을 제거하여 코어부피를 최적화할 수 있을 뿐만 아니라 스위치의 도통손실 및 스위칭 손실을 감소시킬 수 있다. 또한 배터리에 저주파 리플이 허용되는 경우에는 필름 커패시터만을 사용하여 정현파 충전을 함으로써 시스템의 높은 내구성 및 소형화를 달성 할 수 있다. 3.3kW급 시작품을 통해 본 논문의 타당성을 검증하였다.
Vehicle-to-grid (V2G) 시스템에서의 전기자동차는 계통의 에너지 저장장치로서 이용되는데 여기서 계통과 전기자동차의 에너지 교환을 위해서는 양방향 컨버터가 필요하다. 이 논문에서는 BSS-FBC (Bidirectional Single-Stage Full-Bridge Converter)를 이용하여 V2G가 가능한 전기자동차용 11kW급 OBC를 설계하였다.
In this paper, active input filter for power factor correction(PFC) circuit employing ripple arrent and voltage cancellation is proposed to reduce filter's size and cost, and to make filter design easy. Switching ripple current and voltage can be sensed through the secondary windings of filter inductor. Single stage passive filter can achieve high order filter characteristics by using active ripple current and voltage cancellation technique. Conventional high order passive filter and its problems are suggested. Analysis of active filter and design procedure are detailed. Simulation result is presented to verify high order filter characteristics of proposed scheme.
본 논문에서는 THD 개선을 위한 단순한 구조의 단일 단 PFC를 제안하고 벅 컨버터에 적용하였다. 제안한 회로는 밸리-필 정류회로와 부스팅을 위한 인덕터를 결합하여 단일 능동 소자로 DC/DC 변환 과 PFC를 동시에 수행한다. 제안된 회로에서의 입력전류 모양은 입력전압조건과 PWM 스위칭 시간에 관계되고, 부스팅 인덕터에 의해 능동스위치 차단시간동안 입력 전류를 제어하여 THD를 개선한다. 부스팅 인덕터 채용에 따른 동작해석과 최적 THD를 위한 인덕터를 선정하고 100W출력 단일 단 컨버터를 설계, 제작하였다. 실험에 의한 측정된 결과로 제안된 컨버터의 타당성을 검증하였다.
본 논문은 저 도전 손실을 갖는 새로운 단단, 단일 스위치 역률보상 부스트형 교류/직류 변환기를 소개한다. 제안한 변환기는 약간의 구조적 차이점을 제외하고 기존의 변환기와 동일하게 해석될 수 있다. 먼저, 제안한 변환기와 기존의 변환기의 동작원리를 파악하여 두 변환기의 차이점을 이해하고 1단 역률 보상 교류/직류 변환기의 구조적 문제점인 에너지 저장 커패시터에서의 직류 전압 상승을 방지하기 위한 직류 부스 전압 궤환 방식을 도입하여 제안한 변환기에 적용하였다. 100W급 변환기를 제작/실험하여 본 변환기의 타당성을 검증하였다.
본 논문에서는 단위역률과 고효율을 갖기 위한 단일단 동기정류기형 비대칭 하프브리지 플라이백 컨버터 회로를 제안한다. 제안된 회로에서는 역률 개선단을 통해 입력전류의 리플이 줄어들게 되며, 거의 단위역률에 가까운 고역률을 갖게 된다. 또한 비대칭 펄스폭 변조에 의한 하프브리지 플라이백 DC/DC 컨버터는 영전압 스위칭 (ZVS) 동작을 하게 되며, 출력단에 동기정류기를 사용하여 스위칭에 의한 손실을 줄였다. 출력전압 24V, 최대 출력 200W, 스위칭 주파수 100kHz에서 제안된 컨버터의 성능을 입증하기위해 실험이 진행 되었다.
LED 조명시스템의 구동드라이브는 크게 1단 방식과 2단 방식으로 구분할 수 있다. 1단 방식은 경제성은 있으나 LED 출력제어에 역률 보정을 하지 못하는 반면, 2단 방식은 LED 출력제어와 함께 역률 보정은 가능하나 회로가 복잡하여 경제성에 약점을 안고 있다. 본 논문에서는 입력측 역률을 개선하고 고조파 발생을 억제하기 위한 능동역률 개선회로와 함께 능동 클램프 방식의 플라이백 컨버터 방식을 이용하여 2차측 출력을 동시에 제어할 수 있는 단일단 형태의 구동 드라이브를 구성하여 시뮬레이션과 실험을 통해 제작 단가 절감 효과와 시스템 효율 향상을 검증하였다.
본 논문에서는 DC/DC단의 넓은 입력문제를 해결할 수 있는 새로운 형태의 컨버터를 제안한다. 제안된 DC/DC 컨버터는 출력전압을 조절하기 위해 정류회로 뒤에 하나의 스위치와 하나의 다이오드를 추가하였으며 추가된 스위치의 시비율로 출력 전압을 조절하기 때문에 1차측 스위치의 고정 시비율로 동작시킴으로써 변압기 설계가 쉬워지고 1차 측의 큰 전압 스트레스도 해결된다. 제안된 컨버터의 이론적 해석과 설계 방법이 제시되었으며, 실험을 통해 검증하였다.
본 논문에서는 벅-부스트 컨버터와 하프브리지 컨버터가 결합된 형태가 구성된 고역률 AC-DC 컨버터를 제안한다. 제안된 컨버터는 주회로와 제어회로를 단단으로 구성함으로써 입력역률을 개선함과 동시에 출력전압의 제어가 가능한 구조이다. 역률개선용 컨버터로 벅-부스트 컨버터를 사용함으로써 링크 캐패시터의 DC 링크전압을 입력 라인전압의 최대값 이하로 유지하여 회로의 각 소자가 받는 전압 스트레스가 감소하므로 내압이 낮은 소자를 사용하여 효율을 높일 수 있다. 비대칭 제어기법을 통해 두 스위치의 데드타임을 일정하게 유지하여 스위칭손실을 줄였고 출력단에는 동기정류기를 사용하여 정류손실을 줄임으로써 효율을 개선한다.
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[게시일 2004년 10월 1일]
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