소형루프 전자탐사법은 다양한 현장에 성공적으로 적용되어온 효과적인 물리탐사법으로 특히 천부 지반조사나 환경오염대의 조사에 널리 사용되고 있다. 일반적으로 저유도상수(low induction number)대역에서 수행되는 소형루프 전자탐사에서는 주로 기하학적 수직탐사(geometric sounding)이 사용되어 왔으나, 근자에 이르러 정확한 2차장의 측정이 가능한 일체형의 다중 주파수 소형루프 전자탐사장비가 개발되면서, 주파수 수직탐사(frequency sounding)이 시도되고 있다. 본 논문에서는 간단한 2층구조에 대하여 수평루프 전자탐사 모델링을 수행하였다. 분석 결과 동상성분의 경우에는 주파수 수직탐사이 가능하지만, 이상성분의 경우에는 기하학적 수직탐사가 효과적인 것으로 확인되었다. 그러나 동상성분의 경우 신호의 크기가 이상성분에 비하여 미약하므로 국내에서와 같이 전기전도도가 낮고 전자기적 잡음 수준이 높은 지역에서는 적용이 곤란하다. 따라서 본 논문에서는 이상성분이 신호의 크기가 커 안정적 자료획득이 가능하며, 두 개의 주파수에 측정된 이상성분의 차가 동상성분과 같은 거동특성을 보인다는 점에 착안하여, 기존의 방법과는 다른 주파수 수직탐사 방법을 제시하고자 하였다. 또한 지하의 전기전도도를 비교적 잘 반영하는 겉보기 전도도를 정의하였다.
The degradation due to channel distortion in a quadrature modulation system from the ideal constant values over the bandwidth of a direct sequence spread spectrum signal are considered. Through using series expansion for the channel gain and phase response, the degradation in the correlator output at the receiver is found as a function of the parameters involved , including phase error, delay error, linear gin variation, quadratic gain variation, and quadratic phase variation.
SSB(Single Sideband) modulation scheme is high bandwidth efficient method in the mobile communication system compared with present DSB(Double Sideband) modulation scheme. Using the othogonality between inphase PN code and Hilbert transformed quadrature PN code, we propose phase estimation structure that enables coherent demodulation in the reverse link basestation receiver Several system characteristics, bit error rate and phase error variance, are simulated and compared with balanced QPSK DS/CDMA system. To verify system performance, SSB/BPSK-DS/CDMA test board is implemented using FPGA chips.
JSTS:Journal of Semiconductor Technology and Science
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제9권3호
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pp.153-159
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2009
A CMOS frequency synthesizer for $5{\sim}6$ GHz UNII-band sub-harmonic direct-conversion receiver has been developed. For quadrature down-conversion with sub-harmonic mixing, octa-phase local oscillator (LO) signals are generated by an integer-N type phase-locked loop (PLL) frequency synthesizer. The complex timing issue of feedback divider of the PLL with large division ratio is solved by using multimodulus prescaler. Phase noise of the local oscillator signal is improved by employing the ring-type LC-tank oscillator and switching its tail current source. Implemented in a $0.18{\mu}m$ CMOS technology, the phase noise of the LO signal is lower than -80 dBc/Hz and -113 dBc/Hz at 100 kHz and 1MHz offset, respect-tively. The measured reference spur is lower than -70 dBc and the power consumption is 40 m W from a 1.8 V supply voltage.
In general, channel information of received DTV signal analyzed based on symbol timing clock with only In-phase information in DTV receiver. This paper presents technical requirements of channel analysis system for DTV reception signal. In order to meet such requirements and measure more accurate magnitude and phase of channel information, compensation method for the quadrature information from measured in-phase data is proposed. The proposed channel analysis system is implemented with a commercial DTV chipset and provides fast data analysis with good connectivity with field test vehicles. Computer simulation and laboratory test results are provided to figure out the performance of the proposed channel analysis system for DTV signal.
The authors propose a robust symbol timing recovery (STR) for telephone line modems supporting data rates up to 32 Mbps. The STR is initialized by a start signal from carrier sensor, and the novel method is proposed which resolves the difference between the frequency of the transmitter's clock and the receiver's clock, called baud frequency offset. The proposed method is applied on digital receiver in a 16 frequency diverse quadrature amplitude modulation (FDQAM) system.
Equivalent-time sampling can improve measurement or sensing systems because it enables a broader frequency band and higher delay resolution for periodic signals with lower sampling rates than a Nyquist receiver. Meanwhile, a digital down-conversion (DDC) technique can be implemented using a straightforward radio frequency (RF) circuit. It avoids timing skew and in-phase/quadrature gain imbalance instead of requiring a high-speed analog-to-digital converter to sample an intermediate frequency (IF) signal. Therefore, when equivalent-time sampling and DDC techniques are combined, a significant synergy can be achieved. This study provides a parameter design methodology for optimal equivalent-time sampling using DDC.
본 논문에서는 WCDMA단말기 직접변환 수신기에서 DC 오프셋 발생원인과 DC 오프셋에 의한 시스템 성능열화에 대해 언급하고, QPSK(Quadrature Phase Shift Keying)변조 방식에서 DC오프셋 값에 의한 성능 열화를 시뮬레이션을 통해 확률 오류에 대한 $E_{b}/N_{o}$ 값으로 나타내었다. DC 오프셋 제어 회로를 추가한 단말기 직접변환 RF 트랜시버 보드를 구현하여 WCDMA(Wideband Code Division Multiple Access) 테스트 베드를 구축하고, DC 오프셋 변화량에 따른 복조기 수신 성능을 $E_{c}/I_{o}$ 값을 이용하여 평가 및 분석하였다. 분석 및 시스템 시험 결과를 통해 시스템 성능열화 방지를 위한 DC 오프셋 관련 최소 성능 요구규격을 제시하였다.
Kim, Suna;Yoon, Dae-Young;Park, Hyung Chul;Yoon, Giwan;Lee, Sang-Gug
ETRI Journal
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제36권1호
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pp.12-21
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2014
In this paper, we propose a new digital blind in-phase/quadrature-phase (I/Q) mismatch compensation technique for image rejection in a direct-conversion receiver (DCR). The proposed image-rejection circuit adopts DC offset cancellation and a sign-sign least mean squares (LMS) algorithm with a unique step size adaptation both for a fast and precise I/Q mismatch estimation. In addition, several performance-optimizing design considerations related to accuracy, speed, and hardware simplicity are discussed. The implementation of the proposed circuit in an FPGA results in an image-rejection ratio (IRR) of 65 dB, which is the best performance with modulated signals, along with an adaptation time of 0.9 seconds, which is a tenfold increase in the compensation speed as compared to previously reported circuits. The proposed technique will be a promising solution in the area of image rejection to increase both the speed and accuracy of future DCRs.
본 논문에서는 직교주파수분할다중송신(Orthogonal Frequency Division Multiplexing, OFDM) 방식의 송수신기에서 IQ 불균형(In-phase/Quadrature Imbalance) 성분의 영향을 분석한 후, 예기치 않은 IQ 불균형이 존재하는 상황에서 조차 다이버시티 이득을 얻을 수 있음을 보인다. 주파수 선택적 채널 특성을 갖는 경우 IQ 불균형 성분에 의해 마주보는 부반송파 간에 신호 확산으로 인해 송신 신호 왜곡이 발생할 경우, 복조 과정에서 부가적인 다이버시티 이득을 얻을 수 있음을 보인다. IQ 불균형이 존재하는 수신 신호에 대해 ML(Maximum Likelihood) 또는 OSIC(Ordered Successive Interference Cancellation) 신호 검출 기법을 이용하여 SER(Symbol Error Rate) 성능검증을 하면, 주파수 선택적 채널 계수와 송수신 IQ 불균형 성분이 결합에 의하여 초래되는 다이버시티 이득으로 인해 기존의 간섭억제 기법인 ZF(Zero-forcing) 기법에 비해 성능향상이 있음을 보인다. 본 논문에서는 다이버시티 이득을 얻기 위해서는 정확한 왜곡행렬 추정이 뒷받침 되어야 하므로 이를 위해 Alamouti 기법을 적용한 새로운 프리앰블 형태를 제안한다.
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[게시일 2004년 10월 1일]
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