• 전력전자학회논문지
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• 제10권1호
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• pp.70-77
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• 2005

압전소자를 이용한 마이크로발전기를 모델링한 저전압 AC 전류원으로부터 밧데리 충전을 위한 에너지 변환회로를 제안하고, 동작모드를 해석한다. 전체 시스템의 소형화 및 고효율화를 추구하기 위해서, MOSFET 풀브리지 정류기와 부스트 컨버터의 토폴로지를 채택하였다. 제안된 컨버터 시스템의 동작원리 및 동작모드를 스위칭 소자의 기생캐패시턴스를 고려하여 해석하고, 시뮬레이션을 통해 해석결과를 검증하였다.

• 대한전기학회:학술대회논문집
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• 대한전기학회 2007년도 심포지엄 논문집 정보 및 제어부문
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• pp.196-198
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• 2007

A circuit design technique to reduce the propagation time is proposed for the analog parallel processing-based Viterbi decoder. The analog Viterbi decoder implements the function of the conventional digital Viterbi decoder utilizing the analog parallel processing circuit technology. The decoder is for the PR(1.2,2.1) signal of DVD. The benefits are low power consumption and less silicon occupation. In this paper, a propagation time reduction technique is proposed by minimizing the parasitic capacitance components in the layout design of the analog Viterbi decoder. The propagation time reduction effect of the proposed technique has been shown via HSPICE simulation.

• 대한전기학회:학술대회논문집
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• 대한전기학회 1998년도 하계학술대회 논문집 F
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• pp.2151-2155
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• 1998

The traveling wave type ultrasonic motor(USM) has no electro-magnetic circuits( coil or core). The driving principle of the USM is based on high-frequency mechanical vibrations and frictional force. The USM, thus, is fed by two-phase high - frequency sinusoidal inverter using its series resonant parasitic components. For the using of series resonant type inverter, it should be needed to a USM parasitic capacitance and a proper inductor chosen. In this paper, the values of optimal inductance are designed and the efficiency of USM drives is achieved. The effectiveness of the proposed design is demonstrated by experiments.

• Journal of Power Electronics
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• 제9권1호
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• pp.18-25
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• 2009

Conventional series-resonant pulse frequency modulation controlled DC-DC high power converters with a high-frequency transformer link which is designed for driving the high power microwave generator has the problem of hard switching commutation at turn-on and turn-off of active power switching devices. This problem is due to the influence of the magnetizing current of the high-frequency transformer. This paper presents a novel prototype for a high-frequency transformer using parasitic parameters with a lossless inductive snubber and a series resonant capacitor assisted series-resonant zero current switching pulse frequency modulated DC-DC power converter, which is designed using a high power magnetron for microwave ovens. In order to implement a complete and efficient soft switching commutation, the performance of the new converter topology is practically confirmed and evaluated in the prototype of a power microwave generator.

• Journal of Electrical Engineering and Technology
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• 제8권4호
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• pp.938-944
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• 2013

In this paper, we propose a method for suppressing shaft voltage by modifying the shape of the rotor and the permanent magnets in interior permanent magnet-type-high-voltage motors. Shaft voltage, which is induced by parasitic components and the leakage flux in motor-driven systems, adversely affects their bearings. In order to minimize shaft voltage, we designed a magnet rearrangement and rotor re-structuring of the motor. The shaft voltage suppression effect of the designed model was confirmed experimentally and by comparative finite element analysis.

• 조명전기설비학회논문지
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• 제19권4호
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• pp.71-78
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• 2005

본 연구는 AC PDP(Plasma Display Panel)용 멀티레벨 에너지 회수회로에 관한 연구로서, 기존 멀티레벨 구동회로의 문제점을 해결한 새로운 멀티레벨 구동회로를 제안한다. 기존 멀티레벨 구동회로는 Weber회로에서 나타나는 스위칭 소자의 전압 및 전류 스트레스를 개선하였지만 공진 인덕터와 기생 커패시턴스에 의한 기생공진전류가 존재하고 하드스위칭이 발생하며 또한 천이구간이 다소 긴 문제점이 있다. 제안 회로는 사용소자의 수를 줄여 회로를 간단히 하였으며, 기생공진전류를 제거하여 회로 동작의 안정성을 높였다. 또한 CIM(Current Injection Method) 을 사용하여 하드스위칭 문제를 해결하였으며 Vs/2 유지구간을 제거하여 동작주파수를 증가시킬 수 있도록 하였다. 제안 회로의 유용성을 입증하기 위해 모드별로 동작을 해석하였으며, PSpice프로그램을 이용하여 시뮬레이션하고 그 결과를 확인하였다.

• 한국자동차공학회논문집
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• 제15권3호
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• pp.79-84
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• 2007

Recently it is strongly required to develop the better fuel economy as well as basic power performance based on strict emission legislation. This paper focuses on studies of the engine cooling and ancillaries system among fuel economy factors in the developing stage. Firstly through the analysis of the current specifications, it is assessed whether each components may be designed properly, not overdesigned. Secondly, it is predicted how the fuel economy of each components can be improved. Finally the results are confirmed by vehicle field test equppted with the updatedcomponents. This study found good agreementbetween the prediction and the field test on the vehicle fuel economy improvements of the heavy duty engine vehicle with updated components such as engine cooling and ancilliaries.

• 전자공학회논문지
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• 제53권11호
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• pp.25-31
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• 2016

FinFET의 기생 커패시턴스와 기생저항은 회로의 고주파 성능을 결정하는 매우 중요한 요소이다. 선행 연구에서 BSIM-CMG에 구현된 FinFET의 기생 커패시턴스와 저항 모델보다 더 정확한 압축 모델을 개발하였다. 모델의 정확도를 검증하고, FinFET으로 구현 가능한 RF 회로의 성능을 정확하게 예측하기 위해 $S_{21}$ 10dB 이상 중심 주파수 60GHz 이상을 갖는 Low Noise Amplifier (LNA) 에 설계하였다. 22 nm FinFET 소자의 압축모델에 기반한 HSPICE를 사용하여 예측한 회로 성능의 정확도를 검증하기 위해 3D TCAD simulator인 Sentaurus의 mixed-mode 기능을 사용하여 LNA를 시뮬레이션 하였다. TCAD 시뮬레이션 결과를 정확도 측정의 기준으로 삼아 10GHz~100GHz 대역에서 제안한 모델과 Sentaurus의 $S_{21}$을 비교한 결과 87.5%의 정확도를 달성하였다. 이는 기존의 BSIM-CMG의 기생성분으로 예측한 정확도가 56.5%도임에 비해 31% 향상된 정확도를 보여준다. 이를 통해 FinFET의 기생 성분 모델의 정확도를 RF 영역에서 확인하였고, 정확한 기생 저항과 커패시턴스 모델이 LNA 성능을 정확하게 예측하는데 중요한 것임을 확인하였다.

• 전력전자학회:학술대회논문집
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• 전력전자학회 2000년도 전력전자학술대회 논문집
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• pp.501-504
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• 2000

In this paper the PC power supply is studied from the point of system stability. The power stage model of a multiple output forward converter with weighted voltage mode control is derived including all the major parasitic components and the small signal model is also derived. Determination of the weighting factors and a design procedure for the loop compensation are presented. Finally the model is verified through the simulation of three output forward converter with SABER.

• 대한전기학회:학술대회논문집
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• 대한전기학회 1987년도 전기.전자공학 학술대회 논문집(II)
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• pp.1512-1515
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• 1987

The buffer circuit having minimum delay time is designed and analyzed in this paper. Considering the parasitic components of the MOS transistor, the optimal transistor size ratio between the individual buffer stages is presented. This paper's result is better than that of the Mead and Conway's analysis [1] with respect to both delay time and total area that buffer occupies.