• 전자공학회논문지
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• 제51권1호
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• pp.31-36
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• 2014

초기조건에 민감한 특징을 가지는 카오스 통신 시스템은 보안성이 디지털 통신 시스템보다 우수하게 평가되지만 BER 성능은 나쁘게 평가되기 때문에 BER(Bit Error Rate) 성능을 향상시키는 연구가 중요하다. 이전 연구에서 제안한 카오스 송수신기는 원하는 신호에 잡음과 같이 더해지는 요소가 매우 적기 때문에 기존 CDSK(Correlation Delay Shift Keying) 방식보다 BER 성능이 굉장히 많이 향상된다. 카오스 통신 시스템은 카오스 맵 특성에 따라 정보 신호를 확산시키고 전송하기 때문에 전송 심볼의 수가 많다. 따라서 카오스 통신 시스템의 데이터 전송 속도를 좋게 하는 연구가 필요하다. 기존의 카오스 변조 방식은 BPSK 방식을 기반으로 정보 신호를 -1과 1로 변조시킨다. 하지만 BPSK 방식 대신에 QPSK나 QAM과 같은 고레벨 변조 방식을 기반으로 한다면 한 번에 더 많은 데이터를 전송할 수 있기 때문에 카오스 통신 시스템의 데이터 전송 속도를 좋게 만드는 것이 가능하다. 본 논문에서는 이전 연구에서 제안한 카오스 송수신기를 사용하며 이 시스템에 QPSK와 16QAM을 적용했을 때, SER(Symbol Error Rate) 성능을 평가하고 각 성능을 비교한다. 또한, 제안한 카오스 송수신기에서 정보신호를 QPSK와 16QAM을 기반으로 변조시켰을 때, 제안한 카오스 송수신기가 항재밍 성능을 갖는지 평가한다.

• ETRI Journal
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• 제39권2호
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• pp.245-254
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• 2017

In-band full-duplex (IFD) communication has recently attracted a great deal of interest because it potentially provides a two-fold spectral efficiency increase over half-duplex communications. In this paper, we propose a novel digital self-interference cancelation (DSIC) algorithm for an IFD communication system in which two nodes exchange orthogonal frequency-division multiplexing (OFDM) symbols. The proposed DSIC algorithm is based on the least-squares estimation of a self-interference (SI) channel with block processing of multiple OFDM symbols, in order to eliminate the fundamental and harmonic components of SI induced through the practical radio frequency devices of an IFD transceiver. In addition, the proposed DSIC algorithm adopts discrete Fourier transform processing of the estimated SI channel to further enhance its cancelation performance. We provide a minimum number of training symbols to estimate the SI channel effectively. The evaluation results show that our proposed DSIC algorithm outperforms a conventional algorithm.

• JSTS:Journal of Semiconductor Technology and Science
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• 제9권1호
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• pp.22-28
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• 2009

This paper presents a fast received signal strength indicator (RSSI) circuit for wireless communication application. The proposed circuit is developed using power detectors and an analog-to-digital converter to achieve a fast settling time. The power detector is consisted of a novel logarithmic variable gain amplifier (VGA), a peak detector, and a comparator in a closed loop. The VGA achieved a wide logarithmic gain range in a closed loop form for stable operation. For the peak detector, a fast settling time and small ripple are obtained using the orthogonal characteristics of quadrature signals. In $0.18-{\mu}m$ CMOS process, the RSSI value settles down in $20{\mu}s$ with power consumption of 20 mW, and the maximum ripple of the RSSI is 30 mV. The proposed RSSI circuit is fabricated with a personal handy-phone system transceiver. The active area is $0.8{\times}0.2\;mm^2$.

• 한국통신학회논문지
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• 제28권5A호
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• pp.323-332
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• 2003

본 논문에서는 광원이 불필요하며 단일 광섬유를 통하여 양방향 전송이 가능한 base station용 광송수신기 모듈을 제안하였다. 제안한 시스템에서는 써큘레이터와 Mach-Zehnder 변조기로 구성된 ring-type의 base station에서 central office로부터 하향 전송된 광신호의 일부를 재사용하여 상향신호 전송에 사용한다. 시스템의 성능을 평가하기 위해서 IS-95 CDMA 신호 전송을 통한 ACPR 특성과 14개의 캐리어 신호 전송을 통한 CNR을 측정하였다.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2008년도 하계종합학술대회
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• pp.309-310
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• 2008

In this paper, we propose a novel D-ATR (Differential-Average Transmitted Reference) scheme for UWB (Ultra Wide Band) based on impulse radio. The proposed scheme utilizing differential coding at transceiver, does not cause half loss of data rate unlike the conventional TR (Transmitted Reference) and ATR (Average TR) systems which transmit additional reference signals. In addition, the proposed scheme may provide improved BER (Bit Error Rate) performance by averaging the received reference signals like the conventional ATR. The proposed D-ATR receiver produces the averaged reference template by considering both the detected data bit and the differential coding rule.

• Journal of Advanced Marine Engineering and Technology
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• 제38권2호
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• pp.169-174
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• 2014

This paper proposes a novel beehive-shaped reflector for application to light-emitting diode (LED) transceivers for illumination and bi-directional visible light communication (VLC). By using a diffuse propagation model extended to line-of-sight and direct signals, the distribution of illuminance and the path loss of the transceiver are investigated to evaluate the performance of the beehive-shaped reflector. To verify bi-directional communication, a VLC-based image capture system, comprising a complementary metal-oxide semiconductor (CMOS) image sensor and video processor unit, is demonstrated. Real-time images captured by the CMOS camera are successfully transmitted to the monitoring system via a free-space channel at a rate of 115.2 kbps.

• 한국정보통신학회논문지
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• 제9권5호
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• pp.1089-1095
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• 2005

본 논문에서는 5GHz 저잡음 증폭기(LNA)의 성능 측정을 위한 새로운 형태의 저가 BIST(Built-In Self-Test) 회로를 제안한다 이러한 BIST 회로는 system-on-chip (SoC) 송수신 환경에 적용될 수 있도록 설계되어 있다. 본 논문에서 제안하는 BIST 회로는 입력 임피던스, 전압이득, 잡음지수, 입력반사손실(input return loss) 및 출력 신호 대 잡음전력비(signal-to-noise ratio)와 같은 저잡음 증폭기의 주요 성능 지수를 측정 할 수 있으며, 단일 칩 위에 제작되어 있다.

• 한국통신학회논문지
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• 제32권11A호
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• pp.1146-1153
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• 2007

본 논문에서는 RF 단에서 직접변환 방식을 사용하고 있는 Wibro 상향링크에서 대칭되는 부반송파 간 확산으로 작용하여 성능 저하를 일으키는 I/Q 불균형(I/Q Imbalances)의 영향을 분석하였다. 전체 부반송파를 한 사용자가 모두 사용하는 OFDM 시스템과 달리, OFDMA 시스템에서는 대칭되는 부반송파가 각기 다른 사용자에게 할당 되는 부채널 할당 방법을 사용한다. 그러므로 I/Q 불균형 성분의 추정은 불가능 해지고, 이로 인해 왜곡된 수신 신호를 보상해줄 수 없다. 이러한 I/Q 불균형 문제를 해결하기 위해, 본 논문에서는 대칭되는 부반송파들이 한 사용자에게 할당 될 수 있도록 새로운 부채널 할당 방법을 제안한다. 새로운 부채널 할당방법을 적용하면, I/Q 불균형으로 인한 왜곡 성분의 추정이 가능해지곤 I/Q 불균형이 존재하지 않을 때의 성능과 비슷한 수준가지 보상할 수 있게 된다. 적절한 신호 검출 기법을 사용할 경우, 채널 성분과 결합한 I/Q 불균형 성분으로 인해 다이버시티 이득으로 인한 성능 향상 효과까지 얻을 수 있음을 SER(Symbol Error Rate) 성능을 통해 확인 할 수 있다.

• 한국전자파학회논문지
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• 제13권3호
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• pp.288-300
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• 2002

본 논문에서는 최근 IMT-2000 시스템에서 고속데이타 통신을 수용하기 위해 연구되고 있는 다중입력다중 출력(Multiple Input Multiple Output) 안테나를 이용한 공간분할기법을 현실화하기 위한 새로운 등화된 RF 수신부 구성방법을 제안하였다. 제안된 방법의 핵심은 보정시간 동안 궤환회로 및 기억회로를 통해 보정시간중 등화된 다수의 RF 수신부 구성방법에 있으며, 이를 이용할 경우 중간주파 영역에서 weighting 하는 것이 가능하게된다 이는 기존에 연구된 전파노래 각 알고리듬을 사용 가입자 분포에 따라 안테나 빔 형성하는 것을 가능케 하며, 공간분할에 의한 최적 셀 형성을 가능하게 학 것이다. 또한 제시된 RF 전단부의 동작을 확인하기 위하여 Envelope Simulation을 사용 이의 동작을 검증하였다.

• JSTS:Journal of Semiconductor Technology and Science
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• 제12권2호
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• pp.168-174
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• 2012

This paper describes a novel global on-chip interconnect scheme, in which a one UI-delayed symbol as well as the current symbol is sent for easing the sensing operation at receiver end. With this approach, the voltage swing on the channel for reliable sensing can be reduced, resulting in performance improvement in terms of power consumption, peak current, and delay spread due to PVT variations, as compared to the conventional repeater insertion schemes. Evaluation for on-chip interconnects having various lengths in a 130 nm CMOS process indicated that the proposed on-chip interconnect scheme achieved a power reduction of up to 71.3%. The peak current during data transmission and the delay spread due to PVT variations were also reduced by as much as 52.1% and 65.3%, respectively.