• 전기전자학회논문지
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• 제19권4호
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• pp.465-471
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• 2015

An LC-tuned sinusoidal voltage-controlled oscillator (VCO) using temperature-stable linear operational transconductance amplifiers (OTAs) is presented. Its architecture is based on Hartley oscillator configuration, where the inductor is active one realized with two OTAs and a grounded capacitor. Two diode limiters are used for limiting amplitude. A prototype oscillator built with discrete components exhibits less than 3.1% nonlinearity in its current-to-frequency transfer characteristic from 1.99 MHz to 39.14 MHz and $220ppm/^{\circ}C$ frequency stability to the temperature drift over 0 to $75^{\circ}C$. The total harmonic distortion (THD) is as low as 4.4 % for a specified frequency-tuning range. The simulated phase noise of the VCO is about -108.9 dBc/Hz at 1 MHz offset frequency in frequency range of 0.4 - 46.97 MHz and property of phase noise of VCO is better than colpitts-VCO.

• 전자공학회논문지
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• 제53권12호
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• pp.57-63
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• 2016

본 논문은 $0.18{\mu}m$ 실리콘 CMOS 기술을 이용한 IEEE802.15.4g SUN 체계의 센서노드 무선통신부에 적용할 수 있는 RF 주파수 합성기의 구현에 대하여 기술하였다. 제안한 주파수 합성기는 고속 저잡음 특성을 얻기 위하여 VCO, 프리스케일러, 1/N 분주기, ${\Delta}-{\Sigma}$ 모듈레이터 그리고 PLL 공통 회로 등의 설계 최적화가 이루어졌으며, 특히 VCO는 NP 코어 구조와 13단 캡 뱅크를 각각 적용하여 고속, 저잡음 및 광대역 튜닝 범위를 확보하였다. 제안된 주파수 합성기를 칩으로 제작하여 측정한 결과 출력 주파수 범위는 1483MHz~2017MHz, 위상잡음은 100KHz 오프셋에서는 -98.63dBc/Hz, 1MHz 오프셋에서는 -122.05dBc/Hz로 양호한 특성을 얻을 수 있었다.

• 한국전자파학회논문지
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• 제21권1호
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• pp.69-75
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• 2010

본 논문에서는 클랩형 전압 제어 발진기 회로를 바탕으로 UHF 대역에서 광대역 주파수 합성기를 설계하는 방법을 제시하였다. 전압 제어 발진기의 동작 조건 중 부성 저항 회로와 부하 회로의 위상 변화 특성을 해석하여 동작 범위를 증가시킬 수 있는 방법을 제안하였다. 이러한 방법을 적용하여 광대역 전압 제어 발진기를 설계하고, PLL 기반의 광대역 주파수 합성기를 설계하고 제작하였다. 제작된 주파수 합성기는 0~5 V의 버랙터 제어 전압에서 740~1,530 MHz의 발진 주파수 범위를 갖고, 2~-6 dBm의 출력 전력을 얻었다. 또한 위상 잡음은 10 kHz에서 -77 dBc/Hz, 100 kHz에서 -108 dBc/Hz로 측정되었다.

• 한국전자파학회:학술대회논문집
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• 한국전자파학회 2001년도 종합학술발표회 논문집 Vol.11 No.1
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• pp.222-226
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• 2001

In this paper, 2.4GHz RF Module using Even Harmonic Mixer(EHM) was designed and fabricated for Direct conversion(DC) system. By minimizing performance degradation of DC system with DC offset and LO radiation, the capability of minimization and one chip solution in wireless system was proposed. The designed EHM using anti-parallel diode pair represented 9dB conversion loss and about -60dBm 2LO leakage radiation in RF port, and output reflection and reverse transmission characteristic of low noise amplifier was improved. So superior DC offset suppression characteristic is expected. RF Module which consists of EHM, LNA, RF amplifier, Frequency synthesizer and Duplexer was designed and fabricated.

• 대한전기학회논문지
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• 제43권5호
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• pp.711-720
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• 1994

A distance relaying algorithm for detecting faults at power transmission line is presented in this paper. The algorithm is based on differential equation from relaton between voltage and current, which is composed of lumped resistance and inductance. During the fault transient state,the voltage and current signals are severely distorted due to the exponentially decaying DC offset and high frequency components, In spite of using small data, the presented integral method to evaluate R and L from voltage and current has high performance against these harmonics including DC offset. Therefore, the presented algorithm can be implemented with only a low order anti-aliasing analog filter and dosen't need any digital filter to remove specific components.

• JSTS:Journal of Semiconductor Technology and Science
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• 제12권3호
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• pp.278-285
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• 2012

A digital readout IC for capacitive sensors is presented. Digital capacitance readout circuits suffer from static capacitance of sensors, especially single-ended sensors, and require large passive elements to cancel such DC offset signal. For this reason, to maximize a dynamic range with a small die area, the proposed circuit features digital filters having a coarse and fine compensation steps. Moreover, by employing switched-capacitor circuit for the front-end, correlated double sampling (CDS) technique can be adopted to minimize low-frequency device noise. The proposed circuit targeted 8-kHz signal bandwidth and oversampling ratio (OSR) of 64, thus a $3^{rd}$-order ${\Delta}{\Sigma}$ modulator operating at 1 MH was used for pulse-density-modulated (PDM) output. The proposed IC was designed in a 0.18-${\mu}m$ CMOS mixed-mode process, and occupied $0.86{\times}1.33mm^2$. The measurement results shows suppressed DC power under about -30 dBFS with minimized device flicker noise.

• 전기전자학회논문지
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• 제3권2호
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• pp.305-313
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• 1999

OFDM 신호의 복조를 위해서는 시스템 초기화 과정에서 심벌의 시작 부분을 올바로 찾아내는 심볼 타이밍 복원 기능이 수행되어야 한다. 이 논문은 심볼 타이밍 옵셋이 신호에 미치는 영향을 분석하고, 보호 구간을 이용한 새로운 심볼 타이밍 복원 알고리즘을 제시하였다. 제안하는 알고리즘은 계산량, 필요 메모리양을 현저하게 줄이면서, 주파수 옵셋과 위상 옵셋의 영향을 받지 않는 장점을 가진다. 그리고, OFDM을 표준 방식으로 채택한 유럽형 디지털 TV 방송 규격을 기반으로 한 시스템 모델에 제안한 알고리즘을 적용하여 AWGN과 다중 경로 페이딩 채널에서 컴퓨터 모의실험을 통하여 성능을 평가하였다.

• Journal of electromagnetic engineering and science
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• 제9권1호
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• pp.25-31
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• 2009

This paper describes CMOS VCO circuit design procedures and techniques for multi-band/multi-standard RF transceivers. The proposed techniques enable a 4 GHz CMOS VCO to satisfy all requirements for Quad-band GSMIEDGE and WCDMA standards by achieving a good trade-off among important specifications, phase noise, power consumption, modulation performance, and chip area efficiency. To meet the very stringent GSM T/Rx phase noise and wide frequency range specifications, the VCO utilizes bond-wire inductors with high-quality factor, an 8-bit coarse tune capbank for low VCO gain(30$\sim$50 MHz/V) and an on-chip $2^{nd}$ harmonic noise filter. The proposed VCO is implemented in $0.13{\mu}m$ CMOS technology. The measured tuning range is about 34 %(3.17 to 4.49 GHz). The VCO exhibits a phase noise of -123 dBc/Hz at 400 kHz offset and -145 dBc/Hz at 3 MHz offset from a 900 MHz carrier after LO chain. The calculated figure of merit(FOM) is -183.5 dBc/Hz at 3 MHz offset. This fully integrated VCO occupies $0.45{\times}0.9\;mm^2$.

• ETRI Journal
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• 제36권2호
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• pp.206-213
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• 2014

This paper presents a novel 90 GHz band 16-quadrature amplitude modulation (16-QAM) orthogonal frequency-division multiplexing (OFDM) communication system. The system can deliver 6 Gbps through six channels with a bandwidth of 3 GHz. Each channel occupies 500 MHz and delivers 1 Gbps using 16-QAM OFDM. To implement the system, a low-noise amplifier and an RF up/down conversion fourth-harmonically pumped mixer are implemented using a $0.1-{\mu}m$ gallium arsenide pseudomorphic high-electron-mobility transistor process. A polarization-division duplex architecture is used for full-duplex communication. In a digital modem, OFDM with 256-point fast Fourier transform and (255, 239) Reed-Solomon forward error correction codecs are used. The modem can compensate for a carrier-frequency offset of up to 50 ppm and a symbol rate offset of up to 1 ppm. Experiment results show that the system can achieve a bit error rate of $10^{-5}$ at a signal-to-noise ratio of about 19.8 dB.

• 한국ITS학회 논문지
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• 제11권5호
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• pp.89-96
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• 2012

본 논문에서는 인터디지털 헤어핀 공진기를 이용하여 UTIS (도시 교통 정보 시스템)에 사용 가능한 저 위상잡음 발진기를 설계 및 제작하였다. 인터디지털 헤어핀 공진기는 기존의 소형화된 헤어핀 공진기에 인터디지털을 접목시켜 공진기의 물리적인 크기를 기존 대비 약 70%로 축소시켰고, 고조파 특성을 향상시켰다. 또한 132 의 높은 Q 값은 저 위상잡음 발진기 설계에 적합하다. UTIS 용 저 위상잡음 발진기는 5.75 GHz에서 출력 12 dBm 의 전력과 100 kHz offset 에서 -100.8 dBc/Hz 의 낮은 위상잡음을 얻었다. 이는 기존의 헤어핀을 이용한 발진기에 비해 12 dB 정도의 개선을 보여준다.