• 한국지진공학회논문집
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• 제27권5호
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• pp.203-211
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• 2023

For fast-built and safe precast concrete (PC) construction, the dry mechanical splicing method is a critical technique that enables a self-sustaining system (SSS) during construction with no temporary support and minimizes onsite jobs. However, due to limited experimental evidence, traditional wet splicing methods are still dominantly adopted in the domestic precast industry. For PC beam-column connections, the current design code requires achieving emulative connection performances and corresponding structural integrity to be comparable with typical reinforced concrete (RC) systems with monolithic connections. To this end, this study conducted the standard material tests on mechanical splices to check their satisfactory performance as the Type 2 mechanical splice specified in the ACI 318 code. Two PC beam-column connection specimens with dry mechanical splices and an RC control specimen as the special moment frame were subsequently fabricated and tested under lateral reversed cyclic loadings. Test results showed that the seismic performances of all the PC specimens were fully comparable to the RC specimen in terms of strength, stiffness, energy dissipation, drift capacity, and failure mode, and their hysteresis responses showed a mitigated pinching effect compared to the control RC specimen. The seismic performances of the PC and RC specimens were evaluated quantitatively based on the ACI 374 report, and it appeared that all the test specimens fully satisfied the seismic performance criteria as a code-compliant special moment frame system.

• Earthquakes and Structures
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• 제27권2호
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• pp.143-154
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• 2024

Friction pendulums typically suffer from poor uplift-restraining. To improve the uplift-restraining and enhance the energy dissipation capacity, this article proposed a composite isolation device based on electromagnetic forces. The device was constructed based on a remote control system to achieve semi-active control of the composite isolation device. This article introduces the theory and design of an electromagnetic chuck-friction pendulum system (ECFPS) and derives the theoretical equation for the ECFPS based on Maxwell's electromagnetic attraction equation to construct the proposed model. By conducting 1:3 scale tests on the electromagnetic device, the gaps between the practical, theoretical, and simulation results were analyzed, and the accuracy and effectiveness of the theoretical equation for the ECFPS were investigated. The hysteresis and uplift-restraining performance of ECFPS were analyzed by adjusting the displacement amplitude, vertical load, and input current of the simulation model. The data obtained from the scale test were consistent with the theoretical and simulated data. Notably, the hysteresis area of the ECFPS was 35.11% larger than that of a conventional friction pendulum. Lastly, a six-story planar frame structure was established through SAP2000 for a time history analysis. The isolation performances of ECFPS and FPS were compared. The results revealed that, under horizontal seismic action, the horizontal seismic response of the bottom layer of the ECFPS isolation structure is greater than that of the FPS, the horizontal vibration response of the top layer of the ECFPS isolation structure is smaller than that of the FPS, and the axial force at the bottom of the columns of the ECFPS isolation structure is smaller than that of the FPS isolation structure. Therefore, the reliable uplift-restraining performance is facilitated by the electromagnetic force generated by the device.

• 에너지공학
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• 제20권3호
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• pp.185-190
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• 2011

본 논문은 초전도 에너지 저장장치(SMES)용 전도냉각형 고온초전도 자석의 설계, 제작 및 평가에 대해 기술한다. 고온초전도 자석은 황동 안정화재를 갖는 2개의 Bi-2223 다심 선재가 적층된 4-ply 도체로 제작된 22개의 double pancake coil(DPC)로 구성된다. 그리고, 각 DPC는 내경과 외경이 각각 500 mm, 691 mm이고 높이가 10 mm인 2개의 single solenoid coil로 구성된다. 코일 내부의 전기적 손실에 의해 발생된 열의 냉각을 위하여 DPC 사이에 두께 3 mm의 알루미늄 판이 내재된다. 고온초전도 자석은 2단 Gifford McMahon 냉동기에 의해 5.6 K까지 냉각된다. 충전전류가 증가할수록 방전시 고온초전도에서의 최대 온도가 증가 하였다. 충전전류가 360 A일 때 ��치 없이 고온초전도 자석에 1 MJ의 자기에너지가 성공적으로 저장되었다. 본 연구에서는 SMES용 전도 냉각형 고온초전도자석에 대한 열적, 전자기적 특성을 보이고, 본 연구를 통해 얻어진 결과는 전도냉각형 고온초전도자석의 최적설계 및 안정도 평가에 활용될 것이다.

• 대한전자공학회논문지SD
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• 제43권1호
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• pp.27-36
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• 2006

기존의 지연 무관 (Delay-Insensitive(DI)) 데이터 인코딩 방식은 N 비트 데이터 전송에 물리적으로 2N+1 개의 도선이 필요하다. GALS(Globally Asynchronous Locally Synchronous) 시스템과 같은 대규모 칩 설계 시에 많은 도선 수로 인해 발생할 수 있는 전력 소모와 설계 복잡성을 줄이기 위해, 의사지연 무관 (Quasi D디ay-Insensitive(QDI)) 모델에 기반하고, N+1 개의 도선으로 N 비트 데이터를 전송할 수 있는 인코더와 디코더 회로를 설계한다. 이 회로들은 전류모드 다치 논리 회로(Current-Mode Multiple Valued Logic(CMMVL))를 사용하여 설계되었으며, 도선수를 줄임으로써 파생되는 효율성을 검증하기 위해 0.25 um CMOS 공정에서 기존의 DI 인코딩 방식인 dual-rail 방식 및 1-of-4 방식과 delay-power product ($D{\ast}P$) 값 측면에서 비교하였다. HSPICE를 통한 모의실험 결과 4 mm 이상의 도선의 길이에서, dual-rail 방식과는 5 MHz의 data rate 이상에서, 1-of-4 방식과는 18 MHz의 data rate 이상에서 제안된 CMML 방식이 유리하였다. 또한, 긴 도선에 버퍼를 장착한 dual-rail 방식, 1-of-4방식과의 비교에서도 개선된 CMMVL 방식이 10 mm 도선, 32 비트 데이터 전송에서 각각 4 MHz, 25 MHz data rate 이상에서 최대 $57.7\%$와 $17.9\%$의 $D{\ast}P$ 값 감소 효과를 나타냈다.

• 대한전자공학회논문지SD
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• 제46권4호
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• pp.1-9
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• 2009

본 논문에서는 디스플레이 시스템을 위한 소면적 12-bit 300MSPS의 D/A 변화기(DAC)를 제안한다. 최근 SoC(System-On-Chip) 경향에 맞는 소면적 DAC를 구현하기 위한 전체적인 구조는 6-MSB(Most Significant Bit) + 6-LSB(Least Significant Bit)의 full matrix 구조로 설계 하였다. 고해상도 동작에 요구되는 output impedance을 만족하는 monitoring bias 구조, 고속 동작 및 소면적 디지털 회로 구성을 위하여 logic과 latch 및 deglitching 역할을 동시에 할 수 있는 self-clocked switching logic을 각각 제안하였다. 설계된 DAC는 Samsung $0.13{\mu}m$ thick gate 1-poly 6-metal N-well CMOS 공정으로 제작되었다. 제작된 DAC의 측정결과 INL (Integrated Non Linearity) / DNL (Differential Non Linearity)은 ${\pm}3LSB$ / ${\pm}1LSB$ 이하로 나타났으며, 300MHz 샘플링 속도와 15MHz의 출력신호에서 SFDR은 약 70dB로 측정되었다. DAC의 유효면적은 $0.26mm^2$ ($510{\mu}m{\times}510{\mu}m$)로 기존의 DAC에 비하여 최대 40% 감소된 초소면적으로 구현되었으며, 최대 전력 소모는 100mW로 측정되었다.

• 대한전자공학회논문지SD
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• 제44권2호
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• pp.19-24
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• 2007

최근 대용량 데이터 전송이 이루어지면서 하드웨어의 복잡성과 전력, 가격 등의 이유로 인하여 입력데이터와 클럭을 함께 수신 단으로 전송하는 병렬버스 기법보다는 시리얼 링크 기법이 메모리 인터페이스에 많이 사용되고 있다. 시리얼 링크 기법은 병렬버스 기법과는 달리 클럭을 제외한 데이터 정보만을 수신단으로 보내는 방식이다. 클럭 및 데이터 복원 회로(clock and data recovery 혹은 CDR)는 시리얼 링크의 핵심 블록으로, 본 논문에서는 그래픽 DRAM 인터페이스용의 5.4Gb/s half-rate bang-bang 클럭 및 데이터 복원회로를 설계하였다. 이 회로는 half-rate bang-bang 위상검출기, current-mirror 전하펌프, 이차 루프필터, 및 4단의 차동 링타입 VCO로 구성되었다. 위상 검출기의 내부에서 반 주기로 DeMUX된 데이터를 복원할 수 있게 하였고, 전체 회로의 용이한 검증을 위해 MUX를 연결하여, 수신된 데이터가 제대로 복원이 되는지를 확인하였다. 설계한 회로는 66㎚ CMOS 공정파라미터를 기반으로 설계 및 layout하였고, post-layout 시뮬레이션을 위해 5.4Gb/s의 $2^{13}-1$ PRBS 입력데이터를 사용하였다. 실제 PCB 환경의 유사 기생성분을 포함하여 시뮬레이션 한 결과, 10psRMS 클럭 지터 및 $40ps_{p-p}$ 복원된 데이터 지터 특성을 가지고, 1.8V 단일 전원전압으로부터 약 80mW 전력소모를 보인다.

• 대한전자공학회논문지SD
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• 제41권10호
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• pp.95-104
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• 2004

본 논문에서는 0.13㎛ 이하의 deep sub-micron 공정처럼 누설 전류가 심한 공정을 이용하여 멀티미디어 SoC를 설계할 때, 가장 전력 소모가 높은 움직임 추정 기법의 전력 소모를 줄이기 위한 저전력 움직임 추정기의 아키텍쳐를 제안하였다. 제안하는 아키텍쳐는 기존의 동적 전력 소모만을 고려한 구조와는 달리 정적 전력 소모까지 고려하여 누설 전류가 심한 공정에 적합한 구조로, 효율적인 전력 관리가 필수적인 동영상 전화기 등의 각종 휴대용 정보기기 단말기에 적합한 형태이다. 제안하는 아키텍쳐는 하드웨어 구현이 용이한 전역 탐색 기법 (full search)을 기본으로 하며 동적 전력 소모를 줄이기 위하여 조기 은퇴(early break-off) 기법을 도입하였다. 또한 정적 전력 소모를 줄이기 위하여 전원선 잡음을 고려한 메가블록 전원 차단 기법을 사용하였다. 제안된 아키텍쳐를 멀티미디어 SoC에 적용하였을 때의 효용성을 검증하기 위해 시스템 수준의 제어 흐름과 저전력 제어 기법을 개발하였으며, 이를 바탕으로 시스템 수준에서의 소모 전력을 계산하였다. 모의실험 결과 0.13㎛ 공정에서 전력 소모가 50% 정도로 감소함을 확인할 수 있었다. 선폭의 감소와 칩 내부 발열량의 증가로 인한 누설 전류의 증가를 고려할 때, 기존의 동적 전력 소모만을 고려한 구조는 전력 감소 효율이 점점 나빠짐에 반하여 제안하는 움직임 추정기 아키텍쳐는 안정적인 전력 감소 효율을 보여주었다.

• 전자공학회논문지
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• 제53권1호
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• pp.59-67
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• 2016

저가, 광대역, 그리고 넓은 이득 제어 범위를 갖는 전자 계측 시스템을 실현하기 위한 완전-차동 선형(fully-differential linear operational transconductance amplifier : FLOTA)를 사용한 새로운 계측 증폭기(instrumentation amplifier : IA)를 설계하였다. 이 IA는 한 개의 FLOTA, 두 개의 저항 그리고 한 개의 연산 증폭기(operational amplifier : op-amp로 구성된다. 동작 원리는 FLOTA에 인가되는 두 입력 전압의 차가 각각 동일한 차동 전류로 변환되고 이 전류는 op-amp의 (+)단자의 저항기와 귀환 저항기를 통과시켜 단일 출력 전압을 구하는 것이다. 제안한 IA의 동작 원리를 확인하기 위해 FLOTA를 설계하였고 상용 op-amp LF356을 사용하여 IA를 구현하였다. 시뮬레이션 결과 FLOTA를 사용한 전압-전류 특성은 ${\pm}3V$의 입력 선형 범위에서 0.1%의 선형오차와 2.1uA의 오프셋 전류를 갖고 있었다. IA는 1개의 저항기의 저항 값 변화로 -20dB~+60dB의 이득을 갖고 있으며, 60dB에 대한 -3dB 주파수는 10MHz이였다. 제안한 IA의 외부의 저항기의 정합이 필요 없고 다른 저항기로 오프셋을 조절할 수 있는 장점을 갖고 있다. 소비전력은 ${\pm}5V$ 공급전압에서 105mW이였다.

• 한국정보통신학회논문지
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• 제12권3호
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• pp.517-526
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• 2008

본 논문에서는 자동차 계기판의 OLED 디스플레이 모듈용 One-chip DC-DC 변환기 회로를 제안하였다. 전하 펌핑 방식의 OLED 패널 구동전압 회로는 PWM(Pulse Width Modulation) 방식을 사용한 DC-DC 변환기 회로에 비해 소형화, 저가격 및 낮은 EMI 특성을 갖는다. 그리고 Bulk-potential 바이어싱 회로를 사용하므로 전하 펌핑 시 기생하는 PNP BJT에 의한 전하 손실을 방지하도록 하였고, 밴드갭 기준전압 발생기의 Start-up 회로에서 전류소모를 기존 BGR 회로에 비해 42% 줄였고 VDD의 링 발진기 회로에 로직전원인 VLP를 사용하여 링 발진기기 레이아웃 면적을 줄였다. 또한 OLED 구동전압인 VDD의 구동 전류는 OLED 패널에서 요구하는 40mA 이상이다. $0.25{\mu}m$ High-voltage 공정을 이용하여 테스트 칩을 제작 중에 있으며, 레이아웃 면적은$477{\mu}m{\times}653{\mu}m$이다.

• 한국결정성장학회지
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• 제24권6호
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• pp.229-236
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• 2014

수평 전기로에서 $MnAl_2S_4$ 다결정을 합성하여 HWE(Hot Wall Epitaxy)방법으로 $MnAl_2S_4$ 단결정 박막을 반절연성 GaAs(100)기판에 성장시켰다. $MnAl_2S_4$ 단결정 박막의 성장 조건은 증발원의 온도 $630^{\circ}C$, 기판의 온도 $410^{\circ}C$였고 성장 속도는 $0.5{\mu}m/hr$였다. 이때 $MnAl_2S_4$ 단결정 박막의 결정성의 조사에서 이중결정 X-선 요동곡선(DCRC)의 반폭치(FWHM)도 132 arcsec로 가장 작아 최적 성장 조건임을 알 수 있었다. $MnAl_2S_4$/SI(Semi-Insulated) GaAs(100) 단결정 박막의 광흡수를 293 K에서 10 K까지 측정하였다. 광흡수 스펙트럼으로부터 band gap $E_g(T)$는 Varshni 공식에 따라 계산한 결과 $E_g(T)=3.7920eV-(5.2729{\times}10^{-4}eV/K)T^2/(T+786K)$였다. $MnAl_2S_4$ 단결정 박막의 응용소자인 photocell로 사용할 수 있는 pc/dc 값이 가장 큰 광전도셀은 S 증기분위기에서 열처리한 셀로 $1.10{\times}10^7$이었으며, 광전도 셀의 감도(sensitivity)도 S 증기분위기에서 열처리한 셀이 0.93로 가장 좋았다. 또한 최대 허용소비전력(MAPD)값도 S 증기분위기에서 열처리한 셀이 316 mW로 가장 좋았으며, S 증기분위기에서 열처리한 셀의 응답시간은 오름시간 14.8 ms, 내림시간 12.1 ms로 가장 빠르게 나타나, $MnAl_2S_4$ 단결정 박막을 S 분위기에서 $290^{\circ}C$로 30분 열처리한 photocell이 상용화가 가능할 것으로 여겨진다.