최근, 집적 소자의 미세화에 따라 늘어난 배선 신호 지연 및 상호 간섭, 그리고 소비 전력의 증가는 초고집적 소자 성능 개선에 한계를 가져온다. 이에 따라 기존의 알루미늄(Al)/실리콘 절연 산화막은 구리(Cu)/저유전율 박막(low-k)으로 대체되고 있고, 이는 소자 성능 개선에 큰 영향을 미친다. 그러나 Cu는 Si과 low-k 내부로 확산이 빠르게 일어나 소자의 비저항을 높이고, 누설 전류를 일으키는 등 소자의 성능을 저하시킬 수 있는 문제점을 가지고 있다. 이러한 Cu의 확산을 막기 위하여 Ta, TaN 등과 같은 확산방지막에 대한 연구가 활발히 진행되어 왔으나, 배선 공정의 집적화와 low-k 대체에 따른 공정 및 신뢰성 문제로 인해 새로운 확산방지막의 개발이 필요하게 되었다. 이를 위해, 본 연구에서는 Cu-V 합금을 사용하여 low-k 기판 위에 확산방지막을 자가 형성 시키는 공정에 대한 연구를 진행하였다. 다양한 low-k 기판에서 열처리조건에 따른 Cu-V 합금의 특성을 확인하기 위해 4-point probe를 통한 비저항 평가와 XRD (X-ray diffraction) 분석이 이뤄졌다. 또한, TEM (transmission electron microscope)을 이용하여 $300^{\circ}C$에서 1 시간 동안 열처리를 거쳐 자가형성된 V-based interlayer가 low-k와 Cu의 계면에서 균일하게 형성된 것을 확인하였다. 형성된 V-based interlayer의 barrier 특성을 평가하고자 Cu-V합금/low-k/Si 구조와 Cu/low-k/Si 구조의 leakage current를 비교 분석하였다. Cu/low-k/Si 구조는 비교적 낮은 온도에서 leakage current가 급격히 증가하는 양상을 보였으나, Cu-V 합금/low-k/Si 구조는 $550^{\circ}C$의 thermal stress 에서도 leakage current의 변화가 거의 없었다. 이러한 결과를 바탕으로 열처리를 통해 자가형성된 V-based interlayer의 Cu/low-k 간 확산방지막으로서 가능성을 검증하였다.
Adhesion between Cu and low-k films has been investigated. Low-k films deposited using a mixture of hexamethyldisilane(HMDS) and Para-xylene had a dielectric constant as low as 2.7, showing the thermally stable properties up to $400^{\circ}C$. In this study, Ti glue layer, boron dopant, and $N_2$plasma treatment were used to improve adhesion property of between Cu and low-k films. Ti glue layer slightly improved adhesion property. After $N_2$plasma treatment, the adhesion property was significantly improved due to the increased roughness and the formation of new binding states between Ti and plasma-treated PPpX : HMDS. However, $300^{\circ}C$ annealing of $N_2$plasma treated sample caused the diffusion of Cu into the PPpX : HMDS, degrading the low-k properties. In the case of Cu(B)/Ti/PPpX : HMDS, the adhesion was remarkably increased. This enhanced adhesion was attributed to formation of Ti-boride at the Cu-Ti interface. It is because the formed Ti-boride prevented the diffusion of Cu into the PPpX : HMDS and the Cu-Ti reaction at the Ti interface.
현대 전자 산업에서Cu/Low-K공정의 도입을 통해 반도체 칩의 소형화 및 전기적 성능 향상이 가능해졌으나, Cu/Low-K는 기존의 반도체 제조 공정에 사용된 물질에 비해 물리적으로 매우 취약해진 단점을 가지고 있어 칩 제조 공정 과 패키지 공정에서 많은 문제를 유발하고 있다. 특히, 온도 사이클 후, Cu 층과 Low-K 유전층 사이의 박리현상은 주요 불량 현상의 하나이다. Cu/Low-K층은 플립 칩 패드의 상부에 위치하기 때문에 플립 칩이 받는 스트레스가 직접적으로 Cu/Low-K층에 영향을 주고 있다. 이런 문제를 해결하기 위한 언더필 공정이나 언더필 물질의 개선이 필요하게 되었고 특히, 플립 칩에 대한 스트레스를 줄이고 솔더 범프를 보호하기 위한 언더필의 선택이 중요하게 되었다. 90 nm Cu/Low-K 플립 칩 패키지의 온도 사이클 후 발생한 박리 문제를 적합한 언더필 선택을 통해 해결하였다.
Advanced back-end processing requires the integration of low-k dielectrics and Cu. However, in the presence of an electric field and a temperature, positive Cu ions may drift rapidly through dielectric and causing reliability problems. Therefore, in this paper, Cu+ drift diffusion in two low-k materials and silicon oxide is evaluated. The drift diffusion is investigated by measuring shifts in the flat band voltage of capacitance-voltage measurements on Cu gate capacitors after bias thermal stressing. The Cu+ drift late in $SiO_{x}C_{y}\;(2.85{\pm}0.03)$ and Polyimide(2.7${\leq}k{\leq}3.0$) is Considerably lower than in thermal oxide.
In this paper, we fabricated Cu/Mn alloy shunt resistor with low resistance and thermal stability for use of mobile electronic devices. We designed metal alloy composed of copper (Cu) and manganese (Mn) to embody in low resistance and low TCR which are conflict each other. Cu allows high electrical conductivity and Mn serves thermal stability in this Cu/Mn alloy system. We confirmed the elemental composition of the designed metal alloy system by using energy dispersive X-ray (EDX) analysis. We obtained low resistance below $10m{\Omega}$ and low temperature coefficient of resistance (TCR) below $100ppm/^{\circ}C$ from the designed Cu/Mn alloy resistor. And in order to minimize resistance change caused by alternative frequency on circuit, shape design of the metal alloy wire is performed by rolling process. Finally, we conclude that design of the metal alloy system was successfully done by alloying Cu and 3 wt% of Mn, and the Cu/Mn alloy resistor has low resistance and thermal stability.
한국정보디스플레이학회 2009년도 9th International Meeting on Information Display
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pp.1193-1196
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2009
Low resistivity interconnection and high-mobility channel are required to realize ultrahigh-definition LCDs such as 4k ${\times}$ 2k TVs. We evaluated fully Cu-based gate and Source/Drain interconnections, consisting of stacked pure-Cu/Cu-Mn layers for TFT-LCDs, and found the underlying Cu-Mn alloy film has superior adhesion to glass substrates and CVD-SiOx films. It was also confirmed that wet etching of the Cu/Cu-Mn films without residues and low contact resistance with both channel IGZO and pixel ITO films can be obtained. It is thus considered that the stacked Cu/Cu-Mn structure is one of candidates to replacing conventionally pure-Cu/refractory metal.
This study was performed to investigate the effects of different levels of Cu(0,6,60 ppm ) and kinds of lipid(corn oil, sesame oil or butter) in the diet upon lipids metabolism and Cu & Fe contents in weanling rats. The results obtained were summarized as following : 1) Food consumptions, total body weight gains and F.E.R.s showed no significant differences among groups with different dietary Cu levels and the kinds of lipid. 2) Weights of liver, hind limb muscle, kidney, spleen and epididymal fat pad showed no significant differences among groups. 3) The contents of total lipids and total cholesterols in serum, hind limb muscle were significantly higher in low Cu groups than in control and high Cu groups. But the contents of total lipid in liver were significantly lower in low Cu groups than in other groups. 4) The contents of total lipid and total cholesterol in serum, liver and total lipid in muscle were significantly higher in butter groups, but the contents of total cholesterol in muscle were significantly lower in butter groups. 5) The Cu concentrations in serum, liver, muscle and feces were significantly higher in high Cu groups than in control and low Cu groups. The Fe concentrations in serum tended to be lower and those in muscle were significantly higher in low Cu groups.
Effective control of the heat generated from electronics and semiconductor devices requires a high thermal conductivity and a low thermal expansion coefficient appropriate for devices or modules. A method of reducing the thermal expansion coefficient of Cu has been suggested wherein a ceramic filler having a low thermal expansion coefficient is applied to Cu, which has high thermal conductivity. In this study, using pressureless sintering rather than costly pressure sintering, a polymer solution synthesis method was used to make nano-sized Cu powder for application to Cu matrix with an AlN filler. Due to the low sinterability, the sintered Cu prepared from commercial Cu powder included large pores inside the sintered bodies. A sintered Cu body with Zn, as a liquid phase sintering agent, was prepared by the polymer solution synthesis method for exclusion of pores, which affect thermal conductivity and thermal expansion. The pressureless sintered Cu bodies including Zn showed higher thermal conductivity (180 W/m·K) and lower thermal expansion coefficient (15.8×10-6/℃) than did the monolithic synthesized Cu sintered body.
In this present work, we report a Cu-Mn alloy as a materials for the self-forming barrier process. And we investigated diffusion barrier properties of self-formed layer on low-k dielectrics with or without UV curing treatment. Cu alloy films were directly deposited onto low-k dielectrics by co-sputtering, followed by annealing at various temperatures. X-ray diffraction revealed Cu (111), Cu (200) and Cu (220) peaks for both of Cu alloys. The self-formed layers were investigated by transmission electron microscopy. In order to compare barrier properties between Mn-based interlayer interlayer, thermal stability was measured with various low-k dielectrics. X-ray photoelectron spectroscopy analysis showed that chemical compositions of self-formed layer. The compositions of the Mn based self-formed barriers after annealing were determined by the C concentration in the dielectric layers.
Cu 본딩을 이용한 웨이퍼 레벨 적층 기술은 고밀도 DRAM 이나 고성능 Logic 소자 적층 또는 이종소자 적층의 핵심 기술로 매우 중요시 되고 있다. Cu 본딩 공정을 최적화하기 위해서는 Cu chemical mechanical polishing(CMP)공정 개발이 필수적이며, 본딩층 평탄화를 위한 중요한 핵심 기술이라 하겠다. 특히 Logic 소자 응용에서는 ultra low-k 유전체와 호환성이 좋은 Ti barrier를 선호하는데, Ti barrier는 전기화학적으로 Cu CMP 슬러리에 영향을 받는 경우가 많다. 본 연구에서는 웨이퍼 레벨 Cu 본딩 기술을 위한 Ti/Cu 배선 구조의 Cu CMP 공정 기술을 연구하였다. 다마싱(damascene) 공정으로 Cu CMP 웨이퍼 시편을 제작하였고, 두 종류의 슬러리를 비교 분석 하였다. Cu 연마율(removal rate)과 슬러리에 대한 $SiO_2$와 Ti barrier의 선택비(selectivity)를 측정하였으며, 라인 폭과 금속 패턴 밀도에 대한 Cu dishing과 oxide erosion을 평가하였다.
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[게시일 2004년 10월 1일]
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