In this paper, a specification for wireless LAN MODEM using direct sequence spread spectrum (DS/SS) technique is presented. Some algorithms and hardware architectures for an efficient implementation of the DS/SS MODEM are suggested. In the method, all baseband signal processing are done digitally for single chip implementation. Schemes of DQPSK baseband modulation/demodulation, despreading with digital matched filter, digital timing recovery, and efficient carrier sensing are among the discussed algorithms. We also performed various kinds of simulations to evaluate the system performance and to extract parameters for hardware implementation. In addition, the pictorial view of ASIC of the SS MODEM is also shown.
In this paper, we designed and made up/down converter (UDC) for using W-CDMA digital pre-distortion system which is one of the efficiency enhancement techniques. UDC is required that frequency up(baseband to RF) and down(RF to baseband) of information signals. The focus of the design and PCB layout is to satisfy the linearity of the UDC. We tested that UDC was satisfied specification which is based on 3GPP base stations and repeaters. The ACLR results which are -51.84dBc(Up Converter) and -55.0dBc(Down Converter) at upper 5 MHz offset from center-frequency show that UDC satisfy the 3GPP specification with superior linearity data.
It is well known that an OFDM receiver is vulnerable to synchronization errors. Despite fine estimations used in the initial acquisition, there are still residual synchronization errors. Though these errors are very small, they severely degrade the bit error rate (BER) performance. In this paper, we propose a residual error elimination scheme for the digital OFDM baseband receiver aiming to improve the overall BER performance. Three improvements on existing schemes are made: a pilot-aided recursive algorithm for joint estimation of the residual carrier frequency and sampling time offsets; a delay-based timing error correction technique, which smoothly adjusts the incoming data stream without resampling disturbance; and a decision-directed channel gain update algorithm based on recursive least-squares criterion, which offers faster convergence and smaller error than the least-mean-squares algorithms. Simulation results show that the proposed scheme works well in the multipath channel, and its performance is close to that of an OFDM system with perfect synchronization parameters.
An error-compensated pulse width modulator (ECPWM) is proposed to improve the baseband harmonic performance and the switching loss of voltage source inverters (VSIs). Selecting between harmonic distortion and switching loss is a design tradeoff in the conventional space vector pulse width modulation. In this work, an accumulated difference in produced and desired phase voltages is considered to adjust the reference signal. This mechanism can compensate for the voltage error in the previous carrier period. With error compensation every half-carrier period, the proposed ECPWM allows one-half reduction in carrier frequency without scarifying baseband harmonic distortion. The proposed modulator is applied to a three-phase VSI with R-L load and a motor-speed-control system for experiments. The measured efficiency and operating temperature of switches confirm the effectiveness of the proposed scheme.
본 논문에서는 ATSC 8-VSB 전송 시스템에서 8-VSB 신호의 페이딩과 간섭에 대한 오율식을 유도하여 그 결과를 시뮬레이션 결과와 함께 도시하였다. 또한, 표준 파라미터에 의한 송수신기 모델링을 Baseband 시뮬레이션 하였으며, 인접 채널간 간섭에 대해서는 Passband 시뮬레이션 하였다. 시뮬레이션 결과, Rician 채널을 고려하지 않았을 경우에는 주파수 간격이 20MHz 이상 떨어지면 간섭이 거의 없었고, Rician 채널의 경우, 간섭이 없더라도 페이딩에 의한 성능의 저하가 있음을 알 수 있었다.
차세대 통신기술인 Software-Defined Radio (SDR)시스템은 단일 하드웨어 플랫폼에 소프트웨어 변경만으로 다양한 통신표준을 수용할 수 있는 시스템이다. 시스템의 융통성(flexibility)과 적응성(adaptability)을 위하여 RF와 관련된 하드웨어의 최소화가 필요하며, 이를 위해 ADC를 사용으로 기저대역(baseband) 또는 낮은 IF단으로 직접하향 변환(downconversion)을 할 수 있는 bandpass sampling 기법이 필수적이다. 이 논문에서는 complex bandpass sampling 방식을 이용하여 두 가지의 통신 표준이 한 시스템에서 동시에 직접 하향 변환하는 새로운 방법을 제안하였다. 이에 따른 sampling 가능 영역, 보호대역(guard-band)을 고려한 sampling 가능 최소 주파수 그리고 이동된 신호의 위치를 구하는 수식들을 유도한 뒤 그래프를 통해 비교 분석하였다. 또한 제안한 sampling방식이 모의실험을 통해 기존에 제안되었던 real bandpass sampling방식보다 SDR시스템에 더욱 적합하다는 것을 입증하였다.
본 연구에서는 기존의 접촉식 센서를 이용한 생체신호 측정이 아닌 비접촉 방식으로 심박과 호흡을 추출하기 위해 2.4GHz 대역에서 동작하는 도플러 레이더 센서와 베이스 밴드 모듈로 구성된 도플러 레이더 시스템을 설계하고 그 성능을 평가하였다. 설계된 도플러 레이더 시스템은 인체표면의 변위변화에 의해 반사되는 위상변화를 이용하여 심폐 활동을 검출할 수 있다. 도플러 레이더 센서의 I/Q 채널에서 획득한 신호는 베이스 밴드 모듈의 전처리 필터부, 증폭부, 옵셋조정부를 통과하여 호흡과 심박 신호로 분리된다. 도플러 레이더 시스템으로부터 측정된 생체신호와 기존의 생체신호 간의 상관성을 확인하기 위해 호흡과 심박 대역이 각각 다른 쥐, 토끼, 사람을 대상으로 측정하여 그 결과를 비교하였다. 설계된 도플러 레이더 시스템에서 분리된 호흡 및 심박 신호는 측정 대상의 움직임이 없는 상태에서는 높은 검출률을 보였으며, 도플러 레이더에서 심박과 호흡 신호를 검출한 결과 거리, 호흡과 심박의 변이량, 호흡과 심박대역에 따라 검출률이 영향을 받는다는 것을 알 수 있었다.
The purpose of this study is to realize the real time monitoring ECG telemetry system applied by the telemetry unit, in which transmission is made through the electronic wave and reception is made through the light, and by the wavelet algorithm as well. A light receiver via existing telemetry unit which is based on baseband, the reception length was 50cm, but when the frequency modulation is used, the reception length is extended to 3m. In addition to this, we have found that the full-duplex method of transmission became available by using dual-mechanism.
The Third Generation (3G) cellular mobile communication systems aim at providing higher data rates, improved quality of service, support for multimedia applications and global roaming. Cdma2000 and Universal Mobile Telecommunication System (UMTS) have emerged as two leading 3G standards in USA and European countries, respectively. Both the standards are capable of delivering high bandwidth data, voice and multimedia services to users of mobile equipment, but are not directly interoperableand are not available across different geographic areas, due to which global roaming is not possible in true sense of using single mobile equipment. However, both UMTS and cdma2000 are based on wideband code division multiple access (WCDMA) as the access method. Due to this, there exist some inherent commonalities between them. In this paper we will try to exploit the commonalities between the two standards in order to design an ASIC, which can provide dual standard capability. This paper discusses the physical layer aspects of the two standards and proposes an approach to design an ASIC which can be mapped to baseband processing part of the physical layer and is capable of delivering for either of the two aforementioned standards.
본 논문은 Field Programmable Gate Array (FPGA)와 디지털 신호처리 소자를 이용한 IS-95 CDMA신호 처리기 FPGA와 고속의 ADC/DAC를 이용한 기저대역과 중간주파수(IF)의 디지털 변환기 그리고 주파수 상·하향 변환기를 구현하였다. IS-95 CDMA 채널 처리기는 짧은 PN 코드 발생기와 왈쉬 코드 발생기로 파일롯 채널의 신호를 발생시킨다. 디지털 IF는 FPGA, 디지털 송·수신 신호처리 소자와 고속의 ADC/DAC로 구성하였다. 주파수 상·하향 변환기는 필터, 믹서, 디지털 감쇠기와 PLL로 구성되어 중간주파수(IF)와 RF 주파수를 변환하였다. 이 구현된 시스템은 IS-95 CDMA 기지국 장비 등에 장착할 수 있다.
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[게시일 2004년 10월 1일]
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