• 제목/요약/키워드: Area Error

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Mean estimation of small areas using penalized spline mixed-model under informative sampling

  • Chytrasari, Angela N.R.;Kartiko, Sri Haryatmi;Danardono, Danardono
    • Communications for Statistical Applications and Methods
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    • 제27권3호
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    • pp.349-363
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    • 2020
  • Penalized spline is a suitable nonparametric approach in estimating mean model in small area. However, application of the approach in informative sampling in a published article is uncommon. We propose a semiparametric mixed-model using penalized spline under informative sampling to estimate mean of small area. The response variable is explained in terms of mean model, informative sample effect, area random effect and unit error. We approach the mean model by penalized spline and utilize a penalized spline function of the inclusion probability to account for the informative sample effect. We determine the best and unbiased estimators for coefficient model and derive the restricted maximum likelihood estimators for the variance components. A simulation study shows a decrease in the average absolute bias produced by the proposed model. A decrease in the root mean square error also occurred except in some quadratic cases. The use of linear and quadratic penalized spline to approach the function of the inclusion probability provides no significant difference distribution of root mean square error, except for few smaller samples.

에러교정기법을 이용한 WBAN 서비스품질 최적화 설계 (WBAN Service Quality Optimization Design Using Error Correction Technique)

  • 이정재
    • 한국전자통신학회논문지
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    • 제14권4호
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    • pp.657-662
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    • 2019
  • 웨어러블 센서, 심전도조정기의 전력 소비는 네트워크 수명을 늘리기 위해 매우 낮아야 하며 WBAN노드에서 처리하는 데이터의 에러교정 및 인증등의 예상되는 서비스품질 제어는 중요하다. 따라서 서비스품질제어는 건강모니터링규정에서 WBAN을 구현하는 데 있어 가장 긴급한 관심사이다. 최적의 QoS제어를 위해 에너지 효율을 고려한 에러교정기법과 IEEE 802.15.6과 성능을 에너지효율 및 평균전송갯수면에서 비교평가 한다. 제안된 에러교정기법의 성능은 채널 추정을 이용하여 부호화율을 적절히 조절함으로써 에너지 효율 및 전송율이 향상됨을 보인다.

한반도 지역에서 이동형 위성단말의 오류확률 분석 (Analysis of Error Probability of Mobile Satellite Communication System In Korea Peninsula Area)

  • 이희규
    • 한국인터넷방송통신학회논문지
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    • 제19권2호
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    • pp.67-71
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    • 2019
  • 본 논문은 이동형 위성단말이 운용되는 환경에서 기준이 되는 오류확률 성능을 도출한다. 위성단말이 이동을 하면 주변 장애물에 의해 shadwoingd 발생하고, BER성능을 저하시킨다. 분석을 위해 이동형 위성단말이 운용되는 환경을 모의한 Lutz모델을 활용한다. Lutz모델은 Rician분포와 Suzuki모델을 결합한 형태이다. 오류확률은 두 분포함수를 수식적 분석을 이용하여 도출한다. 한반도 수풀지역에서 측정 결과로 시뮬레이션한 결과는 Lutz모델을 이용해 근서화한 BER결과와 유사했다. 직관적으로 측정결과와 근사화한 결과는 유사하고, 수치적으로 SNR이 30dB에서 BER오차는 약 3e-4이하이다.

연직배수재(VDs)에 의한 오염지반정화 메커니즘 연구 (Mechanism of Soil Remediation in Contaminated Area Using Vertical Drains)

  • 이행우;장병욱;강병윤;김현태
    • 한국농공학회논문집
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    • 제47권5호
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    • pp.63-71
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    • 2005
  • In-situ soil remediation mechanism through the vertical drains (VDs) is analyzed with numerical model as the error and complementary error function. Results from in-situ test and analysis indicate that the contaminant concentration ratio as initial one ( C/$C_0$) increases as the radius ratio ( r/R) increases from the injection well, and also increases as the depth ratio ( z/ H) increases from the top of contaminated area. The elapse time needed to attain $50\%$ and $90\%$ clean up level ($ t_{50},\;t_{90}$) increases as the radius ratio ( r/R) and the depth ratio ( z/ H) increase. As above results, the procedure of soil flushing in contaminated area using vertical drains makes progress from the top of injection well to the bottom of extraction well.

초음파를 이용한 위치 인식 시스템의 거리오차와 비이컨의 좌표에 의한 위치오차 (Position error due to distance error in the localization system using Ultrasonic)

  • 황의근;정규식;신동헌
    • 대한기계학회:학술대회논문집
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    • 대한기계학회 2007년도 춘계학술대회A
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    • pp.1155-1160
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    • 2007
  • This paper presents position error for the robot localization system using the ultrasonic wave. The distance between the receiver and a beacon can be computed by using the difference between times of flight. The distance information measured by ultrasonic wave has errors. The position is calculated by distances, and this error is caused by distance errors. The position error is different from receiver¡s position. And the position is also calculated by beacon location. This paper calculates worst case position error within measuring area, and finds beacons location to reduce the position error.

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Breadth-first 검색 알고리즘을 이용한 와이어 오류 검출에 관한 연구 (Error Wire Locating Technology with Breadth-first Search Algorithm)

  • 서건;이정표;이재철;김일구;박재홍
    • 대한전기학회:학술대회논문집
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    • 대한전기학회 2007년도 심포지엄 논문집 정보 및 제어부문
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    • pp.258-260
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    • 2007
  • Nowadays the automotive circuit design becomes more complicated a practical modern car circuit usually contains thousands of wires. So the error connection between connector and pins becomes more difficult to be located. This paper proposes a general way to locate all error wires in an automotive circuit design. Firstly, we give an exact definition of error wire to guide our job. This definition also composes the core part of our algorithm. Then we limit the area of the error wires by several steps. During these steps, we apply breadth-first search method to step over all wires under consideration of reducing time cost. In addition, we apply bidirectional stack technique to organize the data structure for algorithm optimization. This algorithm can get a result with all error wires and doubtful wires in a very efficient way. The analysis of this algorithm shows that the complexity is linear. We also discuss some possible improvement of this algorithm.

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Highly Accurate Approximate Multiplier using Heterogeneous Inexact 4-2 Compressors for Error-resilient Applications

  • Lee, Jaewoo;Kim, HyunJin
    • 대한임베디드공학회논문지
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    • 제16권5호
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    • pp.233-240
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    • 2021
  • We propose a novel, highly accurate approximate multiplier using different types of inexact 4-2 compressors. The importance of low hardware costs leads us to develop approximate multiplication for error-resilient applications. Several rules are developed when selecting a topology for designing the proposed multiplier. Our highly accurate multiplier design considers the different error characteristics of adopted compressors, which achieves a good error distribution, including a low relative error of 0.02% in the 8-bit multiplication. Our analysis shows that the proposed multiplier significantly reduces power consumption and area by 45% and 26%, compared with the exact multiplier. Notably, a trade-off relationship between error characteristics and hardware costs can be achieved when considering those of existing highly accurate approximate multipliers. In the image blending, edge detection and image sharpening applications, the proposed 8-bit approximate multiplier shows better performance in terms of image quality metrics compared with other highly accurate approximate multipliers.

수치정사영상 제작 및 개선에 관한 연구 (The Study on the Digital Orthophoto Generation and Improvement of it's Quality)

  • 김감래;전호원
    • 한국측량학회지
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    • 제17권2호
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    • pp.97-104
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    • 1999
  • 수치표고모델(DEM)은 정사영상 제작을 위한 중요한 기초 자료이며, 품질은 대상 점 또는 선형요소의 기하학적 정확도에 의존하게 된다. 따라서 본 연구에서는 격자의 간격과 스캐닝 해상도를 달리하며 상관매칭에 의해 수치표고모델 생성을 시도하였다. 실험결과 추출점의 격자간격이 작을수록 표준편차가 가장 작게 나타났으며 스캐닝의 해상도는 큰 영향이 없는 것으로 나타났다. 또한 수치표고모델에 대한 편이량 분석결과 소축척에 비해 대축척의 항공사진에서 편이가 크게 발생되었으며 이는 폐쇄영역이 가장 큰 영향 요소임을 알 수 있었다. 이러한 패쇄영역을 줄이기 위하여 다축척 영상의 이용과 종 중복도를 증가시키며 실험한 결과 한 쌍의 입체영상보다 다중영상을 이용한 경우 음영 및 폐쇄영역의 크기를 대폭 감소시킬 수 있는 것으로 나타났다.

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인근지역 범위 설정이 공간회귀모형 적합에 미치는 영향 (The Effects of Neighborhood Segmentation on the Adequacy of a Spatial Regression Model)

  • 이창로;박기호
    • 대한지리학회지
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    • 제48권6호
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    • pp.978-993
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    • 2013
  • 공간회귀모형은 공간가중행렬을 통해 공간관계를 명시적으로 정량화한다는 점에서 타 모형과 뚜렷하게 구별되는 강점이 있는 동시에, 공간가중행렬 구성에 자의성이 개입된다는 약점을 가지고 있기도 하다. 본 연구에서는 공간가중행렬의 구성에 따라 모형 적합도가 어떻게 변화하는지 인천시를 사례로 실증적으로 검토하였다. 또한 인근지역 범위 설정에 따라 공간시차모형(spatial lag model) 또는 공간오차모형(spatial error model) 중 어떠한 모형이 보다 우수하게 나타는지 검토하였다. 분석 결과, 토지가격 추정에 있어 인근지역 범위를 좁게 파악하는 공간가중행렬을 구성할수록 모형 적합도가 전반적으로 개선되는 것이 확인되었다. 또한, 공간적 이질성이 심한 지역은 공간오차모형의 적합도가 보다 우수한 것으로 파악되었다. 공간적 이질성이 심한 지역은 동질적 성격을 갖는 하부 인근지역으로 세분함으로써 그러한 이질성을 완화시킬 수 있었고, 그 결과 공간오차모형보다 공간시차모형의 적합도가 우수하게 나타날 수 있음을 밝혔다.

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오류 정정기능이 내장된 6-비트 70MHz 새로운 Interpolation-2 Flash ADC 설계 (A 6-bit, 70MHz Modified Interpolation-2 Flash ADC with an Error Correction Circuit)

  • 박정주;조경록
    • 대한전자공학회논문지SD
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    • 제41권3호
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    • pp.83-92
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    • 2004
  • 본 논문에서는 새로운 interpolation-2 방식의 비교기 구조를 제안하여 칩 면적과 전력 소모를 줄이며 오류정정 회로를 내장하는 6-비트 70㎒ ADC를 설계하였다. Interpolation 비교기를 적용하지 않은 flash ADC의 경우 2n개의 저항과 2n -1개의 비교기가 사용되며 이는 저항의 수와 비교기의 수에 비례하여 많은 전력과 큰 면적을 필요로 하고 있다. 또한, interpolation-4 비교기를 적용한 flash ADC는 면적은 작으나 단조도, SNR, INL, DNL 특성이 떨어진다는 단점이 있었다. 본 논문에서 설계한 interpolation-2 방식의 ADC는 저항, 비교기, 앰프, 래치, 오류정정 회로, 온도계코드 디텍터와 인코더로 구성되며, 32개의 저항과 31개의 비교기를 사용하였다. 제안된 회로는 0.18㎛ CMOS 공정으로 제작되어 3.3V에서 40mW의 전력소모로 interpolation 비교기를 적용하지 않은 flash ADC에 비해 50% 개선되었으며, 칩 면적도 20% 감소되었다. 또한 노이즈에 강한 오류정정 회로가 사용되어 interpolation-4 비교기를 적용한 flash ADC 에 비해 SNR이 75% 개선된 결과를 얻었다.