• 한국건축시공학회지
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• 제16권1호
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• pp.9-15
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• 2016

건물에서 에너지 손실이 가장 큰 부위는 외피로서, 이 부분의 에너지 손실을 감소하기 위한 연구가 활발히 진행되고 있으나 이는 대부분 창호 및 단열재를 사용한 연구이며 건물 외피의 70% 이상을 차지하고 있는 콘크리트에 대한 연구는 미미한 실정이다. 따라서 건물의 에너지 손실을 최소화하기 위해서는 콘크리트 자체에서 단열성능을 확보할 수 있어야 하며 이에 대한 연구가 필요하다. 이에 본 연구에서는 보통콘크리트보다 열전도율을 2배 이상 개선시킨 구조용 단열성능향상 콘크리트 개발 연구의 일환으로 마이크로기포제, 규조토 미분말, 경량골재를 사용하였으며, 콘크리트 내부공극을 다량확보하여 열전도율을 낮추고자 하였다. 실험결과, 슬럼프와 공기량은 양호한 결과를 나타내었으며, 단위용적질량에서는 마이크로기포제를 사용한 모든 배합에서 보통콘크리트보다 14.3~35.1 % 감소된 결과를 나타내었고 압축강도는 단열성능 향상 재료를 사용하여 다소 감소하는 경향을 나타내었으나 본 실험의 목표 강도(24MPa)를 모두 만족하였다. 또한 열전도율은 보통콘크리트 대비 최대 2배 이상 개선된 결과를 나타내었다.

• 한국언론정보학보
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• 제58권
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• pp.106-129
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• 2012

이 글은 SNS의 보편적 이용이 늘어나고 그것에 대한 규제논의가 증가하는 것을 배경으로 해서, SNS 표현물에 대한 현행 국내 규제체계의 문제점을 분석하고자 한다. 이를 위해 규제대상으로서 SNS표현물의 성격을 살펴보고, SNS 표현물에 대한 국내 내용규제체계의 문제점을 법률적 측면과 규제기관적 차원에서 검토했다. SNS 표현물에 대한 규제체계를 살펴보면, 법률과 행정기구 중심의 국가주의적 규제경향이 강하다는 것을 알 수 있다. 5가지 측면의 규제법률이 SNS 표현물 규제와 연계되어 있으며, 규제의 주체로서 행정기구가 내용심의를 하고 있음을 알 수 있었다. 그로 인해 민간영역의 자율기능은 상대적 약한 것으로 판단된다. SNS와 같은 인터넷공간에는 최소규제의 원칙이 적용되어야 하며, 규제에 적용되는 불법의 정의도 명확히 하고 그것의 판단주체 및 규제대상을 최소화해야 한다. 현재의 행정기구로서 방송통신심의 위원회 구조에 대한 본질적인 고민이 필요하다.

• 전자공학회논문지CI
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• 제42권5호
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• pp.9-20
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• 2005

본 논문에서는 실내에서 이동하는 사용자를 적외선에 기반을 둔 근접방법으로 추적하는 시스템인 ubiTrack을 제안한다. 현재까지 개발된 대부분의 실내 위치 추적 시스템들은 성능 및 정확도 향상을 위해 중앙 집중적인 방식으로 사용자를 추적하고 있다. 그러나 이와 같은 방식은 수많은 센서들이 환경에 편재되는 유비쿼터스 컴퓨팅 환경에서 프라이버시 문제를 야기할 수 있으며 다수의 사용자로 위치 추적을 확장하는 경우 연산의 부하가 크다는 문제점이 있다. 제안된 ubiTrack은 사용자의 모바일 기기에서 위치정보를 획득하는 passive mobile 구조로 설계되어 프라이버시 문제를 완화하며, 이동하는 사용자에 적합한 영역기반의 근접방법을 사용하여 위치 추적을 위한 연산의 효율을 높인다. 이를 위해 ubiTrack은 센싱 영역을 시분할 방식 (Time-Division Multiplexing)으로 중첩시켜 사용자에게 적합한 영역을 생성하며, 시분할 방식에 따른 성능 저하를 막기 위해 짧은 발신 주기를 가지는 적외선 통신 방식을 사용한다. 아울러 ubiTrack은 위치 추적의 정확도와 정밀도를 높이기 위해 하드웨어로 구현된 수신기와 소프트웨어로 구현된 활용 모듈에서 외부로부터의 충격이나 신호 강도 약화에 의해 발생하는 노이즈를 필터링하는 방법들을 각각 사용한다. ubiTrack은 유비쿼터스 컴퓨팅 환경에서 서로 다른 어플리케이션들의 통신을 지원하는 네트워크 모듈과 연계되어 있어, 단순히 위치 정보에 의존적인 어플리케이션뿐만 아니라 사용자 컨텍스트 정보를 활용하는 어플리케이션 등의 다양한 서비스들에서 쉽게 응용될 수 있다.

• 대한전자공학회논문지SD
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• 제45권10호
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• pp.31-38
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• 2008

본 논문은 유선으로 연결된 다양한 센서들의 제어와 센서들 간의 호환성을 보장하는 IEEE 1451.2 표준을 적용한 센서 네트워크 시스템 구현에 대한 연구이다. 제안된 시스템은 IEEE 1451.0에서 기술된 네트워크 수용 가능한 응용 프로세서(NCAP-Network Capable Application Processor)와 IEEE 1451.2에서 기술된 변환기 독립 인터페이스(TII-Transducer Independent Interface), 변환기 전자 데이터 시트(TEDS-Transducer Electronic Data Sheet)와 아날로그 디지털 변환기를 포함한 송수신기 부분으로 구성된다. 본 시스템은 추후 반도체 집적회로 설계에 용이할 수 있돌고 시스템의 소형화와 최적화를 목표로 구현되었다. 네트워크 수용 가능한 응용 프로세서는 개인용 컴퓨터상에서 C언어로 구현하였고 변환기 독립 인터페이스는 개인용 컴퓨터의 병렬포트와 FPGA(Field-Programmable Gate Array) 응용보드의 확장포트를 이용하였고, 송수신기는 FPGA 응용보드를 이용하여 Verilog로 구현하였다. 표준에 근거한 실험을 수행하여 제안된 구조의 검증을 수행하였다.

• 대한전자공학회논문지SD
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• 제45권5호
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• pp.1-11
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• 2008

본 논문에서는 디지털 코드 오차 보정 기법을 사용한 15비트 50MS/s CMOS 파이프라인 ADC를 제안한다. 제안하는 ADC는 15비트 수준의 고해상도에서 면적과 전력 소모를 최소화하기 위해서 4단 파이프라인 구조를 사용하며 전체 ADC의 아날로그 회로를 변경하지 않고 첫 번째 단에 약간의 디지털 회로만을 추가하는 디지털 코드 오차 보정 기법을 적용한다. 첫 번째 단에서 소자 부정합으로 인해 발생하는 코드 오차는 나머지 세 단에 의해 측정된 후 메모리에 저장되고 정상 동작 시 메모리에 저장된 코드 오차를 디지털 영역에서 제거하여 보정한다. 모든 MDAC 커패시터 열에는 주변 신호에 덜 민감한 3차원 완전 대칭 구조의 레이아웃 기법을 적용하여 소자 부정합에 의한 영향을 최소화하면서 동시에 첫 번째 단의 소자 부정합을 보다 정밀하게 측정하도록 하였다. 시제품 ADC는 0.18um CMOS 공정으로 제작되었으며, 측정된 DNL 및 INL은 15비트 해상도에서 각각 0.78LSB 및 3.28LSB의 수준을 보이며, 50MS/s의 샘플링 속도에서 최대 SNDR 및 SFDR은 각각 67.2dB 및 79.5dB를 보여준다. 시제품 ADC의 칩 면적은 $4.2mm^2$이며 전력 소모는 2.5V 전원 전압에서 225mW이다.

• 한국산학기술학회논문지
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• 제17권8호
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• pp.352-362
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• 2016

오늘날 산업 기술의 발달에 따른 고도화로 인해, 최근 우리 사회에 고속열차에 이어 무인운영 도시철도에 이르기까지 다양한 열차 시스템들이 개발 및 운용되고 있는 추세에 있다. 특히, 본 연구에서 대상으로 다룬, 도시철도 도메인에서는 기존 철도차량에 대해서 신호 제어 시스템을 운용하는 환경에서 보다 복잡화된 운용개념을 지원하기 위한 신규 신호 시스템 체계의 도입이 필요로 하고 있다. 또한, 기존의 존재하지 않은 컨셉을 바탕으로 개발되는 신호 시스템은 철도를 이용하는 승객들의 인적 피해를 최소화하기 위한 노력이 필요로 하고 있다. 본 연구에서는 신규 시스템 개발에 참여하는 다양한 도메인 엔지니어로 하여금 동일한 시각 제공과 통합된 방법론을 바탕으로 효율적인 신호시스템 설계 및 안전 활동을 위한 방법론을 제시 하고자 한다. 따라서, 서로 상이한 도메인 영역의 연계성 확보를 통해 향후 신규 시스템 설계시 보다 안전성 확보를 통한 설계적 무결성을 확보할 수 있는 방법론이 될 수 있을 것이다.

• 한국화재소방학회논문지
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• 제30권3호
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• pp.73-78
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• 2016

'화재예방, 소방시설 설치유지 및 안전관리에 관한 법률'에 의하면 지하층 포함 30층 이상 고층 건축물에 대해 화재발생에 따른 위험성을 사전에 과학적으로 평가하여 재난발생 시 인명피해 및 재산피해를 최소화시킬 수 있도록 성능위주 설계를 실시해야 한다. 이에 따라 설계자는 컴퓨터 시뮬레이션 모델링 등 과학적인 분석 기법을 활용하여 거주자의 화재 및 피난 안전성을 평가하고 있다. 이 때, 인명안전성 평가를 위해 가용피난안전시간(ASET)과 소요피난안전시간(RSET) 을 산정하게 되는데 RSET 중에서도 가장 중요한 '반응시간(Response Time)'을 산정함에 있어 우리나라 사람들에 대한 실측 데이터에 기반한 명확한 법적 기준이 제시되지 못하고 있는 것이 현실이다. 이에 '소방시설 등의 성능위주설계 방 법 및 기준, 별표1'을 토대로 설계자별로 각각 상이한 값을 선택, 입력하거나 일본건축센터의 '건축방재계획지침'에 따라 계산하고 있는 경향을 보이고 있다. 따라서 본 연구에서는 최근 5년간 부산지역에서 성능위주 설계대상으로 지정된 고층 특정소방대상물을 대상으로 총 6명의 설계자가 실시한 성능위주 설계안 13건을 중심으로 RSET의 계산방법에 대해 비교 분석하였고, 특히 RSET 계산 시 결과값에 가장 큰 영향을 미치는 반응시간의 계산방법에 대한 결과를 비교하여 오차값을 산정하였다.

• 한국건설관리학회논문집
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• 제14권4호
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• pp.84-96
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• 2013

최근 건설 산업의 디지털화로 인하여 건축 디자인이 정형에서 자유로운 비정형 형태로 변화하고 있다. 특히, 국내에서는 최근 비정형이 디자인 경향으로 도입되어 현상설계, 턴키 등에서 설계 당선을 위한 디자인 요소로 많이 적용되고 있다. 그러나 기존의 정형 건축물의 외벽공법을 비정형 건축물의 외피에 그대로 적용함으로써 누수 및 크랙 등 다양한 하자가 발생하고 있다. 이러한 문제점을 개선하고 공사기간과 공사비를 최소화할 수 있는 비정형 건축물의 설계와 시공이 새로운 기술로 도입되고 있다. 이에 본 연구는 비정형 외피시스템 구현을 위한 공법을 국내외 비정형 건축물의 외피시스템 사례 분석을 통하여 실증적으로 시사점을 도출하고 비정형 건축물 외피시스템의 설계와 시공시 고려해야 할 사항을 다음과 같이 제시하였다. 첫째, 시공성을 고려한 비정형 형태의 설계가 되도록 하여야 한다. 둘째, 2방향 곡면을 정확히 구현할 수 있는 단위 패널 생산 기술의 개발이 필요하다. 셋째, 비정형 콘크리트 외피용 노출 콘크리트 거푸집을 개발하여야 한다. 넷째, 외피 시스템을 부위별로 구분하여 우수처리와 방수를 위한 재료와 공법 특성과 유지관리 방안을 고려하여야 한다.

• 대한전자공학회논문지SD
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• 제43권5호
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• pp.54-63
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• 2006

본 논문에서는 4세대 이동 통신 시스템에서 요구되는 사양을 위해, 해상도, 동작속도, 칩 면적 및 소모 전력을 최적화한 14b 100MS/s 0.18um CMOS ADC를 제안한다. 제안하는 ADC는 동작 모델 시뮬레이션을 통해 최적화된 구조를 분석 및 검증하여 3단 파이프라인 구조로 설계하였으며, Nyquist 입력에서도 14 비트 수준의 유효비트 수를 가지는 광대역 저잡음 SHA 회로를 기반으로 하고, MDAC에 사용되는 커패시터의 소자 부정합에 의한 영향을 최소화하기 위하여 3차원 완전 대칭 구조를 갖는 레이아웃 기법을 적용하였다. 또한, 100MS/s의 동작 속도에서 6 비트의 해상도와 소면적을 필요로 하는 최종단의 flash ADC는 오픈 루프 오프셋 샘플링 및 인터폴레이션 기법을 사용하였다. 제안하는 시제품 ADC는 SMIC 0.18um CMOS 공정으로 제작되었으며, 측정된 DNL과 INL은 14비트 해상도에서 각각 1.03LSB, 5.47LSB 수준을 보이며, 100MS/s의 샘플링 속도에서 SNDR 및 SFDR이 각각 59dB, 72dB의 동적 성능을 보여준다. 시제품 ADC의 칩 면적은 $3.4mm^2$이며 소모 전력은 1.8V 전원전압에서 145mW이다.

• 대한전자공학회논문지SP
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• 제44권5호
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• pp.103-111
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• 2007

본 논문에서는 single-chip CMOS Image Sensor(CIS)용 고화질 image signal processor(ISP)에 최적화된 하드웨어 구조를 제안한다. Single-chip CIS는 CIS와 ISP가 하나의 칩으로 구현된 것으로, 다양한 휴대기기에 사용된다. 휴대기기의 특성상, single-chip CIS용 ISP는 고화질이면서도 저전력을 위해 하드웨어 복잡도를 최소화해야 한다. 영상의 품질 향상을 위해서 다양한 영상 처리 블록들이 ISP에 적용되지만, 그 중에 핵심이면서 하드웨어 복잡도가 가장 큰 블록은 컬러 영상을 만들기 위한 색 보간 블록과 영상을 선명하게 하기 위한 화질 개선 필터 블록이다. 이들 블록은 데이터 처리를 위한 로직 외에도 라인 메모리를 필요로 하기 때문에 ISP의 하드웨어 복잡도의 대부분을 차지한다. 기존 ISP에서는 색 보간과 화질 개선 필터를 독립적으로 수행하였기 때문에 많은 수의 라인 메모리가 필요하였다. 따라서 하드웨어 복잡도를 낮추기 위해서는 낮은 성능의 색보간 알고리즘을 적용하거나, 화질 개선 필터를 사용하지 않아야 했다. 본 논문에서는 화질 개선을 위해 경계 적응적이면서 채널간 상관관계를 고려하는 고화질 색 보간 알고리즘을 적용하였다. 또한 채널 간 상관관계를 고려하는 색 보간 알고리즘의 특성을 이용하여 색 보간 블록과 화질 개선 필터 블록이 라인 메모리를 공유하도록 설계함으로써, 전체 라인 메모리 수를 최소화하는 새로운 구조를 제안한다. 제안된 방법을 적용하면 화질 개선 필터 블록을 위한 추가적인 라인 메모리가 불필요하기 때문에, 고화질과 낮은 복잡도 모두를 만족시킬 수 있다. 제안 방식과 기존 방식의 MSE(Mean Square Error)는 0.37로, 메모리 공유로 인한 화질의 저하는 거의 없었고, 고화질 색 보간 알고리즘을 적용했기 때문에 전체적인 화질은 향상되었다. 제안된 ISP 구조는 Verilog HDL 및 FPGA를 이용하여 실시간으로 구현 검증되었다. 0.25um CMOS 표준 셀 라이브러리를 이용하여 합성하였을 때, 총 게이트 수는 37K개였으며 7.5개의 라인 메모리가 사용되었다.