• Proceedings of the Korean Institute of Electrical and Electronic Material Engineers Conference
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• 1998.11a
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• pp.137-140
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• 1998

An active-matrix LCD using thin film transistors (TFT) has been widely recognized as having potential for high-quality color flat-panel displays. Pixel-Design Array Simulation Tool (PDAST) was used to profoundly understand the gate si후미 distortion and pixel charging capability. which are the most critical limiting factors for high-quality TFT-LCDs. Since PDAST can simulate the gate, data and pixel voltages of a certain pixel on TFT array at any time and at any location on an array, the effect of the resistivity of gate line material on the pixel operations can be effectively analyzed. The gate signal delay, pixel charging ratio and level-shift of the pixel voltage were simulated with varying the parameters. The information obtained from this study could be utilized to design the larger area and finer image quality panel.

• Proceedings of the KIEE Conference
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• 2005.11a
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• pp.172-175
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• 2005

a-Si TFT는 TFT-LCD의 화소 스위칭(swiching) 소자로 폭넓게 이용되고 있다. 현재는 a-Si을 이용하여 gate drive IC를 기판에 집적하는 기술이 연구, 적용되고 있는데 이때 가장 큰 제약은 문턱 전압의 이동이다. 펄스(pulse)형태로 인가되는 gate 전압에 의한 문턱 전압 이동은 a-Si:H gate에 인가되는 펄스의 크기, duty cycle, drain pulse의 크기 및 동작 온도에 기인하며 실험결과를 통해 입증된다. 초기의 DC Stress 측정 Data를 이용하여 문턱전압이동을 모델링/시뮬레이션한 결과 a-Si:H gate 회로설계 및 펄스 조건에 따라 stress시간에 따른 gate의 출력 파형 예측이 가능하고 상온에서 Von=21V를 인가한 결과, 약 4년후에서 시프트레지스터 출력 파형이 열화되기 시작한다.

• Proceedings of the KIEE Conference
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• 1999.11d
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• pp.857-859
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• 1999

본 연구에서는 Poly-Si TFT-LCD 패널에 내장할 수 있는 새로운 방식의 디지털 데이터 구동회로를 설계하였는데, 제안된 데이터 구동회로의 특징 및 장점을 요약하면 다음과 같다. 첫째, 단순한 구조의 샘플드램프 D/A Conversion 회로로 구성되어 회로가 복잡하지 않고, 소요되는 TFT의 수가 적으며, 패널의 스캔방식(Inversion Method : Row/Column/Dot)을 쉽게 선택할 수 있다. 둘째, 기존의 디지털 데이터 구동회로와는 달리, D/A Conversion을 위해 필요한 기준 전압원의 수가적어 입력 핀 수를 적게 가져갈 수 있다. 셋째, Ramp 신호의 조정에 의해 감마 보정 등을 포함한 데이터의 에러에 대한 보정이 수월하다. 넷째, 라인 스친 방식으로 구동하므로 기존의 샘플 앤 홀드방식의 아날로그 구동회로에 비해 화소 데이터의 시간적 안정성을 충분히 확보할 수 있다.

• Proceedings of the Korean Society of Broadcast Engineers Conference
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• 2012.11a
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• pp.50-51
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• 2012

본 논문에서는 기존의 홀로그램 행(열)단위 병렬 연산 방식의 고성능 홀로그램 생성기의 하드웨어 자원 량을 효율적으로 사용하기 위해 공통항을 늘려 자원 량을 줄일 수 있는 구조를 제안한다. 하나의 2D 블록의 행과 열에 해당하는 좌표 항을 연산 후 좌표 항을 이용하여 각 블록의 화소 값을 계산한다. 이전 연구에서의 메모리 접근 량을 줄일 뿐만 아니라 이전 연구에 비하여 조합회로는 45% DSP 블록은 90% 감소하여 하드웨어 자원을 효율적으로 사용할 수 있다.

• Proceedings of the Korean Society of Broadcast Engineers Conference
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• 2011.11a
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• pp.297-298
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• 2011

본 논문에서는 기존의 CGH수식을 이용하여 병렬화된 고성능의 CGH 생성 시 발생하는 다량의 데이터를 효율적으로 처리하기 위해 병목현상을 제거하는 하드웨어 구조를 제안한다. 하나의 가로줄에 해당하는 공통항을 연산한 후 이 값으로 임의의 가로줄에 대한 홀로그램 화소 값을 구하며 공통항과 가로줄에 해당하는 모든 업데이트 항은 객체의 모든 광원에 대하여 계산을 한다. 이 구조는 최종 홀로그램이 한 가로줄에 연산이 끝날 때 마다 생성되기 때문에 이전 연구에서 최종 홀로그램이 한번에 생성되는 구조에 비하여 병목 현상을 줄여서 동영상 홀로그램 생성에 효율적이다.

• Korean Journal of Optics and Photonics
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• v.9 no.6
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• pp.390-395
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• 1998

Iterative Fourier transform algorithm (IFTA) was utilized for the phase retrieval problem or the optimal of the IFTA depends strongly on the selection of initial phase value. In this paper, we proposed the modified interactive Fourier transform algorithm in order to improve the convergence speed of error and the stability of convergence. The modified IFTA was reduced number of iteration about 30% than existing IFTA with the image size of 128$\times$128 pixel.

• Proceedings of the KIEE Conference
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• 2000.07d
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• pp.3084-3087
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• 2000

본 논문은 대면적 Poly-Si TFT-LCD 구동회로의 면적을 줄이기 위한 효율적인 구동방식을 제안한다. 구체적으로 화소의 충전 시간을 줄이기 위한 화면 수평 분할 구동방식과 데이터 라인 프리차징 방식을 제안한다. 또한 수평분할 구동을 위한 Bit-Reduced R-DAC를 제안한다. 마지막으로 본 논문에서는 제안하는 구동 방식을 14 1" XGA 6-bit 일체형 디지털 Poly-Si TFT-LCD 구동회로에 적용하여 효용성을 검증한다 시뮬레이션 결과 계조별 평균 구동오차는 14mv로서 1/2 LSB(${\risingdotseq}$23mV) 정확도 요구 조건을 만족한다. 데이터 드라이버의 폭은 상 하단 각각 약 6mm이며 이는 기존 설계에 비해 66% 감소한 값이다.

• Journal of the Korean Institute of Telematics and Electronics B
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• v.32B no.11
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• pp.1374-1382
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• 1995

In TFT-LCDs, as the display size area becomes larger, and the resolution higher, we have to consider the image degradation effects due to the incorporation of the TFT-LCD parameters such as the data-line resistance, the common electrode resistance, the data-line to common parasitic capacitance, and the output characteristics of driver ICs. One of the degradation effects is crosstalk resulting from the coupling between the source bus-line and common electrode. Since a source signal which represents a large number of display data is supposed to vary frequently, the common signal level is affected through the coupling effect, resulting in the degradation of nearby pixel drive signals. Therefore, we proposed a method to compensate for this source-common electrode coupling effect, we also designed and experimented the feasibility of our crosstalk compensation circuit in the actual TFT-LCD. We saw that the newly designed compensation circuit greatly reduced the crosstalk in display pattern image.

• Proceedings of the Korean Information Science Society Conference
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• 2006.06b
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• pp.277-279
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• 2006

본 논문에서는 스크래치 텍스처 및 형태특성을 이용하여 모든 종류의 스크래치를 자동으로 검출 할 수 있는 방법을 제안한다. 제안한 방법은 텍스처 분류 단계와 형태 필터링 단계를 구성된다. 텍스처 분류단계에서는 스크래치의 텍스처 정보를 이용하여 입력영상의 각 화소를 스크래치와 비스크래래치 영역으로 분류한다. 이때 분류기로 신경망을 사용한다. 형태필터링단계에서는 스크래치의 형태정보에 기반하여 설계된 원소구조를 사용하는 모폴로지 필터를 사용하여 잘못 분류된 스크래치 영역을 제거한다. 제안된 방법의 평가를 위해 다양한 종류의 스크래치를 가진 영화 및 애니메이션 데이터에 대해 실험이 이루어 졌고, 그 결과 제안된 방법의 강건함과 효율성이 입증되었다.

• Proceedings of the Korean Information Science Society Conference
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• 2005.07a
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• pp.685-687
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• 2005

본 논문에서는 깊이 영상기반 3차원 물체(depth image-based 3-D object)의 고속 렌더링 기법을 제안한다. 제안하는 알고리즘은 그래픽 가속기가 지원하는 shader programming 기법을 이용하여 하드웨어 가속을 직접 이용하도록 설계되었다. 또한, 기존의 영상 기반 렌더링의 한계를 극복하여 조명 효과를 표현할 수 있으며 렌더링시 각 화소당 Splat 크기를 하드웨어에서 직접 조절하여 고속 렌더링이 가능하다. 모의 실험결과, 소프트웨어 렌더링 또는 OpenGL 기반의 렌더링에 비해 괄목할 만한 렌더링 속도의 향상이 이루어졌다.