• 제목/요약/키워드: 플립칩 범프 본딩

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SnBi 저온솔더의 플립칩 본딩을 이용한 스마트 의류용 칩 접속공정 (Chip Interconnection Process for Smart Fabrics Using Flip-chip Bonding of SnBi Solder)

  • 최정열;박동현;오태성
    • 마이크로전자및패키징학회지
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    • 제19권3호
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    • pp.71-76
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    • 2012
  • SnBi 저온솔더의 플립칩 공정을 이용한 스마트 의류용 칩 접속공정에 대해 연구하였다. 캐리어 필름에 형성한 Cu 리드프레임을 $130^{\circ}C$에서 직물에 열압착 시킴으로써 Cu 리드프레임이 전사된 직물 기판을 형성하였다. 칩 시편에 SnBi 페이스트를 도포하여 솔더범프를 형성한 후 직물 기판의 Cu 리드프레임에 배열하고 $180^{\circ}C$에서 60초 동안 유지시켜 플립칩 본딩하였다. SnBi 저온솔더를 사용하여 형성된 스마트 의류용 플립칩 접속부의 평균 접속저항은 $9m{\Omega}$이었다.

NCP 적용 COB 플립칩 패키지의 신뢰성에 미치는 실리카 필러의 영향 (Effects of silica fillers on the reliability of COB flip chip package using NCP)

  • 이소정;김준기;이창우;김정한;이지환
    • 한국전기전자재료학회:학술대회논문집
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    • 한국전기전자재료학회 2008년도 하계학술대회 논문집 Vol.9
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    • pp.158-158
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    • 2008
  • 모바일 정보통신기기를 중심으로 실장모듈의 초소형화, 고집적화로 인해 접속단자의 피치가 점점 미세화 됨에 따라 플립칩 본딩용 접착제에 함유되는 무기충전제인 실리카 필러의 크기도 미세화되고 있다. 본 연구에서는 NCP (non-conductive paste)의 실리카 필러의 크기가 COB(chip-on-board) 플립칩 패키지의 신뢰성에 미치는 영향을 조사하였다. 실험에 사용된 실리카 필러는 Fused silica 3 종과 Fumed silica 3종이며 response surface 실험계획법에 따라 혼합하여 최적의 혼합비를 정하였다. 테스트베드로 사용된 실리콘 다이는 투께 $700{\mu}m$, 면적 5.2$\times$7.2mm로 $50\times50{\mu}m$ 크기의 Au 도금범프를 $100{\mu}m$ 피치, peripheral 방식으로 형성시켰으며, 기판은 패드를 Sn으로 finish 하였다. 기판을 플라즈마 전처리 후 Panasonic FCB-3 플립칩 본더를 이용하여 플립칩 본딩을 수행하였다. 패키지의 신뢰성 평가를 위해 $-40^{\circ}C{\sim}80^{\circ}C$의 열충격시험과 $85^{\circ}C$/85%R.H.의 고온고습시험을 수행하였으며 Die shear를 통한 접합 강도와 4-point probe를 통한 접속저항을 측정하였다.

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언더필 공정에서 레이싱 효과와 계면 병합에 대한 가시화 (Visualization for racing effect and meniscus merging in underfill process)

  • 김영배;김선구;성재용;이명호
    • Journal of Advanced Marine Engineering and Technology
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    • 제37권4호
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    • pp.351-357
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    • 2013
  • 플립칩 패키징에서 언더필 공정은 칩과 기판 사이를 에폭시로 채워서 본딩하는 공정으로 제품의 신뢰성 향상을 위해 수행되어 진다. 이 언더필 공정은 모세관 현상에 의해서 이루어지는데 유체의 계면과 범프의 배열이 계면 운동에 미치는 영향으로 인하여 공정 중 예기치 않은 공기층을 형성하게 된다. 본 연구에서는 모세관 언더필 유동에서 나타나는 비정상 계면 유동을 가시화하여 범프 배열에 따른 레이싱 효과와 계면의 병합 현상에 대하여 고찰하였다. 그 결과, 플립칩 내부의 범프가 고밀도일수록 유체의 흐름방향과 수직방향의 유동이 더욱 활발하게 진행되어 더 많은 공기층이 형성되었으며, 엇갈린 배열일 경우 직각 배열에 비해 이러한 현상이 더 지배적으로 나타난다.

Electrodeposition 변수에 따른 Sn 도금의 표면 거칠기와 플립칩 접속된 Sn 범프의 접속저항 (Surface Roughness of the Electroplated Sn with Variations of Electrodeposition Parameters and Contact Resistance of the Flip-chip-bonded Sn Bumps)

  • 정부양;박선희;김영호;오태성
    • 마이크로전자및패키징학회지
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    • 제13권4호
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    • pp.37-43
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    • 2006
  • 플립칩 공정에 Sn 범프를 적용하기 위해 도금전류밀도와 전류모드에 따른 Sn 도금막의 표면 거칠기와 경도를 측정하였다. 전류밀도 $5{\sim}50\;ma/cm^{2}$에서 전기도금한 Sn 도금막은 $2.0{\sim}2.4{\mu}m$의 표면 거칠기를 나타내었으며, 직류모드보다 펄스모드로 형성한 Sn 도금막에서 표면 거칠기가 감소하였다 할로겐 램프를 사용하여 $300^{\circ}C$에서 3초간 유지하는 표면 열처리에 의해 Sn 도금의 표면 거칠기가 $1\;{\mu}m$ 정도로 현저히 저하되었다. 전류밀도 $5{\sim}50mA/cm^{2}$에서 전기도금한 Sn 도금막은 10 Hv의 경도를 나타내었다. Sn 범프들을 이용하여 플립칩 본딩한 시편들은 $33{\sim}17m{\Omega}$의 낮은 접속저항을 나타내었다.

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CNT-Ag 복합패드가 Cu/Au 범프의 플립칩 접속저항에 미치는 영향 (Effect of CNT-Ag Composite Pad on the Contact Resistance of Flip-Chip Joints Processed with Cu/Au Bumps)

  • 최정열;오태성
    • 마이크로전자및패키징학회지
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    • 제22권3호
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    • pp.39-44
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    • 2015
  • 이방성 전도접착제를 이용하여 Cu/Au 칩 범프를 Cu 기판 배선에 플립칩 실장한 접속부에 대해 CNT-Ag 복합패드가 접속저항에 미치는 영향을 연구하였다. CNT-Ag 복합패드가 내재된 플립칩 접속부가 CNT-Ag 복합패드가 없는 접속부에 비해 더 낮은 접속저항을 나타내었다. 각기 25 MPa, 50 MPa 및 100 MPa의 본딩압력에서 CNT-Ag 복합패드가 내재된 접속부는 $164m{\Omega}$, $141m{\Omega}$$132m{\Omega}$의 평균 접속저항을 나타내었으며, CNT-Ag 복합패드를 형성하지 않은 접속부는 $200m{\Omega}$, $150m{\Omega}$$140m{\Omega}$의 평균 접속저항을 나타내었다.

전도성 에폭시를 이용한 솔더 범프의 전기적 특성 연구 (Study on electrical property of solder bump using conductive epoxy)

  • 차두열;강민석;김성태;조세준;장성필
    • 한국전기전자재료학회:학술대회논문집
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    • 한국전기전자재료학회 2008년도 하계학술대회 논문집 Vol.9
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    • pp.164-165
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    • 2008
  • 현재의 소자간 연결을 위해 사용되는 금속배선 PCB의 한계로 인해 보다 고속/대용량의 광PCB가 크게 각광받고 있다. 본 논문에서는 광PCB와 소자간의 전기적 연결을 위해 사용되는 솔더 범프를 전도성 에폭시를 사용하여 마이크로 머시닝 공정을 통해 구현하고 제작된 솔더 범프의 I-V 특성을 살펴보았다. 제작된 100 um $\times$ 100 um $\times$ 25 um 와 300 um $\times$ 300 um $\times$ 25 um 의 샘플에서 각각 30 m$\Omega$과 90m$\Omega$의 전기저항을 얻을 수 있었다. 이를 통해 향후 센서및 엑츄에이터 시스템과 광 MEMS 등의 여러 분야에서 전도성 에폭시 솔더 범프를 이용하여 우수한 성능의 플립칩 본딩을 구현할 수 있을 것이다.

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초미세 범프 측정 시스템 개발을 위한 사전 기술 분석 (An Preliminary Technical Analysis of Developing Micro Bump Inspection System)

  • 유성근;송민정;박상일;조성만;전소연;전지혜;김희태;명찬규;박구만
    • 한국방송∙미디어공학회:학술대회논문집
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    • 한국방송∙미디어공학회 2017년도 추계학술대회
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    • pp.144-145
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    • 2017
  • 최근 전자 기기의 크기가 줄어들고 PCB의 사이즈와 반도체 패키지의 크기가 소형화되어 플립 칩 본딩(Flip chip bonding) 기술을 적용한 반도체 패키지 방식이 점점 늘어나고 있다. 이에 따라 PCB와 반도체 칩 사이를 연결하기 위해 응용되던 BGA(Ball Grid Array)에 핀 배열 대신 사용되는 범프(Bump)를 50um 이내의 초미세 범프로 만들어 일정한 배열을 유지하는 것이 중요하다. 또한 초미세 범프의 모양과 품질이 패키지 수율과 밀접하게 연관되기 때문에 이를 검사할 수 있는 기술이 필수적이다. 이에 본 논문은 초미세 범프측정을 할 수 있는 시스템 개발을 위한 측정 대상의 특징과 사용할 수 있는 광학계를 분석하였고, 획득된 영상을 가지고 딥러닝을 적용하여 정확하게 불량여부를 판별할 수 있는 초미세 범프 측정 시스템을 고안하였다.

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무전해 및 전해 도금법으로 제작된 ACF 접합용 니켈 범프 특성에 관한 연구 (A Study on the Characterization of Electroless and Electro Plated Nickel Bumps Fabricated for ACF Application)

  • 진경선;이원종
    • 마이크로전자및패키징학회지
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    • 제14권3호
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    • pp.21-27
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    • 2007
  • 이방성 전도필름(ACF) 접합에 사용되는 니켈 범프를 무전해 및 전해 도금법으로 제작한 다음, 이 범프들의 기계적 특성과 충격안전성을 압축시험, 범프전단시험, 낙하충격시험을 통하여 연구하였다. Nano indenter를 이용한 압축시험에서 얻은 하중-변형량 데이터를 변환시켜 니켈범프의 응력-변형량 곡선을 구하였다. 전해 니켈 범프는 무전해 니켈 범프에 비해 매우 작은 탄성한계응력과 탄성계수를 나타냈었다. 무전해 니켈 범프의 탄성한계응력과 탄성계수가 각각 600-800MPa, $9.7{\times}10^{-3}MPa/nm$인 반면 전해 니켈 범프의 경우에는 각각 70MPa, $7.8{\times}10^4MPa/nm$이었다. 범프전단 시험에서 무전해 니켈 범프는 소성변형이 거의 일어나지 않고 낮은 전단하중에서 범프가 패드 층에서 튕기듯이 떨어져 나간 반면 전해 니켈 범프는 큰 소성변형을 일으키며 범프가 잘려나갔으며 높은 전단하중을 보여주었다. 낙하충격시험 결과 ACF 플립칩 방법으로 본딩한 무전해 및 전해 범프 모두 높은 충격 신뢰성을 보였다.

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Au 스터드 범프 본딩과 Ag 페이스트 본딩으로 연결된 소자의 온도 측정 및 접촉 저항에 관한 연구 (Temperature Measurement and Contact Resistance of Au Stud Bump Bonding and Ag Paste Bonding with Thermal Heater Device)

  • 김득한;유세훈;이창우;이택영
    • 마이크로전자및패키징학회지
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    • 제17권2호
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    • pp.55-61
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    • 2010
  • 탄탈륨실리사이드 히터가 내장된 소자를 Ag 페이스트와 Au SBB(Stud Bump Bonding)를 이용하여 Au가 코팅 된 기판에 각각 접합 하였다. 전단 테스트와 전류를 흐르면서 열 성능을 측정하였다. Au 스터드 범프 본딩의 최적 플립칩 접합조건은 전단 후 파괴면 관찰하여 설정하였으며, 기판 온도를 $350^{\circ}C$, 소자 온도를 $250^{\circ}C$에서 하중을 300 g/bump 로 하여 접합하는 경우가 최적 조건이였다. 히터에 5 W 인가시 소자의 온도는 Ag 페이스트를 이용한 접합의 경우 최대 온도는 약 $50^{\circ}C$이었으며, Au 금속층을 갖고 있는 실리콘 기판에 Au 스터드 본딩으로 접합된 인 경우 약 $64^{\circ}C$를 나타내었다. 기판과의 접촉면적이 와이어본딩과 Au 스터드 범프 본딩 가 약 300배가 차이가 나는 경우 약 $14^{\circ}C$ 차이를 나타내었고, 전사모사를 통하여 접합면의 접촉저항이 중요한 이유임을 알 수 있었다.

$75{\mu}m$ Cu via가 형성된 3D 스택 패키지용 interconnection 공정 및 접합부의 전기적 특성 (Interconnection Process and Electrical Properties of the Interconnection Joints for 3D Stack Package with $75{\mu}m$ Cu Via)

  • 이광용;오택수;원혜진;이재호;오태성
    • 마이크로전자및패키징학회지
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    • 제12권2호
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    • pp.111-119
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    • 2005
  • 직경 $75{\mu}m$ 높이 $90{\mu}m$$150{\mu}m$ 피치의 Cu via를 통한 삼차원 배선구조를 갖는 스택 시편을 deep RIE를 이용한 via hole 형성공정 , 펄스-역펄스 전기도금법에 의한 Cu via filling 공정, CMP를 이용한 Si thinning 공정, photholithography, 금속박막 스퍼터링, 전기도금법에 의한 Cu/Sn 범프 형성공정 및 플립칩 공정을 이용하여 제작하였다. Cu via를 갖는 daisy chain 시편에서 측정한 접속범프 개수에 따른 daisy chain의 저항 그래프의 기울기로부터 Cu/Sn 범프 접속저항과 Cu via 저항을 구하는 것이 가능하였다. $270^{\circ}C$에서 2분간 유지하여 플립칩 본딩시 $100{\times}100{\mu}m$크기의 Cu/Sn 범프 접속저항은 6.7 m$\Omega$이었으며, 직경 $75 {\mu}m$, 높이 $90{\mu}m$인 Cu via의 저항은 2.3m$\Omega$이었다.

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