본 논문에서는 SRR-DGS 공진기를 제안하고 그것의 등가회로를 해석하여 저역통과 필터 설계에 적용하였다. 기존의 덤벨형 DGS 구조로 된 것과 비교하였을 때 제안된 구조는 차단주파수 근처에서 스커트 특성과 저주파 대역의 평탄도 특성이 우수하였다. 기본적인 SRR-DGS 셀에서 등가회로의 병렬 커패시턴스를 증가하기 위해 전송선로에 개방 스터브를 추가함으로써 대역외 고주파 억압 특성을 개선하였다. 이와 같은 등가회로의 해석적인 방법으로 개선된 SRR-DGS 셀의 특성이 연구되어 차단 특성이 우수하고 고주파 억압 특성이 35dB이상인 저역통과 필터의 설계에 적용되었다. 그리고 공진기의 측면 길이와 링 간격 등과 같은 물리적 크기와 전송특성과의 관계를 해석하여 나타내었다. 개방 스터브의 면적을 증가하면 차단 주파수 이상의 대역에서 억압 특성이 개선되었다. SRR-DGS에 대해 유도해낸 등가 파라미터와 회로의 정확성을 검증하기 위해 SRR-DGS셀을 이용한 저역통과 필터를 설계하고 제작하였다.
본 논문에서는, Ku 대역의 소형 도파관 리미터 설계를 기술한다. 기본적으로 16.125 GHz로부터 16.375 GHz의 주파수 범위에서 통과 특성을 가지며, 큰 전력의 유입 시, 차단특성이 나타난다. 덧붙이면, 협대역에서는 20 dB 이상, 상기 전체 대역에서는 50 dB 이상의 감쇄량을 가지는 대역차단 여파기로 전환가능한 구조가 요구된다. 따라서, 이를 만족하기 위해 Off상태에서는 대역통과 여파기로서 On상태에서는 대역차단 여파기 기능으로 스위칭 가능한 다중 PIN 다이오드 포스트를 갖춘 도파관 장치가 구현되어야 한다. 등가회로모델링에서 출발하여 정확도 높은 전자장 분석기에서 구조 설계가 이뤄진다. 마지막으로, 설계결과가 요구성능에 부합하는지에 대해 논의된다.
본 논문에서는 기존의 2차원적 metamaterial 구조의 교차 편파 효과에 의한 차폐 특성의 열화를 개선하기 위하여 LTCC(Low Temperature Cofired Ceramic) 공정을 이용한 3-D 공진기 구조를 제안하였다. 제안된 3-D 공진기 구조는 X축, Y축, Z축 방향을 갖는 두 개의 평판과 하나의 비아로 구성된 2차원적 병렬 공진기들로 구성되어 있다. 제안된 3-D 공진기 구조의 공진 주파수는 5.024GHz, 차단 대역폭은 19MHz를 나타내었다. 교차 편파에서 3-D 공진기 구조의 공진 주파수는 4.825GHz, 차단 대역폭은 19MHz를 나타내었다. 제안된 3-D 공진기 구조는 교차 편파 효과에 따른 차폐 특성의 열화를 개선하였다. 향후 콘크리트 구조물에 흡수재와 함께 적용하므로 ETCS(Electric Toll Collection System)의 신호 간섭 현상을 차단할 수 있을 것으로 사료된다.
본 논문에서는 도파관의 차단 주파수 이상에서 평형 조건을 만족하는 CRLH(Composite Right-/Left-Handed) 직각 도파관이 설계되었다. 제안된 CRLH 도파관 구조는 특정 주파수에서 음의 유효 투자율 특성을 나타내는 하나의 단락 스터브와 음의 유효 유전율을 구현하는 두 개의 꼬인 형태의 H-plane 아이리스로 구성된다. 도파관 내부에 삽입된 꼬인 형태의 H-plane 아이리스는 단락 스터브와 아이리스 사이의 상호 작용을 최소화하여 RH(Right-Handed) 대역과 LH(Left-Handed) 대역의 밴드 갭을 조절하는 직렬 및 병렬 공진 주파수를 독립적으로 제어할 수 있으므로, 평형 조건을 만족하는 CRLH 도파관의 설계가 가능하다. 설계된 CRLH 도파관 구조의 해석을 위하여 교차 결합된 등가 회로가 제시되었고, 시뮬레이션 및 측정 결과로 부터 차단 주파수 이상에서 RH 대역과 LH 대역 사이에 밴드 갭이 존재하지 않는 평형 조건의 CRLH 전송선 특성을 확인하였다.
인터넷과 전자상거래의 증가로 인터넷은 전보다 더 많이 이용되고, 개인이나 혹은 기업등은 그들의 업무처리나 생활의 많은 부분을 컴퓨터에 의존하고 있다. 또한 인터넷의 쉬운 접근으로 시스템을 속이고 공격하는 방법도 증가하고 있다. 따라서 웹상에서의 보안은 우리 사회에 꼭 필요한 존재이며 보안 메카니즘의 도입도 시급한 편이다. 현재 많은 보안 방법들이 사용되고 있지만 완전한 차단은 불가능한 것으로 보이고 있다. 다양한 환경에서, 또한 견고한 IDPS 솔루션은 여러개의 IDPS 기술사용 없이는 불가능하여 많은 조직들은 많은 벤더들로부터 다중의 IDPS 제품들을 구입하여 사용한다. 이들은 또한 디자인과 구현의 제약사항들 때문에 여전히 최적화 문제에 놓여있다. 본 논문에서는 IDPS의 주요기능을 설명하고 IDPS의 구성요소 및 구조, 각 기술 유형별 특징과 보안 능력과 장단점을 비교 분석하였다. 이것은 서로 다른 장단점을 가지는 IDPS 기술들을 통합하여 최적의 IDPS 솔루션을 찾는, 다중 IDPS 기술 통합의 기반을 조성할 것이다.
제1족지단(第一足趾端)에 심한 통증(痛症)과 궤양(潰瘍)으로 입원한 31세(歲)의 Buerger 병(病) 환자(患者)에 X-선조(線造) 영하(影下)에서 7% phenol을 사용한 제(第)1, 2 및 3 요부교감신경절차단(腰部交感神經節遮斷)을 시행하였다. 교감신경절차단후(交感神經節遮斷後) 족지(足趾)의 통증완화(痛症緩和)와 온감(溫感)을 느낄 수 있었으며 이후 2회(回)의 2.5% bupivacaine을 이용한 경막외강차단(硬膜外腔遮斷) 후 통증(痛症)소실과 함께 순환혈류(循環血流) 개선(改善)을 plethysmogram으로 확인할 수 있어서 성공적인 교감신경절차단술(交感神經節遮術)이 시행됐다고 볼 수 있어 문헌적(文獻的) 고찰(考察)과 함께 보고(報告)하는 바이다.
2-hydroxy-4-methoxy-benzophenone과 titanium(VI) isopropoxide를 나노 금과 나노백금을 사용하여 자외선 차단과 항균성을 갖는 기능성 콘택트렌즈를 제조하였다. 콘택트렌즈는 캐스트 몰드 법을 사용하여 제조하였으며, $70^{\circ}C$에서 약 40분, $80^{\circ}C$에서 약 40분 건조하였다. 마지막으로 $100^{\circ}C$에서 약 40분 열처리 공정을 거쳐 공중합 하였다. 물리적 특성을 측정한 결과 굴절률은 1.434 ~ 1.436, 함수율은 35.24% ~ 36.32% 그리고 가시광선 투과율은 88.3% ~ 90.8%를 나타내었다. 생성된 고분자는 콘택트렌즈를 제조하는 데에 필요한 물리적 특성을 만족하였으며, 안 의료용 기능성 소재로의 응용이 충분히 가능할 것으로 판단된다.
본 논문에서는 상보형 high swing cascode 전류미러를 이용하여 저전압, 저전력 구동이 가능하고 고주파수 응용이 가능한 전류 적분기를 설계하였다. 간단한 전류미러로 구성된 적분기는 적분기의 비 이상적인 입력, 출력 저항 때문에 출력 전류 오차가 발생하는데 제안된 전류 적분기는 출력 저항이 증가하여 출력 전류의 오차가 감소하였다. 설계된 무손실, 유손실 전류 적분기를 이용한 설계 예로 3차 버터워스 저역통과 필터를 개구리도약형으로 구현하였다. 필터 구현시 무손실 전류 적분기의 위상 추이 때문에 발생하는 차단주파수 부근에서의 크기 특성 왜곡을 predistortion 설계법을 이용하여 감소시켰다. 설계된 전류모드 필터를 0.8㎛ CMOS n-well 공정 파라미터를 이용하여 SPICE 시뮬레이션한 결과 단일 2V 공급 전압에서 차단주파수는 20MHz, 전력소모는 615㎼를 갖는다. 또한 필터의 차단주파수는 DC 바이어스 전류에 의해 동조 할 수 있다.
본 논문에서는 광 대역 저지대역특성을 가지는 저역통과필터를 마이크로스트립 선로를 이용하여 설계 및 제작하였다. 개방회로 스터브를 이용한 L-C ladder형 저역통과 필터의 입 출력단에 길이가 $\lambda_g/4$인 개방 스터브를 부가함으로써, 광대역 차단특성을 가지는 필터를 개발하였다. 필터의 전체길이를 줄이기 위해 고 임피던스 마이크로스트럼 라인을 미앤더(meander) 구조로 제작하였다. 제작된 필터는 차단주파수가 2.3 GHz인 저역통과필터였고, 측정된 결과는 전산모의실험에서 예측된 값들과 잘 일치함을 알 수 있었다.
본 논문은 LTE-Advanced 시스템을 위한 멀티채널을 선택할 수 있는 저역통과필터를 제안한다. 제안하는 필터는 5 MHz, 10 MHz, 그리고 40 MHz의 3가지 모드의 차단주파수를 제공하며 Active-RC 5차 Chebyshev 구조로 설계되었다. 저전력을 확보하면서 40 MHz의 높은 차단 주파수를 확보하기 위해서 부성 저항을 가지는 PMOS Cross-Connection Load를 사용한 연산증폭기를 필터에 적용하였다. 더불어 공정, 전압, 그리고 온도에 의한 각각의 차단주파수 변화에 대응할 수 있도록 각각 3-bit 제어 가능한 튜닝회로를 추가하였다. 제안하는 필터는 $0.13-{\mu}m$ CMOS 공정을 사용하여 설계하였으며 1.2V 전압에서 총 20.2 mW 전력을 소모한다.
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[게시일 2004년 10월 1일]
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